JPS6125107B2 - - Google Patents
Info
- Publication number
- JPS6125107B2 JPS6125107B2 JP53154315A JP15431578A JPS6125107B2 JP S6125107 B2 JPS6125107 B2 JP S6125107B2 JP 53154315 A JP53154315 A JP 53154315A JP 15431578 A JP15431578 A JP 15431578A JP S6125107 B2 JPS6125107 B2 JP S6125107B2
- Authority
- JP
- Japan
- Prior art keywords
- timer
- time
- signal
- ringing
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 238000001514 detection method Methods 0.000 claims description 2
- 238000009295 crossflow filtration Methods 0.000 description 11
- 238000010586 diagram Methods 0.000 description 5
- 230000010355 oscillation Effects 0.000 description 2
- 244000145845 chattering Species 0.000 description 1
- 230000002265 prevention Effects 0.000 description 1
Landscapes
- Electric Clocks (AREA)
Description
【発明の詳細な説明】
本発明は、鳴り機能付き電子時計に関するもの
である。
である。
従来、デジタル表示式電子時計は、多機能化さ
れ、鳴り機能も複数化し、アラームやタイマー、
時報等が挿入されて来た、本発明も鳴り機能付の
タイマーに関してのものである。タイマーは、予
じめ時間を設定時間が来ると、発音体を鳴らし使
用者に告げるものであるが、同一の設定時間で使
用するときに再び時間を設定しなくてもすむ様
に、リピート付きタイマーがある。
れ、鳴り機能も複数化し、アラームやタイマー、
時報等が挿入されて来た、本発明も鳴り機能付の
タイマーに関してのものである。タイマーは、予
じめ時間を設定時間が来ると、発音体を鳴らし使
用者に告げるものであるが、同一の設定時間で使
用するときに再び時間を設定しなくてもすむ様
に、リピート付きタイマーがある。
リピート付きタイマーは、自動的に何度も同一
設定時間の間をくり返すオートリピートタイマー
と、再び使用する時まで一回で終了し再び使用す
る時に改めて設定時間を呼び出し、スタートして
使う手動リピート式タイマーの２種類がある。本
発明は、この手動リピート式タイマーの設定時間
の呼び出しを、自動的に行なわしめたことに特徴
がある。すなわち、タイマーの設定時間終了時は
零時間で止まつていないとタイマー終了のイメー
ジが出ないので、鳴つている間は零時間を表示
し、鳴り終わると同時に、設定時間にセツトして
おけば、再び使用する時にすぐスタートが可能と
なる操作性の優れたタイマー付電子時計を提供す
るものである。
設定時間の間をくり返すオートリピートタイマー
と、再び使用する時まで一回で終了し再び使用す
る時に改めて設定時間を呼び出し、スタートして
使う手動リピート式タイマーの２種類がある。本
発明は、この手動リピート式タイマーの設定時間
の呼び出しを、自動的に行なわしめたことに特徴
がある。すなわち、タイマーの設定時間終了時は
零時間で止まつていないとタイマー終了のイメー
ジが出ないので、鳴つている間は零時間を表示
し、鳴り終わると同時に、設定時間にセツトして
おけば、再び使用する時にすぐスタートが可能と
なる操作性の優れたタイマー付電子時計を提供す
るものである。
以下図面により本発明の詳細を説明する。
第１図は、本発明のブロツク配線図である。１
は発振回路であり、基準周波数の信号を作成す
る。２は分周回路であり、発振回路１の信号を、
１秒信号に分周する。３は時刻計数回路であり、
分周回路２の１秒信号を、時刻信号に変換する。
４は表示制御回路であり、時刻及びタイマー用の
信号を切替え、表示手段５で時刻或いはタイマー
の表示を行なう。
は発振回路であり、基準周波数の信号を作成す
る。２は分周回路であり、発振回路１の信号を、
１秒信号に分周する。３は時刻計数回路であり、
分周回路２の１秒信号を、時刻信号に変換する。
４は表示制御回路であり、時刻及びタイマー用の
信号を切替え、表示手段５で時刻或いはタイマー
の表示を行なう。
６は外部スイツチである。７は入力制御回路で
あり、外部スイツチ部６の開閉により、時刻計数
回路３の時刻修正及び、表示切替え信号を作成す
る。その他、タイマー回路８の時間設定及びスタ
ート、ストツプ等を行う。
あり、外部スイツチ部６の開閉により、時刻計数
回路３の時刻修正及び、表示切替え信号を作成す
る。その他、タイマー回路８の時間設定及びスタ
ート、ストツプ等を行う。
８はタイマー回路であり、入力制御回路７によ
り、設定された時間を検出し、鳴り回路９の発音
体を鳴らす。又、鳴り時間タイマー回路を有し、
一定時間鳴ると鳴り止めを行い、且つ再び設定さ
れた時間を読み込んで、ストツプする。
り、設定された時間を検出し、鳴り回路９の発音
体を鳴らす。又、鳴り時間タイマー回路を有し、
一定時間鳴ると鳴り止めを行い、且つ再び設定さ
れた時間を読み込んで、ストツプする。
次に本発明の詳細を、第２図により、具体的回
路図にて説明する。
路図にて説明する。
第２図は、第１図の外部スイツチ部６、入力制
御回路７及びタイマー回路８の回路図の１部分で
あり、説明を容易にするため、タイマー回路８の
カウンターは、16進のダウンカウンターを用いて
説明する。６ａ，６ｂ，６ｃは、外部スイツチ
（以後SWとる）であり、SW６ａはスタート、ス
トツプ指令用のスイツチ、SW６ｂは、カウンタ
ーの修正モード呼び出し用スイツチ、SW６ｃは
タイマーの設定時間を設定するためのスイツチ。
７ａ，７ｂ，７ｃは、入力端子Ｄが、SW６ａ〜
６ｃと接続されたＤフリツプフロツプ（以後
DFFとする）であり、分周回路２からのクロツ
クφD（64Hz）により制御されるチヤタリング防
止用DFFである。７ｆはDFF７ａ〜７ｃの各出
力を入力信号とするNANDゲート７ｄからの出
力信号を入力とするDFFであり、インバータ７
ｅと、NORゲート７ｇ〜７ｊと、DFF７ａ〜７
ｃとにより、SW６ａ，６ｂ，６ｃの動作をワン
シヨツト信号に変換する。
御回路７及びタイマー回路８の回路図の１部分で
あり、説明を容易にするため、タイマー回路８の
カウンターは、16進のダウンカウンターを用いて
説明する。６ａ，６ｂ，６ｃは、外部スイツチ
（以後SWとる）であり、SW６ａはスタート、ス
トツプ指令用のスイツチ、SW６ｂは、カウンタ
ーの修正モード呼び出し用スイツチ、SW６ｃは
タイマーの設定時間を設定するためのスイツチ。
７ａ，７ｂ，７ｃは、入力端子Ｄが、SW６ａ〜
６ｃと接続されたＤフリツプフロツプ（以後
DFFとする）であり、分周回路２からのクロツ
クφD（64Hz）により制御されるチヤタリング防
止用DFFである。７ｆはDFF７ａ〜７ｃの各出
力を入力信号とするNANDゲート７ｄからの出
力信号を入力とするDFFであり、インバータ７
ｅと、NORゲート７ｇ〜７ｊと、DFF７ａ〜７
ｃとにより、SW６ａ，６ｂ，６ｃの動作をワン
シヨツト信号に変換する。
８ａはNORゲート７ｇからの出力を入力とし
出力Ｑ，の状態を反転するフリツプフロツプ
（以後TFFとする）であり、タイマー機能はTFF
８ａの出力Ｑが“Ｈ”レベルでスタート状態
“Ｌ”レベルでストツプ状態に設定される。８ｂ
はNORゲート７ｈの出力を入力とするTFFであ
り、時刻刻機能はTFF８ｂの出力Ｑが“Ｈ”レ
ベルで、修正モード、“Ｌ”レベルでノーマルモ
ードである。８ｄはAND回路であり、TFF８ａ
の出力Ｑが“Ｈ”レベル（すなわちタイマースタ
ート状態）の時、分周回路２からの信号φA（１
秒信号）を通し、信号切替え回路８ｅの入力端子
D1に入る。信号切替え回路８ｅは、TFF８ｂの
出力Ｑにより制御され、TFF８ｂの出力Ｑが
“Ｌ”レベルのとき信号φAを通し、TFF８ｂの
出力Ｑが“Ｈ”レベルのときはSW６ｃの開閉信
号がNORゲート７ｊによりワンシヨツト信号に
変換された信号を入力端子D2を介して信号切替
え回路８ｅから出力される。８ｒ〜８ｕは第一の
記憶手段であるプリセツト付きTFFで、16進の
ダウンカウンターを構成している。８ｎ〜８ｑは
第２の記憶手段であるラツチ回路であり、入力端
子ＤがTFF８ｒ〜８ｕの出力Ｑと接続され、ラ
ツチ回路８ｎ〜８ｑの出力Ｑ，はANDゲート
a1〜a4及びa5〜a8を介してTFF８ｒ〜８ｕの各端
子Ｓ及びＲに接続され、ORゲート８ｖからのプ
リセツト信号が来たときに、ラツチ回路８ｎ〜８
ｑの内容を、TFF８ｒ〜８ｕに伝達する。ラツ
チ回路８ｎ〜８ｑのクロツク入力端子φには、
TFF８ｂの出力Ｑからの信号が供給され、TFF
８ｂの出力Ｑが“Ｈ”レベル（すなわち修正モー
ド中）のみ、ラツチ回路８ｎ〜８ｑを解除し、
TFF８ｒ〜８ｕの出力Ｑをそのままラツチ回路
８ｎ〜８ｑに出力しラツチ動作される。すなわち
タイマー時間の設定終了時のタイマーカウンター
の内容をラツチする。
出力Ｑ，の状態を反転するフリツプフロツプ
（以後TFFとする）であり、タイマー機能はTFF
８ａの出力Ｑが“Ｈ”レベルでスタート状態
“Ｌ”レベルでストツプ状態に設定される。８ｂ
はNORゲート７ｈの出力を入力とするTFFであ
り、時刻刻機能はTFF８ｂの出力Ｑが“Ｈ”レ
ベルで、修正モード、“Ｌ”レベルでノーマルモ
ードである。８ｄはAND回路であり、TFF８ａ
の出力Ｑが“Ｈ”レベル（すなわちタイマースタ
ート状態）の時、分周回路２からの信号φA（１
秒信号）を通し、信号切替え回路８ｅの入力端子
D1に入る。信号切替え回路８ｅは、TFF８ｂの
出力Ｑにより制御され、TFF８ｂの出力Ｑが
“Ｌ”レベルのとき信号φAを通し、TFF８ｂの
出力Ｑが“Ｈ”レベルのときはSW６ｃの開閉信
号がNORゲート７ｊによりワンシヨツト信号に
変換された信号を入力端子D2を介して信号切替
え回路８ｅから出力される。８ｒ〜８ｕは第一の
記憶手段であるプリセツト付きTFFで、16進の
ダウンカウンターを構成している。８ｎ〜８ｑは
第２の記憶手段であるラツチ回路であり、入力端
子ＤがTFF８ｒ〜８ｕの出力Ｑと接続され、ラ
ツチ回路８ｎ〜８ｑの出力Ｑ，はANDゲート
a1〜a4及びa5〜a8を介してTFF８ｒ〜８ｕの各端
子Ｓ及びＲに接続され、ORゲート８ｖからのプ
リセツト信号が来たときに、ラツチ回路８ｎ〜８
ｑの内容を、TFF８ｒ〜８ｕに伝達する。ラツ
チ回路８ｎ〜８ｑのクロツク入力端子φには、
TFF８ｂの出力Ｑからの信号が供給され、TFF
８ｂの出力Ｑが“Ｈ”レベル（すなわち修正モー
ド中）のみ、ラツチ回路８ｎ〜８ｑを解除し、
TFF８ｒ〜８ｕの出力Ｑをそのままラツチ回路
８ｎ〜８ｑに出力しラツチ動作される。すなわち
タイマー時間の設定終了時のタイマーカウンター
の内容をラツチする。
８ｈはNORゲートであり、TFF８ｒ〜８ｕの
内容が零になるのを検出し、TFF８ａをリセツ
トすると同時にインバータ８ｙを通して、TFF
８ｘのクロツク信号として、TFF８ｘの出力Ｑ
を“Ｈ”レベルにし、TFF８ｆをリセツトして
TFF８ｆの出力を“Ｈ”レベルにする。尚、
TFF８ｘのリセツト端子Ｒには分周回路２から
の16Hzの信号φｃが供給され、周期的にリセツト
動作される。NANDゲート８ｇは、NORゲート
８ｈの出力が“Ｈ”レベルのときには、TFF８
ｆの出力が“Ｈ”レベルになると出力が“Ｌ”
レベルとなり、インバータ８ｃを通して、鳴り回
路９を鳴らす。一方、零検出用のNORゲート８
ｈからの“Ｈ”レベルの信号は、ANDゲート８
ｉを開き、時刻計数回路３からの信号φB（10秒
信号）を通し、信号φB２パルス入ると鳴り時間
設定タイマー８ｋの出力Ｑが“Ｈ”レベルとな
り、NORゲート８ｌ，８ｍで組んだラツチ回路
で信号φD64Hzの半周期のワンシヨツト信号が作
成され、ORゲート８ｕ及びAND回路a1〜a8をそ
れぞれ通して、プリセツト信号としてラツチ回路
８ｎ〜８ｑの内容をTFF８ｒ〜８ｕにプリセツ
トする。同時にTFF８ｆの出力を“Ｌ”レベ
ルとし、NANDゲート８ｑの出力は“Ｈ”レベル
となつてインバーター８ｃにより鳴り回路９の鳴
りが止まる。タイマーが鳴つている時、すなわち
NADゲート８ｑが“Ｌ”レベルのとき、NORゲ
ート７ｇ，７ｈ，７ｊはゲートを閉じられるので
SW６ａ〜６ｃを閉じてもワンシヨツト信号は出
ない。又このときゲート７ｉはゲートが開いてい
るので、SW６ａ〜６ｃのどれかを閉じるとワン
ヨツト信号がNORゲート７ｉより作成され、OR
ゲート８ｕを通して前述プリセツト信号及び鳴り
止め信号となる。
内容が零になるのを検出し、TFF８ａをリセツ
トすると同時にインバータ８ｙを通して、TFF
８ｘのクロツク信号として、TFF８ｘの出力Ｑ
を“Ｈ”レベルにし、TFF８ｆをリセツトして
TFF８ｆの出力を“Ｈ”レベルにする。尚、
TFF８ｘのリセツト端子Ｒには分周回路２から
の16Hzの信号φｃが供給され、周期的にリセツト
動作される。NANDゲート８ｇは、NORゲート
８ｈの出力が“Ｈ”レベルのときには、TFF８
ｆの出力が“Ｈ”レベルになると出力が“Ｌ”
レベルとなり、インバータ８ｃを通して、鳴り回
路９を鳴らす。一方、零検出用のNORゲート８
ｈからの“Ｈ”レベルの信号は、ANDゲート８
ｉを開き、時刻計数回路３からの信号φB（10秒
信号）を通し、信号φB２パルス入ると鳴り時間
設定タイマー８ｋの出力Ｑが“Ｈ”レベルとな
り、NORゲート８ｌ，８ｍで組んだラツチ回路
で信号φD64Hzの半周期のワンシヨツト信号が作
成され、ORゲート８ｕ及びAND回路a1〜a8をそ
れぞれ通して、プリセツト信号としてラツチ回路
８ｎ〜８ｑの内容をTFF８ｒ〜８ｕにプリセツ
トする。同時にTFF８ｆの出力を“Ｌ”レベ
ルとし、NANDゲート８ｑの出力は“Ｈ”レベル
となつてインバーター８ｃにより鳴り回路９の鳴
りが止まる。タイマーが鳴つている時、すなわち
NADゲート８ｑが“Ｌ”レベルのとき、NORゲ
ート７ｇ，７ｈ，７ｊはゲートを閉じられるので
SW６ａ〜６ｃを閉じてもワンシヨツト信号は出
ない。又このときゲート７ｉはゲートが開いてい
るので、SW６ａ〜６ｃのどれかを閉じるとワン
ヨツト信号がNORゲート７ｉより作成され、OR
ゲート８ｕを通して前述プリセツト信号及び鳴り
止め信号となる。
尚、第２図に於いて、16進のダウンカウンター
を用いたが、実際には、修正時にアツプカウント
タイマー動作時にダウンカウントを行なうアツプ
ダウンカウンターを用いたり、時分秒をセツト出
来る10進、６進、12進等のカウンターを用いて構
成するが、上記説明により、簡単に推定すること
が可能である。
を用いたが、実際には、修正時にアツプカウント
タイマー動作時にダウンカウントを行なうアツプ
ダウンカウンターを用いたり、時分秒をセツト出
来る10進、６進、12進等のカウンターを用いて構
成するが、上記説明により、簡単に推定すること
が可能である。
以上でのごとく本発明によれば、タイマーの終
了を音で使用者に報知することが出来ると共にタ
イマーが終了してから鳴り手段が鳴つている所定
の時間に使用者に対してタイマーが零になつたこ
とを表示手段によつて強くイメージづけることが
出来、且つ鳴り手段の音が鳴り止むことによつて
タイマーがリピート可能な特機状態にあることが
容易にわかり、極めて使いやすいタイマー付き電
子時計が実現される。
了を音で使用者に報知することが出来ると共にタ
イマーが終了してから鳴り手段が鳴つている所定
の時間に使用者に対してタイマーが零になつたこ
とを表示手段によつて強くイメージづけることが
出来、且つ鳴り手段の音が鳴り止むことによつて
タイマーがリピート可能な特機状態にあることが
容易にわかり、極めて使いやすいタイマー付き電
子時計が実現される。
第１図は、本発明の実施ブロツク配線図、第２
図は第１図を詳細に示した要部回路図である。 １……発振回路、２……分周回路、３……時刻
計数回路、４……表示制御回路、５……表示手
段、６……外部スイツチ部、７……入力制御回
路、８……タイマー回路、９……鳴り回路、６ａ
〜６ｃ……外部スイツチ、７ａ〜７ｃ……Ｄ形フ
リツプフロツプ、８ａ，８ｂ，８ｆ，８ｘ……Ｔ
型フリツプフロツプ、８ｋ……鳴り時間設定タイ
マー、８ｎ〜８ｑ……ラツチ回路、８ｒ〜８ｕ…
…Ｔ型フリツプフロツプ。
図は第１図を詳細に示した要部回路図である。 １……発振回路、２……分周回路、３……時刻
計数回路、４……表示制御回路、５……表示手
段、６……外部スイツチ部、７……入力制御回
路、８……タイマー回路、９……鳴り回路、６ａ
〜６ｃ……外部スイツチ、７ａ〜７ｃ……Ｄ形フ
リツプフロツプ、８ａ，８ｂ，８ｆ，８ｘ……Ｔ
型フリツプフロツプ、８ｋ……鳴り時間設定タイ
マー、８ｎ〜８ｑ……ラツチ回路、８ｒ〜８ｕ…
…Ｔ型フリツプフロツプ。
Claims (1)
- １ タイマー設定時間を設定するためのスイツチ
入力手段と、該スイツチ入力手段からの信号に基
づきタイマー設定時間を記憶する第１及び第２の
記憶手段と、該第１の記憶手段の内容を表示する
表示手段と、前記第１の記憶手段に記憶されたタ
イマー設定時間を一定時間毎に減算動作せしめる
手段と、該減算の結果前記第１の記憶手段の計数
内容が零になつたことを検出する手段と、該検出
手段からの零検出信号に基づきタイマー動作を開
始する鳴り時間設定タイマーと、該鳴り時間設定
タイマーで与えられる鳴り時間中に音響を発する
鳴り手段と、該鳴り手段の鳴り終了時に前記第２
の記憶手段に記憶されている前記タイマー設定時
間をを前記第１の記憶手段に入力し記憶せしめる
手段とを備えていることを特徴とするタイマー付
き電子時計。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15431578A JPS5580089A (en) | 1978-12-12 | 1978-12-12 | Electronic watch with timer |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15431578A JPS5580089A (en) | 1978-12-12 | 1978-12-12 | Electronic watch with timer |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5580089A JPS5580089A (en) | 1980-06-16 |
| JPS6125107B2 true JPS6125107B2 (ja) | 1986-06-13 |
Family
ID=15581424
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15431578A Granted JPS5580089A (en) | 1978-12-12 | 1978-12-12 | Electronic watch with timer |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5580089A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6353705U (ja) * | 1986-09-26 | 1988-04-11 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52154672A (en) * | 1976-06-18 | 1977-12-22 | Seiko Epson Corp | Timer device |
| JPS5414772A (en) * | 1977-07-05 | 1979-02-03 | Seikosha Kk | Electronic timer |
-
1978
- 1978-12-12 JP JP15431578A patent/JPS5580089A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52154672A (en) * | 1976-06-18 | 1977-12-22 | Seiko Epson Corp | Timer device |
| JPS5414772A (en) * | 1977-07-05 | 1979-02-03 | Seikosha Kk | Electronic timer |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6353705U (ja) * | 1986-09-26 | 1988-04-11 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5580089A (en) | 1980-06-16 |
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