JPS61196323A - 回転形デイスク制御方式 - Google Patents
回転形デイスク制御方式Info
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- JPS61196323A JPS61196323A JP3635185A JP3635185A JPS61196323A JP S61196323 A JPS61196323 A JP S61196323A JP 3635185 A JP3635185 A JP 3635185A JP 3635185 A JP3635185 A JP 3635185A JP S61196323 A JPS61196323 A JP S61196323A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は回転形ディスク制御方式に係り、特に開始セク
タアドレスまでのヘッドの回転待ち時間を削減し、処理
速度の向上を図った回転形ディスク装置における制御方
式に関する。
タアドレスまでのヘッドの回転待ち時間を削減し、処理
速度の向上を図った回転形ディスク装置における制御方
式に関する。
回転形ディスク装置としては、一般に、磁気ディスク装
置や光デイスク装置がよく知られている。例えば、磁気
ディスク装置の制御機構において、処理装置より指示さ
れた読出/書込目的アドレスを検索する方法としては次
の様なものがある。即ち磁気ディスク装置から読取られ
たアドレス情報と処理装置から与えられたアドレス情報
との照合を繰り返し、両者のアドレスとが一致したこと
により、読出/書込動作を実行するものである。
置や光デイスク装置がよく知られている。例えば、磁気
ディスク装置の制御機構において、処理装置より指示さ
れた読出/書込目的アドレスを検索する方法としては次
の様なものがある。即ち磁気ディスク装置から読取られ
たアドレス情報と処理装置から与えられたアドレス情報
との照合を繰り返し、両者のアドレスとが一致したこと
により、読出/書込動作を実行するものである。
所で処理装置より読出/書込が指示され、アドレス照合
を開始した時点で既に目的アドレスを通過している場合
には、回転待ちが発生し、1回転後、一致したアドレス
から、読出/書込動作を実行するのが一般的である。
を開始した時点で既に目的アドレスを通過している場合
には、回転待ちが発生し、1回転後、一致したアドレス
から、読出/書込動作を実行するのが一般的である。
この様に処理装置から読出/書込指示を受け。
磁気ディスク装置へ読出/書込を開始しようとしたとき
、磁気ヘッドが目的アドレスを通過している場合、ディ
スク装置への読出/書き込み動作までの回転待ちが発生
しシステムとしての処理速度を低下するという問題があ
る。なお。
、磁気ヘッドが目的アドレスを通過している場合、ディ
スク装置への読出/書き込み動作までの回転待ちが発生
しシステムとしての処理速度を低下するという問題があ
る。なお。
この種の問題について言及したものには例えば特開昭5
9−62961号、特開昭58−56145号、特開昭
59−41073号などがある。
9−62961号、特開昭58−56145号、特開昭
59−41073号などがある。
(発明の目的〕
本発明の目的は、前記の如き問題点を解決し、回転形デ
ィスクの回転待ち時間を削減し、システムの処理速度向
上を可能にする回転形ディスク制御方式を提供すること
にある。
ィスクの回転待ち時間を削減し、システムの処理速度向
上を可能にする回転形ディスク制御方式を提供すること
にある。
而して、本発明は処理装置から読出/書込指示を受けた
時、記録再生ヘッドの位置が読出/書込該当エリアの範
囲内にある時は、当該ヘッド位置のセクタより直ちに読
出/書込動作を行ない、先頭アドレスまでの回転待ちす
ることなく、回転形記憶媒体が1回転以内にデータの読
出/書込処理を行なう様にしたものである。
時、記録再生ヘッドの位置が読出/書込該当エリアの範
囲内にある時は、当該ヘッド位置のセクタより直ちに読
出/書込動作を行ない、先頭アドレスまでの回転待ちす
ることなく、回転形記憶媒体が1回転以内にデータの読
出/書込処理を行なう様にしたものである。
以下本発明の一実施例を磁気ディスク装置に適用した場
合について第1図及び第2図を用いて説明する。第1図
は磁気ディスク制御機構のブロック図であり、第2図は
タイムチャートである。
合について第1図及び第2図を用いて説明する。第1図
は磁気ディスク制御機構のブロック図であり、第2図は
タイムチャートである。
第1図において、トラックの先頭セクタアドレスを格納
するレジスタ1.処理セクタ数を格納するレジスタ2、
レジスタ1および2より算出した当該トラックの終了セ
クタアドレスを格納するレジスタ3、読出/書込制御回
路4、ディスク装置5、バッファメモリ6、ディスク装
置5より読出したセクタアドレス情報eがレジスタ1と
レジスタ2の範囲内にあるか否かを比較するアドレス比
較回路7、アドレス比較回路7により比較し、読出/書
込を開始したセクタアドレスに対応するバッファメモリ
のアドレスに変換するメモリアドレス変換回路8、処理
装置より制御バスnを介して送られる制御情報を格納す
る制御回路9から構成される。
するレジスタ1.処理セクタ数を格納するレジスタ2、
レジスタ1および2より算出した当該トラックの終了セ
クタアドレスを格納するレジスタ3、読出/書込制御回
路4、ディスク装置5、バッファメモリ6、ディスク装
置5より読出したセクタアドレス情報eがレジスタ1と
レジスタ2の範囲内にあるか否かを比較するアドレス比
較回路7、アドレス比較回路7により比較し、読出/書
込を開始したセクタアドレスに対応するバッファメモリ
のアドレスに変換するメモリアドレス変換回路8、処理
装置より制御バスnを介して送られる制御情報を格納す
る制御回路9から構成される。
まず、読出動作について第1図、第2図を用いて説明す
る。処理装置より制御バスnを介して制御情報(トラッ
クアドレス・データ転送数等)を受けた制御回路9は当
該トラックの先頭セクタアドレス及び処理セクタ数を、
内部バスbを介して、それぞれレジスタl、レジスタ2
に格納し先頭セクタアドレス情報りをアドレス比較回路
7及びメモリアドレス変換回路8に供給する。また、処
理セクタ数より算出した終了セクタアドレス情報iをア
ドレス比較回路7に供給する。次に処理装置より、制御
バスnを介して読出指示を与えられた制御回路9は読出
/書込制御回路4に対して、第2図に示すA位置で読出
指示を発行する。読出/書込制御回路4はディスク装置
5に対して読出/書込信号5を送出し、データを読出す
。読出データのアドレス部(セクタアドレス情報e)は
アドレス比較回路7へ、データはバッファメモリ6へ供
給される。アドレス比較回路7は前記3つのアドレス情
報(即ち先頭セクタアドレス情報り、終了セクタアドレ
ス情報i、セクタアドレス情報e)を比較する。この比
較の結果・h≦e < iの条件が成立した時、読出/
書込制御回路4に読出/書込許可信号dを送るとともに
、読出/書込許可信号dを送出した時の開始セクタアド
レスkをメモリアドレス変換回路8に送出する。読出/
書込許可信号dと開始セクタアドレスkを受けたメモリ
アドレス変換回路8は開始セクタアドレスkに対応する
メモリアドレスをセットする。読出/書込許可信号dを
受けた読出/書込制御回路4は再度、読出/書込信号5
を送り、ディスク装置5からデータを読出しメモリアド
レス線mを介して前記メモリアドレス変換回路8で示す
メモリアドレスより順次、メモリ読出/書込信号1によ
りバッファメモリ6へ格納する。
る。処理装置より制御バスnを介して制御情報(トラッ
クアドレス・データ転送数等)を受けた制御回路9は当
該トラックの先頭セクタアドレス及び処理セクタ数を、
内部バスbを介して、それぞれレジスタl、レジスタ2
に格納し先頭セクタアドレス情報りをアドレス比較回路
7及びメモリアドレス変換回路8に供給する。また、処
理セクタ数より算出した終了セクタアドレス情報iをア
ドレス比較回路7に供給する。次に処理装置より、制御
バスnを介して読出指示を与えられた制御回路9は読出
/書込制御回路4に対して、第2図に示すA位置で読出
指示を発行する。読出/書込制御回路4はディスク装置
5に対して読出/書込信号5を送出し、データを読出す
。読出データのアドレス部(セクタアドレス情報e)は
アドレス比較回路7へ、データはバッファメモリ6へ供
給される。アドレス比較回路7は前記3つのアドレス情
報(即ち先頭セクタアドレス情報り、終了セクタアドレ
ス情報i、セクタアドレス情報e)を比較する。この比
較の結果・h≦e < iの条件が成立した時、読出/
書込制御回路4に読出/書込許可信号dを送るとともに
、読出/書込許可信号dを送出した時の開始セクタアド
レスkをメモリアドレス変換回路8に送出する。読出/
書込許可信号dと開始セクタアドレスkを受けたメモリ
アドレス変換回路8は開始セクタアドレスkに対応する
メモリアドレスをセットする。読出/書込許可信号dを
受けた読出/書込制御回路4は再度、読出/書込信号5
を送り、ディスク装置5からデータを読出しメモリアド
レス線mを介して前記メモリアドレス変換回路8で示す
メモリアドレスより順次、メモリ読出/書込信号1によ
りバッファメモリ6へ格納する。
ディスク装W5から1セクタ分のデータを読出す毎に、
レジスタ2を1づつ減算し、0”となるまで読出動作を
繰り返す。アドレス比較回路7が、h≦e < iの条
件を満足せず(e<i)、なおかつレジスタ2が“0″
でないとき、アドレス比較回路7は読出/書込許可信号
dをオフにする。読出/書込許可信号dがオフになると
、メモリアドレス変換回路8はメモリ読出/書込信号l
を禁止しデータの格納を中止する。
レジスタ2を1づつ減算し、0”となるまで読出動作を
繰り返す。アドレス比較回路7が、h≦e < iの条
件を満足せず(e<i)、なおかつレジスタ2が“0″
でないとき、アドレス比較回路7は読出/書込許可信号
dをオフにする。読出/書込許可信号dがオフになると
、メモリアドレス変換回路8はメモリ読出/書込信号l
を禁止しデータの格納を中止する。
その後、ディスクの回転が進み、ディスクの起点を示す
インデックスパルスj後、セクタアドレスOより順次、
セクタアドレス情報eがディスク装置5から送られる。
インデックスパルスj後、セクタアドレスOより順次、
セクタアドレス情報eがディスク装置5から送られる。
そして、アドレス比較回路7は再びレジスタl、2.3
の3つのアドレス情報の比較を行ない、h≦e < i
の条件が成立した時、再び読出/書込許可信号dをオン
にして前記同様、ディスク装置5よりデータを読出しバ
ッファメモリ6に格絡する。なお、この時インデックス
パルスjを受けたメモリアドレス変換回路8はインデッ
クスパルスjによりtr Ouにリセットされ、バッフ
ァメモリ6の0番地からデータを格納する。レジスタ2
が0”になった時、ディスク装置5からの読出を終了し
、データ処理中を示す信号aがオフすることによりメモ
リアドレス変換回路8は再びN O11にリセットされ
バッファメモリ6のO番地より、順次、データバスCを
介して処理装置へ転送する。
の3つのアドレス情報の比較を行ない、h≦e < i
の条件が成立した時、再び読出/書込許可信号dをオン
にして前記同様、ディスク装置5よりデータを読出しバ
ッファメモリ6に格絡する。なお、この時インデックス
パルスjを受けたメモリアドレス変換回路8はインデッ
クスパルスjによりtr Ouにリセットされ、バッフ
ァメモリ6の0番地からデータを格納する。レジスタ2
が0”になった時、ディスク装置5からの読出を終了し
、データ処理中を示す信号aがオフすることによりメモ
リアドレス変換回路8は再びN O11にリセットされ
バッファメモリ6のO番地より、順次、データバスCを
介して処理装置へ転送する。
次に書込動作について説明する。読出動作と同様に、処
理装置より制御バスnを介して制御情報を受けた制御回
路9は当該トラック先頭セクタアドレスおよび処理セク
タ数を内部バスbを介してそれぞれ、レジスタ1.レジ
スタ2に格納する。さらに処理装置よりデータバスCを
介して、バッファメモリ6の0番地よりデータを格納す
る。制御バスnを介して処理装置より書込指示を受けた
制御回路9は、処理セクタ数分のデータをすべて、バッ
ファメモリ6へ格納終了後、読出/書込制御回路4に書
込指示を発行する。読出/書込制御回路4はディスク装
置5に対して、読出/書込信号5を送出する。
理装置より制御バスnを介して制御情報を受けた制御回
路9は当該トラック先頭セクタアドレスおよび処理セク
タ数を内部バスbを介してそれぞれ、レジスタ1.レジ
スタ2に格納する。さらに処理装置よりデータバスCを
介して、バッファメモリ6の0番地よりデータを格納す
る。制御バスnを介して処理装置より書込指示を受けた
制御回路9は、処理セクタ数分のデータをすべて、バッ
ファメモリ6へ格納終了後、読出/書込制御回路4に書
込指示を発行する。読出/書込制御回路4はディスク装
置5に対して、読出/書込信号5を送出する。
ディスク装W5より読出したセクタアドス情報eをアド
レス比較回路7に供給し、読出時開様に、先頭セクタア
ドレス情報り、終了セクタアドレス情報i、およびセク
タアドレス情報eの比較を行なう。この比較の結果、h
≦e < iが成立した場合、直ちに読出/書込許可信
号dと開始セクタアドレスkをメモリアドレス変換回路
8に送る。メモリアドレス変換回路8は開始セクタアド
レスkに対応したメモリアドレスをセットし、メモリア
ドレス線mを介して前記メモリアドレス変換回路8で示
すメモリアドレスより順次、メモリ読出/書込信号1に
よりバッファメモリ6よりデータを読出す。また、読出
/書込許可信号dを受けた読出/書込制御回路4はディ
スク装置5に読出/書込信号5を送り、バッファメモリ
6から読出したデータを書込む。
レス比較回路7に供給し、読出時開様に、先頭セクタア
ドレス情報り、終了セクタアドレス情報i、およびセク
タアドレス情報eの比較を行なう。この比較の結果、h
≦e < iが成立した場合、直ちに読出/書込許可信
号dと開始セクタアドレスkをメモリアドレス変換回路
8に送る。メモリアドレス変換回路8は開始セクタアド
レスkに対応したメモリアドレスをセットし、メモリア
ドレス線mを介して前記メモリアドレス変換回路8で示
すメモリアドレスより順次、メモリ読出/書込信号1に
よりバッファメモリ6よりデータを読出す。また、読出
/書込許可信号dを受けた読出/書込制御回路4はディ
スク装置5に読出/書込信号5を送り、バッファメモリ
6から読出したデータを書込む。
書込時においても、読出時開様、アドレス比較回路7が
h≦e < iの条件を満足せず(e〉iで)、なおか
つ、レジスタ2がit O+yでない時は、書込動作を
一時中止し、インデックスパルスj受信後、アドレス比
較回路7においてh≦e < iのチェックを行ない1
条件が成立した時点から、再び書込を再開し、レジスタ
2がrr Ouになるまで書込動作を実施する。
h≦e < iの条件を満足せず(e〉iで)、なおか
つ、レジスタ2がit O+yでない時は、書込動作を
一時中止し、インデックスパルスj受信後、アドレス比
較回路7においてh≦e < iのチェックを行ない1
条件が成立した時点から、再び書込を再開し、レジスタ
2がrr Ouになるまで書込動作を実施する。
本実施例においては1トラック分のデータ処理について
説明したが、通常行なわれる複数トラックにわたってデ
ータを処理する場合は、先頭セクタアドレスと処理セク
タ数を当該トラックに該当する値を制御回路9によって
再設定および更新等を行ない、1トラツク毎に、前記読
出/書込動作を行いデータを処理することができる。こ
の様に本実施例によれば、当該トラックにおける読出/
書込動作を1回転以内に終了することができ、システム
処理速度を向上することができる。
説明したが、通常行なわれる複数トラックにわたってデ
ータを処理する場合は、先頭セクタアドレスと処理セク
タ数を当該トラックに該当する値を制御回路9によって
再設定および更新等を行ない、1トラツク毎に、前記読
出/書込動作を行いデータを処理することができる。こ
の様に本実施例によれば、当該トラックにおける読出/
書込動作を1回転以内に終了することができ、システム
処理速度を向上することができる。
本発明によれば、読出/書込先頭セクタアドレスを検出
する時の回転待ちが不要で、しかも1回転以内に読出/
書込処理が終了する為、磁気ディスク装置の処理時間が
短縮でき、システムの処理速度を向上することができる
。
する時の回転待ちが不要で、しかも1回転以内に読出/
書込処理が終了する為、磁気ディスク装置の処理時間が
短縮でき、システムの処理速度を向上することができる
。
第1図は本発明の一実施例による磁気ディスク制御装置
のブロック図、第2図は第1図のブロック図の動作を説
明するためのタイムチャート図。 1・・・先頭セクタアドレスレジスタ、2・・・セクタ
カウントレジスタ、3・・終了セクタアドレスレジスタ
、4・・・読出/書込制御回路、5・・・ディスク装置
、6・・・バッファメモリ、7・・・アドレス比較回路
、8・・・メモリアドレス変換回路、9・・・制御回路
、 a・・読出/書込動作中表示信号、b・・・内部バス、
C・・・データバス、d・・・読出/書込許可信号。 e・・・データ(アドレス部)、5・・・読出/書込信
号、g・・・データ(データ部)、H・・・先頭セクタ
アドレス情報、■・・・終了セクタアドレス情報、j・
・・インデックスパルス、k・・・開始セクタアドレス
、■・・・メモリ読出/書込信号、m・・・メモリアド
レス線、n・・・制御バス。 才11 オ 2 あ の
のブロック図、第2図は第1図のブロック図の動作を説
明するためのタイムチャート図。 1・・・先頭セクタアドレスレジスタ、2・・・セクタ
カウントレジスタ、3・・終了セクタアドレスレジスタ
、4・・・読出/書込制御回路、5・・・ディスク装置
、6・・・バッファメモリ、7・・・アドレス比較回路
、8・・・メモリアドレス変換回路、9・・・制御回路
、 a・・読出/書込動作中表示信号、b・・・内部バス、
C・・・データバス、d・・・読出/書込許可信号。 e・・・データ(アドレス部)、5・・・読出/書込信
号、g・・・データ(データ部)、H・・・先頭セクタ
アドレス情報、■・・・終了セクタアドレス情報、j・
・・インデックスパルス、k・・・開始セクタアドレス
、■・・・メモリ読出/書込信号、m・・・メモリアド
レス線、n・・・制御バス。 才11 オ 2 あ の
Claims (1)
- バスを介して処理装置と接続され、ディスク装置間との
データ授受を制御するディスク制御装置において、該処
理装置より与えられる読出/書込エリアの先頭アドレス
を格納する第1のレジスタと、処理セクタ数より算出し
た終了アドレスを格納する第2のレジスタと、前記第1
、第2のレジスタとディスク装置のヘッドの現在位置を
比較するアドレス比較回路と、該比較回路から与えられ
るセクタアドレスにもとづいてメモリの該当アドレスに
変換するメモリアドレス変換回路とを設け、処理装置よ
り読出/書込指示を受けた時、ヘッド位置が、前記アド
レス格納レジスタ間にあるか否かを判定し、所定の範囲
内にある場合には、ヘッド位置に該当するセクタより読
出/書込動作を行なうことを特徴とする回転形ディスク
制御方式。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3635185A JPS61196323A (ja) | 1985-02-27 | 1985-02-27 | 回転形デイスク制御方式 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3635185A JPS61196323A (ja) | 1985-02-27 | 1985-02-27 | 回転形デイスク制御方式 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61196323A true JPS61196323A (ja) | 1986-08-30 |
Family
ID=12467416
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3635185A Pending JPS61196323A (ja) | 1985-02-27 | 1985-02-27 | 回転形デイスク制御方式 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61196323A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6714373B1 (en) | 1999-09-30 | 2004-03-30 | Fujitsu Limited | Magnetic disk device having an improved seek control |
JP2008192208A (ja) * | 2007-02-01 | 2008-08-21 | Marvell World Trade Ltd | 磁気ディスクコントローラおよび方法 |
-
1985
- 1985-02-27 JP JP3635185A patent/JPS61196323A/ja active Pending
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6714373B1 (en) | 1999-09-30 | 2004-03-30 | Fujitsu Limited | Magnetic disk device having an improved seek control |
JP2008192208A (ja) * | 2007-02-01 | 2008-08-21 | Marvell World Trade Ltd | 磁気ディスクコントローラおよび方法 |
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