JPS6118198B2 - - Google Patents
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- JPS6118198B2 JPS6118198B2 JP58097766A JP9776683A JPS6118198B2 JP S6118198 B2 JPS6118198 B2 JP S6118198B2 JP 58097766 A JP58097766 A JP 58097766A JP 9776683 A JP9776683 A JP 9776683A JP S6118198 B2 JPS6118198 B2 JP S6118198B2
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Classifications
-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G1/00—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data
- G09G1/28—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data using colour tubes
- G09G1/285—Interfacing with colour displays, e.g. TV receiver
Landscapes
- Engineering & Computer Science (AREA)
- Radar, Positioning & Navigation (AREA)
- Remote Sensing (AREA)
- Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Processing Of Color Television Signals (AREA)
- Controls And Circuits For Display Device (AREA)
- Color Television Systems (AREA)
- Transforming Electric Information Into Light Information (AREA)
- Digital Computer Display Output (AREA)
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明はラスタ走査型ビデオ表示器用色信号発
生器に関する。
生器に関する。
大規模集積回路の価格低下にともなつて、家庭
用として適当な安価なマイクロコンピユータを提
供することが可能となつてきた。近年発展してき
ているそのような用途の一例は、ゲームや図形表
示用のビデオ表示器に関連するマイクロコンピユ
ータの応用である。これらの用途では家庭用のテ
レビジヨン受像機がビデオ表示器として利用され
るのがほとんどである。これらのテレビジヨン受
像機やそれに類似する表示器で用いられているラ
スタ走査される陰極線管は、それらの表示器と、
マイクロコンピユータによつて与えられるデジタ
ル情報とを結びつける際に問題が生ずる。
用として適当な安価なマイクロコンピユータを提
供することが可能となつてきた。近年発展してき
ているそのような用途の一例は、ゲームや図形表
示用のビデオ表示器に関連するマイクロコンピユ
ータの応用である。これらの用途では家庭用のテ
レビジヨン受像機がビデオ表示器として利用され
るのがほとんどである。これらのテレビジヨン受
像機やそれに類似する表示器で用いられているラ
スタ走査される陰極線管は、それらの表示器と、
マイクロコンピユータによつて与えられるデジタ
ル情報とを結びつける際に問題が生ずる。
マイクロコンピユータによつて制御される従来
の多くの表示器では、デジタル情報は４ビツトで
貯えられ、各ビツトは緑，赤，青および輝度を示
すために用いられる。色発生器は純粋の色信号
（pure color signal：CW）を発生するための信
号発生器を一般に含む。それらの純粋な色信号は
４ビツトの２進状態に従つてゲートおよび制御さ
れ、標準テレビジヨン受像機に適合する色信号を
与える。このようにしてビデオ色信号を発生する
やり方は複雑で、多くの回路を必要とする。
の多くの表示器では、デジタル情報は４ビツトで
貯えられ、各ビツトは緑，赤，青および輝度を示
すために用いられる。色発生器は純粋の色信号
（pure color signal：CW）を発生するための信
号発生器を一般に含む。それらの純粋な色信号は
４ビツトの２進状態に従つてゲートおよび制御さ
れ、標準テレビジヨン受像機に適合する色信号を
与える。このようにしてビデオ色信号を発生する
やり方は複雑で、多くの回路を必要とする。
本発明では４ビツト情報を循環させる循環シフ
トレジスタを含む。これによつて、先行技術で採
用されている面倒な信号発生技術を利用すること
なしに、ビデオ色信号がデジタル情報から直接に
発生される。
トレジスタを含む。これによつて、先行技術で採
用されている面倒な信号発生技術を利用すること
なしに、ビデオ色信号がデジタル情報から直接に
発生される。
本発明では、循環シフトレジスタを用いる独特
の色信号発生器を含む。このシフトレジスタは色
を表すデジタル信号をメモリから受け、その信号
を所定の速さで循環させる。このようにして、ビ
デオ表示器に使用するのに適する色信号がデジタ
ル信号から発生される。
の色信号発生器を含む。このシフトレジスタは色
を表すデジタル信号をメモリから受け、その信号
を所定の速さで循環させる。このようにして、ビ
デオ表示器に使用するのに適する色信号がデジタ
ル信号から発生される。
以下、図面を参照して本発明を詳細に説明す
る。
る。
第１図に示すマイクロコンピユータは、ラスタ
走査される標準の陰極線管で表示されるカラー図
形を制御するのに特に適する。このマイクロコン
ピユータは、デジタル情報から色信号を直接に発
生するビデオ発生器と、複雑なプログラミングを
行なうことなしに、特に垂直方向が明確なカラー
図形を与えるタイミング器とを含む。
走査される標準の陰極線管で表示されるカラー図
形を制御するのに特に適する。このマイクロコン
ピユータは、デジタル情報から色信号を直接に発
生するビデオ発生器と、複雑なプログラミングを
行なうことなしに、特に垂直方向が明確なカラー
図形を与えるタイミング器とを含む。
このマイクロコンピユータは中央処理ユニツト
（CPU）すなわちマイクロプロセツサ１０を含
む。このマイクロコンピユータにはM6800または
8080のような市販されている多くのマイクロプロ
セツサのうちから任意のものを用いることができ
るが、ここで説明する実施例では部品番号6502の
マイクロプロセツサを用いる。CPU１０は双方
向性三状態バツフア１２を介してデータバス１８
に結合される。CPU１０は三状態バツフア１３
を介してアドレスバス２０にも結合される。
（CPU）すなわちマイクロプロセツサ１０を含
む。このマイクロコンピユータにはM6800または
8080のような市販されている多くのマイクロプロ
セツサのうちから任意のものを用いることができ
るが、ここで説明する実施例では部品番号6502の
マイクロプロセツサを用いる。CPU１０は双方
向性三状態バツフア１２を介してデータバス１８
に結合される。CPU１０は三状態バツフア１３
を介してアドレスバス２０にも結合される。
第１図に示すマイクロコンピユータは２つのメ
モリを含む。その１つは12Kバイトの読取り専用
メモリ（ROM）１４で、このメモリはデータバ
ス１８に結合される。このROMとしてはマスク
プログラム可能なメモリ、Ｅ PROMまたはその
他の読取り専用メモリを用いることができる。こ
のマイクロコンピユータの主データ蓄積装置はラ
ンダム・アクセス・メモリ（RAM）２３で構成
される。ここで説明している実施例では、このメ
モリ２３の容量は4K〜48Kバイトで、市販のダ
イナミツクMOSメモリで構成できる。このRAM
２３はバス３０と、データバス１８と、映像信号
発生器２５とを介して入力／出力インタフエース
２１に結合される。
モリを含む。その１つは12Kバイトの読取り専用
メモリ（ROM）１４で、このメモリはデータバ
ス１８に結合される。このROMとしてはマスク
プログラム可能なメモリ、Ｅ PROMまたはその
他の読取り専用メモリを用いることができる。こ
のマイクロコンピユータの主データ蓄積装置はラ
ンダム・アクセス・メモリ（RAM）２３で構成
される。ここで説明している実施例では、このメ
モリ２３の容量は4K〜48Kバイトで、市販のダ
イナミツクMOSメモリで構成できる。このRAM
２３はバス３０と、データバス１８と、映像信号
発生器２５とを介して入力／出力インタフエース
２１に結合される。
このマイクロコンピユータのタイミング信号は
タイミングおよび同期信号発生器１５によつて発
生される。この信号発生器１５の新規な部分につ
いては第３図を参照して詳しく説明する。この信
号発生器１５はマイクロコンピユータ用のタイミ
ング信号と、ビデオ表示器用の同期信号とを発生
する。このタイミング信号は約2MHzであつて、
線３２を介してRAM２３に与えられる。同期信
号は14.31818MHzであつて、線３３を介して映像
信号発生器２５に与えられる。タイミングおよび
同期信号発生器１５はタイミング信号をデコーダ
１６と、アドレス・マルチプレクサ２８とにも与
える。
タイミングおよび同期信号発生器１５によつて発
生される。この信号発生器１５の新規な部分につ
いては第３図を参照して詳しく説明する。この信
号発生器１５はマイクロコンピユータ用のタイミ
ング信号と、ビデオ表示器用の同期信号とを発生
する。このタイミング信号は約2MHzであつて、
線３２を介してRAM２３に与えられる。同期信
号は14.31818MHzであつて、線３３を介して映像
信号発生器２５に与えられる。タイミングおよび
同期信号発生器１５はタイミング信号をデコーダ
１６と、アドレス・マルチプレクサ２８とにも与
える。
アドレス・デコーダ１６はアドレスバス２０か
らアドレス信号を受けて、そのアドレス信号を復
号する。このアドレス・デコーダ１６はROM１
４とRAM２３に結合される。アドレス信号はバ
ス２０とアドレス・マルチプレクサ２８とを介し
てRAM２３へも与えられる。
らアドレス信号を受けて、そのアドレス信号を復
号する。このアドレス・デコーダ１６はROM１
４とRAM２３に結合される。アドレス信号はバ
ス２０とアドレス・マルチプレクサ２８とを介し
てRAM２３へも与えられる。
入力／出力インタフエース２１は、マイクロプ
ロセツサをカセツト・ジヤツクに電気的に結合さ
せたり、ゲームの入力／出力信号を受けるために
用いられるコネクタに電気的に接続させるように
するための入力部を構成する。この目的のために
公知のバツフアおよびタイミング要素を用いるこ
とができる。
ロセツサをカセツト・ジヤツクに電気的に結合さ
せたり、ゲームの入力／出力信号を受けるために
用いられるコネクタに電気的に接続させるように
するための入力部を構成する。この目的のために
公知のバツフアおよびタイミング要素を用いるこ
とができる。
映像信号発生器２５は入力／出力インタフエー
ス２１とRAM２３から信号を受ける。この映像
信号発生器２５は出力線２６に映像信号出力を与
える。映像信号発生器２５については第２図を参
照して詳しく説明する。
ス２１とRAM２３から信号を受ける。この映像
信号発生器２５は出力線２６に映像信号出力を与
える。映像信号発生器２５については第２図を参
照して詳しく説明する。
ここで説明している実施例では、第１図に示す
マイクロコンピユータは１枚のプリント回路板上
に作られる。このプリント回路板には、マイクロ
コンピユータをカセツトテープ再生器などの装置
に接続するためのコネクタが含まれる。第１図に
は数多くの周知の相互接続や、駆動回路などのマ
イクロコンピユータで用いられるその他の回路装
置は記載を省略してある。第１図に示すマイクロ
プロセツサで使用される回路や相互接続（これに
はRAM２３のトランスペアレント・リフレツシ
ユ・サイクルも含まれる）についての詳細な説明
が雑誌「インタフエース・エージ（Interface
Age）」第２巻第２号（1977年１月）所載のロイ
（Roy）とモリス（Morris）の「M6800フアミリ
ーを用いるCRT端末器（Ａ CRT Terminal
Using The M6800Family）」と題する論文にお
いて記述されている。
マイクロコンピユータは１枚のプリント回路板上
に作られる。このプリント回路板には、マイクロ
コンピユータをカセツトテープ再生器などの装置
に接続するためのコネクタが含まれる。第１図に
は数多くの周知の相互接続や、駆動回路などのマ
イクロコンピユータで用いられるその他の回路装
置は記載を省略してある。第１図に示すマイクロ
プロセツサで使用される回路や相互接続（これに
はRAM２３のトランスペアレント・リフレツシ
ユ・サイクルも含まれる）についての詳細な説明
が雑誌「インタフエース・エージ（Interface
Age）」第２巻第２号（1977年１月）所載のロイ
（Roy）とモリス（Morris）の「M6800フアミリ
ーを用いるCRT端末器（Ａ CRT Terminal
Using The M6800Family）」と題する論文にお
いて記述されている。
次に第３図を参照して、タイミングおよび同期
信号発生器１５は周波数基準源５１を含む。この
周波数基準源５１は水晶発振器で構成できる。こ
の周波数基準源５１はバツフア５２に結合され
る。このバツフア５２は、ここで説明している実
施例では、14.31818MHzの信号を出力線３３を介
して、第２図に示す映像信号発生器２５と、分周
器５５と、シフトレジスタ・カウンタ６０とに与
える。分周器５５は14.31818MHzの信号を２分の
１に分周して、7.15909MHzの信号を出力線５６
を介して分周器５７と、シフトレジスタ・カウン
タ６０と、マイクロプロセツサとに与える。この
信号はマイクロプロセツサによりタイミング信号
として用いられるとともに、シフトレジスタ・カ
ウンタ６０によつて帰還同期信号として用いられ
る。分周器５７は与えられた7.15909MHzの信号
を２分の１に分周して、3.579545MHzの標準色副
搬送波基準信号を出力線５８に出す。この信号は
ビデオ表示器で通常の態様で用いらるとともに、
シフトレジスタ・カウンタ６０によつて帰還同期
信号として用いられる。
信号発生器１５は周波数基準源５１を含む。この
周波数基準源５１は水晶発振器で構成できる。こ
の周波数基準源５１はバツフア５２に結合され
る。このバツフア５２は、ここで説明している実
施例では、14.31818MHzの信号を出力線３３を介
して、第２図に示す映像信号発生器２５と、分周
器５５と、シフトレジスタ・カウンタ６０とに与
える。分周器５５は14.31818MHzの信号を２分の
１に分周して、7.15909MHzの信号を出力線５６
を介して分周器５７と、シフトレジスタ・カウン
タ６０と、マイクロプロセツサとに与える。この
信号はマイクロプロセツサによりタイミング信号
として用いられるとともに、シフトレジスタ・カ
ウンタ６０によつて帰還同期信号として用いられ
る。分周器５７は与えられた7.15909MHzの信号
を２分の１に分周して、3.579545MHzの標準色副
搬送波基準信号を出力線５８に出す。この信号は
ビデオ表示器で通常の態様で用いらるとともに、
シフトレジスタ・カウンタ６０によつて帰還同期
信号として用いられる。
バツフア５２の出力線３３に与えられたおよそ
14.3MHzの信号はシフトレジスタ・カウンタ６０
により７分の１に分周されて、出力線３２へ約
2MHz信号として与えられる。この信号はRAM２
３によつて用いられる。この約2MHz信号は分周
器６２によつて２分の１に分周されて約1MHzの
タイミング信号として出力線６５に与えられる。
この信号はマイクロプロセツサの他の回路部で用
いられるとともに、カウンタ６３，６４によつて
も用いられる。
14.3MHzの信号はシフトレジスタ・カウンタ６０
により７分の１に分周されて、出力線３２へ約
2MHz信号として与えられる。この信号はRAM２
３によつて用いられる。この約2MHz信号は分周
器６２によつて２分の１に分周されて約1MHzの
タイミング信号として出力線６５に与えられる。
この信号はマイクロプロセツサの他の回路部で用
いられるとともに、カウンタ６３，６４によつて
も用いられる。
65分の１分割カウンタ６３は水平同期信号を得
るために用いられる。カウンタ６３が最大カウン
トまで計数すると、出力線６６を介してシフトレ
ジスタ６０へ信号が与えらるとともに、垂直同期
カウンタ６４へも与えられる。このカウンタ６４
はその信号を262分の１に分周して垂直同期信号
を発生する。
るために用いられる。カウンタ６３が最大カウン
トまで計数すると、出力線６６を介してシフトレ
ジスタ６０へ信号が与えらるとともに、垂直同期
カウンタ６４へも与えられる。このカウンタ６４
はその信号を262分の１に分周して垂直同期信号
を発生する。
ここで説明している実施例では、表示器は65×
262のアレイに分割される。しかし、65個所の水
平キヤラクタ位置のうち25個所がブランキングの
ために用いられ、262本の走査線のうち70本がブ
ランキングのために用いられる。
262のアレイに分割される。しかし、65個所の水
平キヤラクタ位置のうち25個所がブランキングの
ために用いられ、262本の走査線のうち70本がブ
ランキングのために用いられる。
第３図から明らかなように、カウンタ６３から
発生される水平同期信号の周波数は約15734Hzで
ある。この周波数は標準水平同期信号の周波数で
ある15750Hzにきわめて近い。カウンタ６３の各
カウントは色副搬送波基準周波数の３１／２の色サイ クルを含む。更に、走査線当りの色サイクルの総
数は整数ではない。その結果、新しい各走査線ご
とに色副搬送波基準信号が180度だけ移相され
る。したがつて、この現象に対して何らかの補正
を加えなければ垂直走査線は不完全なものとな
る。後で説明するように、約1MHzのタイミング
信号の発生を、各走査ごとに、3.58MHz副搬送波
基準信号の２分の１周期に相当する時間だけ遅ら
せることによつて、上記補正が行なわれる。
発生される水平同期信号の周波数は約15734Hzで
ある。この周波数は標準水平同期信号の周波数で
ある15750Hzにきわめて近い。カウンタ６３の各
カウントは色副搬送波基準周波数の３１／２の色サイ クルを含む。更に、走査線当りの色サイクルの総
数は整数ではない。その結果、新しい各走査線ご
とに色副搬送波基準信号が180度だけ移相され
る。したがつて、この現象に対して何らかの補正
を加えなければ垂直走査線は不完全なものとな
る。後で説明するように、約1MHzのタイミング
信号の発生を、各走査ごとに、3.58MHz副搬送波
基準信号の２分の１周期に相当する時間だけ遅ら
せることによつて、上記補正が行なわれる。
第３図に示すように、シフトレジスタ・カウン
タ６０の正常な計数動作順序には７種類の状態が
含まれる。この４段カウンタの終段に２進０が含
まれている場合には、第２段（位置７０）には２
進１が与えられる。第１段と第２段は、終段が２
進０を含んでいる時は、第２段の出力を含む。し
たがつて、次の桁送りの後では状態は1110とな
り、最後には状態は矢印６８で示されているよう
に1111となる。
タ６０の正常な計数動作順序には７種類の状態が
含まれる。この４段カウンタの終段に２進０が含
まれている場合には、第２段（位置７０）には２
進１が与えられる。第１段と第２段は、終段が２
進０を含んでいる時は、第２段の出力を含む。し
たがつて、次の桁送りの後では状態は1110とな
り、最後には状態は矢印６８で示されているよう
に1111となる。
カウンタ６３の出力線６６に信号が与えられる
たびに（約1MHz信号の65サイクルごと）、カウン
タ６０の正常な計数動作順序が、第３図の拡張さ
れた順序によつて示されているように変更され
る。信号が出力線６６に与えられ、0000カウント
に達すると、第２段（位置７０）への２進１のロ
ードは14.318MHzのクロツク信号の２サイクルに
相当する時間だけ遅らされる。これらの２サイク
ルは3.58MHz信号の180度に相当する。これらの
２サイクルの後で第２段へ２進１がロードされ、
その後で第１段と第３段へ２進１がロードされ
る。矢印６９で示されているように、それから正
常な計数動作順序が開始される。カウンタ６０に
おけるカウントを上記のようにして拡大すること
により、走査線ごとに垂直の色合わせを行なう補
償が行なわれる。
たびに（約1MHz信号の65サイクルごと）、カウン
タ６０の正常な計数動作順序が、第３図の拡張さ
れた順序によつて示されているように変更され
る。信号が出力線６６に与えられ、0000カウント
に達すると、第２段（位置７０）への２進１のロ
ードは14.318MHzのクロツク信号の２サイクルに
相当する時間だけ遅らされる。これらの２サイク
ルは3.58MHz信号の180度に相当する。これらの
２サイクルの後で第２段へ２進１がロードされ、
その後で第１段と第３段へ２進１がロードされ
る。矢印６９で示されているように、それから正
常な計数動作順序が開始される。カウンタ６０に
おけるカウントを上記のようにして拡大すること
により、走査線ごとに垂直の色合わせを行なう補
償が行なわれる。
次に第２図を参照して、第１図に示す映像信号
発生器２５は２つの４ビツト・シフトレジスタ３
６，３７を含む。各シフトレジスタ３６，３７は
RAM２３にバス３０で結合されて４ビツトデー
タを受ける。また、シフトレジスタ３６，３７は
線４９を介してロード信号を受ける。このロード
信号は線３０ａ〜３０ｈを介して与えられる信号
をシフトレジスタ３６，３７の中へ桁送りさせ
る。シフトレジスタ３７の初段（I0）は線４２を
介してマルチプレクサ３８に結合され、第３段
（I1）は線４３によりマルチプレクサ３８に結合さ
れる。同様に、シフトレジスタ３６の初段（I2）
と第３段（I3）は、それぞれ線４４，４５によつ
てマルチプレクサ３８に結合される。
発生器２５は２つの４ビツト・シフトレジスタ３
６，３７を含む。各シフトレジスタ３６，３７は
RAM２３にバス３０で結合されて４ビツトデー
タを受ける。また、シフトレジスタ３６，３７は
線４９を介してロード信号を受ける。このロード
信号は線３０ａ〜３０ｈを介して与えられる信号
をシフトレジスタ３６，３７の中へ桁送りさせ
る。シフトレジスタ３７の初段（I0）は線４２を
介してマルチプレクサ３８に結合され、第３段
（I1）は線４３によりマルチプレクサ３８に結合さ
れる。同様に、シフトレジスタ３６の初段（I2）
と第３段（I3）は、それぞれ線４４，４５によつ
てマルチプレクサ３８に結合される。
シフトレジスタ３６の中の４ビツトデータを循
環させるために、線４４はシフトレジスタ３６の
第４段に結合される。シフトレジスタ３６，３７
はデータを左から右へ、すなわち初段へ向つて桁
送りさせる。シフトレジスタ３７の中の４ビツト
データを循環できるようにするために、線４２を
マルチプレクサ４０を介してシフトレジスタ３７
の第４段に選択的に結合できる。線４４はマルチ
プレクサ４０を介してシフトレジスタ３７の第４
段へ結合できる。このように結合することによつ
て、シフトレジスタ３６と３７は単一の８ビツ
ト・シフトレジスタとして動作する。
環させるために、線４４はシフトレジスタ３６の
第４段に結合される。シフトレジスタ３６，３７
はデータを左から右へ、すなわち初段へ向つて桁
送りさせる。シフトレジスタ３７の中の４ビツト
データを循環できるようにするために、線４２を
マルチプレクサ４０を介してシフトレジスタ３７
の第４段に選択的に結合できる。線４４はマルチ
プレクサ４０を介してシフトレジスタ３７の第４
段へ結合できる。このように結合することによつ
て、シフトレジスタ３６と３７は単一の８ビツ
ト・シフトレジスタとして動作する。
奇／偶Ｘとして示されている信号（線４７）
と、上／下Ｙとして示されている信号（線４８）
がマルチプレクサ３８を制御するために用いられ
る。カラー図形モードの間はシフトレジスタ３
６，３７は独立のシフトレジスタとして動作し、
データを線２６へ結合させるために、そのデータ
はマルチプレクサ３８によつて交互に選択され
る。上／下Ｙ信号は、カラー図形モードの間は、
シフトレジスタ３６または３７からのデータ選択
を可能にする。それから、奇／偶Ｘ信号が選択さ
れたシフトレジスタからのデータをトグル制御す
る。このトグル制御は、シフトレジスタ３７が選
択された時はI0またはI1を交互に選択することに
より、あるいはシフトレジスタ３６が選択された
時はI2またはI3を交互に選択することによつて行
なわれる。
と、上／下Ｙとして示されている信号（線４８）
がマルチプレクサ３８を制御するために用いられ
る。カラー図形モードの間はシフトレジスタ３
６，３７は独立のシフトレジスタとして動作し、
データを線２６へ結合させるために、そのデータ
はマルチプレクサ３８によつて交互に選択され
る。上／下Ｙ信号は、カラー図形モードの間は、
シフトレジスタ３６または３７からのデータ選択
を可能にする。それから、奇／偶Ｘ信号が選択さ
れたシフトレジスタからのデータをトグル制御す
る。このトグル制御は、シフトレジスタ３７が選
択された時はI0またはI1を交互に選択することに
より、あるいはシフトレジスタ３６が選択された
時はI2またはI3を交互に選択することによつて行
なわれる。
カラー図形モードの間は、８ビツト色情報が
RAM２３から約1MHzの率でシフトレジスタ３
６，３７の中へ（並列に）桁送りされる。このデ
ータは線３３を介して与えられるクロツク信号に
より、14.31818MHzの速さでシフトレジスタ３６
と３７の中を循環させられる。この速さでシフト
レジスタ３６と３７の中を循環させられるデータ
ビツトにより、3.58MHzの成分を有する信号が得
られ、それらの信号は、後で説明するように、ビ
デオ表示器のためカラー信号を得るために容易に
用いることができる。
RAM２３から約1MHzの率でシフトレジスタ３
６，３７の中へ（並列に）桁送りされる。このデ
ータは線３３を介して与えられるクロツク信号に
より、14.31818MHzの速さでシフトレジスタ３６
と３７の中を循環させられる。この速さでシフト
レジスタ３６と３７の中を循環させられるデータ
ビツトにより、3.58MHzの成分を有する信号が得
られ、それらの信号は、後で説明するように、ビ
デオ表示器のためカラー信号を得るために容易に
用いることができる。
カラー図形モードにおいては、各表示キヤラク
タは上側カラー長方形と下側カラー長方形に分割
される。RAM２３は上側カラー長方形のための
４ビツト・カラーデータをシフトレジスタ３６に
与え、下側カラー長方形のための４ビツト・カラ
ーデータをシフトレジスタ３７に与える。ここで
説明している実施例では、このカラーデータは下
記のように符号化される。
タは上側カラー長方形と下側カラー長方形に分割
される。RAM２３は上側カラー長方形のための
４ビツト・カラーデータをシフトレジスタ３６に
与え、下側カラー長方形のための４ビツト・カラ
ーデータをシフトレジスタ３７に与える。ここで
説明している実施例では、このカラーデータは下
記のように符号化される。
赤 色 0001 中間紫色 0011
桃 色 1011 中間青色 0110
青 色 0010 中間緑色 1100
薄青色 0111 ダイダイ色 1001
濃緑色 0100 白 色 1111
薄緑色 1110 灰 色 1010
茶 色 1000 灰 色 0101
黄 色 1101
色が上記のようにして符号化され、それらの色
コードが14.318MHzの速さでシフトレジスタ３
６，３７の中を循環させられると、標準テレビジ
ヨン受像機に適合するテレビジヨン色信号が発生
される。このようにして得られた赤，薄青，茶お
よび灰の各色に対する信号を第４図の線７１，７
２，７３，７４と７５にそれぞれ示す。
コードが14.318MHzの速さでシフトレジスタ３
６，３７の中を循環させられると、標準テレビジ
ヨン受像機に適合するテレビジヨン色信号が発生
される。このようにして得られた赤，薄青，茶お
よび灰の各色に対する信号を第４図の線７１，７
２，７３，７４と７５にそれぞれ示す。
水平同期カウンタ６３の各カウントは副搬送波
基準信号の３１／２サイクルに相当する（第３図）。し たがつて、色副搬送波基準信号に関しては、キヤ
ラクタ間で180度の位相推移が起る。このこと
は、色信号を第２図に示す映像信号発生器２５に
より180度だけ移相させるか、それらの信号に対
する符号化を奇数と偶数の水平キヤラクタ位置に
対して交互に行なわなければならないことを意味
する。ここで説明している実施例では、選択され
たシフトレジスタの初段と第３段の間でトグルす
ることによつて、色信号の位相を180度変えるこ
とができる。たとえば、キヤラクタの下側部分が
表示され、そのために色情報がシフトレジスタ３
７の中に含まれるものと仮定する。また、この情
報は循環させられる、すなわち、線４２が第４段
をマルチプレクサ４０を介して初段に結合してい
ると仮定する。そうすると、線４７上の信号によ
り示される偶数水平キヤラクタ位置に対して、位
相選択マルチプレクサ３８がI0信号を線２６に結
合する。奇数水平キヤラクタ位置に対しては、I1
信号を選択することにより位相が180度変えられ
る。
基準信号の３１／２サイクルに相当する（第３図）。し たがつて、色副搬送波基準信号に関しては、キヤ
ラクタ間で180度の位相推移が起る。このこと
は、色信号を第２図に示す映像信号発生器２５に
より180度だけ移相させるか、それらの信号に対
する符号化を奇数と偶数の水平キヤラクタ位置に
対して交互に行なわなければならないことを意味
する。ここで説明している実施例では、選択され
たシフトレジスタの初段と第３段の間でトグルす
ることによつて、色信号の位相を180度変えるこ
とができる。たとえば、キヤラクタの下側部分が
表示され、そのために色情報がシフトレジスタ３
７の中に含まれるものと仮定する。また、この情
報は循環させられる、すなわち、線４２が第４段
をマルチプレクサ４０を介して初段に結合してい
ると仮定する。そうすると、線４７上の信号によ
り示される偶数水平キヤラクタ位置に対して、位
相選択マルチプレクサ３８がI0信号を線２６に結
合する。奇数水平キヤラクタ位置に対しては、I1
信号を選択することにより位相が180度変えられ
る。
第２の動作モード中は、第２図に示す映像信号
発生器２５は高解像度の図形を得るために用いら
れる。この場合には、RAM２３からレジスタ３
６，３７へ８ビツト情報が与えられる。この高解
像モードに対しては、線４２が映像線２６に結合
されて、RAM２３からの８ビツト情報が
14.318MHzの速さで線２６へ直列に与えられる。
マルチプレクサ４０は線４４をシフトレジスタ３
７の第４段に結合して、単一の８ビツト・シフト
レジスタを構成する。その結果得られた信号を第
４図の線７７，７８に示す。それらの信号は緑ま
たは紫の表示を行なう。ここで説明している実施
例ではカラー図形モードの間にマルチプレクサ３
８により行なわれる補償を得るためにデータの変
更が採用される。
発生器２５は高解像度の図形を得るために用いら
れる。この場合には、RAM２３からレジスタ３
６，３７へ８ビツト情報が与えられる。この高解
像モードに対しては、線４２が映像線２６に結合
されて、RAM２３からの８ビツト情報が
14.318MHzの速さで線２６へ直列に与えられる。
マルチプレクサ４０は線４４をシフトレジスタ３
７の第４段に結合して、単一の８ビツト・シフト
レジスタを構成する。その結果得られた信号を第
４図の線７７，７８に示す。それらの信号は緑ま
たは紫の表示を行なう。ここで説明している実施
例ではカラー図形モードの間にマルチプレクサ３
８により行なわれる補償を得るためにデータの変
更が採用される。
以上、カラー映像表示器を制御するのに特に適
当なマイクロコンピユータについて説明した。独
特のタイミング要素によつて、複雑なプログラミ
ング変更なしに鮮明な垂直カラー走査線が得ら
れ、しかも標準の水平同期周波数に非常に近い周
波数を持つた水平同期信号を発生できる。また、
独特の映像信号発生器により、先行技術でしばし
ば採用されている複雑な回路を用いることなし
に、デジタル信号から色信号を直接に発生でき
る。
当なマイクロコンピユータについて説明した。独
特のタイミング要素によつて、複雑なプログラミ
ング変更なしに鮮明な垂直カラー走査線が得ら
れ、しかも標準の水平同期周波数に非常に近い周
波数を持つた水平同期信号を発生できる。また、
独特の映像信号発生器により、先行技術でしばし
ば採用されている複雑な回路を用いることなし
に、デジタル信号から色信号を直接に発生でき
る。
以上述べたように、本発明によるラスタ走査型
ビデオ表示器用色信号発生器を用いればきわめて
簡単な構成でビデオ色信号をデジタル情報から直
接に発生することができる。
ビデオ表示器用色信号発生器を用いればきわめて
簡単な構成でビデオ色信号をデジタル情報から直
接に発生することができる。
第１図は本発明が適用されたマイクロコンピユ
ータの一実施例の全体的なブロツク図、第２図は
第１図に示すマイクロコンピユータで用いられる
映像信号発生器のブロツク図、第３図は第１図に
示すマイクロコンピユータで用いられるタイミン
グおよび同期信号発生器のブロツク図、第４図は
第２図に示す映像信号発生器により発生される信
号波形のいくつかを示す波形図である。 １０…中央処理ユニツト、１４…ROM、１５
…タイミングおよび同期信号発生器、１６…デコ
ーダ、２３…RAM、２５…映像信号発生器、２
８…アドレスマルチプレクサ、３６，３７…シフ
トレジスタ、３８…マルチプレクサ、５５，５７
…分周器、６０…シフトレジスタカウンタ、６
３，６４…カウンタ。
ータの一実施例の全体的なブロツク図、第２図は
第１図に示すマイクロコンピユータで用いられる
映像信号発生器のブロツク図、第３図は第１図に
示すマイクロコンピユータで用いられるタイミン
グおよび同期信号発生器のブロツク図、第４図は
第２図に示す映像信号発生器により発生される信
号波形のいくつかを示す波形図である。 １０…中央処理ユニツト、１４…ROM、１５
…タイミングおよび同期信号発生器、１６…デコ
ーダ、２３…RAM、２５…映像信号発生器、２
８…アドレスマルチプレクサ、３６，３７…シフ
トレジスタ、３８…マルチプレクサ、５５，５７
…分周器、６０…シフトレジスタカウンタ、６
３，６４…カウンタ。
Claims (1)
- 【特許請求の範囲】 １ デジタル信号を蓄積するためのデジタル蓄積
器と、このデジタル蓄積器からのデジタル信号を
受け、そのデジタル信号を所定の速度で循環させ
るための循環シフトレジスタとを備え、それによ
りビデオ表示に使用するのに適当な色信号が発生
されることを特徴とするラスタ走査型ビデオ表示
器用色信号発生器。 ２ 特許請求の範囲の第１項に記載の色信号発生
器において、前記循環シフトレジスタは４ビツ
ト・レジスタであることを特徴とするラスタ走査
型ビデオ表示器用色信号発生器。 ３ 特許請求の範囲の第１項に記載の色信号発生
器において、前記循環率が約14318MHzであるこ
とを特徴とするラスタ走査型ビデオ表示器用色信
号発生器。 ４ 特許請求の範囲の第３項に記載の色信号発生
器において、前記循環シフトレジスタ内の種々の
段で前記循環しているデジタル信号を選択するた
めのスイツチング装置を含み、それにより移相さ
れた信号を選択できるようにすることを特徴とす
るラスタ走査型ビデオ表示器用色信号発生器。 ５ 特許請求の範囲の第１項に記載の色信号発生
器において、前記循環シフトレジスタは、更に第
１シフトレジスタと第２のシフトレジスタとを含
み、前記色信号発生器は、前記第１および第２の
シフトレジスタを２つの循環シフトレジスタとし
て結合しかつ前記第１および第２のシフトレジス
タを単一のシフトレジスタとして結合する回路装
置と、前記第１および第２のシフトレジスタと結
合されて前記各レジスタからの信号を選択する多
重化器とを備え、前記第１と第２のシフトレジス
タは前記デジタル蓄積器から貯えられている信号
を受けるために結合され、前記シフトレジスタは
循環シフトレジスタとして動作させられたときに
色信号を発生し、それにより前記シフトレジスタ
が単一のシフトレジスタとして動作するときに高
解像度のビデオ信号が発生されることを特徴とす
るラスタ走査型ビデオ表示器用色信号発生器。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US786197 | 1977-04-11 | ||
| US05/786,197 US4136359A (en) | 1977-04-11 | 1977-04-11 | Microcomputer for use with video display |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59186A JPS59186A (ja) | 1984-01-05 |
| JPS6118198B2 true JPS6118198B2 (ja) | 1986-05-10 |
Family
ID=25137868
Family Applications (2)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP53042582A Expired JPS5846027B2 (ja) | 1977-04-11 | 1978-04-11 | ラスタ走査型ビデオ表示器用タイミング信号発生装置 |
| JP58097766A Granted JPS59186A (ja) | 1977-04-11 | 1983-06-01 | ラスタ走査型ビデオ表示器用色信号発生器 |
Family Applications Before (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP53042582A Expired JPS5846027B2 (ja) | 1977-04-11 | 1978-04-11 | ラスタ走査型ビデオ表示器用タイミング信号発生装置 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US4136359A (ja) |
| JP (2) | JPS5846027B2 (ja) |
| GB (2) | GB1599734A (ja) |
| HK (2) | HK8382A (ja) |
| MY (2) | MY8300015A (ja) |
Families Citing this family (30)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4217604A (en) * | 1978-09-11 | 1980-08-12 | Apple Computer, Inc. | Apparatus for digitally controlling pal color display |
| JPS55143588A (en) * | 1979-04-10 | 1980-11-08 | Nippon Electric Co | Pattern display system |
| US4383296A (en) * | 1980-05-16 | 1983-05-10 | Apple Computer, Inc. | Computer with a memory system for remapping a memory having two memory output buses for high resolution display with scrolling of the displayed characters |
| US4533909A (en) * | 1980-05-16 | 1985-08-06 | Apple Computer, Inc. | Computer with color display |
| US4344075A (en) * | 1980-08-28 | 1982-08-10 | Rca Corporation | Timing circuit for the digital generation of composite luminance and chrominance video signal for non-interlaced television raster scan-line pattern |
| US6356316B1 (en) * | 1982-01-04 | 2002-03-12 | Video Associates Labs, Inc. | Microkeyer: microcomputer broadcast video overlay device and method |
| US4500908A (en) * | 1982-06-18 | 1985-02-19 | Research And Development Institute For Infosystems, Inc. | Method and apparatus for standardizing nonstandard video signals |
| JPS5940694A (ja) * | 1982-08-30 | 1984-03-06 | シャープ株式会社 | Ｃｒｔデイスプレイのコントロ−ル装置 |
| US4599610A (en) * | 1984-03-21 | 1986-07-08 | Phillips Petroleum Company | Overlaying information on a video display |
| US4631692A (en) * | 1984-09-21 | 1986-12-23 | Video-7 Incorporated | RGB interface |
| US6225973B1 (en) | 1998-10-07 | 2001-05-01 | Microsoft Corporation | Mapping samples of foreground/background color image data to pixel sub-components |
| US6396505B1 (en) | 1998-10-07 | 2002-05-28 | Microsoft Corporation | Methods and apparatus for detecting and reducing color errors in images |
| US6597360B1 (en) | 1998-10-07 | 2003-07-22 | Microsoft Corporation | Automatic optimization of the position of stems of text characters |
| US6356278B1 (en) | 1998-10-07 | 2002-03-12 | Microsoft Corporation | Methods and systems for asymmeteric supersampling rasterization of image data |
| US6307566B1 (en) | 1998-10-07 | 2001-10-23 | Microsoft Corporation | Methods and apparatus for performing image rendering and rasterization operations |
| US6278434B1 (en) | 1998-10-07 | 2001-08-21 | Microsoft Corporation | Non-square scaling of image data to be mapped to pixel sub-components |
| US6236390B1 (en) | 1998-10-07 | 2001-05-22 | Microsoft Corporation | Methods and apparatus for positioning displayed characters |
| US6188385B1 (en) | 1998-10-07 | 2001-02-13 | Microsoft Corporation | Method and apparatus for displaying images such as text |
| WO2000042564A2 (en) * | 1999-01-12 | 2000-07-20 | Microsoft Corporation | Filtering image data to obtain samples mapped to pixel sub-components of a display device |
| US6393145B2 (en) | 1999-01-12 | 2002-05-21 | Microsoft Corporation | Methods apparatus and data structures for enhancing the resolution of images to be rendered on patterned display devices |
| US6973210B1 (en) | 1999-01-12 | 2005-12-06 | Microsoft Corporation | Filtering image data to obtain samples mapped to pixel sub-components of a display device |
| US7134091B2 (en) * | 1999-02-01 | 2006-11-07 | Microsoft Corporation | Quality of displayed images with user preference information |
| US6674436B1 (en) | 1999-02-01 | 2004-01-06 | Microsoft Corporation | Methods and apparatus for improving the quality of displayed images through the use of display device and display condition information |
| US6750875B1 (en) | 1999-02-01 | 2004-06-15 | Microsoft Corporation | Compression of image data associated with two-dimensional arrays of pixel sub-components |
| US6342890B1 (en) | 1999-03-19 | 2002-01-29 | Microsoft Corporation | Methods, apparatus, and data structures for accessing sub-pixel data having left side bearing information |
| US6282327B1 (en) | 1999-07-30 | 2001-08-28 | Microsoft Corporation | Maintaining advance widths of existing characters that have been resolution enhanced |
| US6738526B1 (en) | 1999-07-30 | 2004-05-18 | Microsoft Corporation | Method and apparatus for filtering and caching data representing images |
| US6226017B1 (en) | 1999-07-30 | 2001-05-01 | Microsoft Corporation | Methods and apparatus for improving read/modify/write operations |
| US6681053B1 (en) | 1999-08-05 | 2004-01-20 | Matsushita Electric Industrial Co., Ltd. | Method and apparatus for improving the definition of black and white text and graphics on a color matrix digital display device |
| TW584801B (en) * | 2000-12-11 | 2004-04-21 | Ntt Docomo Inc | Terminal and repeater |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3581011A (en) * | 1967-10-23 | 1971-05-25 | Telemation | Television broadcast synchronizing apparatus and method |
-
1977
- 1977-04-11 US US05/786,197 patent/US4136359A/en not_active Expired - Lifetime
-
1978
- 1978-03-09 GB GB8737/80A patent/GB1599734A/en not_active Expired
- 1978-03-09 GB GB9365/78A patent/GB1599733A/en not_active Expired
- 1978-04-11 JP JP53042582A patent/JPS5846027B2/ja not_active Expired
-
1982
- 1982-02-25 HK HK83/82A patent/HK8382A/xx unknown
- 1982-02-25 HK HK84/82A patent/HK8482A/xx unknown
-
1983
- 1983-06-01 JP JP58097766A patent/JPS59186A/ja active Granted
- 1983-12-30 MY MY15/83A patent/MY8300015A/xx unknown
- 1983-12-30 MY MY41/83A patent/MY8300041A/xx unknown
Also Published As
| Publication number | Publication date |
|---|---|
| GB1599733A (en) | 1981-10-07 |
| US4136359A (en) | 1979-01-23 |
| JPS53126825A (en) | 1978-11-06 |
| HK8482A (en) | 1982-03-05 |
| HK8382A (en) | 1982-03-05 |
| GB1599734A (en) | 1981-10-07 |
| MY8300015A (en) | 1983-12-31 |
| JPS59186A (ja) | 1984-01-05 |
| JPS5846027B2 (ja) | 1983-10-13 |
| MY8300041A (en) | 1983-12-31 |
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