JPS61135130A - 半導体装置の製造方法 - Google Patents
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- H01L2924/15165—Monolayer substrate
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
この発明は半導体基板に良熱伝導金属を一体化した、い
わゆるプレーデッドヒートシンク構造(P HS構造と
略称)に形成された半導体素子のマウントを改良した高
周波半導体装置の製造方法に関する。
わゆるプレーデッドヒートシンク構造(P HS構造と
略称)に形成された半導体素子のマウントを改良した高
周波半導体装置の製造方法に関する。
近年、高周波半導体装置の高出力化はめざましく、−例
のシリコンバイポーラトランジスタにあってはベース幅
の減少、エミッタ抵抗の最適化など能動領域の改良と、
さらに、熱抵抗の低減等により高出力化が図られている
。熱抵抗の低減には能動領域の分割等の方法が用いられ
ているが、近年はさらにPH5構造も採用されつつある
。PH5g造は薄い半導体基板の電極配線の設けられて
ない主面(以降裏面と称する)に良熱伝導金属層を形成
するために、半導体基板がすべてシリコンの場合に比べ
、熱抵抗の低減に有効であると考えられる。
のシリコンバイポーラトランジスタにあってはベース幅
の減少、エミッタ抵抗の最適化など能動領域の改良と、
さらに、熱抵抗の低減等により高出力化が図られている
。熱抵抗の低減には能動領域の分割等の方法が用いられ
ているが、近年はさらにPH5構造も採用されつつある
。PH5g造は薄い半導体基板の電極配線の設けられて
ない主面(以降裏面と称する)に良熱伝導金属層を形成
するために、半導体基板がすべてシリコンの場合に比べ
、熱抵抗の低減に有効であると考えられる。
従来、上記P、H8構造のシリコンバイポーラトランジ
スタの半導体素子の製造と外囲器へのマウント工程を第
2図によって説明する。
スタの半導体素子の製造と外囲器へのマウント工程を第
2図によって説明する。
板厚が約300μmのシリコン基板(101)の表面に
熱酸化膜形成、イオン注入等によってベースおよびエミ
ッタの能動領域(102)が形成され、さらに素子に分
離させるためのダイシングライン(103)が設けられ
る(図(a))。
熱酸化膜形成、イオン注入等によってベースおよびエミ
ッタの能動領域(102)が形成され、さらに素子に分
離させるためのダイシングライン(103)が設けられ
る(図(a))。
次に、上記シリコン基板(101) (以降基板と略称
)の表面(電極配線形成側主面)を下にして例えばエレ
クトロワックス等の可溶性樹脂JW (100)で石英
等の支持台(104)に固着させる。なお、この支持台
への固着は、次に施されるラッピング、ケミカルエツチ
ング、真空蒸着等の工程に備えて基板が支持台に精密に
平行であること、可溶性樹脂層中に空隙が存在しないこ
と、蒸着時の温度上昇に充分に耐えつる同樹脂を選定す
ることを特に注意する必要がある1次いでラッピングパ
ウダの81000を用いて基板の板厚を100μm程度
にラッピングしたのち、弗酸と硝酸からなるエツチング
液によって板厚を30μm程度にエツチングする(図(
b))。
)の表面(電極配線形成側主面)を下にして例えばエレ
クトロワックス等の可溶性樹脂JW (100)で石英
等の支持台(104)に固着させる。なお、この支持台
への固着は、次に施されるラッピング、ケミカルエツチ
ング、真空蒸着等の工程に備えて基板が支持台に精密に
平行であること、可溶性樹脂層中に空隙が存在しないこ
と、蒸着時の温度上昇に充分に耐えつる同樹脂を選定す
ることを特に注意する必要がある1次いでラッピングパ
ウダの81000を用いて基板の板厚を100μm程度
にラッピングしたのち、弗酸と硝酸からなるエツチング
液によって板厚を30μm程度にエツチングする(図(
b))。
次に、上記基板(101)の裏面の全面に電子ビーム蒸
着装置によってTi(2000人)、 Pt(1000
人)、Au(5000人)の蒸着層(105)を形成し
、さらに、めっき液、例えばテンペレックス601A(
商品名)によってAu厚めつき層(106)を30μ厘
程度形成してPH5構造が得られる(図(C))。
着装置によってTi(2000人)、 Pt(1000
人)、Au(5000人)の蒸着層(105)を形成し
、さらに、めっき液、例えばテンペレックス601A(
商品名)によってAu厚めつき層(106)を30μ厘
程度形成してPH5構造が得られる(図(C))。
次に、上記支持台(104)をシリコン基板(101)
の裏面にかえ、露出した表面からダイシングライン(1
03)に沿いブレードダイサ等を用いて切断し。
の裏面にかえ、露出した表面からダイシングライン(1
03)に沿いブレードダイサ等を用いて切断し。
各半導体素子(遅U、遅J・・・)(以降素子と略称)
に分離する(図(d))。
に分離する(図(d))。
次に、可溶性樹脂層(100)を例えばトリクレン等の
有機溶剤で溶除すれば各素子(Mμ、107−)は支持
台から離れて個々の素子となる(図(e))。
有機溶剤で溶除すれば各素子(Mμ、107−)は支持
台から離れて個々の素子となる(図(e))。
次に、上記素子(遅ユ)はそのAu厚めつき層(106
)を外囲器(108)のマウントベッド(108a)に
はんだ層(109)でマウントされて半導体装置が得ら
れる(@(f))。
)を外囲器(108)のマウントベッド(108a)に
はんだ層(109)でマウントされて半導体装置が得ら
れる(@(f))。
叙上の従来の技術によると、素子の発熱がはんだ層を経
て外囲器に導出されるが、はんだの熱伝導率は良熱伝導
金属に比べて大きく、また、この方法によるとはんだ層
厚が大に形成されるので熱抵抗は大きい、また、はんだ
層厚が不均一になり熱抵抗にばらつきを生じやすい、さ
らにはんだ層内部に空隙ができ、これも熱抵抗を増大さ
せる要因になっている。
て外囲器に導出されるが、はんだの熱伝導率は良熱伝導
金属に比べて大きく、また、この方法によるとはんだ層
厚が大に形成されるので熱抵抗は大きい、また、はんだ
層厚が不均一になり熱抵抗にばらつきを生じやすい、さ
らにはんだ層内部に空隙ができ、これも熱抵抗を増大さ
せる要因になっている。
以上述べたように、はんだ層を用いた組立工程において
は、上述の種々の要因によりPH5構造の熱抵抗の低減
の効果が十分には得られていない上に熱抵抗が増大する
場合がある。
は、上述の種々の要因によりPH5構造の熱抵抗の低減
の効果が十分には得られていない上に熱抵抗が増大する
場合がある。
この発明は上記の欠点を除去するもので、外囲器に素子
をマウントする工程を改良し、熱抵抗の増大を防止して
PHS構造の特徴を充分活かし、熱抵抗のばらつきなく
工程歩留を向上できる半導体装置の製造方法を提供する
。
をマウントする工程を改良し、熱抵抗の増大を防止して
PHS構造の特徴を充分活かし、熱抵抗のばらつきなく
工程歩留を向上できる半導体装置の製造方法を提供する
。
この発明のかかる半導体装置の製造方法は、一方の主面
に電極配線が形成された半導体基板の他方の主面から薄
くする工程と、前記他方の主面に良熱伝導金属層を厚く
形成する工程と、前記金属層に障壁金属層を介して、半
導体薄層を被着する工程と、前記半導体基板を素子に分
離する工程と、該素子がマウントされる外囲器内に予め
設けられ前記被着半導体薄層に対する共晶形成部材層に
該素子を共晶マウントする工程を含むことを特徴とする
。
に電極配線が形成された半導体基板の他方の主面から薄
くする工程と、前記他方の主面に良熱伝導金属層を厚く
形成する工程と、前記金属層に障壁金属層を介して、半
導体薄層を被着する工程と、前記半導体基板を素子に分
離する工程と、該素子がマウントされる外囲器内に予め
設けられ前記被着半導体薄層に対する共晶形成部材層に
該素子を共晶マウントする工程を含むことを特徴とする
。
以下に本発明の一つの実施例をシリコンバイポーラトラ
ンジスタの製造方法について第1図を参照して説明する
6なお、この実施例の製造工程は第2図(aン〜(c)
によって説明した、すなわち、PH5構造のAu厚めつ
き層(105)の形成までは従来と変わらないので説明
を省略し、その後の工程につき説明する。
ンジスタの製造方法について第1図を参照して説明する
6なお、この実施例の製造工程は第2図(aン〜(c)
によって説明した、すなわち、PH5構造のAu厚めつ
き層(105)の形成までは従来と変わらないので説明
を省略し、その後の工程につき説明する。
金厚めつき層(106)上にバリアメタルとしてのpt
層を1000人に、またシリコンとの密着を良くするた
めのTi層を1000人に夫々蒸着して蒸着N(1)を
形成したのち、さらに真空蒸着によりシリコン薄層(2
)を4μm程度形成する(図(a))。
層を1000人に、またシリコンとの密着を良くするた
めのTi層を1000人に夫々蒸着して蒸着N(1)を
形成したのち、さらに真空蒸着によりシリコン薄層(2
)を4μm程度形成する(図(a))。
次に、基板の電極配線側の直を上にして支持台(3)に
可溶性樹脂層(100)を用いて固着する。上記支持台
は他のシリコン基板を用いるとよい。次にブレードダイ
サによってダイシングライン(図(a)における(10
3)に沿って切断する(図(b))。
可溶性樹脂層(100)を用いて固着する。上記支持台
は他のシリコン基板を用いるとよい。次にブレードダイ
サによってダイシングライン(図(a)における(10
3)に沿って切断する(図(b))。
次に、可溶性樹脂層(100)をトリクレン等の溶剤で
溶除し、各素子(図(b)における(4.4・))は支
持台(3)から離れて個々の素子となる。上述の如く形
成された素子(りは、ベース・エミッタ領域等を含む能
動領域(102)を有する厚さ約30μmの基板(Lo
t)の裏面にPH8構造を構成する約30μmの金厚め
っきJ5 (106)、いずれも約1000八属のpt
層とTi層とからなる蒸着層(1)、さらに約4μm厚
のシリコン薄層(2)を上記の順に形成されたものであ
る(図(C))。
溶除し、各素子(図(b)における(4.4・))は支
持台(3)から離れて個々の素子となる。上述の如く形
成された素子(りは、ベース・エミッタ領域等を含む能
動領域(102)を有する厚さ約30μmの基板(Lo
t)の裏面にPH8構造を構成する約30μmの金厚め
っきJ5 (106)、いずれも約1000八属のpt
層とTi層とからなる蒸着層(1)、さらに約4μm厚
のシリコン薄層(2)を上記の順に形成されたものであ
る(図(C))。
次に、上記素子の外囲器への組立は外囲器(10g)を
400℃程度に熱して素子を構成している約4μm厚の
シリコン薄膜層(2)と外囲器(tOS)のマウント部
分にメタライズされた厚さ4〜5μ門程度の金層(10
8a)によってAu−5iの共晶マウント(28)によ
りマウントする(図(d))。
400℃程度に熱して素子を構成している約4μm厚の
シリコン薄膜層(2)と外囲器(tOS)のマウント部
分にメタライズされた厚さ4〜5μ門程度の金層(10
8a)によってAu−5iの共晶マウント(28)によ
りマウントする(図(d))。
引き続き前記素子のポンディングパッドと外囲器の端子
(図示省略)にボンディングを施して半導体装置ができ
る。
(図示省略)にボンディングを施して半導体装置ができ
る。
上記製造方法によれば、上記従来例における厚く形成さ
れるはんだ層による熱抵抗の増大、さらに厚さが不均一
となり、あるいは空隙ができることによる熱抵抗のばら
つき等の欠点が改善される。
れるはんだ層による熱抵抗の増大、さらに厚さが不均一
となり、あるいは空隙ができることによる熱抵抗のばら
つき等の欠点が改善される。
すなわち、Au−5i共晶部は極めて薄膜に形成される
ので厚さのばらつきがなく空隙を生じない。したがって
熱抵抗はばらつきなく低減される。
ので厚さのばらつきがなく空隙を生じない。したがって
熱抵抗はばらつきなく低減される。
上記実施例において、シリコン薄膜層(2)の上にさら
に真空蒸着によりTi(200人)、 Au(6000
人)層を形成してもよい。このようにすればシリコン薄
膜層(2)が自然酸化されるのが防止でき、^u−3i
共晶層が安定に形成できる利点がある。
に真空蒸着によりTi(200人)、 Au(6000
人)層を形成してもよい。このようにすればシリコン薄
膜層(2)が自然酸化されるのが防止でき、^u−3i
共晶層が安定に形成できる利点がある。
以上述べたようにこの発明によれば、Au−8i共晶マ
ウントを用いて共晶部がきわめて薄層であるので厚さの
ばらつきがなく、空隙ができない。従ってPH5構造に
よる熱抵抗の低減が十分に活がされる。さらに、マウン
ト性も向上する。
ウントを用いて共晶部がきわめて薄層であるので厚さの
ばらつきがなく、空隙ができない。従ってPH5構造に
よる熱抵抗の低減が十分に活がされる。さらに、マウン
ト性も向上する。
この結果、熱抵抗が低減されたPH3構造のシリコンバ
イポーラトランジスタが歩留よく製造組立ができ高出力
化を図ることができる。
イポーラトランジスタが歩留よく製造組立ができ高出力
化を図ることができる。
以上、本発明の詳細においてはシリコンバイポーラトラ
ンジスタの製造方法について説明したが。
ンジスタの製造方法について説明したが。
これに限定されるものでなく、GaAs F E Tに
おいても適用でき、同様の効果が期待できることは明ら
かである。
おいても適用でき、同様の効果が期待できることは明ら
かである。
第1図(a)〜(d)は第2図(a)〜(C)とともに
この発明の一実施例のシリコンバイポーラトランジスタ
の製造方法を工程順に示すいずれも断面図、第2図(a
)〜(f)は従来の製造方法を工程順に示すいずれも断
面図である。
この発明の一実施例のシリコンバイポーラトランジスタ
の製造方法を工程順に示すいずれも断面図、第2図(a
)〜(f)は従来の製造方法を工程順に示すいずれも断
面図である。
Claims (1)
- 一方の主面に電極配線が形成された半導体基板の他方
の主面から薄くする工程と、前記他方の主面に良熱伝導
金属層を厚く形成する工程と、前記金属層に障壁金属層
を介して、半導体薄層を被着する工程と、前記半導体基
板を素子に分離する工程と、該素子がマウントされる外
囲器内に予め設けられ前記被着半導体薄層に対する共晶
形成部材層に該素子を共晶マウントする工程を含むこと
を特徴とする半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP25649584A JPS61135130A (ja) | 1984-12-06 | 1984-12-06 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP25649584A JPS61135130A (ja) | 1984-12-06 | 1984-12-06 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS61135130A true JPS61135130A (ja) | 1986-06-23 |
Family
ID=17293427
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP25649584A Pending JPS61135130A (ja) | 1984-12-06 | 1984-12-06 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS61135130A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01149428A (ja) * | 1987-12-07 | 1989-06-12 | Nec Corp | 半導体装置 |
-
1984
- 1984-12-06 JP JP25649584A patent/JPS61135130A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH01149428A (ja) * | 1987-12-07 | 1989-06-12 | Nec Corp | 半導体装置 |
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