JPS61132764U - - Google Patents

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JPS61132764U
JPS61132764U JP1622985U JP1622985U JPS61132764U JP S61132764 U JPS61132764 U JP S61132764U JP 1622985 U JP1622985 U JP 1622985U JP 1622985 U JP1622985 U JP 1622985U JP S61132764 U JPS61132764 U JP S61132764U
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JP
Japan
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signal
decimal
relays
circuit
relay
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JP1622985U
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  • Testing Electric Properties And Detecting Electric Faults (AREA)

Description

【図面の簡単な説明】
第1図は本考案によるリレー検査装置の一実施
例を示すブロツク図、第2図は、第1図の10進
/2進変換回路9の回路図である。 1……ゲート、2……ゲート、3……クロツク
発生器、4……累加加算器、5……デコーダ・ド
ライバ、7,7…,7100……ノア回路、
,8…,8100……インバータ、9……
10進/2進変換回路、10……オア回路、11
……印字装置、12……遅延回路、SW……スイ
ツチ、R,R…,R100……リレー、S
,S,…,S100……リレー接点、B,B
,…B100……電極。

Claims (1)

  1. 【実用新案登録請求の範囲】 検査開始を指令するためのスイツチと、 クロツク信号を発生するクロツク発生器と、 該クロツク信号を累加加算し、検査対象である
    複数個のリレーの全数の検査が終了したときにク
    リヤされる累加加算器と、 前記各リレーのコイルの一端が接続され、前記
    累加加算器の2進出力を10進出力に変換して、
    該10進出力に対応するリレーをドライブするデ
    コーダ・ドライバと、 前記各リレーに対応して設けられ、コイルの一
    端における信号と接点の電極における信号を入力
    し、接点が正常に動作したか否かに応じて相異な
    るレベルの信号を出力する複数のゲート回路と、 これらゲート回路の出力を入力し、10進から
    2進に変換する10進/2進変換回路と、 該10進/2進変換回路に出力によつて接点が
    正常動作しないリレーの番号を印字する印字装置
    と、 前記ゲート回路から接点が正常に動作しなかつ
    たことを示す信号が入力したとき、一定時間後に
    前記印字装置に印字を開始させるストローブ信号
    を出力する遅延回路と、 前記スイツチから検査開始の信号が入力したと
    き開き、全リレーの検査が終了したときに閉じて
    前記クロツク発生器から前記累加加算器へのクロ
    ツク信号を制御するゲートを備えてなるリレー検
    査装置。
JP1622985U 1985-02-07 1985-02-07 Pending JPS61132764U (ja)

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JP1622985U JPS61132764U (ja) 1985-02-07 1985-02-07

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JP1622985U JPS61132764U (ja) 1985-02-07 1985-02-07

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JPS61132764U true JPS61132764U (ja) 1986-08-19

Family

ID=30502803

Family Applications (1)

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JP1622985U Pending JPS61132764U (ja) 1985-02-07 1985-02-07

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JP (1) JPS61132764U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02161365A (ja) * 1988-12-15 1990-06-21 Nippondenso Co Ltd スイッチ開閉状態モニター装置

Cited By (1)

* Cited by examiner, † Cited by third party
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