JPS611194A - デイジタル通話路装置 - Google Patents
デイジタル通話路装置Info
- Publication number
- JPS611194A JPS611194A JP59107516A JP10751684A JPS611194A JP S611194 A JPS611194 A JP S611194A JP 59107516 A JP59107516 A JP 59107516A JP 10751684 A JP10751684 A JP 10751684A JP S611194 A JPS611194 A JP S611194A
- Authority
- JP
- Japan
- Prior art keywords
- conversion
- data
- digital
- control
- rules
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
- H03K17/296—Time-programme switches providing a choice of time-intervals for executing more than one switching action and automatically terminating their operation after the programme is completed
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04Q—SELECTING
- H04Q11/00—Selecting arrangements for multiplex systems
- H04Q11/04—Selecting arrangements for multiplex systems for time-division multiplexing
- H04Q11/06—Time-space-time switching
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
- Time-Division Multiplex Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
発明の技術分野
本発明は、ディジタル交換機において、異なるPCM符
号変換則の相互変換を経済的に行うディジタル通話路装
置に関するものである。
号変換則の相互変換を経済的に行うディジタル通話路装
置に関するものである。
従来技術と問題点
ディジタル交換機は、音声信号をディジタル化して時分
割交換を行うものであり、データも含めて交換処理する
ことも可能である。又音声信号をディジタル化する為の
変換則としては、CCITT勧告のG711によるAロ
ー(A−1aw)とμロー(μ−1aw)とが知られて
いる。それぞれの変換則によりPCM符号化された信号
間では相互の互換性がないので、Aロー変換則の地域と
?μコロ−換則の地域とが接して交換網を形成している
場合とそれらの地域間で変換則間の変換を行う必要が生
じることになる。
割交換を行うものであり、データも含めて交換処理する
ことも可能である。又音声信号をディジタル化する為の
変換則としては、CCITT勧告のG711によるAロ
ー(A−1aw)とμロー(μ−1aw)とが知られて
いる。それぞれの変換則によりPCM符号化された信号
間では相互の互換性がないので、Aロー変換則の地域と
?μコロ−換則の地域とが接して交換網を形成している
場合とそれらの地域間で変換則間の変換を行う必要が生
じることになる。
このような変換則間の変換を行う為に、例えば、第6図
に示すように、専用の変換装置1を任意の位置に設ける
ことが考えられる。通常A口〜は、2Mb/Sであるか
ら4回線を収容して、合計120チヤネルとし、μロー
は、1.5 M b / sであるから5回線を収容し
て、合計120チヤネルとし、Aローとμローとの相互
変換を行うものであって、回線数に従って変換装置1の
8置台数が決まることになる。従って、回線数によって
は不経済な構成となる場合があり、又チャネル毎に変換
を無効化することができないので、ビ・ノド透過性を必
要とするデータ、即ちAローやμローに従った変換を行
う必要のないデータを、八ロー地域とμロー地域との間
で転送することが不可能である欠点があった。
に示すように、専用の変換装置1を任意の位置に設ける
ことが考えられる。通常A口〜は、2Mb/Sであるか
ら4回線を収容して、合計120チヤネルとし、μロー
は、1.5 M b / sであるから5回線を収容し
て、合計120チヤネルとし、Aローとμローとの相互
変換を行うものであって、回線数に従って変換装置1の
8置台数が決まることになる。従って、回線数によって
は不経済な構成となる場合があり、又チャネル毎に変換
を無効化することができないので、ビ・ノド透過性を必
要とするデータ、即ちAローやμローに従った変換を行
う必要のないデータを、八ロー地域とμロー地域との間
で転送することが不可能である欠点があった。
又第7図は、μローの通話路スイッチを有するディジタ
ル交換機4に於いて、へローのディジタルターミナル(
DT)2とディジタル交換機4との間に変換装置(A/
μ)3を設けて、Aローとμローとの相互変換を行い、
μローにより交換処理を行う構成を示し、又第8図は、
Aローの通話路スイッチを有するディジタル交換機7に
於いて、μローのディジタルターミナル(DT)5とデ
ィジクル交換機7との間に変換袋W(μ/A)6を設け
て、へローとμローとの相互変換を行う構成を示すもの
である。
ル交換機4に於いて、へローのディジタルターミナル(
DT)2とディジタル交換機4との間に変換装置(A/
μ)3を設けて、Aローとμローとの相互変換を行い、
μローにより交換処理を行う構成を示し、又第8図は、
Aローの通話路スイッチを有するディジタル交換機7に
於いて、μローのディジタルターミナル(DT)5とデ
ィジクル交換機7との間に変換袋W(μ/A)6を設け
て、へローとμローとの相互変換を行う構成を示すもの
である。
この第7図及び第8図に示す構成は、ディジタ ”ル交
換機内に変換則間の変換を行う機能を設けることにより
、第6図に示す専用の変換装置を回線間に設ける場合に
比較して経済的となるが、回線単位或いは回線グループ
単位に変換装置3.6を設ける必要がある。又Aローと
μローとの変換を、回線単位でストラップ等により指定
しておくことが可能であるが、指定、非指定をダイナミ
ックに制御することはできなかった。従って、融通性に
欠けると共に、音声信号とデータとを混在させた回線を
収容して時分割交換を行わせることはできなかった。
換機内に変換則間の変換を行う機能を設けることにより
、第6図に示す専用の変換装置を回線間に設ける場合に
比較して経済的となるが、回線単位或いは回線グループ
単位に変換装置3.6を設ける必要がある。又Aローと
μローとの変換を、回線単位でストラップ等により指定
しておくことが可能であるが、指定、非指定をダイナミ
ックに制御することはできなかった。従って、融通性に
欠けると共に、音声信号とデータとを混在させた回線を
収容して時分割交換を行わせることはできなかった。
発明の目的
本発明は、経済的構成で且つ融通性に冨む制御により、
音声信号は勿論のこと、データについても時分割交換可
能な変換則間の変換制御を可能とすることを目的とする
ものである。
音声信号は勿論のこと、データについても時分割交換可
能な変換則間の変換制御を可能とすることを目的とする
ものである。
発明の構成
本発明は、前記目的を達成する為、異なる2種のアナロ
グ信号のディジタル化変換規則間の変換データ及び減衰
データを記憶したディジタルパッドと、該ディジタルパ
ッドによる変換則間の変換或いは減衰量を出ハイウェイ
上のタイムスロット毎に指示する制御メモリとを設け、
タイムスロット単位で変換則間の変換の有無、減衰量の
大小等をダイナミックに制御することができるものであ
る。以下実施例について詳細に説明する。
グ信号のディジタル化変換規則間の変換データ及び減衰
データを記憶したディジタルパッドと、該ディジタルパ
ッドによる変換則間の変換或いは減衰量を出ハイウェイ
上のタイムスロット毎に指示する制御メモリとを設け、
タイムスロット単位で変換則間の変換の有無、減衰量の
大小等をダイナミックに制御することができるものであ
る。以下実施例について詳細に説明する。
発明の実施例
第1図は1本発明の実施例の要部ブロック図であり、A
ローとμローとの両方のPCM信号について交換処理で
きるディジタル交換機10を用い、この宇イジタル交換
機10内に、Aローとμローとの変換則間の変換をタイ
ムスロット対応に制御できるディジタルバンド11と制
御メモリ12とを設けたものである。ディジタルパッド
11はリードオンリメモリ (ROM)等により構成さ
れ、変換則間を変換する為の変換データが記憶されてい
る。又制御メモリ12にはタイムスロット対応に制御デ
ータが書込まれ、読出された制御データによって、Aロ
ーとμローとの変換則間の変換、無変換を!j御するデ
ィジタルパッド11の変換データの記憶領域が指定され
て、変換則間の変換、無変換が、時分割交換を行うタイ
ムスロット単位で制御されるものである。なお、13は
Aロー(A−1aw)のディジタルターミナル、14は
μロー(μmlaw)のディジタルターミナルである。
ローとμローとの両方のPCM信号について交換処理で
きるディジタル交換機10を用い、この宇イジタル交換
機10内に、Aローとμローとの変換則間の変換をタイ
ムスロット対応に制御できるディジタルバンド11と制
御メモリ12とを設けたものである。ディジタルパッド
11はリードオンリメモリ (ROM)等により構成さ
れ、変換則間を変換する為の変換データが記憶されてい
る。又制御メモリ12にはタイムスロット対応に制御デ
ータが書込まれ、読出された制御データによって、Aロ
ーとμローとの変換則間の変換、無変換を!j御するデ
ィジタルパッド11の変換データの記憶領域が指定され
て、変換則間の変換、無変換が、時分割交換を行うタイ
ムスロット単位で制御されるものである。なお、13は
Aロー(A−1aw)のディジタルターミナル、14は
μロー(μmlaw)のディジタルターミナルである。
第2図は、T−3−T構成のディジタル交換機に適用し
た本発明の実施例の要部ブロック図であり、20はマル
チプレクサ、21は二次時間スイッチ(T)、22は空
間スイッチ(S)、−23は二次時間スイッチ−(T)
、24はリードオンリメモリ (R’OM)等からなる
ディジタルパッド(DP)、25はデマルチプレクサ、
26〜29は制御メモリ (CM)である。制御メモリ
26〜28に図示を省略した中央制御装置から制御情報
が書込まれ、その制御情報に従って、−次時間スイノチ
21、空間スイッチ22及び二次時間スイッチ23が既
に良く知られているように制御されて、時分割交換処理
が行われる。
た本発明の実施例の要部ブロック図であり、20はマル
チプレクサ、21は二次時間スイッチ(T)、22は空
間スイッチ(S)、−23は二次時間スイッチ−(T)
、24はリードオンリメモリ (R’OM)等からなる
ディジタルパッド(DP)、25はデマルチプレクサ、
26〜29は制御メモリ (CM)である。制御メモリ
26〜28に図示を省略した中央制御装置から制御情報
が書込まれ、その制御情報に従って、−次時間スイノチ
21、空間スイッチ22及び二次時間スイッチ23が既
に良く知られているように制御されて、時分割交換処理
が行われる。
又制御メモリ29には、タイムスロット対応に、A→μ
、μ→A、A→A1μ→μ等の変換或いは減衰量を制御
する制御データが書込まれ、この制−メモリ29からタ
イムスロット対応に読出された制御データと、二次時間
スイッチ23の出ハイウェイ上のタイムスロット対応の
PCM信号とをアドレスとして、ディジタルパッド24
がアクセスされる。制御データにより指定されたディジ
タルパッド24の領域の変換データが、出ハイウェイ上
のタイムスロットのPCM信号に従って読出されるので
、変換則間の変換又は無変換の制御がタイムスロット単
位で行われることになる。
、μ→A、A→A1μ→μ等の変換或いは減衰量を制御
する制御データが書込まれ、この制−メモリ29からタ
イムスロット対応に読出された制御データと、二次時間
スイッチ23の出ハイウェイ上のタイムスロット対応の
PCM信号とをアドレスとして、ディジタルパッド24
がアクセスされる。制御データにより指定されたディジ
タルパッド24の領域の変換データが、出ハイウェイ上
のタイムスロットのPCM信号に従って読出されるので
、変換則間の変換又は無変換の制御がタイムスロット単
位で行われることになる。
第3図は、本発明の実施例のディジタルパッドと制御メ
モリとの要部ブロック図であり、24はディジタルパッ
ド、29は制御メモリ、30はパリティチェック回路、
31はアドレスカウンタ5.32はセレクタ、WAは書
込アドレス、WDは書込データ、PEはパリティエラー
信号である。ディジタルパッド24ば、例えば、8ピツ
)X4にの記憶容量のリードオンリメモリ (ROM)
により構成され、二次時間スイッチ23の出ハイウェイ
上のタイムスロット毎のPCM信号の8ビツト81〜B
8のうちの7ビツトB2〜B8を一部のアドレスAO〜
A6とし、制御メモリ29から読出した5ビツトの制御
データを残部のアドレスA7〜A1.1として、12ビ
ツトのアドレス信号によりディジタルパッド24をアク
セスする。そして、ディジクルパッド24の8ビツトの
読出データのうちの7ビソトの読出データDo〜D6と
、出ハイウェイ上のタイムスロットのP’ CM信号の
1ビツトB1とにより、デマルチプレクサ25に加える
8ビットB1〜B8−のPCM信号とするものである。
モリとの要部ブロック図であり、24はディジタルパッ
ド、29は制御メモリ、30はパリティチェック回路、
31はアドレスカウンタ5.32はセレクタ、WAは書
込アドレス、WDは書込データ、PEはパリティエラー
信号である。ディジタルパッド24ば、例えば、8ピツ
)X4にの記憶容量のリードオンリメモリ (ROM)
により構成され、二次時間スイッチ23の出ハイウェイ
上のタイムスロット毎のPCM信号の8ビツト81〜B
8のうちの7ビツトB2〜B8を一部のアドレスAO〜
A6とし、制御メモリ29から読出した5ビツトの制御
データを残部のアドレスA7〜A1.1として、12ビ
ツトのアドレス信号によりディジタルパッド24をアク
セスする。そして、ディジクルパッド24の8ビツトの
読出データのうちの7ビソトの読出データDo〜D6と
、出ハイウェイ上のタイムスロットのP’ CM信号の
1ビツトB1とにより、デマルチプレクサ25に加える
8ビットB1〜B8−のPCM信号とするものである。
ディジタル通話路内の多重度を例えば1024とすると
、制御メモリ29は、5ピントXIKの記憶容量のグイ
ナミソクメモリで構成され、3ピントのパッド制御ピン
トCo、C,、C2により減衰量が指示され、2ビツト
のパッドモードピッ)Mo、M+により変換則間の変換
及び無変換が指示される。又Pはパリティビットである
。第1表は、バンド制御ビットc、 I CI 2C
2と減衰量(dB)との関係の一例を示し、第2表は、
パッドモードビットM o 、 M +と変換則間の変
換との関係の一例を示すものである。
、制御メモリ29は、5ピントXIKの記憶容量のグイ
ナミソクメモリで構成され、3ピントのパッド制御ピン
トCo、C,、C2により減衰量が指示され、2ビツト
のパッドモードピッ)Mo、M+により変換則間の変換
及び無変換が指示される。又Pはパリティビットである
。第1表は、バンド制御ビットc、 I CI 2C
2と減衰量(dB)との関係の一例を示し、第2表は、
パッドモードビットM o 、 M +と変換則間の変
換との関係の一例を示すものである。
第 1 表
第2表
従って、へローからμローへ変換し、且つ減衰量を0と
するタイムスロットに対しては、制御メモリ29に、P
+ M + 9Mo + C2+ C1、C。
するタイムスロットに対しては、制御メモリ29に、P
+ M + 9Mo + C2+ C1、C。
として書込む制御データを、”001000″とし、又
Aローを無変換とし且つ減衰量を3dBとするタイムス
ロットに対しては、制御メモリ29に書込む制御データ
を“100011”とするものである。なおパリティビ
ットPは奇数パリティの場合についてのものである。
Aローを無変換とし且つ減衰量を3dBとするタイムス
ロットに対しては、制御メモリ29に書込む制御データ
を“100011”とするものである。なおパリティビ
ットPは奇数パリティの場合についてのものである。
アドレスカウンタ31はクロック信号をカウントして続
出アドレスを発生するものであり、セレクタ32を介し
て制御メモリ29に加えられ、タイムスロット対応の制
御データP、M1.Mo。
出アドレスを発生するものであり、セレクタ32を介し
て制御メモリ29に加えられ、タイムスロット対応の制
御データP、M1.Mo。
C2,’CI+GOが続出される。この制御データが前
述のように、ディジタルパッド24の続出アドレスA7
〜Allとなり、又二次時間スイッチ23からの8ビッ
トB1−88のうちの7ビツトB2〜B8のデータがデ
ィジクルパッド24の続出アドレスAO−A6となり、
制御データにより指定された領域内のデータにより指定
された領域から変換、無変換或いは減衰された7ビソト
DO〜D6のデータが読出される。
述のように、ディジタルパッド24の続出アドレスA7
〜Allとなり、又二次時間スイッチ23からの8ビッ
トB1−88のうちの7ビツトB2〜B8のデータがデ
ィジクルパッド24の続出アドレスAO−A6となり、
制御データにより指定された領域内のデータにより指定
された領域から変換、無変換或いは減衰された7ビソト
DO〜D6のデータが読出される。
又制御メモリ29から読出された制御テークはパリティ
チェック回路30に加えられ、制御データのパリティチ
ェックが行われ、パリティエラーが検出されると、パリ
ティエラー信号PEが中央制御装置(図示せず)等に送
出されて、そのタイムスロットの使用を中止する等の処
置がとられることになる。
チェック回路30に加えられ、制御データのパリティチ
ェックが行われ、パリティエラーが検出されると、パリ
ティエラー信号PEが中央制御装置(図示せず)等に送
出されて、そのタイムスロットの使用を中止する等の処
置がとられることになる。
又中央制御装置(図示せず)からの書込アドレスWAが
セレクタ32を介して制御メモリ29に加えられると共
に書込制御データWDが制御メモリ29に加えられて、
タイムスロット対応の制御データの書込みが行われる。
セレクタ32を介して制御メモリ29に加えられると共
に書込制御データWDが制御メモリ29に加えられて、
タイムスロット対応の制御データの書込みが行われる。
それにより、タイムスロット対応に、変換則間の変換、
無変換或いは減衰量をグイナミソクに制御することがで
きることになる。
無変換或いは減衰量をグイナミソクに制御することがで
きることになる。
第4図は、前述の変換則間の変換及び減衰の説明図であ
り、パッドモードビットM、、M、により第2表に示す
A→A、A−μ、μ→μ、μ→Aの変換則間の変換、無
変換の領域が指定され、又パッド制御ビットC2+
C,、Coにより第1表に示す減衰量aO〜a7の領域
が指定される。なおaOは減衰量OdB、a7は減衰量
■の場合を示す。又TAはAローの端末装置、Tμはμ
ローの端末装置を示す。
り、パッドモードビットM、、M、により第2表に示す
A→A、A−μ、μ→μ、μ→Aの変換則間の変換、無
変換の領域が指定され、又パッド制御ビットC2+
C,、Coにより第1表に示す減衰量aO〜a7の領域
が指定される。なおaOは減衰量OdB、a7は減衰量
■の場合を示す。又TAはAローの端末装置、Tμはμ
ローの端末装置を示す。
成るタイムスロットに対してA−Aの領域がパソドモー
ドビ71−Ml、 Mo (” 00″)により指定
され、パッド制御ビットC2,CI+ co (“
000”)により減衰量OdBが指定されたとすると、
続出アドレスとして入力されたPCM信号は、同じPC
M信号として読出されることになり、変換則間の変換を
行わないものとなるから、Aローの端末装置TA間では
、音声信号■とデータDとの両方について送受信するこ
とができる。
ドビ71−Ml、 Mo (” 00″)により指定
され、パッド制御ビットC2,CI+ co (“
000”)により減衰量OdBが指定されたとすると、
続出アドレスとして入力されたPCM信号は、同じPC
M信号として読出されることになり、変換則間の変換を
行わないものとなるから、Aローの端末装置TA間では
、音声信号■とデータDとの両方について送受信するこ
とができる。
又Aローの端末装置とμローの端末装置Tμとの間では
、変換則間の変換を行わないので、データDのみの送受
信ができることになる。V/Dは音声信号とデータ、D
との送受信ができることを示し、■又はDは音声信号の
み又はデータのみの送受信ができることを示す。例えば
、μ→Aの領域がパッドモードビットMI、MO(“1
1″)により指定された場合のタイムスロットでは、続
出アドレスとして入力されたPC,M信号は、Aローの
PCM信号に変換されて読出されることになり、μロー
の端末装置とAローの端末装置TAとの間で、音声信号
Vのみの送受信が可能となり、データDの送受信は、変
換則間の変換が行われることにより、データが変更され
たものとなるから、不可能となる。
、変換則間の変換を行わないので、データDのみの送受
信ができることになる。V/Dは音声信号とデータ、D
との送受信ができることを示し、■又はDは音声信号の
み又はデータのみの送受信ができることを示す。例えば
、μ→Aの領域がパッドモードビットMI、MO(“1
1″)により指定された場合のタイムスロットでは、続
出アドレスとして入力されたPC,M信号は、Aローの
PCM信号に変換されて読出されることになり、μロー
の端末装置とAローの端末装置TAとの間で、音声信号
Vのみの送受信が可能となり、データDの送受信は、変
換則間の変換が行われることにより、データが変更され
たものとなるから、不可能となる。
第5図は交換網の説明図であり、51.52はへローと
μローとの両方について交換処理できると共に前述のよ
うに変換則間の変換を行うディジタルパッドを設けたデ
ィジタル交換機である。又53〜56は例えばμローの
ディジタル交換機である。このようにμローのディジタ
ル交換機53〜56からなる交換網に対して、他の交換
網との間に両変換則のPCM信号の交換処理ができるデ
ィジタル交換機S1.+2を配置することにより、Aロ
ー(A−1aw)とμロー(μ=、、、I 、、a w
、)のPCM回線と交換網との接続を行うことができる
。又Aローのディジタル交換機により交換網を構成した
場合についても同様である。
μローとの両方について交換処理できると共に前述のよ
うに変換則間の変換を行うディジタルパッドを設けたデ
ィジタル交換機である。又53〜56は例えばμローの
ディジタル交換機である。このようにμローのディジタ
ル交換機53〜56からなる交換網に対して、他の交換
網との間に両変換則のPCM信号の交換処理ができるデ
ィジタル交換機S1.+2を配置することにより、Aロ
ー(A−1aw)とμロー(μ=、、、I 、、a w
、)のPCM回線と交換網との接続を行うことができる
。又Aローのディジタル交換機により交換網を構成した
場合についても同様である。
発明の詳細
な説明したように、本発明は、A°コロ−μローとの変
換則間の変換データ及び減衰データを記憶したディジタ
ルパッド24と、このディジタルパッド234による変
換則間の変換或いは減衰量をタイムスロット毎に指定す
る制御メモリ29とを設けて、ハイウェイ上に異なる変
換則のPCM信号が混在していても、制御メモリ29に
よりタイムスロット対応に変換則間の変換2無変換の制
御を行うことができるので、変換則間の変換をグイナミ
ソクに制御することができ、異なる変換則の端末装置間
で通話し且つデータ伝送用の制御信号を送出することに
より、通話直後にデータの送受信を行わせることが可能
となる。又ディジタルパッド24は、減衰量制御にも用
いることができるものであり、異なる交換網間を接続す
る場合に、レヘル整合が可能となるものである。
換則間の変換データ及び減衰データを記憶したディジタ
ルパッド24と、このディジタルパッド234による変
換則間の変換或いは減衰量をタイムスロット毎に指定す
る制御メモリ29とを設けて、ハイウェイ上に異なる変
換則のPCM信号が混在していても、制御メモリ29に
よりタイムスロット対応に変換則間の変換2無変換の制
御を行うことができるので、変換則間の変換をグイナミ
ソクに制御することができ、異なる変換則の端末装置間
で通話し且つデータ伝送用の制御信号を送出することに
より、通話直後にデータの送受信を行わせることが可能
となる。又ディジタルパッド24は、減衰量制御にも用
いることができるものであり、異なる交換網間を接続す
る場合に、レヘル整合が可能となるものである。
第1図は本発明の実施例の要部ブロック図、第2図はT
−3−T構成のディジタル交換機に適用した本発明の実
施例の要部ブロック図、第3図はディジタルパッドと制
御メモリとのブロック図、第4図はディジタルパッドに
よる変換則間の変換の説明図、第5図は交換網の説明図
、第6図は従来の専用変換装置の説明図、第7図及び第
8図は従来の変換装置を付加したディジタル交換機の説
明図である。 10はディジタル交換機、11はディジクルパッド、1
2は制御メモリ、13はAローのディジタルターミナル
、14はμローのディジタルターミナル、20はマルチ
プレクサ、21は一次時間スイソチ(T) 、22は空
間スイッチ(S) 、23は二次時間スイッチ(T)、
24はリードオンIJ /そり (ROM>等からなる
ディジタルパッド(DP)、25はデマルチプレクサ、
26〜29は制御メモリ (CM)である。
−3−T構成のディジタル交換機に適用した本発明の実
施例の要部ブロック図、第3図はディジタルパッドと制
御メモリとのブロック図、第4図はディジタルパッドに
よる変換則間の変換の説明図、第5図は交換網の説明図
、第6図は従来の専用変換装置の説明図、第7図及び第
8図は従来の変換装置を付加したディジタル交換機の説
明図である。 10はディジタル交換機、11はディジクルパッド、1
2は制御メモリ、13はAローのディジタルターミナル
、14はμローのディジタルターミナル、20はマルチ
プレクサ、21は一次時間スイソチ(T) 、22は空
間スイッチ(S) 、23は二次時間スイッチ(T)、
24はリードオンIJ /そり (ROM>等からなる
ディジタルパッド(DP)、25はデマルチプレクサ、
26〜29は制御メモリ (CM)である。
Claims (1)
- 時分割交換を行うディジタル通話路装置に於いて、異な
る2種のアナログ信号のディジタル化変換規則間の変換
データ及び減衰データを記憶したディジタルパッドと、
該ディジタルパッドによる変換則間の変換或いは減衰量
を出ハイウェイ上のタイムスロット毎に指示する制御メ
モリとを設けたことを特徴とするディジタル通話路装置
。
Priority Applications (7)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59107516A JPH0657075B2 (ja) | 1984-05-29 | 1984-05-29 | ディジタル通話路装置 |
DE8585105919T DE3572290D1 (en) | 1984-05-29 | 1985-05-14 | Digital switch module |
EP85105919A EP0165462B1 (en) | 1984-05-29 | 1985-05-14 | Digital switch module |
KR1019850003505A KR890005232B1 (ko) | 1984-05-29 | 1985-05-22 | 디지탈 스위칭 모듈 |
CA000482525A CA1234643A (en) | 1984-05-29 | 1985-05-28 | Digital switch module |
US06/738,763 US4661946A (en) | 1984-05-29 | 1985-05-29 | Digital switch module having encoding law conversion capability |
HK97/90A HK9790A (en) | 1984-05-29 | 1990-02-08 | Digital switch module |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP59107516A JPH0657075B2 (ja) | 1984-05-29 | 1984-05-29 | ディジタル通話路装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS611194A true JPS611194A (ja) | 1986-01-07 |
JPH0657075B2 JPH0657075B2 (ja) | 1994-07-27 |
Family
ID=14461177
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP59107516A Expired - Lifetime JPH0657075B2 (ja) | 1984-05-29 | 1984-05-29 | ディジタル通話路装置 |
Country Status (7)
Country | Link |
---|---|
US (1) | US4661946A (ja) |
EP (1) | EP0165462B1 (ja) |
JP (1) | JPH0657075B2 (ja) |
KR (1) | KR890005232B1 (ja) |
CA (1) | CA1234643A (ja) |
DE (1) | DE3572290D1 (ja) |
HK (1) | HK9790A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6965596B1 (en) | 1999-11-25 | 2005-11-15 | Nec Corporation | μ-Law-to-a-law translating equipment and a-law-to-μ-law translating equipment |
Families Citing this family (19)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4734907A (en) * | 1985-09-06 | 1988-03-29 | Washington University | Broadcast packet switching network |
JP2713883B2 (ja) * | 1986-02-07 | 1998-02-16 | 株式会社日立製作所 | 時分割交換機 |
CA1240063A (en) * | 1986-02-25 | 1988-08-02 | Milan Skubnik | Digital companding circuit |
US5128929A (en) * | 1988-11-15 | 1992-07-07 | Nec Corporation | Time division switching system capable of broad band communications service |
US5243342A (en) * | 1990-09-28 | 1993-09-07 | Stratacom, Inc. | Integrated PCM level control and conversion using a lookup table |
JPH0548560A (ja) * | 1991-08-16 | 1993-02-26 | Fujitsu Ltd | Pcm伝送路におけるデータのフレーム遅延補正方式 |
SE469812B (sv) * | 1992-02-10 | 1993-09-13 | Ericsson Telefon Ab L M | Bitorienterad digital kopplare och generell digital kopplare för PCM-transmissionssystem |
US6111935A (en) * | 1993-10-27 | 2000-08-29 | Canon Kabushiki Kaisha | Adaptive expansion table in a digital telephone receiver |
JPH07193619A (ja) * | 1993-10-27 | 1995-07-28 | Canon Inc | デジタル電話機及びその動作方法 |
JP3491401B2 (ja) * | 1995-08-02 | 2004-01-26 | ソニー株式会社 | データ符号化装置および方法、並びに、データ復号化装置および方法 |
KR100222433B1 (ko) * | 1997-02-28 | 1999-10-01 | 윤종용 | 종합정보통신망 키폰시스템에서 망접속회로의구성방법 |
US6122288A (en) * | 1997-04-24 | 2000-09-19 | At&T Corp | Apparatus for utilizing spare T1 DSO channels in E1 inverse-multiplexed channels |
KR100299036B1 (ko) * | 1998-07-11 | 2001-09-22 | 윤종용 | 다채널펄스부호변조신호변환장치 |
US6381266B1 (en) | 1998-09-30 | 2002-04-30 | Conexant Systems, Inc. | Method and apparatus for identifying the encoding type of a central office codec |
US6549569B1 (en) * | 1999-04-09 | 2003-04-15 | Siemens Information & Communication Networks, Inc. | System and method for improving conversion between A-law and U-law coding |
US6504866B1 (en) * | 1999-05-14 | 2003-01-07 | Siemens Information & Communication Networks, Inc | System and method for eliminating companding conversion distortion on international modem calls |
KR100315187B1 (ko) * | 1999-10-18 | 2001-11-26 | 윤종용 | 신호의 압신방식(壓伸方式)이 서로 다른 디지털 교환기들 간의 통신방법 |
US6584123B1 (en) * | 2000-01-03 | 2003-06-24 | At&T Corp. | Apparatus for utilizing spare E1 channels |
US7472057B2 (en) * | 2003-10-17 | 2008-12-30 | Broadcom Corporation | Detector for use in voice communications systems |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS50114107A (ja) * | 1974-02-15 | 1975-09-06 |
Family Cites Families (7)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US3825924A (en) * | 1972-06-27 | 1974-07-23 | Bell Telephone Labor Inc | Pulse code modulation code conversion |
US4037226A (en) * | 1976-01-07 | 1977-07-19 | Ncr Corporation | Pulse code modulation compressor |
US4155070A (en) * | 1977-12-01 | 1979-05-15 | Northern Telecom Limited | Code-converter with preservation of parity |
US4311988A (en) * | 1979-04-05 | 1982-01-19 | Motorola Inc. | Programmable A-law and μ-law DAC |
JPS5932943B2 (ja) * | 1979-10-17 | 1984-08-11 | 富士通株式会社 | 信号制御方式 |
US4399534A (en) * | 1980-12-23 | 1983-08-16 | Gte Automatic Electric Labs Inc. | Dual rail time and control unit for a duplex T-S-T-digital switching system |
US4370632A (en) * | 1981-05-08 | 1983-01-25 | Motorola, Inc. | Multiple function operational amplifier circuit |
-
1984
- 1984-05-29 JP JP59107516A patent/JPH0657075B2/ja not_active Expired - Lifetime
-
1985
- 1985-05-14 EP EP85105919A patent/EP0165462B1/en not_active Expired
- 1985-05-14 DE DE8585105919T patent/DE3572290D1/de not_active Expired
- 1985-05-22 KR KR1019850003505A patent/KR890005232B1/ko not_active IP Right Cessation
- 1985-05-28 CA CA000482525A patent/CA1234643A/en not_active Expired
- 1985-05-29 US US06/738,763 patent/US4661946A/en not_active Expired - Fee Related
-
1990
- 1990-02-08 HK HK97/90A patent/HK9790A/xx not_active IP Right Cessation
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS50114107A (ja) * | 1974-02-15 | 1975-09-06 |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6965596B1 (en) | 1999-11-25 | 2005-11-15 | Nec Corporation | μ-Law-to-a-law translating equipment and a-law-to-μ-law translating equipment |
Also Published As
Publication number | Publication date |
---|---|
EP0165462A1 (en) | 1985-12-27 |
HK9790A (en) | 1990-02-16 |
KR850008071A (ko) | 1985-12-11 |
DE3572290D1 (en) | 1989-09-14 |
JPH0657075B2 (ja) | 1994-07-27 |
KR890005232B1 (ko) | 1989-12-18 |
CA1234643A (en) | 1988-03-29 |
EP0165462B1 (en) | 1989-08-09 |
US4661946A (en) | 1987-04-28 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JPS611194A (ja) | デイジタル通話路装置 | |
US4403322A (en) | Voice signal converting device | |
US4257119A (en) | PCM switching system for wide and narrow band signals | |
GB1560844A (en) | Switching networks | |
JPS61502090A (ja) | 分散形パケット交換装置 | |
JPS6410157B2 (ja) | ||
GB2186762A (en) | Communications switching system | |
ES8401294A1 (es) | "un sistema de diagnostico para una red de conmutacion con control distribuido". | |
JPS61290838A (ja) | 電気通信交換装置 | |
CA1167575A (en) | Time slot multiple circuit for the selective establishment of connections in a t.d.m. digital telecommunications system | |
JPS6123902B2 (ja) | ||
US4296492A (en) | Continuity verification arrangement | |
US5202883A (en) | Digital key stystem architecture | |
US4736362A (en) | Programmable data-routing multiplexer | |
US4390982A (en) | Digital PBX system | |
US4873682A (en) | Digital key telephone system | |
CA1238734A (en) | Speech response interface circuit | |
US4621358A (en) | Remote switch for telephony switching system | |
CA2051831C (en) | A digital line card for interfacing a remotely located digital telephone to a central office system | |
JPS5972893A (ja) | デイジタル電子切換装置 | |
CA1256182A (en) | Arrangement for transferring data to an attendant console | |
JPS62114399A (ja) | デイジタル通話路装置 | |
JP2654027B2 (ja) | ディジタルボタン電話装置 | |
CA1263728A (en) | Arrangement for transferring data to a centrex | |
JPS6216652A (ja) | 局間デ−タ交換方式 |