JPS5972893A - デイジタル電子切換装置 - Google Patents
デイジタル電子切換装置Info
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- JPS5972893A JPS5972893A JP58170503A JP17050383A JPS5972893A JP S5972893 A JPS5972893 A JP S5972893A JP 58170503 A JP58170503 A JP 58170503A JP 17050383 A JP17050383 A JP 17050383A JP S5972893 A JPS5972893 A JP S5972893A
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- Japan
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- data
- parallel
- electronic devices
- address
- bus
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04Q—SELECTING
- H04Q11/00—Selecting arrangements for multiplex systems
- H04Q11/04—Selecting arrangements for multiplex systems for time-division multiplexing
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
- Oscillators With Electromechanical Resonators (AREA)
- Communication Control (AREA)
- Control Of Eletrric Generators (AREA)
- Electrochromic Elements, Electrophoresis, Or Variable Reflection Or Absorption Elements (AREA)
- Holo Graphy (AREA)
- Electronic Switches (AREA)
- Data Exchanges In Wide-Area Networks (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
く技術分野〉
本発明はディジタル電子切換装置に関し、より詳しくは
データをディジタル形式で記憶する切換装置に関する。
データをディジタル形式で記憶する切換装置に関する。
〈発明の要約〉
本発明は特にデータを装置の1部から他の部分へ共同ハ
イウェイを用いて送る装置に関する。このような装置で
は、共同ノ・イウエイの大きさが装置の任意の2つの部
分間で同時に送ることのできるデータの量が限定される
。故に本発明の目的は同種の従来装置に比して伝送し得
るデータのitを増大させるノ・イウエイ制御装置を提
供することにある。
イウェイを用いて送る装置に関する。このような装置で
は、共同ノ・イウエイの大きさが装置の任意の2つの部
分間で同時に送ることのできるデータの量が限定される
。故に本発明の目的は同種の従来装置に比して伝送し得
るデータのitを増大させるノ・イウエイ制御装置を提
供することにある。
本発明により提供されるディジタル電子切換装置では複
数の第1と第2の電子装置が%に複数の第6と第4の電
子装置を経て時分割マルチプレクスハイウエイに接続妊
れ、この時分割マルチプレクスハイウエイが第1と第2
の並列なアドレス母線と並列なデータ母線を有し、この
第1と第2のアドレス母線が谷に第1と第2のアドレス
メモリに接続され、まfC特定のタイムスロットにおい
て働かせるべき特定の第1と第2の装置を識別するため
にq!rkの第1と第2のアドレス母線によりアドレス
をデコードするためのアドレスデコード装置を前記第6
と第4の電子装置内に有し、またデータ母線が2つの並
列な母線に分割されてデータが前記特定の第1と第2の
電子装置の間で前記分割された母線に沿って単一のタイ
ムスロット期間内に双方向に伝送される。
数の第1と第2の電子装置が%に複数の第6と第4の電
子装置を経て時分割マルチプレクスハイウエイに接続妊
れ、この時分割マルチプレクスハイウエイが第1と第2
の並列なアドレス母線と並列なデータ母線を有し、この
第1と第2のアドレス母線が谷に第1と第2のアドレス
メモリに接続され、まfC特定のタイムスロットにおい
て働かせるべき特定の第1と第2の装置を識別するため
にq!rkの第1と第2のアドレス母線によりアドレス
をデコードするためのアドレスデコード装置を前記第6
と第4の電子装置内に有し、またデータ母線が2つの並
列な母線に分割されてデータが前記特定の第1と第2の
電子装置の間で前記分割された母線に沿って単一のタイ
ムスロット期間内に双方向に伝送される。
く夾施態様〉
次に本発明の実施例に’1%1区画を参照しつつ記述す
る。
る。
第1図において、多数の電話群100がシェルフS1に
接続され、またよシ多数の電話群102がシェルフSN
に接続される。各々のシェルフはA Ill ”t’
U谷にシェルフインタフェース104゜106を経て3
つの71イウエイ108,110゜112に接続される
。・・イウエイ112はデータ母線として用いられ、ま
たノ1イウエイ108と110はそれぞれアドレス母線
ABQ、AB1として用いられる。データの伝送を制御
するためにA側制御装置114が設けられる。
接続され、またよシ多数の電話群102がシェルフSN
に接続される。各々のシェルフはA Ill ”t’
U谷にシェルフインタフェース104゜106を経て3
つの71イウエイ108,110゜112に接続される
。・・イウエイ112はデータ母線として用いられ、ま
たノ1イウエイ108と110はそれぞれアドレス母線
ABQ、AB1として用いられる。データの伝送を制御
するためにA側制御装置114が設けられる。
図の下方では同様の装置がB側に対して接続され、B側
は上述のA側と同様に機能する。
は上述のA側と同様に機能する。
次に第2図を参照において、シェルフインタフェース1
04がよシ詳細に図示されている。全てのシェルフイン
タフェースは実質的に等しく機能する。シェルフデータ
は図のように2つの8ビツト部分(0−7ビツトと8−
15ビツト)として母線ドライバ200.202と母線
レシーバ204゜206に送らnる。図のように%にの
レシーバ208.210とドライバ212,214によ
ってインタシェルフ母1IsBに対する双方向アクセス
が得られる。
04がよシ詳細に図示されている。全てのシェルフイン
タフェースは実質的に等しく機能する。シェルフデータ
は図のように2つの8ビツト部分(0−7ビツトと8−
15ビツト)として母線ドライバ200.202と母線
レシーバ204゜206に送らnる。図のように%にの
レシーバ208.210とドライバ212,214によ
ってインタシェルフ母1IsBに対する双方向アクセス
が得られる。
シェルフアドレス母線ABOに関してはビット0から1
5までがレシーバ216に送られ、そこでビット0から
10までが分離されてドライバ218に送られ、またビ
ット11から15がデコーダ220に送られる。デコー
ダ220はシェルフ可能化信号を線路222上に与え、
またシェルフ識別コード回路224に接続される。
5までがレシーバ216に送られ、そこでビット0から
10までが分離されてドライバ218に送られ、またビ
ット11から15がデコーダ220に送られる。デコー
ダ220はシェルフ可能化信号を線路222上に与え、
またシェルフ識別コード回路224に接続される。
アドレス母MAB1は同様にして図のようにレシーバ2
26に接続され、このレシーバはシェルフ可能化信号を
線路232上に与えるためにドライバ228とデコーダ
230t/c接続される。
26に接続され、このレシーバはシェルフ可能化信号を
線路232上に与えるためにドライバ228とデコーダ
230t/c接続される。
2つの電話コードチャネルの間で双方向接続を設置する
ために1例えば第1図のシェルフ5(1)と8N上のA
とBのようにABOとABlにエントリが作成される。
ために1例えば第1図のシェルフ5(1)と8N上のA
とBのようにABOとABlにエントリが作成される。
ABQにおけるエントリは電話チャネルAでアシ、また
ABlにおいてはチャネルBである。ABOとABIの
両方について512の異なるエントリアドレスがある。
ABlにおいてはチャネルBである。ABOとABIの
両方について512の異なるエントリアドレスがある。
上述の接続のためのエントリは同一の位置、例えばタイ
ムスロット20において挿入される。
ムスロット20において挿入される。
データは以下の第1表と第2表によシ定められているよ
うにして伝送される。
うにして伝送される。
表2によればシェルフ(1)のインタフェース104は
下位のデータ母線バイトのみを操作し。
下位のデータ母線バイトのみを操作し。
またシェルフNのインタフェース106は上位のデータ
母線バイトのみを操作する。チャネルAとBが同一のシ
ェルフに属する場合には、シェルフインタフェースは上
位と下位の両方のデータ母線によシ送信する。同一のシ
ェルフインタフェースもまた上位と下位の両方のデータ
母線バイトを受は取る。
母線バイトのみを操作する。チャネルAとBが同一のシ
ェルフに属する場合には、シェルフインタフェースは上
位と下位の両方のデータ母線によシ送信する。同一のシ
ェルフインタフェースもまた上位と下位の両方のデータ
母線バイトを受は取る。
めき状態では全てのシェルフインタフェースは 。
全てのデータをインタシェルフ母線(’ I 8 B
)から受は取ってシェルフを操作する。電話カードが伝
送すべきデータを有する場合には、それはABOかまた
はABlによυイネーブルにされる。そしてその電話カ
ードがシェルフインタフェースドライバ200,202
Th不可能化してシェルフインタフェースレシーバ20
4.206をイネーブルにする信号を生成する。シェル
フデータはその電話カードが生成したデータを操作しか
つ受は取る。
)から受は取ってシェルフを操作する。電話カードが伝
送すべきデータを有する場合には、それはABOかまた
はABlによυイネーブルにされる。そしてその電話カ
ードがシェルフインタフェースドライバ200,202
Th不可能化してシェルフインタフェースレシーバ20
4.206をイネーブルにする信号を生成する。シェル
フデータはその電話カードが生成したデータを操作しか
つ受は取る。
するトソのシェルフインタフェースが変化して次のタイ
ムスロットにおいてシェルフを操作する。
ムスロットにおいてシェルフを操作する。
この操作中のシェルフインタフェースを含めて全てのシ
ェルフインタフェースがそのデータ’e受ff取るので
1次のタイムスロットでは全てのシェルフインタフェー
スが新しいデータによってシェルフを操作する。
ェルフインタフェースがそのデータ’e受ff取るので
1次のタイムスロットでは全てのシェルフインタフェー
スが新しいデータによってシェルフを操作する。
他のアドレス母線によシ既に4つのタイムスロットをノ
ミネートされたカードのみがそのデータを受は取って受
納する。
ミネートされたカードのみがそのデータを受は取って受
納する。
あき状態では全てのシェルフインタフェース104.1
06がインタシェルフ母線112から全てのデータ全党
けjl12#)、このデータがドライバ200により全
てのシェルフヘトライブされる。
06がインタシェルフ母線112から全てのデータ全党
けjl12#)、このデータがドライバ200により全
てのシェルフヘトライブされる。
Aのような電話カードが伝送すべきデータを有する場合
、それは例えばタイムスロット20において(第1表参
照)時分割マルチプレクス回路網制御装置114内のア
ドレスメモリに記憶されたアドレスABOまたはABl
によりイネーブルにされる。すると電話カードはこの特
定の刻時期間20においてシェルフインタフェースドラ
イバ1 200.202を不可能化しまたインタフェースレシー
バ204,206とドライバ212,214をイネーブ
ルにする信号を線路240上に与える。
、それは例えばタイムスロット20において(第1表参
照)時分割マルチプレクス回路網制御装置114内のア
ドレスメモリに記憶されたアドレスABOまたはABl
によりイネーブルにされる。すると電話カードはこの特
定の刻時期間20においてシェルフインタフェースドラ
イバ1 200.202を不可能化しまたインタフェースレシー
バ204,206とドライバ212,214をイネーブ
ルにする信号を線路240上に与える。
次のタイムスロット21ではアドレスされた電話カード
からのデータが母線レシーバ204に下位バイトとして
送られ、レシーバ204内に記憶される。線路240上
の抑止パルスはタイムスロット21内では除去される。
からのデータが母線レシーバ204に下位バイトとして
送られ、レシーバ204内に記憶される。線路240上
の抑止パルスはタイムスロット21内では除去される。
これは装置のデータ伝送刻時速度の2倍の速さで動いて
抑止パルスの半分全タイムスロット20に与え、また半
分をタイムスロット21から除去することを可能にする
り■ツクによシ最も容易に達成される。いかなるデータ
伝送作用も1つのタイムスロット期間の開始時に開始さ
れねばなら外いので、ドライバ200゜202は期間2
1の間中不可能化される。
抑止パルスの半分全タイムスロット20に与え、また半
分をタイムスロット21から除去することを可能にする
り■ツクによシ最も容易に達成される。いかなるデータ
伝送作用も1つのタイムスロット期間の開始時に開始さ
れねばなら外いので、ドライバ200゜202は期間2
1の間中不可能化される。
次のタイムスロット22内ではレシーバ204内に記憶
されたデータがインタシェルフ母#i!112上に出力
され、シェルフインタフェース106(N)により受は
取られるデータAとシェルフインタフェース104(1
)により受は取られるデ2 −タBに関してデータの「クロスオーバー」が生じる(
第1表と第2表を参照のこと)。
されたデータがインタシェルフ母#i!112上に出力
され、シェルフインタフェース106(N)により受は
取られるデータAとシェルフインタフェース104(1
)により受は取られるデ2 −タBに関してデータの「クロスオーバー」が生じる(
第1表と第2表を参照のこと)。
各々のデータはタイムスロット22においてはシェルフ
インタフェースの%にのレシーバ208゜210に記憶
され1次にタイムスロット23ではそれは谷りのシェル
フ母線を通じて電話カードに出力され、そのカードから
ディジタルデータが例えば電話加入者の電話機で受信す
るためのアナログ音声信号に変換される。
インタフェースの%にのレシーバ208゜210に記憶
され1次にタイムスロット23ではそれは谷りのシェル
フ母線を通じて電話カードに出力され、そのカードから
ディジタルデータが例えば電話加入者の電話機で受信す
るためのアナログ音声信号に変換される。
このようにデータは1つの電話カードAからもう1つの
電話カードBヘハイウエイ112を経て4つのクロック
パルス期間を伴う一連の4つのステップで送られるが、
ハイウェイ112は単一のクロックパルス期間のために
のみ用いられる。従ってこのハイウェイによるデータ伝
送は非常に効率的でアシ、このことがデータをハイウェ
イ上で送るために少なくとも2つのタイムスロットヲ必
要とした従来技術による形態よシも速く電話又換金行な
うことを可能にする。
電話カードBヘハイウエイ112を経て4つのクロック
パルス期間を伴う一連の4つのステップで送られるが、
ハイウェイ112は単一のクロックパルス期間のために
のみ用いられる。従ってこのハイウェイによるデータ伝
送は非常に効率的でアシ、このことがデータをハイウェ
イ上で送るために少なくとも2つのタイムスロットヲ必
要とした従来技術による形態よシも速く電話又換金行な
うことを可能にする。
本装置は4.096メガヘルツの刻時速度で機能するに
ふされしく設計されている。本装置の通話処理能力は刻
時速度を8.192メガヘルツにしかつ本装置のクロッ
クをシェルフインタフェース上に働かせることによ92
倍になる。その場合シェルフインタフェースは上位バイ
トと下位バイトのデータ全インタシェルフ母線(18B
)に送るためにパイプラインレジスタを備えねばならな
い。
ふされしく設計されている。本装置の通話処理能力は刻
時速度を8.192メガヘルツにしかつ本装置のクロッ
クをシェルフインタフェース上に働かせることによ92
倍になる。その場合シェルフインタフェースは上位バイ
トと下位バイトのデータ全インタシェルフ母線(18B
)に送るためにパイプラインレジスタを備えねばならな
い。
第1図は本発明による装置のブロック線図。
第2図は第1図のシェルフインタフェースをよシ詳細に
示すブロック線図である。 符号の説明 104・・・シェルフインタフェース。 106・・・シェルフインタフェース。 108・・・アドレス母a。 110・・・アドレス母線。 112・・・データ母線、 114・・・A側制御装置。 220・・・デコーダ。 224・・・シェルフ識別コーF’回M。 230・・・デコーダー 15
示すブロック線図である。 符号の説明 104・・・シェルフインタフェース。 106・・・シェルフインタフェース。 108・・・アドレス母a。 110・・・アドレス母線。 112・・・データ母線、 114・・・A側制御装置。 220・・・デコーダ。 224・・・シェルフ識別コーF’回M。 230・・・デコーダー 15
Claims (1)
- 【特許請求の範囲】 (1)複数の第1と第2の電子装置が各々複数の第3と
第4の電子装置を経て時分割マルチプレクスハイウエイ
に接続され、この時分割マルチプレクスハイウエイが第
1と第2の並列なアドレス母線と並列なデータ母線を有
し、この第1と第2のアドレス母線が谷に第1と第2の
アドレスメモリに接続され、また特定のタイムスロット
において働かせるべき特定の第1と第2の装置を識別す
るために各々の第1と第2のアドレス母線によシアドレ
スをデコードするためのアPレスデコード装置を前記第
6と第4の電子装置内に有し、またデータ母線が2つの
並列な母線に分割されてデータが前記特定の第1と第2
の電子装置の間で前記分割された母線に沿って単一のタ
イムスロット期間内に双方向に伝送されることを特徴と
したディジタル電子切換装置。 (2、特許請求の範囲第1項記載の装置において、第1
および第2の電子装置と第6および第4の電子装置との
間の各接続が2つの並列なシェルフデータ母線に分割さ
れた時分割マルチプレクスデータハイウエイを有し、デ
ータが第1と第2の電子装置から前記2つの並列な母線
の1番目の方によシ出力され、また前記2つの並列な母
線の2番目の方から前記第1と第2の電子装置に入力さ
れることを特徴としたディジタル電子切換装置。 (3)特許請求の範囲第2項記載の装置において。 第3と第4の電子装置が同一であって前記並列なシェル
フデータ母線の1つと前記並列なデータ母線の1つとの
間でデータを送受するために第1の母線ドライバとレシ
ーバおよびレシーバとドライバの結合を有し、また前記
並列なシェルフデータ母線のもう一方と前記並列なデー
タ母線のもう一方との間でデータ全送受するために第2
の母線ドライバとレシーバおよびレシーバとドライバの
結合を有して1%々のレシーバが1つの刻時パルス期間
について並列データを記憶する記憶装置を有するディジ
タル電子切換装置。 (4)特許請求の範囲第3項記載の装置において。 前記第3の電子装置に接続された前記第1の電子装置の
1つが前記並列なデータ母線によシデータを伝送すべく
選択された場合に、並列データ母線に接続されたレシー
バの機能を抑止する装置を有するディジタル電子切換装
置。 (5)特許請求の範囲第4項記載の装置において。 前記第1と第2の電子装置が通話をディジタル形式で記
憶しかつそれを前記第1の電子装置に接続された第1の
電話加入者から前記第2の電子装置に接続された第2の
電話加入者に送り届ける電話カードを有するディジタル
電子切換装置。 (6)特許請求の範囲第5項記載において、前記第1と
第2のアドレスメモリが各々のタイムスロット期間中に
前記第1と第2の電子装置の特定の1つにアドレスを供
給し、各アドレス母線上載アドレスの1つは第1と第2
の電話加入者に伴う電話カードを選択するためにq!r
k第6と第4の電子装置にニジデコードされ、そ扛によ
シ後続のタイムスロット期間における前記電話加入者間
の接続を果たすことを特徴としたディジタル電子切換装
置。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
GB8226237 | 1982-09-15 | ||
GB8226237 | 1982-09-15 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5972893A true JPS5972893A (ja) | 1984-04-24 |
JPH0417518B2 JPH0417518B2 (ja) | 1992-03-26 |
Family
ID=10532907
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP58170503A Granted JPS5972893A (ja) | 1982-09-15 | 1983-09-14 | デイジタル電子切換装置 |
Country Status (13)
Country | Link |
---|---|
US (1) | US4564938A (ja) |
EP (1) | EP0103437B1 (ja) |
JP (1) | JPS5972893A (ja) |
AT (1) | ATE21476T1 (ja) |
AU (1) | AU552458B2 (ja) |
CA (1) | CA1210120A (ja) |
DE (1) | DE3365300D1 (ja) |
DK (1) | DK162002C (ja) |
GB (1) | GB2126842B (ja) |
IE (1) | IE54883B1 (ja) |
NO (1) | NO159569C (ja) |
NZ (1) | NZ205470A (ja) |
ZA (1) | ZA836453B (ja) |
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1983
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