JPS61116434A - 自動等化方式 - Google Patents
自動等化方式Info
- Publication number
- JPS61116434A JPS61116434A JP59237977A JP23797784A JPS61116434A JP S61116434 A JPS61116434 A JP S61116434A JP 59237977 A JP59237977 A JP 59237977A JP 23797784 A JP23797784 A JP 23797784A JP S61116434 A JPS61116434 A JP S61116434A
- Authority
- JP
- Japan
- Prior art keywords
- memory
- difference
- coefficient
- time
- tap
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L25/00—Baseband systems
- H04L25/02—Details ; arrangements for supplying electrical power along data transmission lines
- H04L25/03—Shaping networks in transmitter or receiver, e.g. adaptive shaping networks
- H04L25/03006—Arrangements for removing intersymbol interference
- H04L25/03012—Arrangements for removing intersymbol interference operating in the time domain
- H04L25/03019—Arrangements for removing intersymbol interference operating in the time domain adaptive, i.e. capable of adjustment during data reception
- H04L25/03038—Arrangements for removing intersymbol interference operating in the time domain adaptive, i.e. capable of adjustment during data reception with a non-recursive structure
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Soundproofing, Sound Blocking, And Sound Damping (AREA)
- Filters That Use Time-Delay Elements (AREA)
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はディジタル伝送系に於いて使用されるトランス
バーサル型自動等化器の制御方式に関するものである。
バーサル型自動等化器の制御方式に関するものである。
トランスバーサル型自動等化器は伝送路の特性の変化に
追従して其のタップ制御係数を変化さセているが、伝送
路の特性の変化が大きい場合には自動等化器の収束時間
が長くなるので此の改善が要望されていた。
追従して其のタップ制御係数を変化さセているが、伝送
路の特性の変化が大きい場合には自動等化器の収束時間
が長くなるので此の改善が要望されていた。
第２園
の自動制御方式の一例を示す図である。
図中、１はＡ／Ｄ変換器、２、６、及び７は夫々シフト
レジスタ、３は係数器、４−１〜４−Ｎは夫々ハソファ
カウンタ、５は相開器、８は掛算累積器、９は復号器で
ある。尚以下全図を通し同一記号は同一対象物を表す。
レジスタ、３は係数器、４−１〜４−Ｎは夫々ハソファ
カウンタ、５は相開器、８は掛算累積器、９は復号器で
ある。尚以下全図を通し同一記号は同一対象物を表す。
入力信号はサンプリングされた後、Ａ／Ｄ変換器１に入
ってディジタル化されてＮ桁のシフトレジスタ２に入力
される。シフトレジスタ２の各桁の出力Ｘｉ は掛算累
積器８に入力され、−力係数器３の各係数Ｃｉ も掛算
累積器８に人力される。
ってディジタル化されてＮ桁のシフトレジスタ２に入力
される。シフトレジスタ２の各桁の出力Ｘｉ は掛算累
積器８に入力され、−力係数器３の各係数Ｃｉ も掛算
累積器８に人力される。
掛算累積器８に於いて、各桁毎にＸｉ ＸＣｉを演算し
、其の総和を取り、復号器９に送る。
、其の総和を取り、復号器９に送る。
復号器９に於いて１６ビツト信号を４ビツトに丸め、其
の極性信号をシフトレジスタ６へ、其の誤差信号をシフ
１〜レジスタ７へ送出する。
の極性信号をシフトレジスタ６へ、其の誤差信号をシフ
１〜レジスタ７へ送出する。
相関器５はシフトレジスタ６とシフトレジスタ７の夫々
の出力のＥＸ−ＯＲを取り、夫々ハソファカウンタ４−
１〜４−Ｎに入力する。
の出力のＥＸ−ＯＲを取り、夫々ハソファカウンタ４−
１〜４−Ｎに入力する。
此の場合従来の自動等化器の係数器３の制御はタイマ（
第２図には記載されていない）により、自動等化器の引
き込み時の成る時間内ｉｌｌステップサイズを大きく制
御し、此の時間を過ぎた後はステップサイズを小さく制
御して引き込みに要する時間の短縮を計っていた。
第２図には記載されていない）により、自動等化器の引
き込み時の成る時間内ｉｌｌステップサイズを大きく制
御し、此の時間を過ぎた後はステップサイズを小さく制
御して引き込みに要する時間の短縮を計っていた。
然し此の様な制御方法では引き込み時の成る時間内に、
若し自動等化器の収束が不十分な場合にはステップサイ
ズを小さくなってしまう為収束するのに大変時間がかか
ると云う欠点かあった。
若し自動等化器の収束が不十分な場合にはステップサイ
ズを小さくなってしまう為収束するのに大変時間がかか
ると云う欠点かあった。
本発明の目的は−１−記従来方式の欠点を除去し、タッ
プ制御係数の変化量に応して収束速度を加減することに
より収束時間が短縮され、安定に制御を行うことが出来
る自動等化方式を提供することである。
プ制御係数の変化量に応して収束速度を加減することに
より収束時間が短縮され、安定に制御を行うことが出来
る自動等化方式を提供することである。
問題点を解決するだめの手段は、トランスバーザル型自
動等化器に於けるタップ制御係数を監視し、単位時間当
たりの該タップ制御係数の変化量の絶対値を検出し、該
変化量の絶対値と１屯位時間前の該変化量の絶対値とを
比較し、両変化量の絶対値の差が成る一定値より大きい
時は該タップ制御係数の１ステップサイズを大きくし、
該両変化量の絶対値の差か成る一定値より小さい時は該
タップ制御係数の１ステップサイズを小さくする様に制
御することにより達成される。
動等化器に於けるタップ制御係数を監視し、単位時間当
たりの該タップ制御係数の変化量の絶対値を検出し、該
変化量の絶対値と１屯位時間前の該変化量の絶対値とを
比較し、両変化量の絶対値の差が成る一定値より大きい
時は該タップ制御係数の１ステップサイズを大きくし、
該両変化量の絶対値の差か成る一定値より小さい時は該
タップ制御係数の１ステップサイズを小さくする様に制
御することにより達成される。
本発明に依ると一定時間間隔でタップ制御係数を監視し
て其の変化量の絶対値を検出し、変化量の絶対値と１慣
位時間前の該変化量の絶対値とを比較し、二つの変化量
の絶対値の差が成る基準値より大きい場合にはステップ
サイズを大きくて制御速度を−１−げ、小さい場合にＧ
Ｊステソプザイズを小ざくて制御速度を下げ、自動的に
収束速度を加減するので収束時間が短縮され安定に制御
を行うことが出来ると云う効果か生まれる。
て其の変化量の絶対値を検出し、変化量の絶対値と１慣
位時間前の該変化量の絶対値とを比較し、二つの変化量
の絶対値の差が成る基準値より大きい場合にはステップ
サイズを大きくて制御速度を−１−げ、小さい場合にＧ
Ｊステソプザイズを小ざくて制御速度を下げ、自動的に
収束速度を加減するので収束時間が短縮され安定に制御
を行うことが出来ると云う効果か生まれる。
第１図は本発明に依る自動等化方式の一実施例を示す図
であり、第２図に於ける鎖線で囲まれた部分に対応する
回路である。
であり、第２図に於ける鎖線で囲まれた部分に対応する
回路である。
図中、１０．１１．１２．１３は夫々メモリ、１４は加
減算器、１５は減算器、１６は多数決回路、１７ば比較
器である。
減算器、１５は減算器、１６は多数決回路、１７ば比較
器である。
以下図に従って本発明の詳細な説明する。
第１図の点線で囲まれた部分番才係数器３であり、メモ
リ１３と加減算器１４から構成される。
リ１３と加減算器１４から構成される。
一定時間毎に係数器３のｉ番目のタップ制御係数をメモ
リ１３からメモ１月Ｏに人力し、前回入力したメモリ１
０の内容と現在のメモ１月３の出力の差を減算器１５に
於いて求める。此の差値を一定時間毎にメモ１月１に移
し、更に一定時間毎にメモリ拉に移す。
リ１３からメモ１月Ｏに人力し、前回入力したメモリ１
０の内容と現在のメモ１月３の出力の差を減算器１５に
於いて求める。此の差値を一定時間毎にメモ１月１に移
し、更に一定時間毎にメモリ拉に移す。
比較器１７はメモリ１２の内容とメモリ１１の内容を比
較し、其の差が成る一定値より大きいか否かを判定し、
比較結果を多数決回路１６に入力する。
較し、其の差が成る一定値より大きいか否かを判定し、
比較結果を多数決回路１６に入力する。
多数決回路１６には係数器３の各タップに就いての比較
結果が入力されて其の多数決を携り、加減算器１４で加
減算する数を制御することによりタップ制御ステップサ
イズを変化させる。
結果が入力されて其の多数決を携り、加減算器１４で加
減算する数を制御することによりタップ制御ステップサ
イズを変化させる。
又加減算器１４で加算するか、減算するかばハソファカ
ウンタ４−１〜４−Ｎがアンダーフローするか、オーバ
ーフローするかにより決定される。
ウンタ４−１〜４−Ｎがアンダーフローするか、オーバ
ーフローするかにより決定される。
以上詳細に説明した様に本発明によれば、タップ係数の
制御速度を自動的に変化させることにより収束時間を短
縮することが出来ると云う大きい効果がある。
制御速度を自動的に変化させることにより収束時間を短
縮することが出来ると云う大きい効果がある。
第１図は本発明に依る自動等化方式の一実施例を示す図
である。 第２図はトランスバーサル型自動等化器の従来の自動制
御方式の一例を示す図である。 図中、１はＡ／Ｄ変換器、２．６、及び７は夫々シフト
レジスタ、３は係数器、４−１〜４−Ｎは夫々バッファ
カウンタ、５は相関器、８は掛算累積器、９は復号器、
１０．１１．１２．１３は夫々メモリ、１４は加法算器
、１５は減算器、１６は多数決回路、１７は比較器であ
る。
である。 第２図はトランスバーサル型自動等化器の従来の自動制
御方式の一例を示す図である。 図中、１はＡ／Ｄ変換器、２．６、及び７は夫々シフト
レジスタ、３は係数器、４−１〜４−Ｎは夫々バッファ
カウンタ、５は相関器、８は掛算累積器、９は復号器、
１０．１１．１２．１３は夫々メモリ、１４は加法算器
、１５は減算器、１６は多数決回路、１７は比較器であ
る。
Claims (1)
- トランスバーサル型自動等化器に於けるタップ制御係数
を監視し、単位時間当たりの該タップ制御係数の変化量
の絶対値を検出し、該変化量の絶対値と１単位時間前の
該変化量の絶対値とを比較し、両変化量の絶対値の差が
或る一定値より大きい時は該タップ制御係数の１ステッ
プサイズを大きくし、該両変化量の絶対値の差が成る一
定値より小さい時は該タップ制御係数の１ステップサイ
ズを小さくする様に制御することを特徴とする自動等化
方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59237977A JPS61116434A (ja) | 1984-11-12 | 1984-11-12 | 自動等化方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59237977A JPS61116434A (ja) | 1984-11-12 | 1984-11-12 | 自動等化方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61116434A true JPS61116434A (ja) | 1986-06-03 |
Family
ID=17023276
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59237977A Pending JPS61116434A (ja) | 1984-11-12 | 1984-11-12 | 自動等化方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61116434A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03266516A (ja) * | 1990-03-15 | 1991-11-27 | Nec Corp | アダプティブ・フィルタ適応化方法及び装置 |
-
1984
- 1984-11-12 JP JP59237977A patent/JPS61116434A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03266516A (ja) * | 1990-03-15 | 1991-11-27 | Nec Corp | アダプティブ・フィルタ適応化方法及び装置 |
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