JPS6095664A - デ−タ記憶制御装置 - Google Patents

デ−タ記憶制御装置

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Publication number
JPS6095664A
JPS6095664A JP58203185A JP20318583A JPS6095664A JP S6095664 A JPS6095664 A JP S6095664A JP 58203185 A JP58203185 A JP 58203185A JP 20318583 A JP20318583 A JP 20318583A JP S6095664 A JPS6095664 A JP S6095664A
Authority
JP
Japan
Prior art keywords
data
error detection
data storage
host device
storage device
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP58203185A
Other languages
English (en)
Inventor
Hiroshi Tomita
弘 富田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP58203185A priority Critical patent/JPS6095664A/ja
Publication of JPS6095664A publication Critical patent/JPS6095664A/ja
Pending legal-status Critical Current

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    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00Error detection; Error correction; Monitoring
    • G06F11/07Responding to the occurrence of a fault, e.g. fault tolerance
    • G06F11/0703Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation

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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Quality & Reliability (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Debugging And Monitoring (AREA)
  • Detection And Correction Of Errors (AREA)
  • Techniques For Improving Reliability Of Storages (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明はデータ処理装置におけるデータ記憶制御装置に
関し、特にデータ記憶装置へのデータ書込み中に上位装
置が故障し、データ記憶装置へのアクセス管理が不能に
汝っだ場合のエラー報告に関する。
(従来技術) 最初に従来技術に関して、磁気ディスク装置の実例を挙
げて説明する。
従来、磁気ディスク装置に書込むデータは、一般に磁気
ディスク装置、およびその制御装置などの故障を考慮し
て、書込みデータを磁気テープへ同時にコピーする方式
が採用されていた。
すなわち、これは一般にジャーナルと呼ばれているもの
である。しかし、オペレーティングシステムの制御デー
タに対してジャーナル方式をすべて適用すると、性能の
大幅な低下を招くと云う欠点があった。従って、書込み
データが途中で途切れたか否かをチェックするためのチ
ェックデータを、ソフトウェアのプログラムにより付加
する方式を採用している場合もあるが、このときもチェ
ックのために性能が低下すると云う欠点があった。
(発明の目的) 本発明の目的は、データ記憶装置に対するデータ書込み
中にデータ送出元である上位装置が故障した場合、ある
いはデータを書込み中であったデータ記憶装置上の所在
管理が不能になつた場合に、次に当該データを上位装置
が読出す際に付加されて書込まれた誤り検出訂正符号を
判別することによって上記欠点を除去し、当該データの
書込み中に上位装置が故障し、正常にデータが書かれて
いないことを上位装置に報告するように構成したデータ
記憶制御装置を提供することにある。
(発明の構成) 本発明によるデータ記憶制御装置は上位装置とデータ記
憶装置との間でデータの書込みと読出しを制御するため
のもので、データ書込み制御手段と、データ読出し制御
手段と、誤り検出訂正手段と、異常状態検出手段と、デ
ータ伝達手段と、符号変換手段とを具備して構成したも
のである。
データ書込み制御手段は、データ記憶装置へのデータ書
込みを制御するためのものである。
データ読出し制御手段は、データ記憶装置からのデータ
の読出しを制御するためのものである。
誤り検出訂正手段はデータ記憶装置への書込みデータに
対して誤り検出訂正符号を発生し、読出しデータに対し
て誤り検出、あるいは誤り訂正を行うためのものである
異常状態検出手段は、データの書込みや読出しなどの要
求元である上位装置から送出される上位装置の異常状態
通知信号を検出するためのものである。
データ伝達手段はデータ書込み制御手段とデータ読出し
制御手段とによって制御され、上位装置がデータ記憶装
置に要求する書込みデータ、あるいは読出しデータを伝
送するためのものである。
符号変換手段はデータ書込み制御手段からの書込み中通
知信号、ならびに異常状態検出手段からの異常状態通知
信号が同時に発生した場合に書込みデータに対して算出
生成されて付加され、誤り検出訂正手段から送出される
誤り検出訂正符号を、読出し時に訂正不可能な誤りにな
るような符号に変換してデータ伝達手段に送出するため
のものである。
(実施例) 次に、本発明について図面を参照して詳細に説明する。
第1図は、本発明によるデータ記憶制御装置の一実施例
を周辺装竹と共に示すブロック図である。第1図におい
て、100は上位装置、101はデータ伝達回路、10
2idデータ選択回路、103はデータ記憶装置、10
4は誤り検出訂正回路、105は異常状態検出回路、1
06は書込み/読出し制御回路、107ばANDゲート
である。
本発明の実施例を示す第1図において、上位装f 10
0からデータ書込みの指示があった時には、上位装置1
00は信号線200を通してデータ伝達回路101にデ
ータを転送すると共に、書込み/読出し制御回路106
から信号線208 、210を通して書込み信号を送出
する。データは信号線201を通してデータ伝達回路1
01からデータ選択回路102に入力され、異常状態が
検出されていIt、−、ときには信号線202を通して
データ記憶装置103に送出される。
データ書込み中に上位装置100に異常があった場合に
は、異常状態検出回路105は上位装置100から信号
線206を通して異常状態通知信号を受取り、信号線2
07を通して異常状態通知信号をANDゲート107に
送出する。この時、信号線208の書込み信号もオンで
あるため、ANDゲート107が開き、信号線209を
通してデータ選択回路102に異常のあったことが指示
される。データ選択回路102では信号線203を通し
て誤り検出訂正回路104に誤り検出訂正符号の発生を
指示し、誤り検出訂正回路104は誤り検出訂正符号を
信号線204を通してデータ選択回路102に送出する
。データ選択回路102では、データに誤り検出訂正符
号を付加してデータ記憶装置103にデータを書込む。
上位装置100からデータ読出しの指示があった時には
、書込み/読出し制御回路106は信号線210を通し
て読出し信号を送出する。データ記憶装置103から読
出したデータは、信号線202を通してデータ選択回路
102に送出されると共に、信号線203を通して誤り
検出訂正回路104にも入力される。データは、データ
伝達回路101を介して上位装置100に送出される。
誤り検出訂正回路104で誤り検出訂正符号が検出され
た時には、信号線204を通して誤り検出訂正符号の検
出を指示し、データ選択回路102は訂正不可能になる
ようにデータを交換して、データ伝達回路101を介し
て上位装置100に訂正不可能なデータを送出する。
(発明の効果) 本発明は以上説明したように、データ記憶装置に対する
データ書込み中にデータ送出元である上位装置が故障し
た場合、あるいはデータの書込み中であったデータ記憶
装価上の所在管埋が不能になった場合に、次に当該デー
タを上位装置が抗出す際に付加されて書込オれた誤り検
出訂正符号を判別することによって、中央処理装置の負
荷を軽減して性能をあげることができると云う効果があ
る。
【図面の簡単な説明】
第1図は、本発明によるデータ記憶制御装置の一実施例
を示すブロック図である。 100・・・上位装置 101・・・データ伝達回路1
02・・・データ選択回路 103・・・データ記憶装置 104・・・誤り検出訂正回路 106・・・異常状態検出回路 106・・・書込み/読出し制御回路 107・・・ANDゲート200〜210・・・信号線
特許出願人 日本電気株式会社 代理人 弁理士 井 ノ ロ 壽

Claims (1)

    【特許請求の範囲】
  1. 上位装置とデータ記憶装置との間でデータの書込みと読
    出しとを制御するためのデータ記憶制御装置において、
    前記データ記憶装置へのデータ書込みを制御するための
    データ書込み制御手段と、前記データ記憶装置からのデ
    ータの読出しを制御するためのデータ読出し制御手段と
    、前記データ記憶装置への書込みデータに対して誤り検
    出訂正符号を発生し、読出しデータに対して誤り検出、
    あるいは誤り訂正を行うための誤り検出訂正手段と、デ
    ータの書込みや読出しなどの要求元である前記上位装置
    から送出される上位装置の異常状態通知信号を検出する
    ための異常状態検出手段と、前記データ書込み制御手段
    と前記データ読出し制御手段とによって制御され、前記
    上位装置が前記データ記憶装置に要求する書込みデータ
    、あるいは流出しデータを伝送するためのデータ伝達手
    段と、前記データ書込み制御手段からの書込み中通知信
    号、ならびに前記異常状態検出手段からの異常状態通知
    信号が同時に発生した場合に前記書込みデータに対して
    算出生成されて付加され、前記誤り検出訂正手段から送
    出される誤り検出訂正符号を、読出し時に訂正不可能な
    誤りになるような符号に変換して前記データ伝達手段に
    選出するための符号変換手段とを具備して構成したこと
    を特徴とするデータ記憶制御装置。
JP58203185A 1983-10-28 1983-10-28 デ−タ記憶制御装置 Pending JPS6095664A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP58203185A JPS6095664A (ja) 1983-10-28 1983-10-28 デ−タ記憶制御装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP58203185A JPS6095664A (ja) 1983-10-28 1983-10-28 デ−タ記憶制御装置

Publications (1)

Publication Number Publication Date
JPS6095664A true JPS6095664A (ja) 1985-05-29

Family

ID=16469863

Family Applications (1)

Application Number Title Priority Date Filing Date
JP58203185A Pending JPS6095664A (ja) 1983-10-28 1983-10-28 デ−タ記憶制御装置

Country Status (1)

Country Link
JP (1) JPS6095664A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04353935A (ja) * 1991-05-30 1992-12-08 Nec Corp 磁気ディスク制御装置

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH04353935A (ja) * 1991-05-30 1992-12-08 Nec Corp 磁気ディスク制御装置

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