JPS6063474A - インサ−キット・テスタ− - Google Patents

インサ−キット・テスタ−

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Publication number
JPS6063474A
JPS6063474A JP58145512A JP14551283A JPS6063474A JP S6063474 A JPS6063474 A JP S6063474A JP 58145512 A JP58145512 A JP 58145512A JP 14551283 A JP14551283 A JP 14551283A JP S6063474 A JPS6063474 A JP S6063474A
Authority
JP
Japan
Prior art keywords
contact
circuit
contacting
measured
tester
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP58145512A
Other languages
English (en)
Inventor
Kazuhiko Wada
一彦 和田
Harunobu Tateno
舘野 治信
Kenji Uchida
憲司 内田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP58145512A priority Critical patent/JPS6063474A/ja
Publication of JPS6063474A publication Critical patent/JPS6063474A/ja
Pending legal-status Critical Current

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Classifications

    • GPHYSICS
    • G01MEASURING; TESTING
    • G01RMEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
    • G01R31/00Arrangements for testing electric properties; Arrangements for locating electric faults; Arrangements for electrical testing characterised by what is being tested not provided for elsewhere
    • G01R31/28Testing of electronic circuits, e.g. by signal tracer
    • G01R31/2832Specific tests of electronic circuits not provided for elsewhere
    • G01R31/2836Fault-finding or characterising
    • G01R31/2843In-circuit-testing

Landscapes

  • Engineering & Computer Science (AREA)
  • General Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Tests Of Electronic Circuits (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 +a)発明の技術分野 本発明はプリント板パンケージの製作に際して使用され
る所謂インサーキット・テスターの改良に関す。
(b)技術の背景 各種電子機器の構成に各種電子部品を搭載した単層、あ
るいは多層のプリント板、所謂プリント板パッケージが
広く使用されている。
このパッケージの製作に際しては、各種電子部品が夫々
所定の場所に正しく搭載接続されているかどうかの試験
が行われる。
このために使用される所謂インザーキソ1−・テスター
は、被試験プリント板パッケージと該パッケージ背面に
露出している被測定接続個所と接触する接触ピンを介し
て電気的に接続されるカベこの接触ピン数は数百にも及
ぶため、両者の総ての接触を完全にするために真空吸引
による手段が使用されている。
又被測定電子部品は回路上単独に接続されていることは
少ないため、インサーキット・テスターでは個々の部品
素子を精度よく測定するために、該素子に直接接触して
いるピンのほかに、所謂ガーデイング・ビンを設定して
使用される。即61個の部品素子の測定に少なくとも3
個の接触ピンの使用が必要であり、その一つが接触不良
でも正確な測定ができない。
(C)従来技術と問題点 第1図は従来のインサーキット・テスターlCTに於け
る抵抗素子Rxの測定回路構成部分を示すもので、RI
SR2は被測定回路を構成する他の抵抗素子、Rfはテ
スター中の基準抵抗、OAはオペレーション・アンプで
被測定素子Rxの両端の接触ピンP1、R2の他に更に
ガーディング・ビンP3が使用されている。
図示のように直流電源EDの電圧eiが付与された場合
の出力電圧eoは eo=−Rx/Rf−ei となり、入力電圧eiおよび基準抵抗Rfが一定である
故に、出力電圧eoより被測定素子Rxがめられること
公知の通りである。
被測定素子Rxがコンデンサーのようなりアクタンスの
場合は、定電流交流電源が使用される。
然しこの際接触ピンP1あるいはR2の接触不良の場合
は測定値は無限大となり、被測定素子Rxの不良との区
別がつかない。又ガーディング・ピンP3の接触不良の
場合も、他の素子R1、R2の影響で誤差を含んで被測
定素子Rxの不良との区別がつかない。
しかも既述のように接触ピンの接触不良の機会がかなり
多く、屡正市な電子部品が不良と見なされる恐れがあっ
た。
(d1発明の目的 本発明は上記従来のインサーキソレテスターにおける接
触ピンの接触不良に基づく測定結果の不確実性を除去す
ることをその目的とする。
+e1発明の構成 上記本発明の目的は、正規の測定回路の他に切り換え手
段による個々の接触ピンに対する導通試験回路が設けら
れ、無限大の測定値に際して該切り換え手段によって該
素子の不良か、使用された接触ピンの接触不良がを判別
する機能を備えた本発明による構成のインサーキ・2ト
・テスターによって達成される。
導通試験回路による試験のだめの電源としてインサーキ
ット・テスターに使用される電源がその゛ま一使用でき
るので、特別の電源を準備する必要はない。テスターに
使用される交流、直流、両型源のうち交流電源を使用す
れば、被測定素子が抵抗の場合でもリアクタンスの場合
でも使用できる故に有利である。
又この際接触ピンの接触機能の良否を判別するのに、該
接触ピンを経る回路の導通の有無を確認すればよく、導
通電流値を測定する必要はないので回路構成は簡単であ
る。
(f)発明の実施例 以下第2図に示す実施例により本発明の要旨を具体的に
説明する。全図を通じ同一符号は同一対象物を示す。
第2図の実施例は第1図の従来の正規の測定回路構成に
本発明による接触ピンのための導通を付加したものであ
る。
接触ピンP1、R2およびB3のリード線は、夫々切り
換えスイッチSl、s2およびB3によって、正規の測
定回路のための接点B1、B2およびB3より導通回路
のための接点M1、M2およびM3に切り換えられるよ
う構成されている。
導通は該接点M1、M2およびM3と交流電源EA、電
流計IAを介する回路で構成されている。
従ワて今抵抗Rxの測定に際して無限大の値が示された
とすれば、切り換えスイッチ31を動作させて接点をB
1からMlに切り換え、接触ピンP1に交流電源EAの
電圧を印加する。この際電流計IAが振れなければ、真
の接触不良であり、電流が流れ\ば接触ピンP3との間
にながれたこと\なり、接触性は良である。
次に切り換えスイッチS2を動作させて接点をB2から
M2に切り換えることによって接触ピンP2に交流電圧
を加え、同様にしてその接触性が判別される。
最後に切り換えスイッチS3を動作させて接点をB3か
らM3に切り換え、接触ピンP3の接触性が試験される
かくて測定に使用している総ての接触ピンの接触性の良
否が確認でき、被測定素子の良否との相違が明らかとな
る。
(g1発明の詳細 な説明のように本発明によるインサーキット・テスター
にあっては、被測定電子部品の不良表示に際して、測定
回路から導通試験回路へ切り換え試験することにより、
接触ピンの接触不良ニ起因するかどうかの判別が容易に
可能となすことができる、著しい工業的効果をそなえて
いる。
【図面の簡単な説明】
第1図は公知のインサーキット・テスターにおける抵抗
素子測定回路の1例を示し、第2図は本発明によるイン
サーキット・テスターの構成を公知測定回路に適用した
実施例を示す。 図において、ICTはインサーキット・テスター、Pl
、P2およびP3は接触ピン、Rxは被測定抵抗素子、
Rfは基準抵抗、OAはオペレーション・アンプ、ED
は直流電源、EAは交流電源、IAは交流電流針を示す

Claims (1)

    【特許請求の範囲】
  1. プリント板パッケージに搭載された個々の電子部品素子
    が、夫々所定の接続ランドに正しく接続されているかど
    うかの試験において、正規の測定回路のほかに切り換え
    手段による個々の接触ピンに対する導通試験回路が設け
    られ、無限大の測定値に際して該切り換え手段によって
    該素子の不良か、使用された接触ピンの接触不良かを判
    別する機能を備えてなることを特徴とするプリント板パ
    ッケージ試験のためのインサーキット・テスタO
JP58145512A 1983-08-09 1983-08-09 インサ−キット・テスタ− Pending JPS6063474A (ja)

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JPS6063474A true JPS6063474A (ja) 1985-04-11

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