JPS606060B2 - 双安定リレ−制御回路 - Google Patents
双安定リレ−制御回路Info
- Publication number
- JPS606060B2 JPS606060B2 JP7306878A JP7306878A JPS606060B2 JP S606060 B2 JPS606060 B2 JP S606060B2 JP 7306878 A JP7306878 A JP 7306878A JP 7306878 A JP7306878 A JP 7306878A JP S606060 B2 JPS606060 B2 JP S606060B2
- Authority
- JP
- Japan
- Prior art keywords
- switching element
- diode
- control pole
- bistable relay
- collector
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Relay Circuits (AREA)
- Electronic Switches (AREA)
Description
【発明の詳細な説明】
本発明は双安定リレー制御回路に関する。
第１図は従来のこの種の双安定リレー制御回路の回路図
を示すものである。
を示すものである。
かかる回路は、電源スイッチＳを投入して電源電圧が除
々に上昇する段階にあって、シュミットトリガ回路１の
入力トランジスタＴ４がオンとなって、出力トランジス
タＴ３がオフとなり、従って出力トランジスタＴ３のコ
レクタに直列接続したコレクタ抵抗Ｒ，と抵抗Ｒ２とを
介してＮＰＮ型のトランジスタからなる第２のスイッチ
ング素子Ｌの制御極たるベースにベース電流が流れてス
イッチング素子Ｔ２はオン状態となるとともに、逆に第
１の、ＰＮＰ型のトランジスタからなるスイッチング素
子Ｔ，はオフ状態となる。その結果コンデンサＣ，の充
電電荷がスイッチング素子Ｔ２を介して放電されること
になる。電源電圧が更に上昇して、入力トランジスタＴ
４のベース電位がツェナーダイオードＺＤのツェナー電
圧Ｖｚｏに達すると、ツヱナータイオードＺＤが導通し
入力トランジスタＴ４のベース電位をツェナータィオー
ドＺＤのツェナー電圧Ｖｚ。に固定する。従ってシュミ
ットトリガ回路１の入力トランジスタＬのベース・ェミ
ッタ間電圧とェミツタ抵抗欠３における電圧降下との合
計が前記ッェナーダィオード血のッェナ‐電圧Ｖ２ｏに
達するとべ−ス電流が流れなくなってトランジスタＬは
カットオフ状態となり、出力トランジスタｔのベースに
電流が流れ始めて出力トランジスタＴ３がオンしてのヱ
ミツタ電流を抵抗Ｒ３に流し入力トランジスタＴｒ４の
オフ状態を保持させるのである。つまりシュミットトリ
ガ回路１は反転する。このためスイッチング素子Ｔ，，
Ｌのベース電位がェミツタ電位より低くなってスイッチ
ング素子Ｔ，はオン状態となり、一方スイッチング素子
Ｔ２はオフ状態となる。このとき電源より、スイッチン
グ素子Ｔ，、ダイオードＤ８、コンデンサＣ，、双方向
安定リレーＲそｓの励滋コイルの回路を通じてコンデン
サＣ，に急激に充蚤々流が流れ、双安定リレーＲそｓは
励滋されて動作する。次いで電源電圧が低下して「 シ
ュミットトリガ回路１の入力トランジスタＴ４のベース
電位がツヱナーダィオード電圧Ｖ２Ｄより低下すると、
ッェナータィオードＺＤは導通しなくなり、従って入力
トランジスタＬのベース電位は電源電圧に応じて変化し
、入力トランジスタＴ４のベース電位が入力トランジス
タＴ４のェミッタ電位より高くなると、入力トランジス
タＬのベースにベース電流が流れてオン動作する。この
オンド作によって出力トランジスタＴ４のベース電位は
ェミツタ電位よりも低くなり、その結果出力トランジス
タＴ３はオフ状態となる。つまりシュミットトリガ回路
１は反転したことになり、この結果スイッチング素子Ｔ
，はオフ状態となり、スイッチング素子Ｔ２はオン状態
となる。このことによって「 コンデンサＣ，の充電々
荷は、スイッチング素子Ｌ、双安定リレーＲそｓの励滋
コイルを介して急激に放電され、双安走りレ−Ｒ〆ｓは
元に反転動作する。このようにかかる従来例は電源電圧
を下降、上昇させて双方安リレーＲそｓをシュミットト
リガ回路１の動作にて駆動することができきるものであ
るが、シュミットトリガ回路１の出力トランジスタｔが
オフのとき、スイッチング素子Ｔ，がオフで、スイッチ
ング素子Ｔ２がオンの動作が保証されないという恐れが
あった。即ちスイッチング素子Ｌのベース電流によるコ
レクタ抵抗Ｒ，の電圧降下により、スイッチング素子Ｔ
，は順バイアス電流が抵抗Ｒ４を介して流れてしまい入
力電流はスイッチング素子Ｔ，，Ｔ２を通って短絡して
しまうという欠点があった。尚ダイオードＤ５はコレク
タ抵抗Ｒ，、抵抗Ｒ２を通じてコンデンサＣ，が徐々に
充電されることを防止するためのものであり、またダイ
オードＤＢ，Ｄ７はスイッチング素子Ｔ２のェミツタ電
位が出力トランジスタ公が導適状態になった場合にその
コレクタ電位を越えているように、いいかえればスイッ
チング素子Ｔ２が確実に阻止状態となるように設定する
ものである。コンデンサＣ２は電源電圧（励滋電圧）の
変化が激しくても、シュミットトリガ回路１の確実な動
作を確保するためのものである。Ｒ５〜Ｒ８は夫々抵抗
である。本発明は上述の欠点に鑑みて為したもので、そ
の目的とするところは、安定した動作が得られて誤動作
が生じる恐れがない双安定リレー制御回路を提供するに
ある。
々に上昇する段階にあって、シュミットトリガ回路１の
入力トランジスタＴ４がオンとなって、出力トランジス
タＴ３がオフとなり、従って出力トランジスタＴ３のコ
レクタに直列接続したコレクタ抵抗Ｒ，と抵抗Ｒ２とを
介してＮＰＮ型のトランジスタからなる第２のスイッチ
ング素子Ｌの制御極たるベースにベース電流が流れてス
イッチング素子Ｔ２はオン状態となるとともに、逆に第
１の、ＰＮＰ型のトランジスタからなるスイッチング素
子Ｔ，はオフ状態となる。その結果コンデンサＣ，の充
電電荷がスイッチング素子Ｔ２を介して放電されること
になる。電源電圧が更に上昇して、入力トランジスタＴ
４のベース電位がツェナーダイオードＺＤのツェナー電
圧Ｖｚｏに達すると、ツヱナータイオードＺＤが導通し
入力トランジスタＴ４のベース電位をツェナータィオー
ドＺＤのツェナー電圧Ｖｚ。に固定する。従ってシュミ
ットトリガ回路１の入力トランジスタＬのベース・ェミ
ッタ間電圧とェミツタ抵抗欠３における電圧降下との合
計が前記ッェナーダィオード血のッェナ‐電圧Ｖ２ｏに
達するとべ−ス電流が流れなくなってトランジスタＬは
カットオフ状態となり、出力トランジスタｔのベースに
電流が流れ始めて出力トランジスタＴ３がオンしてのヱ
ミツタ電流を抵抗Ｒ３に流し入力トランジスタＴｒ４の
オフ状態を保持させるのである。つまりシュミットトリ
ガ回路１は反転する。このためスイッチング素子Ｔ，，
Ｌのベース電位がェミツタ電位より低くなってスイッチ
ング素子Ｔ，はオン状態となり、一方スイッチング素子
Ｔ２はオフ状態となる。このとき電源より、スイッチン
グ素子Ｔ，、ダイオードＤ８、コンデンサＣ，、双方向
安定リレーＲそｓの励滋コイルの回路を通じてコンデン
サＣ，に急激に充蚤々流が流れ、双安定リレーＲそｓは
励滋されて動作する。次いで電源電圧が低下して「 シ
ュミットトリガ回路１の入力トランジスタＴ４のベース
電位がツヱナーダィオード電圧Ｖ２Ｄより低下すると、
ッェナータィオードＺＤは導通しなくなり、従って入力
トランジスタＬのベース電位は電源電圧に応じて変化し
、入力トランジスタＴ４のベース電位が入力トランジス
タＴ４のェミッタ電位より高くなると、入力トランジス
タＬのベースにベース電流が流れてオン動作する。この
オンド作によって出力トランジスタＴ４のベース電位は
ェミツタ電位よりも低くなり、その結果出力トランジス
タＴ３はオフ状態となる。つまりシュミットトリガ回路
１は反転したことになり、この結果スイッチング素子Ｔ
，はオフ状態となり、スイッチング素子Ｔ２はオン状態
となる。このことによって「 コンデンサＣ，の充電々
荷は、スイッチング素子Ｌ、双安定リレーＲそｓの励滋
コイルを介して急激に放電され、双安走りレ−Ｒ〆ｓは
元に反転動作する。このようにかかる従来例は電源電圧
を下降、上昇させて双方安リレーＲそｓをシュミットト
リガ回路１の動作にて駆動することができきるものであ
るが、シュミットトリガ回路１の出力トランジスタｔが
オフのとき、スイッチング素子Ｔ，がオフで、スイッチ
ング素子Ｔ２がオンの動作が保証されないという恐れが
あった。即ちスイッチング素子Ｌのベース電流によるコ
レクタ抵抗Ｒ，の電圧降下により、スイッチング素子Ｔ
，は順バイアス電流が抵抗Ｒ４を介して流れてしまい入
力電流はスイッチング素子Ｔ，，Ｔ２を通って短絡して
しまうという欠点があった。尚ダイオードＤ５はコレク
タ抵抗Ｒ，、抵抗Ｒ２を通じてコンデンサＣ，が徐々に
充電されることを防止するためのものであり、またダイ
オードＤＢ，Ｄ７はスイッチング素子Ｔ２のェミツタ電
位が出力トランジスタ公が導適状態になった場合にその
コレクタ電位を越えているように、いいかえればスイッ
チング素子Ｔ２が確実に阻止状態となるように設定する
ものである。コンデンサＣ２は電源電圧（励滋電圧）の
変化が激しくても、シュミットトリガ回路１の確実な動
作を確保するためのものである。Ｒ５〜Ｒ８は夫々抵抗
である。本発明は上述の欠点に鑑みて為したもので、そ
の目的とするところは、安定した動作が得られて誤動作
が生じる恐れがない双安定リレー制御回路を提供するに
ある。
以下本発明を実施例回路によって説明する。第２図は一
実施例回路を示し、同図中第１図回路と同一番号又は記
号の回路、素子は同様な構成、作用を有するものである
。コレクタ抵抗Ｒ，と、シュミットトリガ回路１の出力
トランジスタＴ３のコレク夕との間には、出力トランジ
スタＴ３の順万向に第１のダイオード○，を直列接続し
、更に、出力トランジスタＴ３のコレクタと、第１のス
イッチング素子Ｔ，の制御極たるベースとの間には抵抗
公４と「 順方向の第２のダイオードＤ２との直列回路
を接続している。またコレクタ抵抗Ｒ，と第１のダイオ
ードＤ，のアノードとの接続点を順方向の第３のダイオ
ードＤ３と、抵抗Ｒ２とを介して第２のスイッチング素
子Ｌのべ−スに援続している。また抵抗Ｒ２と第３のダ
イオードＤ３のカソードとの接続点を第２のダイオード
Ｄ２のアノード‘と第４のダイオードＤ４を介して接続
しており、この第４のダイオードＤ４は両スイッチング
素子Ｔ，，Ｌのベースに対して逆方向接続となっている
。しかしてスイッチング素子Ｔ，がオンするとき、即ち
ベース電流が流れるときはシュミットトリガ回路１の出
力トランジスタｔがオンするときのみとなり、例えば出
力トランジスタＴ３がオフして、コレクタ抵抗Ｒ，にス
イッチング素子Ｔ２のベース電流による電圧降下が生じ
てもスイッチング素子Ｔ，のベース電流はダイオードＤ
，，Ｄ４によって阻止されていることとなって誤動作す
ることがなくなるのである。尚双安定リレーＲ〆ｓの動
作は第１図回路と同様である。本発明は「第１のコンデ
ンサと双安定リレーの励滋コイルとの直列回路を単方向
型の第１のスイッチング素子と電源スイッチとを介して
電源入力機に接続するとともに、第１のスイッチング素
子に対して相補の第２のスイッチング素子を第１のコン
デンサと双安定リレーとの直列回路に並列接続し、電源
入力端に接続して電源電圧から導出した比較電圧を有す
るシュミットトリガ回路の出力トランジスタのコレクタ
と「 コレクタ抵抗との闇に順方向の第１のダイオード
を直列挿入し、出力トランジスタのコレクタと第１のス
イッチング素子の制御極との間にこの制御極に綾して順
方向の第２のダイオードＤ２を接続し、第１のダイオー
ドのァノードとコレクタ抵抗との接続点に第２のスイッ
チング素子の制御極を制御極に対して順方向の第３のダ
イオードを介して接続し、第１のスイッチング素子の制
御極と第２のスイッチング素子の制御極に対して逆方向
の第４のダイオードを接続し、前記電源スイッチを介し
て電源端子に第２のコンデンサを接続してあるので、シ
ュミットトリガ回路の動作によって双安定リレーを確実
に動作させることができるもので、その上第１乃至第４
のダィオー日こよって、シュミットトリガ回路の出力ト
ランジスタがオン動作するときのみ、第１のスイッチン
グ素子を順バイアスすることを保証できて、安定した動
作が得られるという効果を奏する。
実施例回路を示し、同図中第１図回路と同一番号又は記
号の回路、素子は同様な構成、作用を有するものである
。コレクタ抵抗Ｒ，と、シュミットトリガ回路１の出力
トランジスタＴ３のコレク夕との間には、出力トランジ
スタＴ３の順万向に第１のダイオード○，を直列接続し
、更に、出力トランジスタＴ３のコレクタと、第１のス
イッチング素子Ｔ，の制御極たるベースとの間には抵抗
公４と「 順方向の第２のダイオードＤ２との直列回路
を接続している。またコレクタ抵抗Ｒ，と第１のダイオ
ードＤ，のアノードとの接続点を順方向の第３のダイオ
ードＤ３と、抵抗Ｒ２とを介して第２のスイッチング素
子Ｌのべ−スに援続している。また抵抗Ｒ２と第３のダ
イオードＤ３のカソードとの接続点を第２のダイオード
Ｄ２のアノード‘と第４のダイオードＤ４を介して接続
しており、この第４のダイオードＤ４は両スイッチング
素子Ｔ，，Ｌのベースに対して逆方向接続となっている
。しかしてスイッチング素子Ｔ，がオンするとき、即ち
ベース電流が流れるときはシュミットトリガ回路１の出
力トランジスタｔがオンするときのみとなり、例えば出
力トランジスタＴ３がオフして、コレクタ抵抗Ｒ，にス
イッチング素子Ｔ２のベース電流による電圧降下が生じ
てもスイッチング素子Ｔ，のベース電流はダイオードＤ
，，Ｄ４によって阻止されていることとなって誤動作す
ることがなくなるのである。尚双安定リレーＲ〆ｓの動
作は第１図回路と同様である。本発明は「第１のコンデ
ンサと双安定リレーの励滋コイルとの直列回路を単方向
型の第１のスイッチング素子と電源スイッチとを介して
電源入力機に接続するとともに、第１のスイッチング素
子に対して相補の第２のスイッチング素子を第１のコン
デンサと双安定リレーとの直列回路に並列接続し、電源
入力端に接続して電源電圧から導出した比較電圧を有す
るシュミットトリガ回路の出力トランジスタのコレクタ
と「 コレクタ抵抗との闇に順方向の第１のダイオード
を直列挿入し、出力トランジスタのコレクタと第１のス
イッチング素子の制御極との間にこの制御極に綾して順
方向の第２のダイオードＤ２を接続し、第１のダイオー
ドのァノードとコレクタ抵抗との接続点に第２のスイッ
チング素子の制御極を制御極に対して順方向の第３のダ
イオードを介して接続し、第１のスイッチング素子の制
御極と第２のスイッチング素子の制御極に対して逆方向
の第４のダイオードを接続し、前記電源スイッチを介し
て電源端子に第２のコンデンサを接続してあるので、シ
ュミットトリガ回路の動作によって双安定リレーを確実
に動作させることができるもので、その上第１乃至第４
のダィオー日こよって、シュミットトリガ回路の出力ト
ランジスタがオン動作するときのみ、第１のスイッチン
グ素子を順バイアスすることを保証できて、安定した動
作が得られるという効果を奏する。
第１図は従釆例の回路図、第２図は本発明の一実施例の
回路図であり、１はシュミットトリガ回路、Ｓは電源ス
イッチ、Ｃ，，Ｃ２はコンデンサ、Ｔ，は第１のスイッ
チング素子、Ｔ２は第２のスイッチング素子、ＲＺｓは
双安定リレー、Ｔ３は出力トランジスタ、Ｒ，はコレク
タ抵抗、Ｄ，乃至Ｄ４はダイオードである。 第１図 第２図
回路図であり、１はシュミットトリガ回路、Ｓは電源ス
イッチ、Ｃ，，Ｃ２はコンデンサ、Ｔ，は第１のスイッ
チング素子、Ｔ２は第２のスイッチング素子、ＲＺｓは
双安定リレー、Ｔ３は出力トランジスタ、Ｒ，はコレク
タ抵抗、Ｄ，乃至Ｄ４はダイオードである。 第１図 第２図
Claims (1)
- １ 第１のコンデンサと双安定リレーの励滋コイルとの
直列回路を単方向型の第１のスイツチング素子と電源ス
イツチとを介して電源入力端に接続するとともに、第１
のスイツチング素子に対して相補の第２のスイツチング
素子を第１のコンデンサと、双安定リレーとの直列回路
に並列接続し、電源入力端に接続して電源電圧から導出
した比較電圧を有するシユミツトトリガ回路の出力トラ
ンジスタのコレクタと、コレクタ抵抗との間に順方向の
第１のダイオードを直列挿入し、出力トランジスタのコ
レクタと第１のスイツチング素子の制御極との間にこの
制御極に対して順方向の第２のダイオードを接続し、第
１のダイオードのアノードとコレクタ抵抗との接続点に
第２のスイツチング素子の制御極を制御極に対して順方
向の第３のダイオードを介して接続し、第１のスイツチ
ング素子の制御極と第２のスイツチング素子の制御極と
の間に各制御極に対して逆方向の第４のダイオードを接
続し、前記電源スイツチと介して電源端子に第２のコン
デンサを接続して成ることを特徴とする双安定リレー制
御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7306878A JPS606060B2 (ja) | 1978-06-15 | 1978-06-15 | 双安定リレ−制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7306878A JPS606060B2 (ja) | 1978-06-15 | 1978-06-15 | 双安定リレ−制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS54163668A JPS54163668A (en) | 1979-12-26 |
| JPS606060B2 true JPS606060B2 (ja) | 1985-02-15 |
Family
ID=13507643
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7306878A Expired JPS606060B2 (ja) | 1978-06-15 | 1978-06-15 | 双安定リレ−制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS606060B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62110456U (ja) * | 1985-12-28 | 1987-07-14 |
-
1978
- 1978-06-15 JP JP7306878A patent/JPS606060B2/ja not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62110456U (ja) * | 1985-12-28 | 1987-07-14 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS54163668A (en) | 1979-12-26 |
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