JPS6054009A - バス接続型プログラマブルコントロ−ラ - Google Patents
バス接続型プログラマブルコントロ−ラInfo
- Publication number
- JPS6054009A JPS6054009A JP16160283A JP16160283A JPS6054009A JP S6054009 A JPS6054009 A JP S6054009A JP 16160283 A JP16160283 A JP 16160283A JP 16160283 A JP16160283 A JP 16160283A JP S6054009 A JPS6054009 A JP S6054009A
- Authority
- JP
- Japan
- Prior art keywords
- bus
- main control
- port
- programmable controller
- register
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B19/00—Programme-control systems
- G05B19/02—Programme-control systems electric
- G05B19/18—Numerical control [NC], i.e. automatically operating machines, in particular machine tools, e.g. in a manufacturing environment, so as to execute positioning, movement or co-ordinated operations by means of programme data in numerical form
- G05B19/414—Structure of the control system, e.g. common controller or multiprocessor systems, interface to servo, programmable interface controller
- G05B19/4147—Structure of the control system, e.g. common controller or multiprocessor systems, interface to servo, programmable interface controller characterised by using a programmable interface controller [PIC]
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は数値制御装置のプログラマブルコントローラ
(以下、NC装置のPCと略称する)に関し、特に、N
C装置の主制御部とPCとの接続をバス接続型とするこ
とにより、配線の簡易化をすると共に主制御部とのコミ
ュニケーションを容易化したものである。
(以下、NC装置のPCと略称する)に関し、特に、N
C装置の主制御部とPCとの接続をバス接続型とするこ
とにより、配線の簡易化をすると共に主制御部とのコミ
ュニケーションを容易化したものである。
従来、PCは単体の独立したものとして制御盤に組込ま
れ広く使用されている。
れ広く使用されている。
しかし、上記PCをNCI置に組み込む際、接点入力及
び接点出力(DI、Do)モジュールを介して行なって
いたため、多数の盤内配線を必要とすると共に、PCと
NC装置とのコミュニケーションには多くの制約がある
という不都合があった。
び接点出力(DI、Do)モジュールを介して行なって
いたため、多数の盤内配線を必要とすると共に、PCと
NC装置とのコミュニケーションには多くの制約がある
という不都合があった。
この発明は上記不都合を解消するもので、NC装置の主
制御部とPCとの接続をバス接続型とすることにより、
配線の簡易化をすると共に主制御部とのコミュニケーシ
ョンを容易化できるバス接続型のPCを提供することを
目的とする。
制御部とPCとの接続をバス接続型とすることにより、
配線の簡易化をすると共に主制御部とのコミュニケーシ
ョンを容易化できるバス接続型のPCを提供することを
目的とする。
上記目的を達成するためのこの発明は、数値制御装置の
主制御部のバスとプログラマブルコントローラとの間に
I10ポートインタフェイスを設け、該■/○ポートイ
ンタフェイスに、前記主制御部から前記プログラマブル
コントローラを制御するだめのポートコントロールレジ
スタと、前記プログラマブルコントローラの内部動作情
報を主制御部に知らせるためのポートステータスレジス
タと、主制御部が前記プログラマブルコントローラのメ
モリエリアをアドレス指定するためのポートアドレスレ
ジスタと、データのやりとりを行なうためのポートデー
タレジスタと、前記主制御部のバス上での前記ポートコ
ントロールレジスタ、ポートステータスレジスタ、ポー
トアドレスレジスタ及びポートデータレジスタのアドレ
ッシングを行なうI10デコーダと、前記主制御部に対
して該主制御部のバス使用権を請求するDMAコントロ
ーラとを備えたことを特徴とするバス接続型プログラマ
ブルコントローラである。
主制御部のバスとプログラマブルコントローラとの間に
I10ポートインタフェイスを設け、該■/○ポートイ
ンタフェイスに、前記主制御部から前記プログラマブル
コントローラを制御するだめのポートコントロールレジ
スタと、前記プログラマブルコントローラの内部動作情
報を主制御部に知らせるためのポートステータスレジス
タと、主制御部が前記プログラマブルコントローラのメ
モリエリアをアドレス指定するためのポートアドレスレ
ジスタと、データのやりとりを行なうためのポートデー
タレジスタと、前記主制御部のバス上での前記ポートコ
ントロールレジスタ、ポートステータスレジスタ、ポー
トアドレスレジスタ及びポートデータレジスタのアドレ
ッシングを行なうI10デコーダと、前記主制御部に対
して該主制御部のバス使用権を請求するDMAコントロ
ーラとを備えたことを特徴とするバス接続型プログラマ
ブルコントローラである。
以下、この発明の実施例について図面を用いて詳説する
。
。
第1図はPCのブロック図を示す。NO装置1はホスト
CPtJ3により制御され、該ホストCPUのバス5、
DIモジュール7、及びDoモジュール9を介して図示
しない工作機械を制御している。一方、PCl 1は制
御部13とI10インタフェイス15とから成り、CP
U17のバス19はバスインタフェイス21を介して前
記小ストCPU3のバス5と接続している。
CPtJ3により制御され、該ホストCPUのバス5、
DIモジュール7、及びDoモジュール9を介して図示
しない工作機械を制御している。一方、PCl 1は制
御部13とI10インタフェイス15とから成り、CP
U17のバス19はバスインタフェイス21を介して前
記小ストCPU3のバス5と接続している。
制御部13はROM23、RAM25、UART27、
タイマ29、インタラブドコントローラ31を有する。
タイマ29、インタラブドコントローラ31を有する。
ROM23はPCのコントロールプログラム、テーブル
エリア及びシーケンスプログラム等記憶している。RA
M25はシーケンスデータエリア、PC内で処理しやず
い言語にコンパイルされたシーケンスプログラムエリア
、スタックワークエリア、主制御部からデータを読み書
きするためのVIEWエリアを有する。
エリア及びシーケンスプログラム等記憶している。RA
M25はシーケンスデータエリア、PC内で処理しやず
い言語にコンパイルされたシーケンスプログラムエリア
、スタックワークエリア、主制御部からデータを読み書
きするためのVIEWエリアを有する。
UARTは外部機器との通信を行なう時に使用する。タ
イマ2つはDMA周期をコントロールする。
イマ2つはDMA周期をコントロールする。
インタラブドコントローラ31はタイマ29からの信号
により割込み優先度を決定し、CPU17に割込みを発
生し、或いはマスクする。
により割込み優先度を決定し、CPU17に割込みを発
生し、或いはマスクする。
I10インタフェイス15は前記パスインタフェイス2
1と、バスタイミングコントローラ33、I10デコー
ダ35、DMAコントローラ37を有する。パスインタ
フェイス21はホストCPUのバス5をTTLレベルに
変換する。バスタイミングコントローラ33はホストの
CPIJバスからの信号のうち制御信号に基づいてパス
インタフェイス21、或いは前記I10デコーダ部を制
御する。I10デコーダ35はホストCPUのバス5上
でのポートコントロールレジスタ39、ボートステータ
スレジスタ41、ポートアドレスレジスタ43、ポート
データレジスタ45のアドレッシングを行なう。
1と、バスタイミングコントローラ33、I10デコー
ダ35、DMAコントローラ37を有する。パスインタ
フェイス21はホストCPUのバス5をTTLレベルに
変換する。バスタイミングコントローラ33はホストの
CPIJバスからの信号のうち制御信号に基づいてパス
インタフェイス21、或いは前記I10デコーダ部を制
御する。I10デコーダ35はホストCPUのバス5上
でのポートコントロールレジスタ39、ボートステータ
スレジスタ41、ポートアドレスレジスタ43、ポート
データレジスタ45のアドレッシングを行なう。
ポートコントロールレジスタ39は主制御部からPCを
制御するためのコマンドレジスタとじて使用する。ポー
トステータスレジスタ41はPCの内部状態を主制御部
に知らせる。ポートアドレスレジスタ43は主制御部が
PCのVIEWエリアの内容を読み、或いは書き込む際
のアドレス指定を行なうものである。ボートデータレジ
スタ45はボー′ドアドレスレジスタ43で指定された
アドレスの内容を保持する。DMAコントローラ37は
ホストCPUのバス5の使用権を要求し、許可がおりれ
ばそれをCPU17に知らせる。
制御するためのコマンドレジスタとじて使用する。ポー
トステータスレジスタ41はPCの内部状態を主制御部
に知らせる。ポートアドレスレジスタ43は主制御部が
PCのVIEWエリアの内容を読み、或いは書き込む際
のアドレス指定を行なうものである。ボートデータレジ
スタ45はボー′ドアドレスレジスタ43で指定された
アドレスの内容を保持する。DMAコントローラ37は
ホストCPUのバス5の使用権を要求し、許可がおりれ
ばそれをCPU17に知らせる。
上記構成によるPCllはマザーボードを使用すること
が可能であり、ホストCPUのバス5にコネクタにより
接続することが可能である。
が可能であり、ホストCPUのバス5にコネクタにより
接続することが可能である。
PCllのモード種別による動作を第2図フローチャー
トで説明する。PCI 1はポートコン1〜ロールレジ
スタ39のコマンドをステップ202で識別する。ホス
トCPUではプログラムをホストCPU3に転送するの
か、或いは、内部データをVIEWエリアへ送るのかく
モード1)、更にプログラムをコンパイルするのか、又
、或いは内部データをクリアするのか(モード2)命令
することができる。ステップ202でモード1が判断さ
れればステップ203に移り、転送か否かが判断される
。転送命令であればステップ204でホストCPUのバ
ス5にプログラムを送出する。ステップ203で転送で
ないと判断されればステップ205に移り内部データを
VIEWエリアへ送りステップ214に移る。
トで説明する。PCI 1はポートコン1〜ロールレジ
スタ39のコマンドをステップ202で識別する。ホス
トCPUではプログラムをホストCPU3に転送するの
か、或いは、内部データをVIEWエリアへ送るのかく
モード1)、更にプログラムをコンパイルするのか、又
、或いは内部データをクリアするのか(モード2)命令
することができる。ステップ202でモード1が判断さ
れればステップ203に移り、転送か否かが判断される
。転送命令であればステップ204でホストCPUのバ
ス5にプログラムを送出する。ステップ203で転送で
ないと判断されればステップ205に移り内部データを
VIEWエリアへ送りステップ214に移る。
ステップ202でモード2が判断されればステップ20
6に移る。ステップ206ではプログラムをコンパイル
するのか否かが判断され、コンパイル指令であればステ
ップ207でPCに適正な言語、或いは、ホストCPt
Jに適正な言語への翻訳を行なう。ステップ206でコ
ンパイルでないことが判断されればステップ208に移
り、内部データをクリアしステップ214へ移る。
6に移る。ステップ206ではプログラムをコンパイル
するのか否かが判断され、コンパイル指令であればステ
ップ207でPCに適正な言語、或いは、ホストCPt
Jに適正な言語への翻訳を行なう。ステップ206でコ
ンパイルでないことが判断されればステップ208に移
り、内部データをクリアしステップ214へ移る。
ステップ202でモード1、及び、モード2以外はモー
ド3として判断されステップ209に移る。ステップ2
09以下ではシーケンス作業がDMA方式で行なわれる
。即ち、ステップ209ではDMA周期をコントロール
するタイマ29の前処理を行ない、ステップ210で主
制御部バス上にあるDIモジュールから接点のオンオフ
情報をDMAで、前記PCの所定メモリエリアに取り込
む。ステップ211で全入力をワークゴーリアに転送し
ステップ212でシーケンス作業が行なわれる。ステッ
プ214でRAMのチェックを行なってステップ215
でエラーが検出されれば前記シーケンス作業実行時の演
算結果は出力せずステップ216でエラー処理を行なう
。ステップ215でエラーが発見されなければステップ
218で主制御部バス上にあるDoモジュールへ接点の
Aンオフ情報をDMAで転送する。次いで、ステップ2
19でタイマ29の後処理をして作業を終了する。
ド3として判断されステップ209に移る。ステップ2
09以下ではシーケンス作業がDMA方式で行なわれる
。即ち、ステップ209ではDMA周期をコントロール
するタイマ29の前処理を行ない、ステップ210で主
制御部バス上にあるDIモジュールから接点のオンオフ
情報をDMAで、前記PCの所定メモリエリアに取り込
む。ステップ211で全入力をワークゴーリアに転送し
ステップ212でシーケンス作業が行なわれる。ステッ
プ214でRAMのチェックを行なってステップ215
でエラーが検出されれば前記シーケンス作業実行時の演
算結果は出力せずステップ216でエラー処理を行なう
。ステップ215でエラーが発見されなければステップ
218で主制御部バス上にあるDoモジュールへ接点の
Aンオフ情報をDMAで転送する。次いで、ステップ2
19でタイマ29の後処理をして作業を終了する。
上記一実施例に示されるように、PCと主制御部とはD
I、Doモジュールを共有できるので、それぞれに必要
な情報の送受、その伯のコミュニケーション作業を容易
に行なうことができる。又、NG装置1とPCllとの
接続はバス接続型であり、この接続をコネクタにより行
なえば、配線作業は極めて容易となる。
I、Doモジュールを共有できるので、それぞれに必要
な情報の送受、その伯のコミュニケーション作業を容易
に行なうことができる。又、NG装置1とPCllとの
接続はバス接続型であり、この接続をコネクタにより行
なえば、配線作業は極めて容易となる。
この発明は特許請求の範囲の記載の通りの構成を有する
ので、NO波装置主制御部とPCとの接続をバス接続と
し、配線の簡易化をすることができると共に主制御部と
のコミュニケーションを容易化できるバス接続型のPC
を提供することができる。
ので、NO波装置主制御部とPCとの接続をバス接続と
し、配線の簡易化をすることができると共に主制御部と
のコミュニケーションを容易化できるバス接続型のPC
を提供することができる。
なお、この発明は上記実施例に限定されるものではなく
、適宜の設計的変更を行なうことにより、その他の態様
でも実施できるものである。
、適宜の設計的変更を行なうことにより、その他の態様
でも実施できるものである。
添付図面はこの発明の一実施例を示し、第1図はPCの
ブロック図、第2図はPCの動作を示すフローチャート
。 1・・・NO波装置 3・・・ホストCPU5・・・ボ
ストCPUのバス
ブロック図、第2図はPCの動作を示すフローチャート
。 1・・・NO波装置 3・・・ホストCPU5・・・ボ
ストCPUのバス
Claims (1)
- 数値制御装置の主制御部のバスとプログラマブルコント
ローラとの間にI10ボートインタフェイスを設け、該
I10ポートインタフェイスに、前記主制御部から前記
プログラマブルコントローラを制御するためのポートコ
ントロールレジスタと、前記プログラマブルコントロー
ラの内部動作情報を主制御部に知らせるためのポートス
テータスレジスタと、主制御部が前記プログラマブルコ
ントローラのメモリエリアをアドレス指定するためのポ
ートアドレスレジスタと、データのやりとりを行なうた
めのポートデータレジスタと、前記主制御部のバス上で
の前記ポートコントロールレジスタ、ポートステータス
レジスタ、ポートアドレスレジスタ及びボートデータレ
ジスタのアドレッシングを行なうI10デコーダと、前
記主制御部に対して該主制御部のバス使用権を要求する
DMAコントローラとを備えたことを特徴とするバス接
続型プログラマブルコントローラ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16160283A JPS6054009A (ja) | 1983-09-02 | 1983-09-02 | バス接続型プログラマブルコントロ−ラ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP16160283A JPS6054009A (ja) | 1983-09-02 | 1983-09-02 | バス接続型プログラマブルコントロ−ラ |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6054009A true JPS6054009A (ja) | 1985-03-28 |
Family
ID=15738272
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP16160283A Pending JPS6054009A (ja) | 1983-09-02 | 1983-09-02 | バス接続型プログラマブルコントロ−ラ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6054009A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0332710A1 (en) * | 1987-09-02 | 1989-09-20 | Fanuc Ltd. | Spindle control method |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5636709A (en) * | 1979-09-04 | 1981-04-10 | Fanuc Ltd | Numerical control system |
JPS56153407A (en) * | 1980-04-30 | 1981-11-27 | Toshiba Corp | Sequential control device |
JPS5824926A (ja) * | 1981-08-07 | 1983-02-15 | Hitachi Ltd | プログラマブルコントロ−ルシステム |
JPS5851301A (ja) * | 1981-09-22 | 1983-03-26 | Fanuc Ltd | プログラマブルシ−ケンスコントロ−ラ |
-
1983
- 1983-09-02 JP JP16160283A patent/JPS6054009A/ja active Pending
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5636709A (en) * | 1979-09-04 | 1981-04-10 | Fanuc Ltd | Numerical control system |
JPS56153407A (en) * | 1980-04-30 | 1981-11-27 | Toshiba Corp | Sequential control device |
JPS5824926A (ja) * | 1981-08-07 | 1983-02-15 | Hitachi Ltd | プログラマブルコントロ−ルシステム |
JPS5851301A (ja) * | 1981-09-22 | 1983-03-26 | Fanuc Ltd | プログラマブルシ−ケンスコントロ−ラ |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
EP0332710A1 (en) * | 1987-09-02 | 1989-09-20 | Fanuc Ltd. | Spindle control method |
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