JPS60241363A - 読取制御回路 - Google Patents
読取制御回路Info
- Publication number
- JPS60241363A JPS60241363A JP59096403A JP9640384A JPS60241363A JP S60241363 A JPS60241363 A JP S60241363A JP 59096403 A JP59096403 A JP 59096403A JP 9640384 A JP9640384 A JP 9640384A JP S60241363 A JPS60241363 A JP S60241363A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明はファクシミリ装置に係り、特に中間調およびカ
ラー信号読取に好適な読取制御回路に関する。
ラー信号読取に好適な読取制御回路に関する。
最近のファクシミリ装置では、主走査画面を一ラインＷ
咲オるスピードが本々短縮されて来ており、現在では一
ライン数ミリ秒で電送するファクシミリ装置も出現して
いる。ところで、以上のように２１６ｍ幅原稿−ライン
を８本／−の分解能で読取った場合、 １７２Ｂ画素で
しかもカラー信号（中間調）を読み取るためには、１画
素を階調情報で表わす必要がある。また、読取りセンサ
ーの白黒レベルのバラツキおよび感度補正等の処理を行
う必要がある。したがって、１画素を数マイクロ秒内に
全ての処理を行う必要があるために、マイクロプロセッ
サ−等の適用できる範囲ではなく、また従来はハードロ
ジックで構成されており、構成が大がかりとなりしかも
、拡張性に欠けると言う欠点があった。
咲オるスピードが本々短縮されて来ており、現在では一
ライン数ミリ秒で電送するファクシミリ装置も出現して
いる。ところで、以上のように２１６ｍ幅原稿−ライン
を８本／−の分解能で読取った場合、 １７２Ｂ画素で
しかもカラー信号（中間調）を読み取るためには、１画
素を階調情報で表わす必要がある。また、読取りセンサ
ーの白黒レベルのバラツキおよび感度補正等の処理を行
う必要がある。したがって、１画素を数マイクロ秒内に
全ての処理を行う必要があるために、マイクロプロセッ
サ−等の適用できる範囲ではなく、また従来はハードロ
ジックで構成されており、構成が大がかりとなりしかも
、拡張性に欠けると言う欠点があった。
本発明の目的は、拡張性に富みしかも安価なカラー信号
をも可能とする読取制御回路を提供することにある。
をも可能とする読取制御回路を提供することにある。
本発明は読取装置全体を制御するためのマイコンを設置
し、白、黒レベル補正用のメモリ。
し、白、黒レベル補正用のメモリ。
感度補正用のメモリ、読取りデータを格納するメモリ間
をダイレクトメモリアクセス素子を用いて接続し、これ
らをマイコンにより転送方向順序を制御し、メモリ間の
転送を行う際の切替器等を削除したものである。
をダイレクトメモリアクセス素子を用いて接続し、これ
らをマイコンにより転送方向順序を制御し、メモリ間の
転送を行う際の切替器等を削除したものである。
以下本発明を図に示す一実施例により説明する。図にお
いて、１はカラー原稿よりＲＧＢの３色成分情報を読み
取るセンサーユニット、４はセンサーユニット１からの
データとインターフェースするためのバッファーゲート
、５はイニシャル時の暗時センサーデータを格納するた
めのメモ１１） ７Ｒ，７Ｇ、 ７Ｂ （各色で７Ｒは
Ｒ成分のメモリ７ＧはＧ成分、７ＢはＢ成分メモリを示
す）に書き込みを行う時に使用するゲート回路、６は六
ツファーゲート４から入力される読取データからメモリ
７Ｒ，７Ｇ、 ７Ｂの暗時センサーデータを減算し信号
成分を取りだすための減算器、８Ｒ，８Ｇ、 ８ＢはＲ
，Ｇ、Ｂ各成分のイニシャル時の最大振幅時データを格
納するメモリである。９は減算器６の出カバス薯と最大
振幅データバスＣとをつなぐゲート回路、１０は掛は算
器１１からの開時の最大振幅が一定となるようにメモリ
８Ｒ，８Ｇ、および８Ｂからのデータを補正した補正デ
ータを格納している感度補正メモリ、１２Ｒ，１２Ｇ、
１２Ｂは掛は算器１１から出力される感度補正された
センサー出力データを格納するメモリである。また、前
記メモリ１２’Ｒ，１２’Ｇ、１２’Ｂは前記メモリ１
２Ｒ，１２Ｇ、 １２Ｂと同じメモリである。メモリ１
２Ｒ，１２Ｇ、 １２Ｂとメモリ１２に、１２′Ｇ、１
２′Ｂはセンサーデータの格納と制御部１４への読出し
を交互に行う。１５は色補正用および階調情報に符号化
するための色補正頭である。また、２は読取制御用のＣ
ＰＵ、５はメモリ間のデータ転送を制御するダイレクト
メモリアクセス素子（以後１釦とする）７は頂試３のパ
スラインとＣＰＯ２間を接続するゲート回路である。
いて、１はカラー原稿よりＲＧＢの３色成分情報を読み
取るセンサーユニット、４はセンサーユニット１からの
データとインターフェースするためのバッファーゲート
、５はイニシャル時の暗時センサーデータを格納するた
めのメモ１１） ７Ｒ，７Ｇ、 ７Ｂ （各色で７Ｒは
Ｒ成分のメモリ７ＧはＧ成分、７ＢはＢ成分メモリを示
す）に書き込みを行う時に使用するゲート回路、６は六
ツファーゲート４から入力される読取データからメモリ
７Ｒ，７Ｇ、 ７Ｂの暗時センサーデータを減算し信号
成分を取りだすための減算器、８Ｒ，８Ｇ、 ８ＢはＲ
，Ｇ、Ｂ各成分のイニシャル時の最大振幅時データを格
納するメモリである。９は減算器６の出カバス薯と最大
振幅データバスＣとをつなぐゲート回路、１０は掛は算
器１１からの開時の最大振幅が一定となるようにメモリ
８Ｒ，８Ｇ、および８Ｂからのデータを補正した補正デ
ータを格納している感度補正メモリ、１２Ｒ，１２Ｇ、
１２Ｂは掛は算器１１から出力される感度補正された
センサー出力データを格納するメモリである。また、前
記メモリ１２’Ｒ，１２’Ｇ、１２’Ｂは前記メモリ１
２Ｒ，１２Ｇ、 １２Ｂと同じメモリである。メモリ１
２Ｒ，１２Ｇ、 １２Ｂとメモリ１２に、１２′Ｇ、１
２′Ｂはセンサーデータの格納と制御部１４への読出し
を交互に行う。１５は色補正用および階調情報に符号化
するための色補正頭である。また、２は読取制御用のＣ
ＰＵ、５はメモリ間のデータ転送を制御するダイレクト
メモリアクセス素子（以後１釦とする）７は頂試３のパ
スラインとＣＰＯ２間を接続するゲート回路である。
本発明のカラー読取制御回路は、以上のように構成され
ており、電源オン時、センサーユニット１の各画素毎お
よびＲ，Ｇ、Ｂ光源点灯時のイニシャル情報（暗時信号
レベル及び開時最振幅信号）を各々のメモリ７Ｒ，７Ｇ
、 ７Ｂに読み取る。動作としては、まず、ＣＰＵ２よ
りセンサーユニット１に内蔵の赤色光源の消灯指示を出
力して消灯させ、スタート信号をセンサーユニット１に
出力し、読取りを開始する。センサーから読み出された
データはセンサーユニット１でＡ／Ｄ変換されたデーｊ
としてバッファーゲート４に入力される。前記バッファ
ーゲート４から出力さねたセンサーデータはＣＰｔＪ２
によりイニシャル時ＣＰＵ２からの指令であらかじめバ
ッファーゲート４を介してメモリ７Ｒへの転送指示をＤ
ＭＡＣ５にセットしておく。また、ＣＰＵ２はゲート回
路５にバスαとバス薯との接続指示を行う。ＤＭＡＣ５
はこの指示を受けるとメモリ７Ｒのレジスタアドレスを
アドレスバスｅに出力する。それと同時にコントロール
信号（リード、ライト信号）を出力しセンサーユニット
１のセンサーデータをバッファーゲート４およびゲート
回路５を通して入力される暗時データをメモリ７Ｒに書
き込む。また、ＤＭＡＣ５はセンサー読み取りクロック
によりアドレス更新を行い、アドレスバスｅに更新され
たアドレスを出力し次々にメモリに書き込んで行く。１
７２８画素分をメモリ７Ｈに格納するとＩｍｃ３は０返
釦は転送データ数をカウントしている） ＣＰＵ２に対
し読取完了信号を出力する。読取完了信号なＣＰＵ２が
受信すると、次にＧ成分Ｂ成分のメモリイニシャルを行
う。動作は上記メモリ７Ｒに転送したと同様の動作によ
り行う。次にＲ，Ｇ、Ｂ各成分の最大振幅をメモ’）
８Ｒ，８Ｇ、 ８Ｂに書き込む。動作としては、まず、
ＣＰＵ２よりＤＭＭＪに対して転送アドレスをメモリ８
Ｒのスタートアドレスとストップアドレスとをセットす
る。次にゲート回路５を閉じてバスα、Ｃを切りはなす
。
ており、電源オン時、センサーユニット１の各画素毎お
よびＲ，Ｇ、Ｂ光源点灯時のイニシャル情報（暗時信号
レベル及び開時最振幅信号）を各々のメモリ７Ｒ，７Ｇ
、 ７Ｂに読み取る。動作としては、まず、ＣＰＵ２よ
りセンサーユニット１に内蔵の赤色光源の消灯指示を出
力して消灯させ、スタート信号をセンサーユニット１に
出力し、読取りを開始する。センサーから読み出された
データはセンサーユニット１でＡ／Ｄ変換されたデーｊ
としてバッファーゲート４に入力される。前記バッファ
ーゲート４から出力さねたセンサーデータはＣＰｔＪ２
によりイニシャル時ＣＰＵ２からの指令であらかじめバ
ッファーゲート４を介してメモリ７Ｒへの転送指示をＤ
ＭＡＣ５にセットしておく。また、ＣＰＵ２はゲート回
路５にバスαとバス薯との接続指示を行う。ＤＭＡＣ５
はこの指示を受けるとメモリ７Ｒのレジスタアドレスを
アドレスバスｅに出力する。それと同時にコントロール
信号（リード、ライト信号）を出力しセンサーユニット
１のセンサーデータをバッファーゲート４およびゲート
回路５を通して入力される暗時データをメモリ７Ｒに書
き込む。また、ＤＭＡＣ５はセンサー読み取りクロック
によりアドレス更新を行い、アドレスバスｅに更新され
たアドレスを出力し次々にメモリに書き込んで行く。１
７２８画素分をメモリ７Ｈに格納するとＩｍｃ３は０返
釦は転送データ数をカウントしている） ＣＰＵ２に対
し読取完了信号を出力する。読取完了信号なＣＰＵ２が
受信すると、次にＧ成分Ｂ成分のメモリイニシャルを行
う。動作は上記メモリ７Ｒに転送したと同様の動作によ
り行う。次にＲ，Ｇ、Ｂ各成分の最大振幅をメモ’）
８Ｒ，８Ｇ、 ８Ｂに書き込む。動作としては、まず、
ＣＰＵ２よりＤＭＭＪに対して転送アドレスをメモリ８
Ｒのスタートアドレスとストップアドレスとをセットす
る。次にゲート回路５を閉じてバスα、Ｃを切りはなす
。
それと同時に、バス善とｄの接続をゲート９を制御する
ことにより実行する。次に、ＣＰＵ２からセンサーユニ
ット１に対してＲの光源点灯指示が出力される。以上の
セットが完了すると、前記センサーユニット１とＤＭＡ
Ｃｓに対して読取開始指令を出力する。前記指令により
、センサーユニット１は読取りを開始する。一方ＤＭＡ
Ｃ５はメモリ８Ｒのアドレスを出力する。（ただしメモ
リ７Ｒ，８Ｒ，１２Ｒ，１２Ｒは同じアドレスとしアド
レスコントロール回路６によりメモリ８Ｒを選択する。
ことにより実行する。次に、ＣＰＵ２からセンサーユニ
ット１に対してＲの光源点灯指示が出力される。以上の
セットが完了すると、前記センサーユニット１とＤＭＡ
Ｃｓに対して読取開始指令を出力する。前記指令により
、センサーユニット１は読取りを開始する。一方ＤＭＡ
Ｃ５はメモリ８Ｒのアドレスを出力する。（ただしメモ
リ７Ｒ，８Ｒ，１２Ｒ，１２Ｒは同じアドレスとしアド
レスコントロール回路６によりメモリ８Ｒを選択する。
）センサーユニット１より読み出された信号はバッファ
ーゲート４を介して減算器６に入力される。一方、メモ
リ７Ｒと８Ｒは同じアドレスにセットされているのでメ
モリ７Ｒが選択されて、メモリ７Ｒより暗時出力データ
が減算器６に出力される。前記減算器６ではバッファー
ゲート４から入力されるセンサーデータからメモリ７Ｒ
の暗時出力を差し引いて信号成分のみをバスネに出力す
る。バスにの信号はゲート回路９を通り、バスｄに出力
され、メモリ８Ｒに格納される。また、１緩６はセンサ
ーユニット１からのデータ転送用クロックによりアドレ
ス更新を行い１７２８画集転送終了するとＣＰＵ２に読
取り終了信号を出力して読取り動作を終了する。Ｒ成分
の最大出力データを格納すると次にＧ成分、Ｂ成分と上
記動作によりイニシャルを行う。
ーゲート４を介して減算器６に入力される。一方、メモ
リ７Ｒと８Ｒは同じアドレスにセットされているのでメ
モリ７Ｒが選択されて、メモリ７Ｒより暗時出力データ
が減算器６に出力される。前記減算器６ではバッファー
ゲート４から入力されるセンサーデータからメモリ７Ｒ
の暗時出力を差し引いて信号成分のみをバスネに出力す
る。バスにの信号はゲート回路９を通り、バスｄに出力
され、メモリ８Ｒに格納される。また、１緩６はセンサ
ーユニット１からのデータ転送用クロックによりアドレ
ス更新を行い１７２８画集転送終了するとＣＰＵ２に読
取り終了信号を出力して読取り動作を終了する。Ｒ成分
の最大出力データを格納すると次にＧ成分、Ｂ成分と上
記動作によりイニシャルを行う。
イニシャルが終了し、ファクシミリ制御部１４より、読
取指令が入力されると、ＣＰＵ２は、前記イニシャル動
作と同様に頂釦３に対して転送アドレスをメモリ１２Ｒ
または１２′Ｒにセクトする。
取指令が入力されると、ＣＰＵ２は、前記イニシャル動
作と同様に頂釦３に対して転送アドレスをメモリ１２Ｒ
または１２′Ｒにセクトする。
次にゲート回路５，９はバスα−Ｃ間、 Ｊ−ｄ間を切
り離す。センサーユニット１に対し赤色光源点灯命令を
出力し、その後スタート指令を出力し、読取り動作を開
始する。センサーユニット１からのデータは、バッファ
ーゲート４を通して減算器６に入力され、該減算器６に
よりメモリ７Ｒの暗時出力を差し引いた出力Ｂを掛算器
１１に入力する。一方メモリ８Ｒからは開時の最大出力
信号が読み出され、感度補正用ＲＯＭ１０に出力する。
り離す。センサーユニット１に対し赤色光源点灯命令を
出力し、その後スタート指令を出力し、読取り動作を開
始する。センサーユニット１からのデータは、バッファ
ーゲート４を通して減算器６に入力され、該減算器６に
よりメモリ７Ｒの暗時出力を差し引いた出力Ｂを掛算器
１１に入力する。一方メモリ８Ｒからは開時の最大出力
信号が読み出され、感度補正用ＲＯＭ１０に出力する。
感度補正用ＲＯＭ１０には、掛は算器１１の出力が開時
最大振幅が一定になるように（−例としてＡ×α−一定
人＝明時出力電圧 α：係数）係数αを出力する。した
がって、掛げ算器１１によりＢ×αの掛算を行いその出
力をメモリ１２Ｒ（メモリ１２Ｒとメモリ１２′Ｒは一
ライン読取毎に交互に選択し使用する）に出力する。た
だし、掛算器１１の出力はトライステートコントロール
端子を持つ。また、同時に制御部１４に対しこのデータ
送出を行い、メモリー２’Ｒ（書き込みと同様メモリ１
２Ｒとメモリー２Ｒは交互に行５）よりデータ読出しを
行う。動作としては上記掛は算器１１からの出力をメモ
リー２Ｒに書き込む周期Ｔの１の前半を用いメモリー２
′Ｒのアドレスバスｅによリアドレスが選択され読出さ
れます。読出されたデータは１３０色補正用のＲＯＭ１
５に入力され、色補正を行った後制御部１４にカラー読
取データとして出力する。また、メモリー２′Ｒを読出
し中は掛は算器１１の出力はハイインピーダンス状態と
しておく。次に後半のｉ周期において、掛は算器１１の
出力を出力状態とし、メモリー２′Ｒはハイインピーダ
ンス状態として前記メモリー２Ｈにデータを格納する。
最大振幅が一定になるように（−例としてＡ×α−一定
人＝明時出力電圧 α：係数）係数αを出力する。した
がって、掛げ算器１１によりＢ×αの掛算を行いその出
力をメモリ１２Ｒ（メモリ１２Ｒとメモリ１２′Ｒは一
ライン読取毎に交互に選択し使用する）に出力する。た
だし、掛算器１１の出力はトライステートコントロール
端子を持つ。また、同時に制御部１４に対しこのデータ
送出を行い、メモリー２’Ｒ（書き込みと同様メモリ１
２Ｒとメモリー２Ｒは交互に行５）よりデータ読出しを
行う。動作としては上記掛は算器１１からの出力をメモ
リー２Ｒに書き込む周期Ｔの１の前半を用いメモリー２
′Ｒのアドレスバスｅによリアドレスが選択され読出さ
れます。読出されたデータは１３０色補正用のＲＯＭ１
５に入力され、色補正を行った後制御部１４にカラー読
取データとして出力する。また、メモリー２′Ｒを読出
し中は掛は算器１１の出力はハイインピーダンス状態と
しておく。次に後半のｉ周期において、掛は算器１１の
出力を出力状態とし、メモリー２′Ｒはハイインピーダ
ンス状態として前記メモリー２Ｈにデータを格納する。
以上の動作により次々とセンサーデータの読取り格納、
続出しを行い制御部１４にデータを転送する。
続出しを行い制御部１４にデータを転送する。
本実施例によれば、従来メモリ７Ｒ，７Ｇ、 ７Ｂ 、
８Ｒ。
８Ｒ。
８Ｇ、 ８Ｂ 、 １２Ｒ，１２Ｇ、 １２Ｂおよび１
２’Ｒ、１２’Ｇ、 １２’Ｂの各々にこれらを切替え
るための切替器アドレスカウンタ、アドレス切替器およ
びそれらを制御するための制御回路等の構成品数の低減
を計ることが可能である。また、プログラマブルにデー
タ転送が可能なため、感度補正および各種補正を行うた
めの制御の機能追加が容易に行うことができる。
２’Ｒ、１２’Ｇ、 １２’Ｂの各々にこれらを切替え
るための切替器アドレスカウンタ、アドレス切替器およ
びそれらを制御するための制御回路等の構成品数の低減
を計ることが可能である。また、プログラマブルにデー
タ転送が可能なため、感度補正および各種補正を行うた
めの制御の機能追加が容易に行うことができる。
本発明によれば、前記実施例でも述べたが回路構成物を
大幅に省略できるので経済的であり、しかも、新しい機
能追加に対しても拡張性をもつ等の効果を有する。
大幅に省略できるので経済的であり、しかも、新しい機
能追加に対しても拡張性をもつ等の効果を有する。
図は本発明の一実施例である読取制御回路のブロック図
である。 １・・・読取部（センサー）、 ２・・・ＣＰＵ。 ３・・・ＤＭＡＣ１４，５，９・・・ゲート、６・・・
減算器、 ７・・・メモリ、 ８・・・メモリ、 １０・・・感度補正層、１１・・・
掛算器、 １２．１２・・・メモリー、１３・・・色補
正圏、 １４ ・・・ファクシミリ制御部。 代理人弁理士 高 橋 明 夫
である。 １・・・読取部（センサー）、 ２・・・ＣＰＵ。 ３・・・ＤＭＡＣ１４，５，９・・・ゲート、６・・・
減算器、 ７・・・メモリ、 ８・・・メモリ、 １０・・・感度補正層、１１・・・
掛算器、 １２．１２・・・メモリー、１３・・・色補
正圏、 １４ ・・・ファクシミリ制御部。 代理人弁理士 高 橋 明 夫
Claims (1)
- カラー信号読取用に用いる暗時のセンサデータを格納す
るメモリと、開時の最大振幅値データを格納するメモリ
と、読取データを格納するメモリと、色信号補正用の減
算器掛算器等よりなるファクシミリカラー信号読取制御
回路において、前記メモリ間を直接メモリ間転送制御素
子を用いて接続し、該素子を制御することで転送方向、
順序等を制御するようにしたことを特徴とする読取制御
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59096403A JPS60241363A (ja) | 1984-05-16 | 1984-05-16 | 読取制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59096403A JPS60241363A (ja) | 1984-05-16 | 1984-05-16 | 読取制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60241363A true JPS60241363A (ja) | 1985-11-30 |
Family
ID=14163993
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59096403A Pending JPS60241363A (ja) | 1984-05-16 | 1984-05-16 | 読取制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60241363A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62291256A (ja) * | 1986-06-10 | 1987-12-18 | Canon Inc | 画像読取装置 |
-
1984
- 1984-05-16 JP JP59096403A patent/JPS60241363A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62291256A (ja) * | 1986-06-10 | 1987-12-18 | Canon Inc | 画像読取装置 |
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