JPS60226244A - 通信制御装置 - Google Patents
通信制御装置Info
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- JPS60226244A JPS60226244A JP59081795A JP8179584A JPS60226244A JP S60226244 A JPS60226244 A JP S60226244A JP 59081795 A JP59081795 A JP 59081795A JP 8179584 A JP8179584 A JP 8179584A JP S60226244 A JPS60226244 A JP S60226244A
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- 238000004891 communication Methods 0.000 title claims description 10
- 230000005540 biological transmission Effects 0.000 claims abstract description 22
- 238000006243 chemical reaction Methods 0.000 claims description 31
- 238000001514 detection method Methods 0.000 claims description 11
- 239000000284 extract Substances 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 8
- 238000000034 method Methods 0.000 description 6
- 230000006870 function Effects 0.000 description 2
- 239000000463 material Substances 0.000 description 2
- 239000000779 smoke Substances 0.000 description 2
- KRQUFUKTQHISJB-YYADALCUSA-N 2-[(E)-N-[2-(4-chlorophenoxy)propoxy]-C-propylcarbonimidoyl]-3-hydroxy-5-(thian-3-yl)cyclohex-2-en-1-one Chemical compound CCC\C(=N/OCC(C)OC1=CC=C(Cl)C=C1)C1=C(O)CC(CC1=O)C1CCCSC1 KRQUFUKTQHISJB-YYADALCUSA-N 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/28—Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
- H04L12/40—Bus networks
- H04L12/407—Bus networks with decentralised control
- H04L12/413—Bus networks with decentralised control with random access, e.g. carrier-sense multiple-access with collision detection [CSMA-CD]
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Small-Scale Networks (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、複数の装置が同時に送信可能な伝送媒体を用
いた通信システムの通信制御装置に係り、特に各装置の
自己アドレスにより伝送媒体上における優先度が決定さ
れる通信制御装置に関するものである。
いた通信システムの通信制御装置に係り、特に各装置の
自己アドレスにより伝送媒体上における優先度が決定さ
れる通信制御装置に関するものである。
マイクロコンビーータを内蔵した家電製品の普及に伴い
、家庭内における各種装置を相互に接続して集中制御等
を行なう、いわゆるホームオートメ−シロンシステムが
種々提案されている・その１つとして、ＫＥＣ（関西電
子工業振興センター）からホームバスシステム（ＨＢＳ
）の標準他案が発表されている。これは、１９８３年９
月３０日の電気学会、システム・制御研究会における資
料番号Ｓ Ｃ−８３−４１の村山、滑用９１Ｂｓ（ホー
ムバスシステム）について」に述べられている０さらに
、このシステムのベースバンドにおける制御手順及び衝
突検出につ゛いては、１９８３年１０月７日の電子工業
技術大会。
、家庭内における各種装置を相互に接続して集中制御等
を行なう、いわゆるホームオートメ−シロンシステムが
種々提案されている・その１つとして、ＫＥＣ（関西電
子工業振興センター）からホームバスシステム（ＨＢＳ
）の標準他案が発表されている。これは、１９８３年９
月３０日の電気学会、システム・制御研究会における資
料番号Ｓ Ｃ−８３−４１の村山、滑用９１Ｂｓ（ホー
ムバスシステム）について」に述べられている０さらに
、このシステムのベースバンドにおける制御手順及び衝
突検出につ゛いては、１９８３年１０月７日の電子工業
技術大会。
コンファレンス３Ａホームオートメーシヨンシステム資
料９本田著「ＨＢＳのベースバンドについて」の貞３Ａ
−２−５，５に−２−６に詳しく述べられている・この
ＨＢＳ方式を実現する回路ブロック図は第１図のように
なっており、図において、１は演算処理装置（以下、Ｃ
ＰＵと略す）、２は並列データを直列データに変換して
ホームバスへ出力したり、ホームバス上の直列データを
並列データに変換したりするシリアルインターフェース
回路、３はバス上の衝突検出と送信制御を行なう送信制
御回路、４は自己アドレス設定用スイッチ、５はステー
トバッファ、６はスイッチオフ時にもハイレベルヲ保つ
ための抵抗、７はデータバス、８はホームバスなどのパ
スラインである。このようなホームバスシステムでは、
接続する装置が容易に増減できるよう＆こ、各装置に自
己アドレス設定用スイッチ４が付いており、装置をホー
ムバスに接続する時にユーザが自由に設定できる構成と
なっている。今、ある情報をホームバス８に送出して他
の装置へ送る場合を考えると、まず、ＣＰＵ１はスイッ
チ４で設定された自己アドレス（第１図では１６進の５
３に設定されている）をバッファ５を通して読み取る。
料９本田著「ＨＢＳのベースバンドについて」の貞３Ａ
−２−５，５に−２−６に詳しく述べられている・この
ＨＢＳ方式を実現する回路ブロック図は第１図のように
なっており、図において、１は演算処理装置（以下、Ｃ
ＰＵと略す）、２は並列データを直列データに変換して
ホームバスへ出力したり、ホームバス上の直列データを
並列データに変換したりするシリアルインターフェース
回路、３はバス上の衝突検出と送信制御を行なう送信制
御回路、４は自己アドレス設定用スイッチ、５はステー
トバッファ、６はスイッチオフ時にもハイレベルヲ保つ
ための抵抗、７はデータバス、８はホームバスなどのパ
スラインである。このようなホームバスシステムでは、
接続する装置が容易に増減できるよう＆こ、各装置に自
己アドレス設定用スイッチ４が付いており、装置をホー
ムバスに接続する時にユーザが自由に設定できる構成と
なっている。今、ある情報をホームバス８に送出して他
の装置へ送る場合を考えると、まず、ＣＰＵ１はスイッ
チ４で設定された自己アドレス（第１図では１６進の５
３に設定されている）をバッファ５を通して読み取る。
ＫＥＣのＨＢＳ方式では前記文献にあるように、情報を
自己アドレス、相手アドレス、制御コード、データ数。
自己アドレス、相手アドレス、制御コード、データ数。
データ、フレームチェックコードから成るパケットとい
う形にして送信するため、この読み取った自己アドレス
を先頭に、パケットの各要素を次々にシリアルインター
フェース回路２に送り、ここで並列直列変換した後、ホ
ームバス８に順次送出される０この時、送信制御回路３
では、パケット先頭の自己アドレスによって、衝突検出
及び送信制御を行なうわけである０さて、ここでホーム
バス８上へ送るシリアルデータの順序を考えると、これ
にはＭ Ｓ Ｂ （ＭｏｓｔＳｉｇｎｉｆｉｃａｎｔ
Ｂｉｔ ：最上位ビット）から送る方法（以下、ＭＳＢ
送りという）と、ＬＳＢ （Ｌｅａｓｔ ５１ｇｎ１ｆ
ｉｃａｎｔ Ｂｉｔ ：最下位ビット）から送る方法（
以下、ＬＳＢ送りという）があるが、一般に市販されて
いるシリアルインターフェース用回路（例えば、日立部
ＨＤ６８５０などのＬ Ｓ’ Ｉ ）の多くがＬＳＢ送
りとなっていることから、ＫＥＣのＨＢＳ方式において
もＬＳＢ送りを採用している。ここで、ホームバス８上
での自己アドレスと優先度の関係を考える・この例では
このホームバス８上では信号ｖ′１′よりも″０′が優
先されるように設定されている。衝突検出回路３では、
ホームバス８上で伝送中の／＜ケラトから自己アドレス
をシリアルに取り込み、装置の自己アドレスと１ビツト
づつ比較する。
う形にして送信するため、この読み取った自己アドレス
を先頭に、パケットの各要素を次々にシリアルインター
フェース回路２に送り、ここで並列直列変換した後、ホ
ームバス８に順次送出される０この時、送信制御回路３
では、パケット先頭の自己アドレスによって、衝突検出
及び送信制御を行なうわけである０さて、ここでホーム
バス８上へ送るシリアルデータの順序を考えると、これ
にはＭ Ｓ Ｂ （ＭｏｓｔＳｉｇｎｉｆｉｃａｎｔ
Ｂｉｔ ：最上位ビット）から送る方法（以下、ＭＳＢ
送りという）と、ＬＳＢ （Ｌｅａｓｔ ５１ｇｎ１ｆ
ｉｃａｎｔ Ｂｉｔ ：最下位ビット）から送る方法（
以下、ＬＳＢ送りという）があるが、一般に市販されて
いるシリアルインターフェース用回路（例えば、日立部
ＨＤ６８５０などのＬ Ｓ’ Ｉ ）の多くがＬＳＢ送
りとなっていることから、ＫＥＣのＨＢＳ方式において
もＬＳＢ送りを採用している。ここで、ホームバス８上
での自己アドレスと優先度の関係を考える・この例では
このホームバス８上では信号ｖ′１′よりも″０′が優
先されるように設定されている。衝突検出回路３では、
ホームバス８上で伝送中の／＜ケラトから自己アドレス
をシリアルに取り込み、装置の自己アドレスと１ビツト
づつ比較する。
１ビツトづつ比較していき不一致を検出した場合に装置
の自己アドレスの方が′１′であれば、その装置の方が
優先度が低いとしてシリアルインタフェース回路２から
のデータの送出を中止する〇 この場合に自己アドレスの順番と優先度の順番が一致し
なくなる・表１にその関係を示す。
の自己アドレスの方が′１′であれば、その装置の方が
優先度が低いとしてシリアルインタフェース回路２から
のデータの送出を中止する〇 この場合に自己アドレスの順番と優先度の順番が一致し
なくなる・表１にその関係を示す。
表１において自己アドレス０ＯＨ（Ｈは１６進を示す）
の優先度が１番高いが、２番目は８０Ｈ９３番目は４０
Ｈという具合になり、自己アドレスの順番と優先順位と
が必ずしも一致しない。
の優先度が１番高いが、２番目は８０Ｈ９３番目は４０
Ｈという具合になり、自己アドレスの順番と優先順位と
が必ずしも一致しない。
従って、このようなホームバスにユーザが優ｉ度を意識
して装置を接続しようとする際には、自己アドレスと優
先度との対応表などが必要となる０このことは、このシ
ステムのユーザの多くが専門家でないばかりでなく、主
婦や子供が扱うことも多いことなどを考えると、マンマ
シンインタフェース上、非常に操作性の悪いシステムと
なってしまう。
して装置を接続しようとする際には、自己アドレスと優
先度との対応表などが必要となる０このことは、このシ
ステムのユーザの多くが専門家でないばかりでなく、主
婦や子供が扱うことも多いことなどを考えると、マンマ
シンインタフェース上、非常に操作性の悪いシステムと
なってしまう。
表 １
これは例えば、火災検知器の自己アドレスを８０Ｈ，テ
レビの自己アドレス：２ ｏＨとして既に接続してあり
、新たに煙検知器をテレビより優先度を高くして接続す
る場合、設定すべきアドレスをユーザが直感的にわから
ないのである。
レビの自己アドレス：２ ｏＨとして既に接続してあり
、新たに煙検知器をテレビより優先度を高くして接続す
る場合、設定すべきアドレスをユーザが直感的にわから
ないのである。
このことは誤操作を招くばかりでなく、火災検知や煙検
知などのホームセキーリテイを行なう場合などには、大
きな問題となる虞れがある０まだ、これはホームバスシ
ステムにかかわらず、Ｉ！数の装置が同時に送信可能な
伝送媒体を用いた一般の通信システムにおいても、自己
アドレスを用いて送信制御を行なう場合には起こる問題
である〇 〔発明の目的〕 本発明の目的は、従来技術の欠点をなくし、自己アドレ
スの順番と伝送媒体上での優先順位とを一致させること
にある。
知などのホームセキーリテイを行なう場合などには、大
きな問題となる虞れがある０まだ、これはホームバスシ
ステムにかかわらず、Ｉ！数の装置が同時に送信可能な
伝送媒体を用いた一般の通信システムにおいても、自己
アドレスを用いて送信制御を行なう場合には起こる問題
である〇 〔発明の目的〕 本発明の目的は、従来技術の欠点をなくし、自己アドレ
スの順番と伝送媒体上での優先順位とを一致させること
にある。
本発明は、自己アドレス設定手段で設定された自己アド
レスを、ＬＳＢ送りのシリアルイン、タフエース回路か
らバスへシリアルデータトシて出力する際に、自己アド
レスを衝突検出回路でバスから取り込んだパケットの自
己アドレスと自己の装置の自己アドレスとを比較する場
合の優先順位と一致するように変換した後にシリアルイ
ンタフェース回路に人力する変換手段を設けたものであ
る０ 〔発明の実施例〕 以下、実施例をもとに本発明の詳細な説明するＯ 第２図が本発明の１実施例を示すプセツク図であるう図
において、第１図と同一部分は同一符号であり、９が本
発明にかかる要素ブロックのデータ変換回路である。既
に述べたように、ＬＳＢ送りのホームバス８上で自己ア
ドレスを用いて衝突検出及び送信制御を行なう場合、自
己アドレスの順番とバス上での優先順位とが必ずしも一
致しない。そこで、スイッチ４で設定された自己アドレ
スがバス上の優先順位と一致するように自己アドレスの
データ変換を変換回路９で行なうわけである。
レスを、ＬＳＢ送りのシリアルイン、タフエース回路か
らバスへシリアルデータトシて出力する際に、自己アド
レスを衝突検出回路でバスから取り込んだパケットの自
己アドレスと自己の装置の自己アドレスとを比較する場
合の優先順位と一致するように変換した後にシリアルイ
ンタフェース回路に人力する変換手段を設けたものであ
る０ 〔発明の実施例〕 以下、実施例をもとに本発明の詳細な説明するＯ 第２図が本発明の１実施例を示すプセツク図であるう図
において、第１図と同一部分は同一符号であり、９が本
発明にかかる要素ブロックのデータ変換回路である。既
に述べたように、ＬＳＢ送りのホームバス８上で自己ア
ドレスを用いて衝突検出及び送信制御を行なう場合、自
己アドレスの順番とバス上での優先順位とが必ずしも一
致しない。そこで、スイッチ４で設定された自己アドレ
スがバス上の優先順位と一致するように自己アドレスの
データ変換を変換回路９で行なうわけである。
次に変換回路９を実現する具体的な回路を説明する。本
発明に係る変換回路９を実現する最も筒車な回路は、第
３図に示すように、自己アドレスを示すデータ（Ｓφ〜
８７）の順序を逆にしてＣＰＵのデータバスＣＤφ〜Ｄ
７）に接続する回路である０すなわち、自己アドレスを
示すＳφビットをＣＰＵデータバスのＤ７ビツトに、自
己アドレスの８１をＣＰＵのＤ６に、という具合に接続
するわけであるパ従って例えば、第３図の場合にはスイ
ッチ４によって自己アドレスを５３Ｈと設定しているが
、ＣＰＵは変換されたＣＡＭを認識し、ホームバス８へ
送出するパケット先頭の自己アドレスはＣＡＨとするわ
けである。このように変換を行なった場合のホームバス
８上における設定した自己アドレスと優先度との関係は
、表２に示すよう６３なり、自己アドレスの順番と優先
順位とが一致する０ すなわち、自己アドレスｏｏＨの優先度が１番高く、０
１Ｈが２番目、そして、Ｆ’ＦＨの優先度が１番低くな
るわけである。この第４図の変換回路は簡単に実現でき
、自己アドレスと相手アドレスを単に設定して情報を送
るだけのような単純なシステムでは非常に有効なもので
ある。しかしながら、ＣＰＵ内部では変換後の自己アド
レスを認識するために、この順番とバス上の優先度は必
ずしも一致していない。そこで自己アドレスと送信アド
レスとの優先度を比較して送信を行なう場合などには、
ＣＰＵは複雑な処理が必要となる。第４図は、この問題
を解決する本発明の別の実施例である０ 第４図において、１０．１１は３ステートバツフア、１
２はインバータ、１３はＣＰＵからの変換回路９の制御
信号である。制御信号１３を世にして、バッフ１１０を
選択した場合には、第３図と同様の動作となる・一方、
制御信号１３をｒＬＪにして、バッファ１１を選択した
場合・ＣＰＵは設定した自己アドレスをそのまま読み込
むため、Ｉｂ−＝ ＣＰ Ｕ内部において自己アドレス
と優先度の関係を一致させることができる。そこで、ホ
ームバス上にデータを送信する場合の自己アドレスには
、制御信号１６をｒＨＪにして読み取った値を用い、Ｃ
ＰＵ内部における優先度の比較やその演算等には制御信
号１３をｒＬＪにして読み取った値を用いれば良いので
ある。
発明に係る変換回路９を実現する最も筒車な回路は、第
３図に示すように、自己アドレスを示すデータ（Ｓφ〜
８７）の順序を逆にしてＣＰＵのデータバスＣＤφ〜Ｄ
７）に接続する回路である０すなわち、自己アドレスを
示すＳφビットをＣＰＵデータバスのＤ７ビツトに、自
己アドレスの８１をＣＰＵのＤ６に、という具合に接続
するわけであるパ従って例えば、第３図の場合にはスイ
ッチ４によって自己アドレスを５３Ｈと設定しているが
、ＣＰＵは変換されたＣＡＭを認識し、ホームバス８へ
送出するパケット先頭の自己アドレスはＣＡＨとするわ
けである。このように変換を行なった場合のホームバス
８上における設定した自己アドレスと優先度との関係は
、表２に示すよう６３なり、自己アドレスの順番と優先
順位とが一致する０ すなわち、自己アドレスｏｏＨの優先度が１番高く、０
１Ｈが２番目、そして、Ｆ’ＦＨの優先度が１番低くな
るわけである。この第４図の変換回路は簡単に実現でき
、自己アドレスと相手アドレスを単に設定して情報を送
るだけのような単純なシステムでは非常に有効なもので
ある。しかしながら、ＣＰＵ内部では変換後の自己アド
レスを認識するために、この順番とバス上の優先度は必
ずしも一致していない。そこで自己アドレスと送信アド
レスとの優先度を比較して送信を行なう場合などには、
ＣＰＵは複雑な処理が必要となる。第４図は、この問題
を解決する本発明の別の実施例である０ 第４図において、１０．１１は３ステートバツフア、１
２はインバータ、１３はＣＰＵからの変換回路９の制御
信号である。制御信号１３を世にして、バッフ１１０を
選択した場合には、第３図と同様の動作となる・一方、
制御信号１３をｒＬＪにして、バッファ１１を選択した
場合・ＣＰＵは設定した自己アドレスをそのまま読み込
むため、Ｉｂ−＝ ＣＰ Ｕ内部において自己アドレス
と優先度の関係を一致させることができる。そこで、ホ
ームバス上にデータを送信する場合の自己アドレスには
、制御信号１６をｒＨＪにして読み取った値を用い、Ｃ
ＰＵ内部における優先度の比較やその演算等には制御信
号１３をｒＬＪにして読み取った値を用いれば良いので
ある。
第５図は、変換回路９としてＲＯＭ （助ａｄＯｎｌｙ
Ｍｅｍｏｒｙ ）を用いた場合の実施例である。
Ｍｅｍｏｒｙ ）を用いた場合の実施例である。
図は、５１２バイトのＲＯＭ （例えば、ＮＥＣ製μＰ
Ｂ４２５Ｃなど）を用いた場合で、スイッチ４で設定さ
れた自己アドレスをＲＯＭのアドレス端子（Ａφ〜Ａ７
）に接続する。ＲＯＭには、予め自己アドレスに対応す
る優先度を持つデータを記録しておけばよく、例えば、
第４図と同じ変換を行なうためには、表３に示すような
内容を書いておけばよいのである。すなわち、アドレス
の前半（ｏ ｏ ｏＨ〜ｏＦＦＨ）にはアドレスの下位
８ビツトの値をそのまま書き、後半には（１００Ｈ〜１
ＦＦＨ）アドレスの下位８ピツトのビット列の順番を逆
にした値を書いておくのである０このように変換回路９
としてＲＯＭを用いた場合には、その内容によって自己
アドレスと優先度の関係を任意に設定することができる
。さらに、ＲＯＭの代わりにＲＡＭ （Ｒａｎｄｏｍ
Ａｃｃｅｓｓ Ｍｅｍｏｒｙ）を用いれば、自己アドレ
スと優先度の関係をＣＰＵから自由に設定したり、変更
したりすることも可能である・なお、第５図では５１２
バイトのメモリを用いたが、表２と同じ機能を実現する
だけであれば２５６バイトのメモリでよい。また、第４
図においてデータを変換するバッファ１０１にのみ２５
６バイトのメモリを使ってもよい。
Ｂ４２５Ｃなど）を用いた場合で、スイッチ４で設定さ
れた自己アドレスをＲＯＭのアドレス端子（Ａφ〜Ａ７
）に接続する。ＲＯＭには、予め自己アドレスに対応す
る優先度を持つデータを記録しておけばよく、例えば、
第４図と同じ変換を行なうためには、表３に示すような
内容を書いておけばよいのである。すなわち、アドレス
の前半（ｏ ｏ ｏＨ〜ｏＦＦＨ）にはアドレスの下位
８ビツトの値をそのまま書き、後半には（１００Ｈ〜１
ＦＦＨ）アドレスの下位８ピツトのビット列の順番を逆
にした値を書いておくのである０このように変換回路９
としてＲＯＭを用いた場合には、その内容によって自己
アドレスと優先度の関係を任意に設定することができる
。さらに、ＲＯＭの代わりにＲＡＭ （Ｒａｎｄｏｍ
Ａｃｃｅｓｓ Ｍｅｍｏｒｙ）を用いれば、自己アドレ
スと優先度の関係をＣＰＵから自由に設定したり、変更
したりすることも可能である・なお、第５図では５１２
バイトのメモリを用いたが、表２と同じ機能を実現する
だけであれば２５６バイトのメモリでよい。また、第４
図においてデータを変換するバッファ１０１にのみ２５
６バイトのメモリを使ってもよい。
表 ３
さて、以上の実施例はハードウェアによって自己アドレ
スのデータ変換を行なう例を示したが、これは演算処理
装置を用い、ソフトウェアによって変換を行なってもよ
い。その場合、演算処理装置はＣＰＵ１を用いてもよい
し、変換専用に演算処理装置を別に設けてもよいＯソフ
トウェアによって変換を行なう方法には大きく分けて２
つの方法がある。その１つは変換テーブルを持ってそれ
を参照する方法、他の１つは変換の規則（例えば、ビッ
ト列の順序を逆にするなど）に従って直接変換する方法
である。第６図は、変換テーブルを参照して変換を行な
う場合のフローチャートを示した図で、表４はその変換
テーブルの例を示した図であるＯ例えば、自己アドレス
が５３の場合、表４の変換テーブルから直ちにＣＡとい
う値に変換される。第７図は、ビット列の順序を直接変
換する場合のフローチャートを示したものである。これ
は、自己アドレスをＡに読み込み、この人の下位から順
に１ピツトずつ取り出し、Ｂの上位から順に入れて、ビ
ット列の順序を逆にする方法で、この操作は、例えば、
演算処理装置として日立製ＨＤ６８０９を用いた場合に
は、ＡＵＲＡとＲＯＬＢという命令を用いて実現するこ
とができるＯ 表 ４ なお、第３図において、演算処理装置１とシリアルイン
ターフェース回路２．ノくス制御回路３１バッファ５を
１チツプのマイクロコンピュータ（例えば、日立製ＨＤ
６８０１ 、ＨＤ６８０５等）で実現することもできる
。そして、自己アドレスのデータ変換をソフトウェアで
行なう場合には、この１チツプのマイクロコンピュータ
を使うことも可能である。
スのデータ変換を行なう例を示したが、これは演算処理
装置を用い、ソフトウェアによって変換を行なってもよ
い。その場合、演算処理装置はＣＰＵ１を用いてもよい
し、変換専用に演算処理装置を別に設けてもよいＯソフ
トウェアによって変換を行なう方法には大きく分けて２
つの方法がある。その１つは変換テーブルを持ってそれ
を参照する方法、他の１つは変換の規則（例えば、ビッ
ト列の順序を逆にするなど）に従って直接変換する方法
である。第６図は、変換テーブルを参照して変換を行な
う場合のフローチャートを示した図で、表４はその変換
テーブルの例を示した図であるＯ例えば、自己アドレス
が５３の場合、表４の変換テーブルから直ちにＣＡとい
う値に変換される。第７図は、ビット列の順序を直接変
換する場合のフローチャートを示したものである。これ
は、自己アドレスをＡに読み込み、この人の下位から順
に１ピツトずつ取り出し、Ｂの上位から順に入れて、ビ
ット列の順序を逆にする方法で、この操作は、例えば、
演算処理装置として日立製ＨＤ６８０９を用いた場合に
は、ＡＵＲＡとＲＯＬＢという命令を用いて実現するこ
とができるＯ 表 ４ なお、第３図において、演算処理装置１とシリアルイン
ターフェース回路２．ノくス制御回路３１バッファ５を
１チツプのマイクロコンピュータ（例えば、日立製ＨＤ
６８０１ 、ＨＤ６８０５等）で実現することもできる
。そして、自己アドレスのデータ変換をソフトウェアで
行なう場合には、この１チツプのマイクロコンピュータ
を使うことも可能である。
以上・本発明の実施例について、変換回路をスイッチ４
と３ステートバツフア５の間に設ケた場合と、演算処理
装置で行なう場合につし）て詳細に述べたが、変換回路
９の中に３ステ一トバツフア５０機能を取り込んでもよ
し）ことは言うまでもないことであり、要は、ホームノ
くスと自己アドレス設定用スイッチの間に、設定したア
ドレスの順番とバス上の優先順位を一致させる変換手段
を設ければよいのである。また、以上の例ではホームバ
スに限って説明したが、これは複数の装置が同時に送信
可能な他の伝送媒体にも適用可能なものである。
と３ステートバツフア５の間に設ケた場合と、演算処理
装置で行なう場合につし）て詳細に述べたが、変換回路
９の中に３ステ一トバツフア５０機能を取り込んでもよ
し）ことは言うまでもないことであり、要は、ホームノ
くスと自己アドレス設定用スイッチの間に、設定したア
ドレスの順番とバス上の優先順位を一致させる変換手段
を設ければよいのである。また、以上の例ではホームバ
スに限って説明したが、これは複数の装置が同時に送信
可能な他の伝送媒体にも適用可能なものである。
本発明によれば、Ｌ８Ｂ送りの伝送媒体上で自己アドレ
スを用いて送信制御を行なうシステムにおいて、自己ア
ドレス設定手段での順番と衝突検出手段での優先順位と
を一致させることができる。
スを用いて送信制御を行なうシステムにおいて、自己ア
ドレス設定手段での順番と衝突検出手段での優先順位と
を一致させることができる。
第１図は従来技術による通信制御装置を示すブロック図
、第２図は本発明による通信制御装置を示すブロック図
、第３図、第４図、第５図は本発明に係るデータ変換回
路の具体的実施例を示したブロック図、第６図と第７図
は本発明を演算処理装置で実施する場合の７０−チャー
ト図である０ １・・・演算処理装置。 ２・・・シリアルインターフェース回路、３・・・送信
制御回路、 ４・・・スイッチ、 ５・・・３ステートノぐツ７ア、 ８・・・パスライン、 ９・・変換回路。 代理人弁理士 高 橋 明 夫 第 １１ ＝１ 第３０ 第５乙 第 ６圀 第７圃
、第２図は本発明による通信制御装置を示すブロック図
、第３図、第４図、第５図は本発明に係るデータ変換回
路の具体的実施例を示したブロック図、第６図と第７図
は本発明を演算処理装置で実施する場合の７０−チャー
ト図である０ １・・・演算処理装置。 ２・・・シリアルインターフェース回路、３・・・送信
制御回路、 ４・・・スイッチ、 ５・・・３ステートノぐツ７ア、 ８・・・パスライン、 ９・・変換回路。 代理人弁理士 高 橋 明 夫 第 １１ ＝１ 第３０ 第５乙 第 ６圀 第７圃
Claims (1)
- 【特許請求の範囲】 １、 複数ビットの自己アドレスを設定するアドレス設
定手段と、上記自己アドレスをデータに付加しパケット
を構成する制御手段と、上記パケットの情報を最下位ビ
ット優先で直並列変換して複数の装置が接続される伝送
媒体に人出力する直並列変換インタフェース手段と、上
記伝送媒体上で伝送中のパケットの伝送自己アドレスと
上記自己アドレスを１ビツトづつ比較し、当該１ビツト
において上記自己アドレスが伝送自己アドレスと異なる
場合には、上記伝送中のパケットの自己アドレスの優先
順位が自己の装置の自己アドレスより高いと判断し、上
記直並列変換インタフェース手段からの伝送媒体への出
力を中止する衝突検出手段を有する通信制御装置におい
て、上記自己アドレス設定手段と上記直並列インタフェ
ース手段の間に、上記自己アドレス設定手段により設定
された自己アドレスを上記衝突検出手段での優先順位と
一致するように変換する変換手段を設けたことを特徴と
する通信制御装置。 ２、特許請求の範囲第１項において、前記変換手段は、
上記自己アドレスの最上位ビットか３ 特許請求の範囲
第１項において、上記変換手段は、あらかじめ自己アド
レスとそれに対応する優先順位のアドレス信号を記憶し
た記憶手段を有し、上記自己アドレスを入力としその自
己アドレスに対応する優先順位のアドレス信号を出力す
ることを特徴とする通信制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59081795A JPH067652B2 (ja) | 1984-04-25 | 1984-04-25 | 通信制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59081795A JPH067652B2 (ja) | 1984-04-25 | 1984-04-25 | 通信制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60226244A true JPS60226244A (ja) | 1985-11-11 |
| JPH067652B2 JPH067652B2 (ja) | 1994-01-26 |
Family
ID=13756422
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59081795A Expired - Lifetime JPH067652B2 (ja) | 1984-04-25 | 1984-04-25 | 通信制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH067652B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6424538A (en) * | 1987-07-20 | 1989-01-26 | Matsushita Electric Ind Co Ltd | Communication control system |
| JPH02228842A (ja) * | 1989-03-02 | 1990-09-11 | Mitsubishi Electric Corp | ホームコントロールシステムの通信方式 |
-
1984
- 1984-04-25 JP JP59081795A patent/JPH067652B2/ja not_active Expired - Lifetime
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6424538A (en) * | 1987-07-20 | 1989-01-26 | Matsushita Electric Ind Co Ltd | Communication control system |
| JPH02228842A (ja) * | 1989-03-02 | 1990-09-11 | Mitsubishi Electric Corp | ホームコントロールシステムの通信方式 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH067652B2 (ja) | 1994-01-26 |
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