JPS6020657U - チツプセレクト装置 - Google Patents

チツプセレクト装置

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Publication number
JPS6020657U
JPS6020657U JP10987883U JP10987883U JPS6020657U JP S6020657 U JPS6020657 U JP S6020657U JP 10987883 U JP10987883 U JP 10987883U JP 10987883 U JP10987883 U JP 10987883U JP S6020657 U JPS6020657 U JP S6020657U
Authority
JP
Japan
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chip select
address data
control circuit
select device
decoder
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP10987883U
Other languages
English (en)
Inventor
達夫 新井
Original Assignee
カシオ計算機株式会社
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Filing date
Publication date
Application filed by カシオ計算機株式会社 filed Critical カシオ計算機株式会社
Priority to JP10987883U priority Critical patent/JPS6020657U/ja
Publication of JPS6020657U publication Critical patent/JPS6020657U/ja
Pending legal-status Critical Current

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  • Closed-Circuit Television Systems (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
図面は本考案の一実施例を示すもので、第1図はシステ
ム全体の概略構成を示すブロック図、第2図は第1図に
おけるビデオ制御回路の主要部の詳細を示す回路構成図
である。 3・・・共有バス、4・・・ビデオ制御回路、11・・
・内部アドレスバス、12・・・データセレクタ、13
゜16.17・・・出力バッファ、14・・・制御回路
、15・・・デコーダ。

Claims (1)

    【実用新案登録請求の範囲】
  1. CPU及び制御回路が使用する共有バスに複数のデバイ
    スが接続されてなる情報処理機器にお(ζで、上記制御
    回路が構成されるLSI内に設けられ、上記デバイスに
    対するチップセレクト信号を作成するデコーダと、上記
    LSIによる上記デバイスへのアドレスデータを上記共
    有バスへ出力する出力バッファと、この出力バッファへ
    入力されるアドレスデータと上記CPUからのアドレス
    データを選択して上記デコーダへ入力するデータセレク
    タとを具備したことを特徴とするチップセレクト装置。
JP10987883U 1983-07-15 1983-07-15 チツプセレクト装置 Pending JPS6020657U (ja)

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JP10987883U JPS6020657U (ja) 1983-07-15 1983-07-15 チツプセレクト装置

Applications Claiming Priority (1)

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JP10987883U JPS6020657U (ja) 1983-07-15 1983-07-15 チツプセレクト装置

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Publication Number Publication Date
JPS6020657U true JPS6020657U (ja) 1985-02-13

Family

ID=30255777

Family Applications (1)

Application Number Title Priority Date Filing Date
JP10987883U Pending JPS6020657U (ja) 1983-07-15 1983-07-15 チツプセレクト装置

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