JPS6020654U - マイクロプロセツサ割込回路 - Google Patents
マイクロプロセツサ割込回路Info
- Publication number
- JPS6020654U JPS6020654U JP11165883U JP11165883U JPS6020654U JP S6020654 U JPS6020654 U JP S6020654U JP 11165883 U JP11165883 U JP 11165883U JP 11165883 U JP11165883 U JP 11165883U JP S6020654 U JPS6020654 U JP S6020654U
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- microprocessor
- flip
- output
- circuits
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図では本考案の実施例のマイクロプロセッサ割込回
路の構成を示すブロック図、第2図は第1図の回路の動
作タイムチャート、第3図は第1図の具体的な回路を示
す回路図である。 内置において、Ai、 A2;フリップフロップ回路、
Bl、B2;分周回路、C;アンド回路、D;バッファ
回路、E、 F、 G、 H,I、 J、 K
、 U、 M。 N:信号線又は信号波形。
路の構成を示すブロック図、第2図は第1図の回路の動
作タイムチャート、第3図は第1図の具体的な回路を示
す回路図である。 内置において、Ai、 A2;フリップフロップ回路、
Bl、B2;分周回路、C;アンド回路、D;バッファ
回路、E、 F、 G、 H,I、 J、 K
、 U、 M。 N:信号線又は信号波形。
Claims (1)
- 周辺デバイスからの割込要求信号とマイクロプロセッサ
からの割込要求解除信号とで動作する複数のフリップフ
ロップ回路と、前記フリップフロップ回路の出力により
それぞれ動作が制御される複数の分周回路と、前記各フ
リップフロップ回路の出力が接続されたバッファ回路と
前記各分周回路の出力を入力とするアンド回路とを備え
、前記アンド回路の出力を前記マイクロプロセッサの割
込信号とするように構成されたことを特徴とするマイク
ロプロセッサ割込回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11165883U JPS6020654U (ja) | 1983-07-19 | 1983-07-19 | マイクロプロセツサ割込回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP11165883U JPS6020654U (ja) | 1983-07-19 | 1983-07-19 | マイクロプロセツサ割込回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6020654U true JPS6020654U (ja) | 1985-02-13 |
Family
ID=30259164
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP11165883U Pending JPS6020654U (ja) | 1983-07-19 | 1983-07-19 | マイクロプロセツサ割込回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6020654U (ja) |
-
1983
- 1983-07-19 JP JP11165883U patent/JPS6020654U/ja active Pending
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