JPS595095U - メモリ集積回路 - Google Patents

メモリ集積回路

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JPS595095U
JPS595095U JP1982098503U JP9850382U JPS595095U JP S595095 U JPS595095 U JP S595095U JP 1982098503 U JP1982098503 U JP 1982098503U JP 9850382 U JP9850382 U JP 9850382U JP S595095 U JPS595095 U JP S595095U
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JP
Japan
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integrated circuit
memory integrated
abstract
incremented
built
Prior art date
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Pending
Application number
JP1982098503U
Other languages
English (en)
Inventor
国澤 寛治
Original Assignee
松下電工株式会社
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Filing date
Publication date
Application filed by 松下電工株式会社 filed Critical 松下電工株式会社
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Publication of JPS595095U publication Critical patent/JPS595095U/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図はメモリを使用した一般のPCMによる音声合成
回路のブロック回路図、第2図は本考案の一実施例の回
路図、第3図は同上のメモリ集積回路を使用した音声合
成回路のブロック回路図である。 10・・・カウンタ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 外部からのパルス入力によってアト、レス値がインクリ
    メントされるカウンタを内蔵して成るメモリ集積回路。
JP1982098503U 1982-06-30 1982-06-30 メモリ集積回路 Pending JPS595095U (ja)

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JPS595095U true JPS595095U (ja) 1984-01-13

Family

ID=30233833

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