JPS60111124U - パルス発生器の出力制御回路 - Google Patents
パルス発生器の出力制御回路Info
- Publication number
- JPS60111124U JPS60111124U JP20389583U JP20389583U JPS60111124U JP S60111124 U JPS60111124 U JP S60111124U JP 20389583 U JP20389583 U JP 20389583U JP 20389583 U JP20389583 U JP 20389583U JP S60111124 U JPS60111124 U JP S60111124U
- Authority
- JP
- Japan
- Prior art keywords
- pulse generator
- control circuit
- output control
- gate
- generator output
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第１図は従来のパルス発生器の出力制御回路例、第２図
はその動作タイムチャート、第３図は本考案の実施例に
よるパルス発生器の出力制御回路図、第４図はその動作
タイムチャートを示す。 図において１，６は発振器、３． ８． ９はＪＫフリ
ップフロップ、４，７．１０はアンドゲートを示す。
はその動作タイムチャート、第３図は本考案の実施例に
よるパルス発生器の出力制御回路図、第４図はその動作
タイムチャートを示す。 図において１，６は発振器、３． ８． ９はＪＫフリ
ップフロップ、４，７．１０はアンドゲートを示す。
Claims (1)
- パルス発生器からの出力信号と起動ゲート信号を入力と
する第１のアンドゲートと、該第１のアンドゲートの出
力に２段縦列接続したＪＫフリッププロップを接続し、
該２段縦列のＪＦフリップフロップの出力と前記第１の
アンドゲートの出力とを入力とする第２のアンドゲート
を有することを特徴とするパルス発生器の出力制御回路
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20389583U JPS60111124U (ja) | 1983-12-27 | 1983-12-27 | パルス発生器の出力制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20389583U JPS60111124U (ja) | 1983-12-27 | 1983-12-27 | パルス発生器の出力制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60111124U true JPS60111124U (ja) | 1985-07-27 |
Family
ID=30766299
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20389583U Pending JPS60111124U (ja) | 1983-12-27 | 1983-12-27 | パルス発生器の出力制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60111124U (ja) |
-
1983
- 1983-12-27 JP JP20389583U patent/JPS60111124U/ja active Pending
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