JPS6017167B2 - パルス巾変調信号増幅回路 - Google Patents

パルス巾変調信号増幅回路

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JPS6017167B2
JPS6017167B2 JP53061376A JP6137678A JPS6017167B2 JP S6017167 B2 JPS6017167 B2 JP S6017167B2 JP 53061376 A JP53061376 A JP 53061376A JP 6137678 A JP6137678 A JP 6137678A JP S6017167 B2 JPS6017167 B2 JP S6017167B2
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忠雄 吉田
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    • HELECTRICITY
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    • H03F3/20Power amplifiers, e.g. Class B amplifiers, Class C amplifiers
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    • H03F2200/03Indexing scheme relating to amplifiers the amplifier being designed for audio applications
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Description

【発明の詳細な説明】 本発明は音声出力回路等に使用されるパルス中変調信号
増幅回路に関し、特に電源電圧の変動による出力信号の
歪を改善する様にしたものである。
従来パルス中変調信号の音声出力増幅回路として第1図
に示す如きパルス中変調信号増幅回路が使用されている
即ち第1図に於いて、1は音声信号のパルス中変調信号
が供V給されるパルス中変調信号入力端子を示し、この
パルス中変調信号入力端子1をパルス増幅回路2を礎成
するnpn形トランジスタ2a及びpnp形トランジス
タ2bの夫々のベースに夫々接続し、このトランジスタ
2aのコレクタを正の直流電圧+V2が供給される電源
端子3aに接続し、又トランジスタ2bのコレクタを電
源端子3aに供給される正の直流電圧十V2と絶対値の
等しい負の直流鷲庄一V2が供給される電源端子3bに
接続し、之等トランジスタ2a及び2bの夫々のェミッ
タを互いに接続し、このェミツタの接続中点をロ−パス
フィルタ4を介してスピーカ5に供給する。斯る第1図
に示す如きパルス中変調信号増幅回路に於いては電源端
子3a及び3bに夫々供聯合される直流電圧の絶対値I
V2lが一定のときは正常に動作するが、この直流電圧
の絶対値IV2lのレベルが変動したときはパルス増幅
回路2の出力側即ちトランジスタ2a及び2bの夫々の
ェミッタの接続点に得られる矩形波信号の正側又は負側
の面積が変動し、この為ローパスフィルタ4の出力側に
得られるこの矩形波信号の平均値の音声信号が歪む欠点
があった。このパルス中変調信号増幅回路を出力増幅回
路として使用したときは電流の変化に依る電源電圧の変
動がある為特に問題となる。本発明は斯る点に鑑み電源
電圧の変動による出力信号の歪を改善する様にしたパル
ス中変調信号増幅回路を提案せんとするものである。
以下第2図を参照しながら本発明パルス中変調信号増幅
回路の一実施例につき説明しよう。
この第2図に於いて第1図に対応する部分には同一符号
を付し、その詳細説明は省略する。本例に於いては例え
ば音声信号のパルス中変調信号が供給されるパルス中変
調信号入力端子1を抵抗値がR,の抵抗器6を介して積
分回路例えばミラー積分回路7の入力側に接続する。
本例ではこのミラー積分回路7は逆相増幅回路構成とな
されている。このミラー積分回路7の出力信号を鰭圧し
ベルが零の点で、その出力信号が1の電圧レベル−Vo
から他の電圧レベル+Voに変化する様になされたゼロ
クロススイツチ回路8の入力側に供給し、このゼロック
ススイッチ回路8の出力側に得られるパルス中変調信号
をパルス増幅回路2を構成するトランジスタ2a及び2
bの夫々のベースに供給し、このパルス増幅回路2の出
力信号をローパスフィルタ4を介してスピーカ5に供給
すると共にこのトランジスタ2a及び2bの夫々のェミ
ッタの接続点を抵抗値がR2の抵抗器9を介してミラー
積分回路7の入力側に接続する。この場合パルス中変調
信号入力端子1に供V給されるパルス中変調信号の最大
電圧レベルをV,とし、又パルス増幅回路2の出力側に
得られるパルス中変調信号の最大電圧レベル(これは電
源電圧V2に等しい)をV2としたとき登>毒 の関係になる如くする。
本発明は上述の如く構成されているのでパルス中変調信
号入力端子1に第3図Aに示す如きパルス中変調信号が
供孫合されたときはミラー積分回路7の出力側には第3
図Bに示す如き積分波形が得られる。
この場合この第3図Bの積分波形の第1の懐きaはa:
−義+叢 であり、第2の煩きbは b=号+c業2 であり、第3の傾きcは V, V2 Ci粛−両 であり、第4の頭きdは d=−(叢十表) である。
ここでCはミラー積分回路7の容量値である。この積分
波形はこの電圧V,及びV2の変動のないときは、この
第1の傾きa、第2の傾きb、第3の懐きc、第4の懐
きdに依る線の繰り返しにより構成される。この場合l
al=lcl、lbl=ldlである。この第3図Bに
示す如き積分波形をゼロクロススィッチ回路8例えば高
利得増幅回路に供給し、このゼロクロススィッチ回路8
の出力側に第3図Cに示す如きこの積分波形の零しベル
点で1の電圧一Vo又は他の電圧十Voに変化する入力
端子1に供給されるパルス中変調信号と同様のパルス中
変調信号が得られ、この為パルス増幅回路2の出力側に
は従来同機の増幅された第3図Dにパルス中変調信号が
得られ、このパルス中変調信号をローパスフィルタ4を
介してスピーカ5に供給し、再生音を得る。又このパル
ス中変調信号入力端子1に供給されるパルス中変調信号
が第3図Eに示す如く変化したときはミラー積分回路7
の出力信号は第3図Fに示す如き積分波形となる。この
場合この積分波形は第1の傾きa、第2の傾きb、第3
の煩きc及び第4の傾きdに依る線の入力パルス中変調
信号のパルス中に応じたレベルとなり、パルス増幅回路
2の出力側には上述同様にして第3図Gに示す如き増幅
されたパルス中変調信号が得られる。又パルス中変調信
号入力端子1に第4図Aに示す如きパルス中変調信号が
供給されミラー積分回路7の出力側に第4図Bに示す如
き積分波形が得られ、パルス増幅回路2の出力側に第4
図Cに実線で示す如き増幅されたパルス中変調信号が得
られ、ローパスフィルタ4の出力側に第4図Cに破線で
示す如き、このパル,ス中変調信号の平均レベルの信号
成分が得られていたときに於いて、例えば電源端子3b
に供給される電圧が−(V2十△V2)に変動したとき
は第1の頃きaはa,に変化、即ちa,=‐韓+V礎V
2 に変化し、又第2の懐きbはbに変化、即ちq=表+V
帯V2に変化し、第3及び第4の懐きc及びdは変化が
ない。
即ちla,l<lal、lb,l>lbl、lc,l=
lcl、ld,l=ldlとなり、ミラー積分回路7の
出力側には第4図Dに示す如き積分波形が得られ、パル
ス増幅回路2の出力側に第4図Eに示す如きパルス中変
調信号が得られ、このときローパスフィルタ4の出力側
に得られるこのパルス中変調信号の平均レベルは第4図
Eに破線で示す如く第4図Cに破線で示す信号成分レベ
ルと等しくなる。即ちこの第2図に於いてはパルス中変
調信号のままで負帰還が掛かるため電源電圧変動及びパ
ルス増幅回路系の歪の抑圧ができる。以上述べた如く本
発明に依れば電源電圧の変動による出力信号の歪を改善
することができる。尚本発明は上述実施例に限ることな
く本発明の要旨を逸脱することなく、その他種々の構成
が取り得ることは勿論である。
【図面の簡単な説明】 第1図は従来のパルス中変調信号増幅回路の例を示す構
成図、第2図は本発明パルス中変調信号増幅回路の一実
施例を示す構成図、第3図及び第4図は夫々本発明の説
明に供する線図である。 1はパルス中変調信号入力端子、2はパルス増幅回路、
3a及び3bは夫々電源端子、4はローパスフイルタ、
6及び9は夫々抵抗器、7は積分回路、8はゼロクロス
スィツチ回路である。 第1図第2図 第3図 第4図

Claims (1)

    【特許請求の範囲】
  1. 1 入力端子に供給される入力パルス巾変調信号を積分
    回路の入力側に供給し、該積分回路の出力信号をゼロク
    ロススイツチング回路の入力側に供給し、該ゼロクロス
    スイツチング回路の出力信号をパルス増幅回路を介して
    出力端子に供給する様にすると共に該パルス増幅回路の
    出力信号の一部を帰還信号として上記積分回路の入力側
    に帰還し、上記入力パルス巾変調信号電流を上記帰還信
    号電流よりも大なるように設定したことを特徴とするパ
    ルス巾変調信号増幅回路。
JP53061376A 1978-05-23 1978-05-23 パルス巾変調信号増幅回路 Expired JPS6017167B2 (ja)

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