JPS60143389A - イメ−ジデ−タ制御方式 - Google Patents
イメ−ジデ−タ制御方式Info
- Publication number
- JPS60143389A JPS60143389A JP58248423A JP24842383A JPS60143389A JP S60143389 A JPS60143389 A JP S60143389A JP 58248423 A JP58248423 A JP 58248423A JP 24842383 A JP24842383 A JP 24842383A JP S60143389 A JPS60143389 A JP S60143389A
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- Japan
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- data
- image data
- memory
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- Image Processing (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（ａ） 発明の技術分野
本発明はディスプレイにおけるイメージデータを制御す
るイメージデータ制御方式に関する。
るイメージデータ制御方式に関する。
（ｂ） 従来技術と問題点
ビットマッグディスプレイにおいて、表示する図形の拡
大、縮小、回転あるいはスクロールを行う場合には、表
示メモリ（ビットマツプメモリ）の他に、図形処理用の
イメージメモリを設け、どのイメージメモリ上で、上記
の図形の回転などの処理を行う方法を採用している。局
知のようにビットマツプメモリは大容量であるので、表
示メモリの他に、さらに図形処理用のイメージメモリ（
ビットマッグメモリ）を設けることは装置のｔＪｚ％化
を阻む許りでなく、装置が高価となる欠点があった０ （Ｃ） 発明の目的 本発明は上記の欠点を解決するためになされたもので、
図形処理用のメモリを不要とするイメージデータ制御方
式の提供を目的としている。
大、縮小、回転あるいはスクロールを行う場合には、表
示メモリ（ビットマツプメモリ）の他に、図形処理用の
イメージメモリを設け、どのイメージメモリ上で、上記
の図形の回転などの処理を行う方法を採用している。局
知のようにビットマツプメモリは大容量であるので、表
示メモリの他に、さらに図形処理用のイメージメモリ（
ビットマッグメモリ）を設けることは装置のｔＪｚ％化
を阻む許りでなく、装置が高価となる欠点があった０ （Ｃ） 発明の目的 本発明は上記の欠点を解決するためになされたもので、
図形処理用のメモリを不要とするイメージデータ制御方
式の提供を目的としている。
（ｄ） 発明の構成
アドレスカウンタを有する所に容量のメモリに、該所定
容量を越えるデータサイズのイメージデータの中から所
要データを抽出して格納する装置において、前記イメー
ジデータのサイズを計数する手段と、前記所要データの
抽出位置を指定する手段と、該抽出位置の指定情報と前
記計数されたサイズ情報とにより前記メモリへの１．込
を許容する開始時点データを設立する手段と、該開始時
点データと前記アドレスカウンタの値とを比較する手段
とを備え、前記アドレスカウンタの値が該開始時点デー
タの値と一致したとき、前記イメージデータの前記メモ
リへの宿込みを許容せしめることを特徴とするイメージ
データ制御方式である。以上のように本発明は、圧縮さ
れたイメージデータコードから復元されたイメージデー
タを光示メモリに格納する装置において、該イメージデ
ータの中から所要データを抽出して格納する際、抽出処
理用のバッファを不要とするように図ったものである。
容量を越えるデータサイズのイメージデータの中から所
要データを抽出して格納する装置において、前記イメー
ジデータのサイズを計数する手段と、前記所要データの
抽出位置を指定する手段と、該抽出位置の指定情報と前
記計数されたサイズ情報とにより前記メモリへの１．込
を許容する開始時点データを設立する手段と、該開始時
点データと前記アドレスカウンタの値とを比較する手段
とを備え、前記アドレスカウンタの値が該開始時点デー
タの値と一致したとき、前記イメージデータの前記メモ
リへの宿込みを許容せしめることを特徴とするイメージ
データ制御方式である。以上のように本発明は、圧縮さ
れたイメージデータコードから復元されたイメージデー
タを光示メモリに格納する装置において、該イメージデ
ータの中から所要データを抽出して格納する際、抽出処
理用のバッファを不要とするように図ったものである。
（ｅ） 発明の実施例
以下、本発明を図面によって説明する。第１図は本発明
を説明するブロック図、第２図は本発明の一実施例を説
明するブロック図である。第１図（ａ）はデータサイズ
がＡＸＢなるイメージデータを示す。このイメージデー
タ（ＡＸＢ）のうち、点Ｐ及びＱを対角線の頂点とする
イメージデータ（ａＸｂ）を取出し、これを表示するた
めには、イメージデータ（ＡＸＢ）からイメージデータ
（ａＸｂ）を抽出するだめの図形処理用のイメージメモ
リが必要となる。°本発明は、前記のイメージデータ（
ａＸｂ）を、イメージメモリを用いずに第１図（ｂ）に
示す如く、表示メモリ１に取出しうるように図ったもの
である。
を説明するブロック図、第２図は本発明の一実施例を説
明するブロック図である。第１図（ａ）はデータサイズ
がＡＸＢなるイメージデータを示す。このイメージデー
タ（ＡＸＢ）のうち、点Ｐ及びＱを対角線の頂点とする
イメージデータ（ａＸｂ）を取出し、これを表示するた
めには、イメージデータ（ＡＸＢ）からイメージデータ
（ａＸｂ）を抽出するだめの図形処理用のイメージメモ
リが必要となる。°本発明は、前記のイメージデータ（
ａＸｂ）を、イメージメモリを用いずに第１図（ｂ）に
示す如く、表示メモリ１に取出しうるように図ったもの
である。
第２図におけるバッファ２に（ｄｌ ライン毎に圧縮さ
れたライン圧縮データＬ１〜Ｌｎが格納されており、こ
のライン圧縮データＬ１〜Ｌｎは、伸張回路３によって
イメージデータエに復元される。首たゲート部４は初期
状態では「閉」である。第２図において、まずメモリ２
内のライン圧縮化データＬ１〜Ｌｎを読出し、伸張回路
３によってイメージデータエに復元するが、このイメー
ジデータエは、ライン単位の画素信号として、制御回路
４へ送られる。制御回路４は、画素信号と同期したクロ
ック信号ＣＬによって動作し、画素信号の到来毎にパル
スＨを出力する。このパルスＰによりカウンタ５が、駆
動されるが、カウンタ５は、１ライン分の画素信号数を
計数するカウンタである。カウンタ５がカウントアウト
するとキャリー信号Ｃが出力され、これがラインカウン
タ６を駆動する。従ってイメージデータエの全部を計数
し終ったとき、↓ カウンタ５の出力とし、第１図（ａ）に示す如きＸ方向
のサイズデータＡが得られ、またカウンタ６の出力とし
ては、Ｙ方向のサイズデータＢ（すなわちライン数）が
得られる。この２つのサイズデータＡ及びＢは、制御部
７へ送られる。実施例では、第１図（ａ）に示す如き（
ＡＸＢ）なるサイズを有するイメージデータエのうち、
位置Ｐ及びＱを対角線の〕」１点とするイメージデータ
（ａＸｂ）を、第２図におけるメモリ１に格納する例で
ある。この場合、第２図におけるプロセサ８から、Ｐ点
の座欅データＸ１及びＹｌを制御部７へ送出する。これ
により、制御部７は、ＸＩ （＝ｘ、ｘｏ ）及びｙ１
←Ｙ。
れたライン圧縮データＬ１〜Ｌｎが格納されており、こ
のライン圧縮データＬ１〜Ｌｎは、伸張回路３によって
イメージデータエに復元される。首たゲート部４は初期
状態では「閉」である。第２図において、まずメモリ２
内のライン圧縮化データＬ１〜Ｌｎを読出し、伸張回路
３によってイメージデータエに復元するが、このイメー
ジデータエは、ライン単位の画素信号として、制御回路
４へ送られる。制御回路４は、画素信号と同期したクロ
ック信号ＣＬによって動作し、画素信号の到来毎にパル
スＨを出力する。このパルスＰによりカウンタ５が、駆
動されるが、カウンタ５は、１ライン分の画素信号数を
計数するカウンタである。カウンタ５がカウントアウト
するとキャリー信号Ｃが出力され、これがラインカウン
タ６を駆動する。従ってイメージデータエの全部を計数
し終ったとき、↓ カウンタ５の出力とし、第１図（ａ）に示す如きＸ方向
のサイズデータＡが得られ、またカウンタ６の出力とし
ては、Ｙ方向のサイズデータＢ（すなわちライン数）が
得られる。この２つのサイズデータＡ及びＢは、制御部
７へ送られる。実施例では、第１図（ａ）に示す如き（
ＡＸＢ）なるサイズを有するイメージデータエのうち、
位置Ｐ及びＱを対角線の〕」１点とするイメージデータ
（ａＸｂ）を、第２図におけるメモリ１に格納する例で
ある。この場合、第２図におけるプロセサ８から、Ｐ点
の座欅データＸ１及びＹｌを制御部７へ送出する。これ
により、制御部７は、ＸＩ （＝ｘ、ｘｏ ）及びｙ１
←Ｙ。
−ＹＯ）を算出して出力する。このデータＸｉ （ｄレ
ジスタ９にセットされ、またデータｙＩはレジスタ１０
にセントされる（データＸ１及びｙ、のめ方は第１図（
ａ）に基づく）。
ジスタ９にセットされ、またデータｙＩはレジスタ１０
にセントされる（データＸ１及びｙ、のめ方は第１図（
ａ）に基づく）。
第２図において、制御部７から発せられたクロック信号
ＣＬは、メモリ１のＸ方向のアドレス力と、キヤＩＪ−
Ｄが出力され、これによりＹ方向のアドレスカウンタ１
２が、駆動される。一致回路１３は、アドレスカウンタ
１１の計数値とレジスタ９の値（ＸＩ）とが一致したと
き、信号Ｅを出力する。
ＣＬは、メモリ１のＸ方向のアドレス力と、キヤＩＪ−
Ｄが出力され、これによりＹ方向のアドレスカウンタ１
２が、駆動される。一致回路１３は、アドレスカウンタ
１１の計数値とレジスタ９の値（ＸＩ）とが一致したと
き、信号Ｅを出力する。
一方一致回路１４は、アドレスカウンタ１２の計数値と
、レジスタ１０の値（ｙ、）とが一致したとき、信号Ｆ
を出力する。
、レジスタ１０の値（ｙ、）とが一致したとき、信号Ｆ
を出力する。
判別部１５は信号Ｅ及びＦを受けたとき、制御１８号Ｇ
を発して、ゲート部１９を「開」とする。これにより第
１図（ａ）における位置Ｐ以降のイメージデータ（すな
わちデータサイズ（ａＸｂ）なる部分データ）のみが、
書込部１６によって、メモリ１に書込まれることになる
。このメモリ（表示メモリ）１内のイメージデータは、
表示制御部１７へ送られて表示部１８に表示される。
を発して、ゲート部１９を「開」とする。これにより第
１図（ａ）における位置Ｐ以降のイメージデータ（すな
わちデータサイズ（ａＸｂ）なる部分データ）のみが、
書込部１６によって、メモリ１に書込まれることになる
。このメモリ（表示メモリ）１内のイメージデータは、
表示制御部１７へ送られて表示部１８に表示される。
（ｆ） 発明の効果
以上のように本発明は、イメージデータを抽出する等の
画像処理において、画像処理用のバッファメモリを不要
とする利点を有する。
画像処理において、画像処理用のバッファメモリを不要
とする利点を有する。
第１図は本発明を説明するブロック図、第２図は本発明
の一実施例を説明するブロック図でおり、図中に用いた
符号は次の通りである。 １はメモリ（表示メモリ）、２はバッファ、３け伸張回
路、４は制御回路、５はカウンタ、６はラインカウンタ
、７は制御部、８はグロセサ、９゜１０はレジスタ、１
１．１２はアドレスカウンタ、１３．１４は一致回路、
１５は判別部、１６は書込部、１７は表示１１ｉｌＪ御
部、１８は表示部、１９はゲート部、Ａはイメージデー
タ■のＸ方向のデータサイズ、ＢはイメージデータＩの
Ｙ方向のデータサイズ、Ｃ，Ｄはキャリー、ＣＬはクロ
ック信号、Ｅ、Ｆは信号、Ｇは制御（４号、Ｈはパルス
、■はイメージデータ、Ｌ、 、 Ｌｎはライン圧縮デ
ータ、０゜Ｐ、 Ｑはイメージデータ上の位置、Ｘｏ、
Ｘｌ、 Ｘｎ。 ＹＯ、Ｙｌ 、 Ｙｎは座標（データ）、ａ、ｂは部分
イメージデータのサイズデータ、Ｘｌ、ｙｌはデータを
示す。
の一実施例を説明するブロック図でおり、図中に用いた
符号は次の通りである。 １はメモリ（表示メモリ）、２はバッファ、３け伸張回
路、４は制御回路、５はカウンタ、６はラインカウンタ
、７は制御部、８はグロセサ、９゜１０はレジスタ、１
１．１２はアドレスカウンタ、１３．１４は一致回路、
１５は判別部、１６は書込部、１７は表示１１ｉｌＪ御
部、１８は表示部、１９はゲート部、Ａはイメージデー
タ■のＸ方向のデータサイズ、ＢはイメージデータＩの
Ｙ方向のデータサイズ、Ｃ，Ｄはキャリー、ＣＬはクロ
ック信号、Ｅ、Ｆは信号、Ｇは制御（４号、Ｈはパルス
、■はイメージデータ、Ｌ、 、 Ｌｎはライン圧縮デ
ータ、０゜Ｐ、 Ｑはイメージデータ上の位置、Ｘｏ、
Ｘｌ、 Ｘｎ。 ＹＯ、Ｙｌ 、 Ｙｎは座標（データ）、ａ、ｂは部分
イメージデータのサイズデータ、Ｘｌ、ｙｌはデータを
示す。
Claims (1)
- アドレスカウンタを有する所定容量のメモリに、該所定
容量を越えるデータサイズのイメージデータの中から所
要データを抽出して格納する装置において、前記イメー
ジデータのサイズを計数する手段と、前記所要データの
抽出位置を指定する手段と、該抽出位置の指定情報と前
記計数されたサイズ情報とにより前記メ七りへの書込を
許容する開始時点データを設定する手段と、該開始時点
データと前記アドレスカウンタの値とを比較する手段と
を備え、前記アドレスカウンタの値が該開始時点データ
の値と一致したとき前記イメージデータの前記メモリへ
の書込みを許容せしめることを特徴とするイメージデー
タ制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58248423A JPS60143389A (ja) | 1983-12-29 | 1983-12-29 | イメ−ジデ−タ制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58248423A JPS60143389A (ja) | 1983-12-29 | 1983-12-29 | イメ−ジデ−タ制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60143389A true JPS60143389A (ja) | 1985-07-29 |
Family
ID=17177900
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58248423A Pending JPS60143389A (ja) | 1983-12-29 | 1983-12-29 | イメ−ジデ−タ制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60143389A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62198973A (ja) * | 1986-02-26 | 1987-09-02 | Matsushita Electric Ind Co Ltd | 画像デ−タ変換装置 |
| JPS62219080A (ja) * | 1986-03-19 | 1987-09-26 | Matsushita Electric Ind Co Ltd | 画像デ−タ変換装置 |
-
1983
- 1983-12-29 JP JP58248423A patent/JPS60143389A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62198973A (ja) * | 1986-02-26 | 1987-09-02 | Matsushita Electric Ind Co Ltd | 画像デ−タ変換装置 |
| JPS62219080A (ja) * | 1986-03-19 | 1987-09-26 | Matsushita Electric Ind Co Ltd | 画像デ−タ変換装置 |
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