JPS59815Y2 - 電圧・電流変換回路 - Google Patents
電圧・電流変換回路Info
- Publication number
- JPS59815Y2 JPS59815Y2 JP14974479U JP14974479U JPS59815Y2 JP S59815 Y2 JPS59815 Y2 JP S59815Y2 JP 14974479 U JP14974479 U JP 14974479U JP 14974479 U JP14974479 U JP 14974479U JP S59815 Y2 JPS59815 Y2 JP S59815Y2
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- JP
- Japan
- Prior art keywords
- voltage
- resistor
- series circuit
- current
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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- Continuous-Control Power Sources That Use Transistors (AREA)
- Amplifiers (AREA)
- Arrangements For Transmission Of Measured Signals (AREA)
Description
【考案の詳細な説明】
本考案は、入力電圧をその大きさに比例した電流に変換
する電圧・電流変換回路に関する。
する電圧・電流変換回路に関する。
従来の電圧・電流変換回路は第１図に示すように構成さ
れている。
れている。
第１図において、ＯＰｌは演算増幅器で、その反転入力
端子（→に抵抗Ｒ１を介して入力電圧Ｖｉが加えられて
おり、非反転入力端子（１）には電源電圧＋■が抵抗Ｒ
３，Ｒ４で分圧されて加えられている。
端子（→に抵抗Ｒ１を介して入力電圧Ｖｉが加えられて
おり、非反転入力端子（１）には電源電圧＋■が抵抗Ｒ
３，Ｒ４で分圧されて加えられている。
Ｑｌは出力トランジスタで゛、そのベースはＯＰｌの出
力端に接続され、エミッタは抵抗Ｒｒを介して電源＋Ｖ
に接続され、コレクタは負荷Ｒｒ−を介して基準点に接
続されている。
力端に接続され、エミッタは抵抗Ｒｒを介して電源＋Ｖ
に接続され、コレクタは負荷Ｒｒ−を介して基準点に接
続されている。
またＱｌのエミッタとＯＰｌの反転入力端子（−）との
間に抵抗Ｒ２が接続されている。
間に抵抗Ｒ２が接続されている。
このような構成の従来回路においては、出力電流■。
か゛で与えられるので、抵抗Ｒ１〜Ｒ４をマツチングさ
せて、 Ｒ１＝ Ｒ，２＝ Ｒ３＝顯＝Ｒ（２） を満足させることによって、電源電圧■の影響を除いて
いる。
せて、 Ｒ１＝ Ｒ，２＝ Ｒ３＝顯＝Ｒ（２） を満足させることによって、電源電圧■の影響を除いて
いる。
ところで従来回路においては、抵抗Ｒ１〜Ｒ４のマツチ
ングにずれがあると電源電圧の影響を除去できなくなり
誤差を生ずる欠点がある。
ングにずれがあると電源電圧の影響を除去できなくなり
誤差を生ずる欠点がある。
この誤差は、通常入力端子が電源電圧より小さいので大
きなオフセット誤差になりやすく、また電源電圧の変動
による影響も受け、電源電圧変動除去比を大きくできな
い。
きなオフセット誤差になりやすく、また電源電圧の変動
による影響も受け、電源電圧変動除去比を大きくできな
い。
また入力インピーダンスを大きくするため抵抗の値を大
きくすると、演算増幅器のオフセット電流により、オフ
セット誤差およびドノフトを生ずる欠点がある。
きくすると、演算増幅器のオフセット電流により、オフ
セット誤差およびドノフトを生ずる欠点がある。
さらに演算に必要な精密抵抗は高価であり、その数が多
くコスト高になっている。
くコスト高になっている。
本考案の目的は、上述の如き欠点のない新規な電圧・電
流変換回路を実現するにある。
流変換回路を実現するにある。
第２図は本考案回路の一実施例を示す接続図で、第１図
と同一部分には同一符号を付しである。
と同一部分には同一符号を付しである。
第２図において、トランジスタＱ１のコレクタが電源＋
■に接続され、エミッタは抵抗Ｒ４とダイオードＤ１お
よび負荷ＲＩ−の第１の直列回路を介して基準点に接続
されるとともに、抵抗Ｒ５とトランジスタＱ２および抵
抗Ｒ７の第２の直列回路を介して基準点に接続されてい
る。
■に接続され、エミッタは抵抗Ｒ４とダイオードＤ１お
よび負荷ＲＩ−の第１の直列回路を介して基準点に接続
されるとともに、抵抗Ｒ５とトランジスタＱ２および抵
抗Ｒ７の第２の直列回路を介して基準点に接続されてい
る。
またＲ４とＤｌの接続点が演算増幅器ＯＰ２の非反転入
力端子（→に、Ｑ２のエミッタがＯ２０の反転入力端子
（＝）にそれぞれ接続されている。
力端子（→に、Ｑ２のエミッタがＯ２０の反転入力端子
（＝）にそれぞれ接続されている。
Ｏ２０の出力はＱ２のベースに接続されている。
Ｑ２のコレクタはＯＰｌの反転入力端子（−）に接続さ
れている。
れている。
なお、ＤｌはＱ２の動作を確実にするためのものである
。
。
このように構成した本考案においては、出力電流■。
によって抵抗Ｒ４に生ずる電圧降下と、Ｑ２のコレクタ
電流りによって抵抗Ｒ５に生ずる電圧降下が等しくなる
ように、Ｏ２０がＱ２のベース電流（すなわちコレクタ
電流■ｆ）を制御する。
電流りによって抵抗Ｒ５に生ずる電圧降下が等しくなる
ように、Ｏ２０がＱ２のベース電流（すなわちコレクタ
電流■ｆ）を制御する。
したがって出力電流■。
は、で与えられる。
また演算増幅器ＯＰ１は電流りによって抵抗Ｒｆに生ず
る電圧降下と入力電圧Ｖｉとが等しくなるようにトラン
ジスタＱ１のベース電流（すなわちコレクタ電流■。
る電圧降下と入力電圧Ｖｉとが等しくなるようにトラン
ジスタＱ１のベース電流（すなわちコレクタ電流■。
＋■ｆ）を制御する。よって、Ｑ２のコレクタ電流■、
は、 となる。
は、 となる。
よって、出力電流■。は（３）式と（４）式から、とな
って、入力電圧Ｖｉのみに比例し、電源電圧の影響を受
けない。
って、入力電圧Ｖｉのみに比例し、電源電圧の影響を受
けない。
このように本考案の電圧・電流変換回路においては、電
源電圧の影響を除去するために抵抗をマツチングさせる
必要がないので、抵抗のマツチングのずれによる誤差を
生じない。
源電圧の影響を除去するために抵抗をマツチングさせる
必要がないので、抵抗のマツチングのずれによる誤差を
生じない。
しかも高価な精密抵抗の数が従来回路に比して２個少な
くできる。
くできる。
また電源電圧変動は演算増幅器で吸収できるので、電源
電圧変動除去比が大きくとれる。
電圧変動除去比が大きくとれる。
さらに入力インピーダンスも非常に大きい。
なお、演算増幅器ＯＰ□が必要な出力電流を供給できる
容量を持っていれば、トランジスタＱ１を省略して、Ｏ
Ｐｌの出力を直接Ｒ１とＲ２の結合点に接続してもよい
。
容量を持っていれば、トランジスタＱ１を省略して、Ｏ
Ｐｌの出力を直接Ｒ１とＲ２の結合点に接続してもよい
。
また負荷ＲＬと帰還抵抗Ｒｆとを入れ替えて、出力電流
■。
■。
をトランジスタＱ２で制御するようにしてもよい。
第１図は従来回路の一例を示す接続図、第２図は本考案
回路の一実施例を示す接続図である。 ＯＰｌ、Ｏ２０・・・・・・演算増幅器、Ｑｌ、Ｑ２・
・・・・・トランジスタ、Ｒ１−Ｒ５，Ｒ，・・・・・
・抵抗、ＲＬ・・・・・・負荷、Ｖｉ・・・・・・入力
電圧、■。 ・・・・・・出力電流、ｈ・・・・・・帰還電流、■、
・・・・・・帰還電圧。
回路の一実施例を示す接続図である。 ＯＰｌ、Ｏ２０・・・・・・演算増幅器、Ｑｌ、Ｑ２・
・・・・・トランジスタ、Ｒ１−Ｒ５，Ｒ，・・・・・
・抵抗、ＲＬ・・・・・・負荷、Ｖｉ・・・・・・入力
電圧、■。 ・・・・・・出力電流、ｈ・・・・・・帰還電流、■、
・・・・・・帰還電圧。
Claims (1)
- 第１と抵抗と負荷を含む第１の直列回路と、第２の抵抗
と帰還抵抗を含む第２の直列回路と、入力電圧が入力側
に加えられ、出力側に並列に接続された前記第１の直列
回路と第２の直列回路をそれぞれ流れる電流の和を制御
する第１の演算増幅器と、前記第１の直列回路または第
２の直列回路のいずれか一方に挿入されたトランジスタ
と、前記第１の抵抗に生ずる電圧降下と前記第２の抵抗
に生ずる電圧降下とが等しくなるように前記トランジス
タを制御し、前記第１の直列回路を流れる電流と前記第
２の直列回路を流れる電流とを比例させる第２の演算増
幅器と、前記帰還抵抗に生ずる電圧降下を前記入力電圧
と差動的になるように前記第１の演算増幅器の入力側に
負帰還する回路とを具備し、前記負荷に流れる電流を前
記入力電圧に比例させたことを特徴とする電圧・電流変
換回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14974479U JPS59815Y2 (ja) | 1979-10-29 | 1979-10-29 | 電圧・電流変換回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14974479U JPS59815Y2 (ja) | 1979-10-29 | 1979-10-29 | 電圧・電流変換回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5669119U JPS5669119U (ja) | 1981-06-08 |
| JPS59815Y2 true JPS59815Y2 (ja) | 1984-01-11 |
Family
ID=29380824
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14974479U Expired JPS59815Y2 (ja) | 1979-10-29 | 1979-10-29 | 電圧・電流変換回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59815Y2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9350088B2 (en) | 2011-09-12 | 2016-05-24 | Suncall Corporation | Swaging structure for metallic members and bus bar using the same |
-
1979
- 1979-10-29 JP JP14974479U patent/JPS59815Y2/ja not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US9350088B2 (en) | 2011-09-12 | 2016-05-24 | Suncall Corporation | Swaging structure for metallic members and bus bar using the same |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5669119U (ja) | 1981-06-08 |
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