JPS597264B2 - スイヘイドウキシンゴウケンシユツソウチ - Google Patents
スイヘイドウキシンゴウケンシユツソウチInfo
- Publication number
- JPS597264B2 JPS597264B2 JP10766675A JP10766675A JPS597264B2 JP S597264 B2 JPS597264 B2 JP S597264B2 JP 10766675 A JP10766675 A JP 10766675A JP 10766675 A JP10766675 A JP 10766675A JP S597264 B2 JPS597264 B2 JP S597264B2
- Authority
- JP
- Japan
- Prior art keywords
- signal
- pulse
- output
- gate
- differentiating
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Synchronizing For Television (AREA)
Description
【発明の詳細な説明】
本発明は雑音の影響を受けることの少ない水平同期信号
検出装置を提供しようとするものである。
検出装置を提供しようとするものである。
以下本発明の一実施例について図面とともに説明する。
第１図は本発明の一実施例である水平同期信号発生装置
の基本ブロック図である。図中１はチューナ、２は映像
中間周波増巾器、３は映像検波器、４は第１の同期分離
回路、５は第２の同期分離回路、６はゲートパルス発生
回路であわ、４、５は同一内容で１〜５は通常のテレビ
ジョン受像機の回路と共通である。次に第２図、第３図
と共に本発明の具体内容を説明する。第２図において、
第１同期分離回路４内の７はマッチング抵抗、８は結合
容量であるが、８の値は同期分離出力の水平及び垂直同
期信号が歪まない値に選ばれる。９、１０はトランジス
タ１４のベースバイアスを決める抵抗、１１は容量、１
２は抵抗で容量１１と、抵抗１２の時定数を適当に選び
雑音を取わ除く。
第１図は本発明の一実施例である水平同期信号発生装置
の基本ブロック図である。図中１はチューナ、２は映像
中間周波増巾器、３は映像検波器、４は第１の同期分離
回路、５は第２の同期分離回路、６はゲートパルス発生
回路であわ、４、５は同一内容で１〜５は通常のテレビ
ジョン受像機の回路と共通である。次に第２図、第３図
と共に本発明の具体内容を説明する。第２図において、
第１同期分離回路４内の７はマッチング抵抗、８は結合
容量であるが、８の値は同期分離出力の水平及び垂直同
期信号が歪まない値に選ばれる。９、１０はトランジス
タ１４のベースバイアスを決める抵抗、１１は容量、１
２は抵抗で容量１１と、抵抗１２の時定数を適当に選び
雑音を取わ除く。
１３はカラーバースト信号等、高周波成分のバイパス用
コンデンサである。
コンデンサである。
１４は飽和特性の秀れたトランジスタ、１５はコレクタ
負荷抵抗でトランジスタ１４のコレクタ出力は、第３図
φ１１、φ２１の如くである。
負荷抵抗でトランジスタ１４のコレクタ出力は、第３図
φ１１、φ２１の如くである。
φ１１とφ２１は偶数フィールドと奇数フィールドにそ
れぞれ対応しており、同一のものである。以下φ１９と
φ２９まで同様である。
れぞれ対応しており、同一のものである。以下φ１９と
φ２９まで同様である。
φ１ををゲートパルス発生回路６内の容量１６、抵抗Ｉ
Ｔで微分し、前縁で下向き、後縁で上向きのパルスを発
生させ、下向きパルスをダイオード１８で取り除くと、
増幅器１９の入力は第３図φ１２となる。一方抵抗２１
と、容量２３で、φ１１を遅延させ、反転器２４で反転
すると、反転器２４の出力はφ１１′となる。これを抵
抗２５と容量２６で大きく遅延させ、増幅器２７で増幅
すると、増幅器２１の出力はφ１１’となる。φ１１′
とφ１１’の論理積をＡＮＤゲート２８で作ると、ＡＮ
Ｄゲート２８の出力はφ１３となる。この出力パルスφ
１３は、水平同期信号のパルス期間を全く含まない期間
に生じるものである。これらのパルスφ１２とφ１３を
ＮＡＮＤゲート２０へ供給すると、このＮＡＮＤゲート
２０の出力はφ１４となる。φ１４は第３図に示す如く
等化パルスの期間は現われないので、毎フイールド必ず
１０Ｈの始め又は２２７３Ｈの始めから現われる。従つ
て、φ１４でフリツプフロツプ３９をセツトするとフリ
ツブフロツプ３９のＱは１０Ｈの始め（及び２８３Ｈの
始め）から高レベル、Ｑはその逆となる（第３図φ１６
参照）。一方、抵抗２９，３０、容量３１，３２は積分
回路で垂直同期信号を取ｖ出している。３３は結合容量
、３４，３５はトランジスタ３７のベースバイアスを与
える抵抗で、この抵抗３４，３５の値によつて第３図φ
１５のパルス巾Ｔが変化する。
Ｔで微分し、前縁で下向き、後縁で上向きのパルスを発
生させ、下向きパルスをダイオード１８で取り除くと、
増幅器１９の入力は第３図φ１２となる。一方抵抗２１
と、容量２３で、φ１１を遅延させ、反転器２４で反転
すると、反転器２４の出力はφ１１′となる。これを抵
抗２５と容量２６で大きく遅延させ、増幅器２７で増幅
すると、増幅器２１の出力はφ１１’となる。φ１１′
とφ１１’の論理積をＡＮＤゲート２８で作ると、ＡＮ
Ｄゲート２８の出力はφ１３となる。この出力パルスφ
１３は、水平同期信号のパルス期間を全く含まない期間
に生じるものである。これらのパルスφ１２とφ１３を
ＮＡＮＤゲート２０へ供給すると、このＮＡＮＤゲート
２０の出力はφ１４となる。φ１４は第３図に示す如く
等化パルスの期間は現われないので、毎フイールド必ず
１０Ｈの始め又は２２７３Ｈの始めから現われる。従つ
て、φ１４でフリツプフロツプ３９をセツトするとフリ
ツブフロツプ３９のＱは１０Ｈの始め（及び２８３Ｈの
始め）から高レベル、Ｑはその逆となる（第３図φ１６
参照）。一方、抵抗２９，３０、容量３１，３２は積分
回路で垂直同期信号を取ｖ出している。３３は結合容量
、３４，３５はトランジスタ３７のベースバイアスを与
える抵抗で、この抵抗３４，３５の値によつて第３図φ
１５のパルス巾Ｔが変化する。
３６はコレクタ抵抗、３７はパルス成形用トランジスタ
で、３７のコレクタ出力を反転器３８で反転すると第３
図φ，５を得る。
で、３７のコレクタ出力を反転器３８で反転すると第３
図φ，５を得る。
従つて、φ１５が低レベルの間はフリツプフロツプ、３
９はセツトされない。φ１５のパルス巾Ｔは映像検波器
３の出力の変動、回路の温度ドリフト等で、０．５〜１
Ｈ程度変動するが１０Ｈの始め迄伸びることはないので
フリツブフロツブ３９のセツトされるのは１０Ｈの水平
同期信号の後縁からであジ、従つて、カウンタ４０へφ
１１を供給しても、１１Ｈ目から数える。但し、φ１１
をカウントする場合、インパルスノイズがあれば、それ
も数えるので、第ＮＨ目を正確に抜き取る場合は誤シが
生じる。そこでφ１４で単安定マルチバイブレータ４１
をトリカーし、パルス巾を次の水平同期信の少し前まで
の期間接続するたとえば約５７．０μｓに選ぶと単安定
マルチパイプレータ４１のＱとして、同期信号約４．５
μＳｅｃを含む巾約６μＳｅｃのゲートパルスφ１８が
得られる。
９はセツトされない。φ１５のパルス巾Ｔは映像検波器
３の出力の変動、回路の温度ドリフト等で、０．５〜１
Ｈ程度変動するが１０Ｈの始め迄伸びることはないので
フリツブフロツブ３９のセツトされるのは１０Ｈの水平
同期信号の後縁からであジ、従つて、カウンタ４０へφ
１１を供給しても、１１Ｈ目から数える。但し、φ１１
をカウントする場合、インパルスノイズがあれば、それ
も数えるので、第ＮＨ目を正確に抜き取る場合は誤シが
生じる。そこでφ１４で単安定マルチバイブレータ４１
をトリカーし、パルス巾を次の水平同期信の少し前まで
の期間接続するたとえば約５７．０μｓに選ぶと単安定
マルチパイプレータ４１のＱとして、同期信号約４．５
μＳｅｃを含む巾約６μＳｅｃのゲートパルスφ１８が
得られる。
単安定マルチバイブレータ４１の出力はφ１８に示す如
く等化パルスの区間は高レベルになるので、このままで
はゲートパルスとして使えない。そこで、φ，３を反転
器４４で反転しφ，２との論理積をＮＡＮＤゲート４５
で形成するとＮＡＮＤゲート４５の出力は第３図φ，２
′となる。これでフリツプフロツプ４６をセツトすると
、等化パルスの区間はセツトされ続け、φ１４の始め即
ち、１０Ｈ及び２７３Ｈの水平同期信号の後縁でりセツ
トされる。従つてフリツプフロツプ４６のＱは第３図に
示される如く等化パルスの区間は低レベルになる。これ
とφ，８との論理積をＡＮＡゲート４７で作ると、φ１
８′が得られる。φ，８′をゲートパルスとして使うと
最初の等化パルスを通過させるが、これは、各フイール
ドの最後であり、水平パルスを数える場合には影響はな
い。従つてφ１８′でゲートすれば５Ｇの出力はφ１７
の如くなる。又、φ１１′の後縁で単安定マルチバイブ
レータ４２をトリカーし、パルス巾を適当に決めると第
４図φ，，の如きパルスが得られる。φ１９を用い、ト
ランジスタでクランプすれば、第４図の複合映像信号中
のバツクボーチの部分でクランプできる。５Ｃがクラン
プ回路である。
く等化パルスの区間は高レベルになるので、このままで
はゲートパルスとして使えない。そこで、φ，３を反転
器４４で反転しφ，２との論理積をＮＡＮＤゲート４５
で形成するとＮＡＮＤゲート４５の出力は第３図φ，２
′となる。これでフリツプフロツプ４６をセツトすると
、等化パルスの区間はセツトされ続け、φ１４の始め即
ち、１０Ｈ及び２７３Ｈの水平同期信号の後縁でりセツ
トされる。従つてフリツプフロツプ４６のＱは第３図に
示される如く等化パルスの区間は低レベルになる。これ
とφ，８との論理積をＡＮＡゲート４７で作ると、φ１
８′が得られる。φ，８′をゲートパルスとして使うと
最初の等化パルスを通過させるが、これは、各フイール
ドの最後であり、水平パルスを数える場合には影響はな
い。従つてφ１８′でゲートすれば５Ｇの出力はφ１７
の如くなる。又、φ１１′の後縁で単安定マルチバイブ
レータ４２をトリカーし、パルス巾を適当に決めると第
４図φ，，の如きパルスが得られる。φ１９を用い、ト
ランジスタでクランプすれば、第４図の複合映像信号中
のバツクボーチの部分でクランプできる。５Ｃがクラン
プ回路である。
クランプレベルをＯボルトに保ち、クランプ回路５Ｃの
出力をゲート５Ｇへ供給し、φ１８でゲートすれば同期
信号のみとなる。即ちゲート５Ｇの出力としてφ１７を
得る。これは同期信号以外の成分を殆ん含んでいないの
で、雑音の影響も少ない。又、ゲート５Ｇの前後に積分
回路を設けて、狭いパルスを除去すれば雑音は殆どなく
なる。同期信号約４．５μｓに対し、前後に約１μＳｅ
ｃの巾の部分に含まれるノイズ巾は最大１μＳｅｃであ
シ、積分回路で除去できる。又、同期信号の前後１μＳ
ｅｅの幅が余裕としてとつてあるのでトランジスタ１４
の出力φ１１のシャッタが１μ以下なら影響は全くない
。又、バツクポーチをＯボルトにクランプしているので
映像信号分も混入しない。ゲート５Ｇの前にノイズキヤ
ンセラ一をつければ更に効果的である。なお、水平同期
信号以外ではφ，−４が出ないし、又、たまたま出たと
しても、単安定マルチバイブレータ４１のパルスが存在
する期間ではφ１８が変化しない。な卦フリツブフロツ
ブ３９のりセツトをカウンタ４０の出力、例えば２６２
Ｈの始めに相当する時刻に行なうようにすれば、トラン
ジスタ３７を通つて来る垂直同期信号は不要になる。
出力をゲート５Ｇへ供給し、φ１８でゲートすれば同期
信号のみとなる。即ちゲート５Ｇの出力としてφ１７を
得る。これは同期信号以外の成分を殆ん含んでいないの
で、雑音の影響も少ない。又、ゲート５Ｇの前後に積分
回路を設けて、狭いパルスを除去すれば雑音は殆どなく
なる。同期信号約４．５μｓに対し、前後に約１μＳｅ
ｃの巾の部分に含まれるノイズ巾は最大１μＳｅｃであ
シ、積分回路で除去できる。又、同期信号の前後１μＳ
ｅｅの幅が余裕としてとつてあるのでトランジスタ１４
の出力φ１１のシャッタが１μ以下なら影響は全くない
。又、バツクポーチをＯボルトにクランプしているので
映像信号分も混入しない。ゲート５Ｇの前にノイズキヤ
ンセラ一をつければ更に効果的である。なお、水平同期
信号以外ではφ，−４が出ないし、又、たまたま出たと
しても、単安定マルチバイブレータ４１のパルスが存在
する期間ではφ１８が変化しない。な卦フリツブフロツ
ブ３９のりセツトをカウンタ４０の出力、例えば２６２
Ｈの始めに相当する時刻に行なうようにすれば、トラン
ジスタ３７を通つて来る垂直同期信号は不要になる。
但し、２６２Ｈ以前でりセツトする時は、単安定マルチ
バイブレータを用いて、等化パルス期間までフリツプフ
ロツプ３９をりセツトしておく必要がある。このように
してゲートされたφ１７の信号をカウンタ４０でカウン
トすれば、たとえば垂直ブランキング期間の２０Ｈ目を
容易に検出することができ、２０Ｈ目にのつている静止
画像信号を抜き取ることができるパルスを作ることがで
きるものである。以上の通り、本発明はテレビジヨン信
号の複合同期信号中の水平同期信号の後縁に位置するパ
ルスを抜き取ることができるが等化パルスの後縁に位置
するパルスを抜き取ることができないように水平同期信
号卦よび等化パルスを遅延して作つたゲートパルスを発
生し、このゲートパルスによつて抜取られた水平同期信
号の後縁に位置するパルスによつて立ち下がＤ、次の水
平同期信号の手前で立ち上つて水平同期信号のみを抜き
取るパルスを発生し、このパルスによつて水平同期信号
を検出することを特徴とするものであり、等化パルスや
、雑音に無関係に水平同期信号のみを検出することがで
きるものである。
バイブレータを用いて、等化パルス期間までフリツプフ
ロツプ３９をりセツトしておく必要がある。このように
してゲートされたφ１７の信号をカウンタ４０でカウン
トすれば、たとえば垂直ブランキング期間の２０Ｈ目を
容易に検出することができ、２０Ｈ目にのつている静止
画像信号を抜き取ることができるパルスを作ることがで
きるものである。以上の通り、本発明はテレビジヨン信
号の複合同期信号中の水平同期信号の後縁に位置するパ
ルスを抜き取ることができるが等化パルスの後縁に位置
するパルスを抜き取ることができないように水平同期信
号卦よび等化パルスを遅延して作つたゲートパルスを発
生し、このゲートパルスによつて抜取られた水平同期信
号の後縁に位置するパルスによつて立ち下がＤ、次の水
平同期信号の手前で立ち上つて水平同期信号のみを抜き
取るパルスを発生し、このパルスによつて水平同期信号
を検出することを特徴とするものであり、等化パルスや
、雑音に無関係に水平同期信号のみを検出することがで
きるものである。
【図面の簡単な説明】
第１図は本発明の一実施例に卦ける水平同期信号検出装
置のプロツク線図、第２図は同装置の具体回路図、第３
図φ１１ラ φ１２′ φ１３′ φ１４ラφ１５ラφ
１６ラφ１７ｙφ１８ラφ１２ＦＦ４６のＱ：φ１８φ
２１ラ φ２４２φ２８）ＦＦ４６のＱ，φ２８′，φ
２７は同装置説明のための波形図１第４図φ１１２φ１
１φ１１φ１３ｙφ，９，ａ，φ１８は同装置説明のた
めの波形図である。 ４・・・同期分離回路、６・・・ゲートパルス発生回路
、１６，１７・・・微分用コンデンサ訃よび抵抗、１８
・・・ダイオード、２０・・・ＮＡＮＤゲート、２１，
２３・・・遅延用抵抗およびコンデンサ、２５，２６・
・・遅延用抵抗訃よびコンデンサ、２４，４４・・・極
性反転器、２８・・・ＡＮＤゲート、４５・・・ＮＡＮ
Ｄゲート、４６・・・フリツプフロツプ、４１・・・単
安定マルチバイブレータ、４７・・・ＡＮＤゲート、５
Ｇ・・・ゲート。
置のプロツク線図、第２図は同装置の具体回路図、第３
図φ１１ラ φ１２′ φ１３′ φ１４ラφ１５ラφ
１６ラφ１７ｙφ１８ラφ１２ＦＦ４６のＱ：φ１８φ
２１ラ φ２４２φ２８）ＦＦ４６のＱ，φ２８′，φ
２７は同装置説明のための波形図１第４図φ１１２φ１
１φ１１φ１３ｙφ，９，ａ，φ１８は同装置説明のた
めの波形図である。 ４・・・同期分離回路、６・・・ゲートパルス発生回路
、１６，１７・・・微分用コンデンサ訃よび抵抗、１８
・・・ダイオード、２０・・・ＮＡＮＤゲート、２１，
２３・・・遅延用抵抗およびコンデンサ、２５，２６・
・・遅延用抵抗訃よびコンデンサ、２４，４４・・・極
性反転器、２８・・・ＡＮＤゲート、４５・・・ＮＡＮ
Ｄゲート、４６・・・フリツプフロツプ、４１・・・単
安定マルチバイブレータ、４７・・・ＡＮＤゲート、５
Ｇ・・・ゲート。
Claims (1)
- １ テレビジョン信号の複合同期信号を微分する微分手
段と、上記複合同期信号を遅延させた信号とそれをさら
に遅延させた信号とを合成して水平同期信号のパルス期
間の後縁を含みかつ等化パルスのパルス期間を含まない
期間に生じるパルスを発生する遅延手段と、上記遅延手
段の出力信号に基いて上記微分手段の出力信号をゲート
して上記水平同期信号を微分した微分信号のみを取り出
す第１のゲート手段および上記等化パルスを微分した微
分信号のみを取り出す第２のゲート手段と、上記第１の
ゲート手段の信号によりトリガーされ次の水平同期信号
より少し前までの期間持続するパルスを発生するマルチ
バイブレータと、上記第２のゲート手段の出力信号によ
り反転され上記第１のゲート手段の出力信号により復帰
されるフリップフロップと、上記マルチバイブレータの
出力と上記フリップフロップの出力との論理積出力によ
り上記複合同期信号から水平同期信号を取り出す第３の
ゲート手段とを備えたことを特徴とする水平同期信号検
出装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10766675A JPS597264B2 (ja) | 1975-09-04 | 1975-09-04 | スイヘイドウキシンゴウケンシユツソウチ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10766675A JPS597264B2 (ja) | 1975-09-04 | 1975-09-04 | スイヘイドウキシンゴウケンシユツソウチ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5231613A JPS5231613A (en) | 1977-03-10 |
| JPS597264B2 true JPS597264B2 (ja) | 1984-02-17 |
Family
ID=14464918
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10766675A Expired JPS597264B2 (ja) | 1975-09-04 | 1975-09-04 | スイヘイドウキシンゴウケンシユツソウチ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS597264B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5752266A (en) * | 1980-09-12 | 1982-03-27 | Sanyo Electric Co Ltd | Picture stabilizing circuit of television set |
-
1975
- 1975-09-04 JP JP10766675A patent/JPS597264B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5231613A (en) | 1977-03-10 |
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