JPS5941277A - ドツトパタ−ン出力制御方式 - Google Patents
ドツトパタ−ン出力制御方式Info
- Publication number
- JPS5941277A JPS5941277A JP15206982A JP15206982A JPS5941277A JP S5941277 A JPS5941277 A JP S5941277A JP 15206982 A JP15206982 A JP 15206982A JP 15206982 A JP15206982 A JP 15206982A JP S5941277 A JPS5941277 A JP S5941277A
- Authority
- JP
- Japan
- Prior art keywords
- data
- latch circuit
- column
- latched
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 238000010586 diagram Methods 0.000 description 7
- 238000000034 method Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
- 230000002194 synthesizing effect Effects 0.000 description 2
- 238000005516 engineering process Methods 0.000 description 1
- 239000011159 matrix material Substances 0.000 description 1
- 238000003672 processing method Methods 0.000 description 1
Classifications
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/485—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by the process of building-up characters or image elements applicable to two or more kinds of printing or marking processes
- B41J2/505—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by the process of building-up characters or image elements applicable to two or more kinds of printing or marking processes from an assembly of identical printing elements
- B41J2/5056—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by the process of building-up characters or image elements applicable to two or more kinds of printing or marking processes from an assembly of identical printing elements using dot arrays providing selective dot disposition modes, e.g. different dot densities for high speed and high-quality printing, array line selections for multi-pass printing, or dot shifts for character inclination
Landscapes
- Engineering & Computer Science (AREA)
- Quality & Reliability (AREA)
- Dot-Matrix Printers And Others (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、ドツトマトリックスで文字を構成すルインパ
クト式シリアルプリンタの印字処理方式に関する。
クト式シリアルプリンタの印字処理方式に関する。
従来、印字ワイヤを駆動するためのデータを保持するう
、子回路は一つで構成されていた。したかって、第１図
に示す千鳥状に配列した印字ワイヤを持つ“印字ヘッド
を有するプリンタの場合、Ｒ列及びＬ列でそれぞれ印字
するドツトパターンデータをキャラクタジェネレータか
ら引出し、第２図ｆａ１． （ｂｌＫ示すように合成し
た後でう、子回路へ送り出さねばならなかった。すなわ
ち、同図（ａ）のよう［Ｒ列とＬ列の必要なピットデー
タだけを合成するためには、同図（ｂ）［示すとおりＡ
ＮＩ）−（ＪＲ等の演算を行なう必要があった。第３図
は、その印字処理プロ、り図の一例である。キャラクタ
ジェネレータ２１から取り出したＲ列とＬ列のデータ全
合成するために、一度それぞれのパターンデータをマイ
クロプロセッサ（ＭＰＵ）２２に読み込み、Ｌ列は奇数
行のデータだけｉｓ Ｒ列は偶数行のデータだけを取り
出し合成する論理演算が必要であった。したがって、Ｍ
ＰＵの処理が増えることで、プリンタの印字速度に影響
を及ぼしていた。
、子回路は一つで構成されていた。したかって、第１図
に示す千鳥状に配列した印字ワイヤを持つ“印字ヘッド
を有するプリンタの場合、Ｒ列及びＬ列でそれぞれ印字
するドツトパターンデータをキャラクタジェネレータか
ら引出し、第２図ｆａ１． （ｂｌＫ示すように合成し
た後でう、子回路へ送り出さねばならなかった。すなわ
ち、同図（ａ）のよう［Ｒ列とＬ列の必要なピットデー
タだけを合成するためには、同図（ｂ）［示すとおりＡ
ＮＩ）−（ＪＲ等の演算を行なう必要があった。第３図
は、その印字処理プロ、り図の一例である。キャラクタ
ジェネレータ２１から取り出したＲ列とＬ列のデータ全
合成するために、一度それぞれのパターンデータをマイ
クロプロセッサ（ＭＰＵ）２２に読み込み、Ｌ列は奇数
行のデータだけｉｓ Ｒ列は偶数行のデータだけを取り
出し合成する論理演算が必要であった。したがって、Ｍ
ＰＵの処理が増えることで、プリンタの印字速度に影響
を及ぼしていた。
本姑明は、ラッチ回路１１ｉ−Ｒ列、Ｌ列各々別々に動
作できるよう構成することにより、Ｒ列、Ｌ列のドツト
データを合成する処理をな（ｊ、、ＭＰＵの負担を軽く
する方式を提供することにある。
作できるよう構成することにより、Ｒ列、Ｌ列のドツト
データを合成する処理をな（ｊ、、ＭＰＵの負担を軽く
する方式を提供することにある。
次に１本発明の実施例について図面を参照して説明する
。
。
第４図は本発明のプロ、り図の一例である。同図におい
て、′現在の印字へ、ド位置におけるＲ列及びＬ列の印
字ワイヤ駆動データをキャラクタ・ジェネレータ３１か
ら取シ出し、Ｒ列およびＬ列う、子回路３３Ｒおよび３
３Ｌで一時データ全保持した後、印字へ、ドライバ回路
３４へ送り出し印字へ、ド３５で印字を行なう。
て、′現在の印字へ、ド位置におけるＲ列及びＬ列の印
字ワイヤ駆動データをキャラクタ・ジェネレータ３１か
ら取シ出し、Ｒ列およびＬ列う、子回路３３Ｒおよび３
３Ｌで一時データ全保持した後、印字へ、ドライバ回路
３４へ送り出し印字へ、ド３５で印字を行なう。
以下第５図を使用してもう少し詳しく説明する。
千鳥状の印字ワイヤを持つシリアルド、ドブリンクでは
、各印字タイミングの間に毎回Ｌ列及びＬ列の２列分の
ドツトパターンデータをキャラクタ・ジェネレータ３１
から取フ出す。取シ出したデータはＲ列、Ｌ列それぞれ
をデータバスでう、子回路３３へ送る。ここで、Ｒ列の
データを送った時にＲ側うッチ回路３３Ｒｔ動作させる
と、偶数行のピットだけがう、チされ、奇数行のピット
は自動的に消去される。同様にＬ列のデータを送フＴ、
（Ｉｌｌ ５ッチ回路３３Ｌｔ−動作させることによ
）、野数行のピットだけをラッチすることができる。
、各印字タイミングの間に毎回Ｌ列及びＬ列の２列分の
ドツトパターンデータをキャラクタ・ジェネレータ３１
から取フ出す。取シ出したデータはＲ列、Ｌ列それぞれ
をデータバスでう、子回路３３へ送る。ここで、Ｒ列の
データを送った時にＲ側うッチ回路３３Ｒｔ動作させる
と、偶数行のピットだけがう、チされ、奇数行のピット
は自動的に消去される。同様にＬ列のデータを送フＴ、
（Ｉｌｌ ５ッチ回路３３Ｌｔ−動作させることによ
）、野数行のピットだけをラッチすることができる。
したがって、Ｒ列とＬ列のデータを別々に処理すること
が可能となる。ラッチしたデータは、次に印字するドツ
トパターンデータを取り入れるまで保持される。ゲート
回路３６は、ラッチされたデータをタイミングよくドラ
イバ回路３４へ送り出す。すなわち、印字タイミング信
号でゲート回路３６全開くことにより、う、チされたデ
ータがドライバ回路３４へ送られる。ドライバ回路３４
で、印字ワイヤを駆動するための電流を作り、これ全印
字ヘッド３５Ｖｃ送り、この電流全印字ソレノイドに流
すことで印字ワイヤを１駆動する。
が可能となる。ラッチしたデータは、次に印字するドツ
トパターンデータを取り入れるまで保持される。ゲート
回路３６は、ラッチされたデータをタイミングよくドラ
イバ回路３４へ送り出す。すなわち、印字タイミング信
号でゲート回路３６全開くことにより、う、チされたデ
ータがドライバ回路３４へ送られる。ドライバ回路３４
で、印字ワイヤを駆動するための電流を作り、これ全印
字ヘッド３５Ｖｃ送り、この電流全印字ソレノイドに流
すことで印字ワイヤを１駆動する。
以上１本発明において使用する回路では、従来使用して
いたＭ Ｐ Ｕでの演算部分を省略する効果がある。ま
た、ラッチ回路とゲート回路においてＲ列とＬ列のデー
タを別々に制御することで、Ｒ列だけの印字、Ｌ列だけ
の印字及びＲ列、Ｌ列両方の印字を容易に行なうことが
出来る。
いたＭ Ｐ Ｕでの演算部分を省略する効果がある。ま
た、ラッチ回路とゲート回路においてＲ列とＬ列のデー
タを別々に制御することで、Ｒ列だけの印字、Ｌ列だけ
の印字及びＲ列、Ｌ列両方の印字を容易に行なうことが
出来る。
本発明は、以上説明したように、印字ワイヤの左右の配
列に対応させた複数のラッチ回路で（Ｒ成することによ
り、ＭＰＵの負荷を減らして、印字処理速度全向上させ
る効果がある。
列に対応させた複数のラッチ回路で（Ｒ成することによ
り、ＭＰＵの負荷を減らして、印字処理速度全向上させ
る効果がある。
第１図は、千鳥状に配列した印字ワイヤの配置図。第２
図は、従来技術によりＭＰＵで演算した場合の説明図。 第３図は、従来技術による印字処理のブロック図。第４
図は、本発明の一実施例を示したプロ、り図。第５図は
、本発明の一実施例（縦１５ｄＯ１の場合）を示したプ
ロ、り図。 ２１．３１・・・・・・キャラクタ・ジェネレータ、２
２・・・・・・マイクロプロセッサ（ＭＰＵ）、２３・
・・・ラッチ回路、３３Ｒ・・・・・・Ｒ列データラッ
チ回路、３３Ｌ・・・・・Ｌ列データラッチ回路、２４
．３４・・・・印字ヘッドドライバ回路、２５．３５・
旧・・印字へノド。 や Ｌ尺 第１ 図
図は、従来技術によりＭＰＵで演算した場合の説明図。 第３図は、従来技術による印字処理のブロック図。第４
図は、本発明の一実施例を示したプロ、り図。第５図は
、本発明の一実施例（縦１５ｄＯ１の場合）を示したプ
ロ、り図。 ２１．３１・・・・・・キャラクタ・ジェネレータ、２
２・・・・・・マイクロプロセッサ（ＭＰＵ）、２３・
・・・ラッチ回路、３３Ｒ・・・・・・Ｒ列データラッ
チ回路、３３Ｌ・・・・・Ｌ列データラッチ回路、２４
．３４・・・・印字ヘッドドライバ回路、２５．３５・
旧・・印字へノド。 や Ｌ尺 第１ 図
Claims (1)
- 千鳥状に配列した印字ワイヤを持つ、インノ（クト式シ
リアルプリンタにおいて、前記千鳥状に配列した印字ワ
イヤのうちの左側配列に対応したラッチ回路動作と、右
側配列に対応したラッチ回路動作とを個別に動作させる
ことのできるラッチ回路手段を有することを特徴とした
ドラトノくターン出力制御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15206982A JPS5941277A (ja) | 1982-09-01 | 1982-09-01 | ドツトパタ−ン出力制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15206982A JPS5941277A (ja) | 1982-09-01 | 1982-09-01 | ドツトパタ−ン出力制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5941277A true JPS5941277A (ja) | 1984-03-07 |
Family
ID=15532370
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15206982A Pending JPS5941277A (ja) | 1982-09-01 | 1982-09-01 | ドツトパタ−ン出力制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5941277A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6086272A (en) * | 1996-03-26 | 2000-07-11 | Seiko Epson Corporation | Printing apparatus and control method therefor |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5663677A (en) * | 1979-10-30 | 1981-05-30 | Oki Electric Ind Co Ltd | Printing control system of dot printer |
-
1982
- 1982-09-01 JP JP15206982A patent/JPS5941277A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5663677A (en) * | 1979-10-30 | 1981-05-30 | Oki Electric Ind Co Ltd | Printing control system of dot printer |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6086272A (en) * | 1996-03-26 | 2000-07-11 | Seiko Epson Corporation | Printing apparatus and control method therefor |
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