JPS59223047A - リンク機能を有するプログラマブル・コントロ−ラ - Google Patents

リンク機能を有するプログラマブル・コントロ−ラ

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Publication number
JPS59223047A
JPS59223047A JP58098705A JP9870583A JPS59223047A JP S59223047 A JPS59223047 A JP S59223047A JP 58098705 A JP58098705 A JP 58098705A JP 9870583 A JP9870583 A JP 9870583A JP S59223047 A JPS59223047 A JP S59223047A
Authority
JP
Japan
Prior art keywords
data
status information
memory
link
machine
Prior art date
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Pending
Application number
JP58098705A
Other languages
English (en)
Inventor
Ritsuo Hashimoto
律雄 橋本
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Omron Corp
Original Assignee
Tateisi Electronics Co
Omron Tateisi Electronics Co
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Tateisi Electronics Co, Omron Tateisi Electronics Co filed Critical Tateisi Electronics Co
Priority to JP58098705A priority Critical patent/JPS59223047A/ja
Publication of JPS59223047A publication Critical patent/JPS59223047A/ja
Pending legal-status Critical Current

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  • Programmable Controllers (AREA)
  • Small-Scale Networks (AREA)
  • Maintenance And Management Of Digital Transmission (AREA)
  • Debugging And Monitoring (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (発明の分野) この発明はプログラマブル・コントローラ(以下PCと
称する)に関し、特に、リンク機能を有するPCに関す
る。
(発明の背景) 最近のPCには、リンク信号線によって1台以上の他機
と接続されたときに、互いの入出カメモリのデータをリ
ンクメモリを介して所定周期で繰り返し交換し合う通信
手段を有し、リンクされたPCがそれぞれの入出カメモ
リおよびリンクメモリのデータに基づいてそれぞれのユ
ーザプログラムの処理を進めるように構成されたリンク
機能を有するものが知られている。
この種のPCを複数台リンクして制御システムを構成し
た場合、各PCの入出力データが互いに関連して、恰も
1つのシステムのように動作覆る。
ところが、従来のこの種のPCにおいては、リンクされ
たPC相互間でそれぞれの運転モード(プログラム実行
モードやプログラム作成モードなど〉−(b故障状態(
バッテリの電痒異常・装置内の温度異常・パリティチェ
ックによる異常など)を監視できるように構成されてい
なかった。
そのため、リンクされたPC中にプログラム実行モード
になっていないPCやなんらかの故障を生じたPCがあ
っても、これらは係員が各PCを監視することによって
しか判らない。従って、リンクされたPC全体に正常動
作をしていないPCからの入出力データが伝わり、その
正常でない入出力データに基づいてシステム全体が界雷
動作をする虞れがあった。
(発明の目的) ノこの発明の目的は、各PCの運転モードや故障状態を
示すステータス情報を互いに交換し合い、交換し合った
ステータス情報に基づいて各1) Cがどのように振舞
うかをユーザプログラムにて設定できるようにしたリン
ク機能を有づ”るPCを提供することにある。
(発明の(M成と効果) 上記の目的を達成するために、この発明に係るリンク機
能を有するPCは、運転モードや故障状態を示1ステー
タス情報をリンクされたPC間で上述のデータ交換動作
とともに上記通信手段によって交換し合うステータス交
換手段を設け、交換し合ったステータス情報をユーザプ
ログラムの処理対象として使用できるようにしたことを
特徴とづる。
この構成によれば、リンクされた各PCにおいて互いに
他のPCの運転モードや故障状態を監視づることができ
る。そして、交換し合ったステータス情報に基づいて、
どのような異常にどのように対処す゛るかを各PCのユ
ーザプログラムに任意に設定することができる。これで
システム全体としての異常に対する安全性が確保される
(実施例の説明) 第1図において、#1および#2はそれぞれ本発明に係
るPCであり、21台の同一構成のPCをリンク信号線
9でもって結合し、−上述したリンク方式のコントロー
ラシステムを構成している図である。なお、リンク台数
は2台に制限されるものではなく、この例でも2台以上
のPCが接続されているものとする。
P C# 1および#2は、基本構成として、ユーリ“
プログラムが格納されるメモリ3と、外部入力信号が与
えられる入力回路1と、外部出力信号を送出づる出力回
路2と、メモリ3に格納されたニーザブ[jグラムを実
行するCPU5と、プログラム実行性にCI〕U 5に
よってアクセスされるワーキングメ[す4および制御デ
ータメモリ6とを有づる。制御データメモリ6には、入
力回路I J5よび出力回路2に対応した入出力データ
のバッファメモリどなる入出カメモリd1と、この発明
の対象であるリンク機能を実現するためのリンクメモリ
62と、その他タイマ、/カウンタ命令や内部補助リレ
ーなどの処理に使われる制御データエリアとが含まれて
いる。
このP C′h’最大N台までリンクできるものと−す
ると、上記リンクメモリ62はN個の等しいエリアに分
割されていて、後述のように互いに交換される入出力テ
ークが、リンクメモリ62の各分割エリアのそれぞれに
格納される。
CI) U 5は、制御データメモリ6のデータ(自機
の入出力データだけでなくリンクされた他機の入出力デ
ータを含む)に基づいてユーザプログラムを実行づると
ともに、その実行結果で制御データメモリ6の出力デー
タを書換える。また同時に、上記入力回路1の入力デー
タを入出カメモリ61の所定エリアに甫込む入力更新処
理と、入出カメモリ61の所定エリアの出力データを上
記出力回路2にセットする出力更新処理とを行なう。な
お、このPCを1台のみで使用する場合には、従来から
のl) Cと全く同様に動作する。
この発明のPCはリンク機能を実現するために、信号線
ってリンクされたPC間でデータ通信を行なうための通
信装置7と、リンクされた複数のPCを区別する機番を
設定するためのディジタルスイッチなどからなる機番設
定器8を備える。設定器8で設定された機番は、Q P
 U 5に伝えられ、リンクメモリ62の使用エリアを
決定づるデータどなる。また設定された機番は通信装置
7にも入力〉れ、これはデータ通信の主従関係を決定す
る情報となる。つまり、機番「1」が設定されたPCが
データ通信の親局どなり、他の番号が設定されたPCは
子局となる。この例では、PGI1が機番r1Jで、デ
ータ通信の親局となるものとづる。
第3図のフローヂ1−−1〜は通信装置7の動作イ示し
ている。以下このフ1コーヂ(7−トに従って、親局側
の動作、d3よび子局側の動作を順次説明づる。
電源投入後の最初のステップ100のイニシt・ル処理
に続いて、ステップ101で機番設定器8の設定番号を
読込む。次のステップ102で自機が親局か子局かを設
定された機番から判断する。
親局の場合はステップ103以降の処理に進み、子局の
場合はステップ120以降の処理に進む。
まず親局の動作について説明でる。ステップ103では
子局であるPCに所定の順番でポーリングをかりる。ま
ず最初は機番「2]のPCにポーリングをかりる。続く
ステップ104でポーリングを受信し7j P C# 
2から後述するように送信されてくるデータを受信する
このときの送信データのフォーマットを第2図に示しで
いる。この実施例のフォーマットはフレーム形式のデー
タであるが、勿論化のフォーマツ1−の形式でb良い。
第2図にd5いて、Fはフラグ、Δはアドレスフィール
ド、Cはコントロールフィールド、Dは送信局における
入出力データのフィールド(タイマ/カウンタや内部補
助リレーなどのデータを含めても良い)、sはこの発明
の要点に係わる故障ステータスおよびモードステータス
のフィールド、CRCはザイクリック・リダンダンシイ
・キャラクタ、Fは末尾のフラグである。
ここで、故障ステータスとはそれぞれ送信局のバッテリ
翼常・温度異常・パリディ異常などを示す情報であり、
モードステータスとは送信局の運転モードを示す情報で
ある。
第3図のスi゛ツブ105では、受信データ中のステー
タスフィールドSをチェックし、これらが全て正常な状
態であるかを判断する。正常であればステップ106で
、受信したデータをリンクメモリ62の所定のエリノア
(機番に対応する)に格納づる。またステータス情報に
なんらかの異常が認められる場合、その異常情報を例え
ばワーキングメモリ4などに機番と対応させて書込むこ
とににす、CP U 5にその異常情報を伝える。
CI) U 5側に」二連のように伝えられた他機の異
常情報はユーザプログラムにて処理される。つまり、ユ
ーザプログラム2は他;幾にどのような異常が生じlJ
らとのような制御動作を取るかが設定されている。従っ
て、例えば他機がプログラム実行モードになっていない
場合には所定の表示器を動作させてgM報を発するよう
にユーザプログラムを組んでJ5 +jば、従来のよう
に他機が実行モードになっていないのにも拘わらず自機
が勝手にプログラムを実行し、誤った制御を行なうこと
を防止することができる。
ステップ107ではリンクされt= tべての子局にポ
ーリングをかけたかどうかを判断づる。前記にポーリン
グをかけるまでは先のステップ103に戻り、全部終了
したならばステップ108に進む。
ステップ108−では自機のステータス情報を読取り、
これを送信データフレーム中にセットする。
続くステップ1O−Itでは、自機の入出力データおよ
びステータス情報をすべての子局に送信するノこめに、
自機自体を指定するポーリングを発生づ”る。
これで後述づるように子局は全て受信体制となる。
続くステップ110で親局からデータを送信する。
以上が親局の動作である。次に子局の動作について説明
する。
子局に当るP C# 2では、まずステップ12−0で
P C# 1がら上述のように発せられるポーリングを
受信覆る。そのポーリングが自機<PCl3>を指定す
るものか否かをステップ121で判断づ′る。自機を指
定しているものであればステップ122に進み、自機の
ステータス情報を読取り、送信フレームのステータスフ
ィールドSにセットする。続くステップ123で、この
ステータス情報J3よび自機の入出力データを含むデー
タを送信する。この送信データは先のステップ104で
親局(、PC#1)に受信されるだけでなく、次に述べ
るように他の子局(図示していないリンクされた他のP
 C)にも受信される。それは次のような処理による。
つまり、ステップ121のチェックでポーリングが自機
を指定しているものでなかった場合はステップ124に
進み、信号線9に送り出されたデータを受信する。ここ
で受信するデータは、他の子局から送信されたデータで
もあるし、またステップ110で親局から送信されたデ
ータでもある。
続くステップ125で、受信したデータ中のステータス
フィールドSの情報をチェックし、全て正常であればス
テップ126で受信した入出力データをリンクメモリ6
2にストアする。また、なんらかの異常が検出されれば
これをワーキングメモリ4にス1−アづることによって
CPtJ5に伝える。
この異常がCPU5に伝えられることにより、先に説明
しIこのと同様に、子局においても自機のユーザプログ
ラムで設定された異常対策がとられることになる。親局
および子局は以上説明した動作を繰り返す。
【図面の簡単な説明】 第1図はこの発明に係るプログラマブル・コントローラ
を2台リンクした状態を承りブロック図、第2図は各コ
ントローラ間で送受信されるデータのフォーマットを示
す図、第3図は上記コントローラにiJ)ける通信装置
7の動作を示すフローチャートである。 1・・・・・・入力回路 2・・・・・・出ノj回路 3・・・・・・ユーザプログラムメモリ5・・・・・・
CPU 6・・・・・・制御データメモリ 61・・・入出カメモリ 62・・・リンクメモリ 7・・・・・・通信装置 8・・・・・・機番設定器 9・・・・・・リンク信号紅 #1・・・親局どなるPC #2・・・子局となるPC 特t′[出願人 立石電機株式会社

Claims (1)

    【特許請求の範囲】
  1. (1)リンク信号線によって1台以上の他機と接続され
    たときに、互いの入出カメモリのデータをリンクメモリ
    を介して所定周期で繰り返し交換し合う通信手段を有し
    、リンクされたコントローラがそれぞれの入出カメモリ
    およびリンクメモリのデータに基づいてそれぞれのユー
    ザプログラムの2処理を進めるリンク機能を有するプロ
    グラマブル・コントローラにおいて; 運転モードや故障状態を示すステータス情報をリンクさ
    れたコントローラ間で上記データ交換動作とともに上記
    通信手段によって交換し合うステータス交換手段を設け
    、交換し合ったステータス情報をユーザプログラムの処
    理対象として使用できるJ:うにしたこ・とを特徴とす
    るリンク機能を右づるプログラマブル・コントローラ。
JP58098705A 1983-06-02 1983-06-02 リンク機能を有するプログラマブル・コントロ−ラ Pending JPS59223047A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP58098705A JPS59223047A (ja) 1983-06-02 1983-06-02 リンク機能を有するプログラマブル・コントロ−ラ

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP58098705A JPS59223047A (ja) 1983-06-02 1983-06-02 リンク機能を有するプログラマブル・コントロ−ラ

Publications (1)

Publication Number Publication Date
JPS59223047A true JPS59223047A (ja) 1984-12-14

Family

ID=14226917

Family Applications (1)

Application Number Title Priority Date Filing Date
JP58098705A Pending JPS59223047A (ja) 1983-06-02 1983-06-02 リンク機能を有するプログラマブル・コントロ−ラ

Country Status (1)

Country Link
JP (1) JPS59223047A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61212145A (ja) * 1985-03-15 1986-09-20 Fujitsu Ltd 障害情報伝送方法
WO1990008993A1 (en) * 1989-02-03 1990-08-09 Fanuc Ltd Numeric controller for transfer line

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JPS61212145A (ja) * 1985-03-15 1986-09-20 Fujitsu Ltd 障害情報伝送方法
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