JPS59200449A - 半導体装置用リ−ドフレ−ム - Google Patents
半導体装置用リ−ドフレ−ムInfo
- Publication number
- JPS59200449A JPS59200449A JP7500883A JP7500883A JPS59200449A JP S59200449 A JPS59200449 A JP S59200449A JP 7500883 A JP7500883 A JP 7500883A JP 7500883 A JP7500883 A JP 7500883A JP S59200449 A JPS59200449 A JP S59200449A
- Authority
- JP
- Japan
- Prior art keywords
- lead
- outer frame
- external
- lead frame
- gap
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
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- Physics & Mathematics (AREA)
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- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Power Engineering (AREA)
- Lead Frames For Integrated Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は半導体装置用リードフレームに関する。
従来、半導体装置用リードフレームは、一般的に金属板
のプレス加工により外枠、外部導出用リードおよびダイ
パッド部を有するーパターンｔ −足間隔に複数個形成
して構成され、半導体素子のマウント、ボンディング、
気密封止等をへた後短尺に切断される。
のプレス加工により外枠、外部導出用リードおよびダイ
パッド部を有するーパターンｔ −足間隔に複数個形成
して構成され、半導体素子のマウント、ボンディング、
気密封止等をへた後短尺に切断される。
第１図に短尺に切断はれる前のリードフレームの一例？
示す、リードフレーム１のパターン上外枠２．外部導出
用リード３．ダイパッド部４及び間１１ｉ５よ）成句、
これが複数個形成され、前述した作業の後外枠２の切断
部６において切断される。
示す、リードフレーム１のパターン上外枠２．外部導出
用リード３．ダイパッド部４及び間１１ｉ５よ）成句、
これが複数個形成され、前述した作業の後外枠２の切断
部６において切断される。
しかるに、外枠２．外部導出用リード３．ダイパッド部
４及び間隙５の形成後切断せらる為、切断において発生
する加工歪は外部導出用リード３等に大きな影響、すな
わち、外部導出用リードの曲シ、浮き沈みおよび外枠の
湾曲等につながる。
４及び間隙５の形成後切断せらる為、切断において発生
する加工歪は外部導出用リード３等に大きな影響、すな
わち、外部導出用リードの曲シ、浮き沈みおよび外枠の
湾曲等につながる。
第２図に第１図のＡ部分の拡大図金示す。第２図におい
て１間隙５は切断部６において切断されるとき、その加
工歪は間隙５の端面１５１に集中しやすい。従って、外
部導出用リード３の中心１７が間隙５の端面１５１と同
一線上もしくは近接した場合、その端面１５１に集中し
た加工歪は外部導出用リード１３に伝わシ、外部導出用
リード１３の曲ル、浮き沈み等へつながる。
て１間隙５は切断部６において切断されるとき、その加
工歪は間隙５の端面１５１に集中しやすい。従って、外
部導出用リード３の中心１７が間隙５の端面１５１と同
一線上もしくは近接した場合、その端面１５１に集中し
た加工歪は外部導出用リード１３に伝わシ、外部導出用
リード１３の曲ル、浮き沈み等へつながる。
本発明の目的は、切断の際にこ生じる外部導出用リード
への影響を軽減したリードフレームを提供することにあ
る。
への影響を軽減したリードフレームを提供することにあ
る。
本発明による半導体装置用リードフレームは、外枠にお
ける間隙の端面が外部導出用リードの中心線の延長上よ
）離れていることを特徴とする。
ける間隙の端面が外部導出用リードの中心線の延長上よ
）離れていることを特徴とする。
以下に不発明の実施例を図面に示し詳細に説明する。
第３図は不発明の一実施例を示し、特にリードフレーム
の外枠部を拡大したところである。すなわち、外枠部２
２に外部導出用リード２３の中心２７の延長線とはその
端面２５１が一致しない間隙２５を形成する。これによ
多切断２６における加工歪が間隙２５の端面２５１に発
生しても外部導出用リード２３の変形へつながる危険性
をおさえることが可能となる。
の外枠部を拡大したところである。すなわち、外枠部２
２に外部導出用リード２３の中心２７の延長線とはその
端面２５１が一致しない間隙２５を形成する。これによ
多切断２６における加工歪が間隙２５の端面２５１に発
生しても外部導出用リード２３の変形へつながる危険性
をおさえることが可能となる。
以上、詳細に説明した様に本発明によシ短尺への切断時
における外部導出用リードの変形等を生じない半導体装
置用リードフレームを製造するととが可能となシ、その
効果は大きい。
における外部導出用リードの変形等を生じない半導体装
置用リードフレームを製造するととが可能となシ、その
効果は大きい。
第１図は従来のリードフレームを示す平面図。
第２図は第１図におけるＡ部の拡大図、第３図は本発明
の一実施例によるリードフレームの部分拡大図をそれぞ
れ示す。 ｌ・・・・・・リードフレームｓ２＝ ２ｚ・・・
・外枠。 ３．２３・・・・・・外部導出用リード、４・山・ダイ
パッド部、５．２５・・・・・・間隙、１５１，２５１
・・・・間隙の端面％６，２６・・・・・切断部、
２７・・・・・・′外部導出用リードの中心線。
の一実施例によるリードフレームの部分拡大図をそれぞ
れ示す。 ｌ・・・・・・リードフレームｓ２＝ ２ｚ・・・
・外枠。 ３．２３・・・・・・外部導出用リード、４・山・ダイ
パッド部、５．２５・・・・・・間隙、１５１，２５１
・・・・間隙の端面％６，２６・・・・・切断部、
２７・・・・・・′外部導出用リードの中心線。
Claims (1)
- 外枠、該外枠に連結された外部導出用リードおよび外部
導出用リードに連結されたダイパッド部を一単位胞とす
るものを複数個配列せしめ、各単位胞間の外枠に間隙が
設けちれた半導体装置用リードフレームにおいて、前記
間隙の端面が前記外部導出用リードの中心線の延長から
実質的にずれていることを特徴とする半導体装置用リー
ドフレ
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7500883A JPS59200449A (ja) | 1983-04-28 | 1983-04-28 | 半導体装置用リ−ドフレ−ム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7500883A JPS59200449A (ja) | 1983-04-28 | 1983-04-28 | 半導体装置用リ−ドフレ−ム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59200449A true JPS59200449A (ja) | 1984-11-13 |
Family
ID=13563732
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7500883A Pending JPS59200449A (ja) | 1983-04-28 | 1983-04-28 | 半導体装置用リ−ドフレ−ム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59200449A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4984062A (en) * | 1987-03-30 | 1991-01-08 | Mitsubishi Denki Kabushiki Kaisha | Packaged semiconductor device |
-
1983
- 1983-04-28 JP JP7500883A patent/JPS59200449A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4984062A (en) * | 1987-03-30 | 1991-01-08 | Mitsubishi Denki Kabushiki Kaisha | Packaged semiconductor device |
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