JPS59162587A - 画像表示装置 - Google Patents
画像表示装置Info
- Publication number
- JPS59162587A JPS59162587A JP58035439A JP3543983A JPS59162587A JP S59162587 A JPS59162587 A JP S59162587A JP 58035439 A JP58035439 A JP 58035439A JP 3543983 A JP3543983 A JP 3543983A JP S59162587 A JPS59162587 A JP S59162587A
- Authority
- JP
- Japan
- Prior art keywords
- memory
- image
- data
- cpu
- frame memory
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Digital Computer Display Output (AREA)
- Image Generation (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、１つのＣＲＴ−面にイメージや文字。
図形などを同時に表示する画像表示装置の改良に関する
。
。
従来から、コンビ纂−タトモグ２ツィ装置や超音波診断
装置などのいわゆる画像診断装置においては、画像イ・
メークの他にグラフィック図形や文字などが同一の表示
画面上に表示される。第１図にその表示例を示す。
装置などのいわゆる画像診断装置においては、画像イ・
メークの他にグラフィック図形や文字などが同一の表示
画面上に表示される。第１図にその表示例を示す。
このような表示を行なう画像表示装置のメモリ構成は第
２図に示すように、表示装置としてのＣＲＴ 、複数個
のフレームメモリよりなシ主記憶装置ＭＭからのイメー
ジ・データを記憶するイメージ・メモリＭＡ、同様に複
数個のフレームメモリよりなり主記憶装置ＭＭからの文
字・グラフィ、り・データを記憶する文字・グラフィ、
り・メモリＭＢ、ディジタル・アナｎグ変換器（以下Ｄ
Ａ変変換換器いう）ＤＡを介して与えられるイメージ・
メモリＭＡの出力と文字・グラフィ、クメモリＭＢの出
力を組み合わせて１本のビデオ入力信号とするための混
合回路ＭＩＸ 、各メモリＭＡ、 ＭＢを制御し、コン
ピュータの中央処理装置ＣＰＵとの情報交換を行なうグ
ラフィ、り・ディスプレイ・コントローラＧＤＣＩ、Ｇ
ＤＣ２、イメージ・メモリとＣＰＵ間の高速データ転送
をするためのダイレクト・メモリ・アクセスＤＭＡ機能
等から構成されている。
２図に示すように、表示装置としてのＣＲＴ 、複数個
のフレームメモリよりなシ主記憶装置ＭＭからのイメー
ジ・データを記憶するイメージ・メモリＭＡ、同様に複
数個のフレームメモリよりなり主記憶装置ＭＭからの文
字・グラフィ、り・データを記憶する文字・グラフィ、
り・メモリＭＢ、ディジタル・アナｎグ変換器（以下Ｄ
Ａ変変換換器いう）ＤＡを介して与えられるイメージ・
メモリＭＡの出力と文字・グラフィ、クメモリＭＢの出
力を組み合わせて１本のビデオ入力信号とするための混
合回路ＭＩＸ 、各メモリＭＡ、 ＭＢを制御し、コン
ピュータの中央処理装置ＣＰＵとの情報交換を行なうグ
ラフィ、り・ディスプレイ・コントローラＧＤＣＩ、Ｇ
ＤＣ２、イメージ・メモリとＣＰＵ間の高速データ転送
をするためのダイレクト・メモリ・アクセスＤＭＡ機能
等から構成されている。
このような画像表示装置１０へＣＰＵから供給式れるデ
ータの形式は第５図に示すようになっている。
ータの形式は第５図に示すようになっている。
すなわち、イメージ・データは同図（ａ） 、グラフィ
ック・データは同図（ｂ）１文字データは同図（ｅ）の
（１）又はＯｌ）のような形式となる。このような形式
のデータは別々のデータとして主記憶装置に記憶されて
おり、必要に応じて画像表示装置へ転送される。
ック・データは同図（ｂ）１文字データは同図（ｅ）の
（１）又はＯｌ）のような形式となる。このような形式
のデータは別々のデータとして主記憶装置に記憶されて
おり、必要に応じて画像表示装置へ転送される。
しかしながら、このように構成された従来の画像表示装
置１０では、次のような欠点がるる。
置１０では、次のような欠点がるる。
（リ 表示すべきデータがイメージ、グラフィック。
文字など多様なデータであるため、種々の形式（２）画
像データを記憶するためのメモリの使用効率が悪い。イ
メージ、グラフィ、り１文字などすべての画像データを
一括して保存するのに不便でるる。
像データを記憶するためのメモリの使用効率が悪い。イ
メージ、グラフィ、り１文字などすべての画像データを
一括して保存するのに不便でるる。
（Ｓ） ＣＰＵが画像表示装置のイメージ・データ、
グラフィ、り・データ、文字データなど、即ち、各フレ
ームメモリの内容を読出す場合にその手順が複雑でロシ
、読出された内容もデータ形式がそれぞれ異なるために
、その処理本複雑である。
グラフィ、り・データ、文字データなど、即ち、各フレ
ームメモリの内容を読出す場合にその手順が複雑でロシ
、読出された内容もデータ形式がそれぞれ異なるために
、その処理本複雑である。
本発明の目的は、このような欠点を除去し、ＣＰＵの主
記憶装置あるいは補助記憶装置に蓄えられているイメー
ジ情報・文字情報・グラフィ、り情報を効率的にディス
プレイ・メモリに転送し、それｉ ＣＲＴなどの表示装
置に表示できるようにすると共に、逆にディス７レイ・
メモリの内容を、ＣＰＵの主記憶装置や補助記憶装置に
効率的に転送し、記憶保存できるようにもすることので
きる画像表示装置を提供することにろる。
記憶装置あるいは補助記憶装置に蓄えられているイメー
ジ情報・文字情報・グラフィ、り情報を効率的にディス
プレイ・メモリに転送し、それｉ ＣＲＴなどの表示装
置に表示できるようにすると共に、逆にディス７レイ・
メモリの内容を、ＣＰＵの主記憶装置や補助記憶装置に
効率的に転送し、記憶保存できるようにもすることので
きる画像表示装置を提供することにろる。
以下図面を用いて本発明の詳細な説明する。第４図は本
発明に係る画像表示装置の一実施例を示す要部構成図で
、同図において、イメージ、グラフィ、り図形１文字等
は同一構成のフレーム・メモリに記憶される。図におい
て、イメージ・文字・グラフィック・メモリＭＣはｎ−
１枚のフレーム・メモリＦＭから構成され、それぞれの
フレーム・メモリはＣＲＴ全表示面をカバーするに足る
メモリ容量をもっている。例えばＣＲＴの表示画面が横
方向２５６ ドツト、縦方向２５６ドツトで構成される
とき、各フレーム・メモリはそれぞれ２５６ ｘ ２５
６ ＝ ６４にビ、ト（但しＫ −１０２４）のメモリ
容量をもつが、最近のＬＳＩ素子では高々１ケのＲＡＭ
で構成できる。
発明に係る画像表示装置の一実施例を示す要部構成図で
、同図において、イメージ、グラフィ、り図形１文字等
は同一構成のフレーム・メモリに記憶される。図におい
て、イメージ・文字・グラフィック・メモリＭＣはｎ−
１枚のフレーム・メモリＦＭから構成され、それぞれの
フレーム・メモリはＣＲＴ全表示面をカバーするに足る
メモリ容量をもっている。例えばＣＲＴの表示画面が横
方向２５６ ドツト、縦方向２５６ドツトで構成される
とき、各フレーム・メモリはそれぞれ２５６ ｘ ２５
６ ＝ ６４にビ、ト（但しＫ −１０２４）のメモリ
容量をもつが、最近のＬＳＩ素子では高々１ケのＲＡＭ
で構成できる。
イメージ・メモリはｍｍ−４（≦ｎ）枚の７レーム・メ
モリを持ち、これによって各ドツト毎に２ｍ−１とおり
の濃淡を表現できる。残りのｎ−ｍ枚のフレーム・メモ
リは文字やグラフィ、り図形を記憶するために使われる
が、各フレームメそすの内容を順次ＣＲＴへ送り出して
表示したときに、所定のグラフィック図形あるいは文字
を表示するようにそれぞれのフレームメモリには１又は
０の情報が記憶される。イメージ・メモリＭＣの出力は
ＤＡ変換器によってアナログ情報に変換された後に、ま
た、文字・グラフィ、り・メモリの出力はそのｔｔの形
で混合回路ＭＩＸによってＯＲ論理がとられ、そのｉが
ＣＲＴに供給されゐ。このように同一構造のフレーム・
メモリの積層によって構成されたイメージ文字・グラフ
ィック・メモリＩＣを制御するには唯１個のＧＤＣでよ
い。ＧＤＣからはＣＲＴに同期信号が供給される。
モリを持ち、これによって各ドツト毎に２ｍ−１とおり
の濃淡を表現できる。残りのｎ−ｍ枚のフレーム・メモ
リは文字やグラフィ、り図形を記憶するために使われる
が、各フレームメそすの内容を順次ＣＲＴへ送り出して
表示したときに、所定のグラフィック図形あるいは文字
を表示するようにそれぞれのフレームメモリには１又は
０の情報が記憶される。イメージ・メモリＭＣの出力は
ＤＡ変換器によってアナログ情報に変換された後に、ま
た、文字・グラフィ、り・メモリの出力はそのｔｔの形
で混合回路ＭＩＸによってＯＲ論理がとられ、そのｉが
ＣＲＴに供給されゐ。このように同一構造のフレーム・
メモリの積層によって構成されたイメージ文字・グラフ
ィック・メモリＩＣを制御するには唯１個のＧＤＣでよ
い。ＧＤＣからはＣＲＴに同期信号が供給される。
ＧＤＣはＣＰＵとイメージ・文字・グラフィック・メモ
リＭＣとのインタフェイス機能を持ち、ＧＤＣ経由で当
該メモリへの書き込み、読み出しができるが、ＤＭＡと
ＤＭＡへの入出力信号を制御するマスクレジスタ（ＭＡ
ＲＫ ＲＥＧ） ＲＥＧＩ、 ＲＥＧ２及びゲート回路
ＧＩ。
リＭＣとのインタフェイス機能を持ち、ＧＤＣ経由で当
該メモリへの書き込み、読み出しができるが、ＤＭＡと
ＤＭＡへの入出力信号を制御するマスクレジスタ（ＭＡ
ＲＫ ＲＥＧ） ＲＥＧＩ、 ＲＥＧ２及びゲート回路
ＧＩ。
〜ＧＩｉ−０，Ｇｏ、〜ＧＯ，，・−、は、ＣＰＵとイ
メージ・文字・グラフィ、り・メモリ間の選択的データ
転送を可能とするように構成されたものである。
メージ・文字・グラフィ、り・メモリ間の選択的データ
転送を可能とするように構成されたものである。
コントローラは、上記マスクレジスタとＣＰＵとのイン
タ７エイスを受持つ装置で、ＣＰＵはこの装置を経由し
てＭＡＳＫ ＲＥＧ、 １．２に任意のデータを設定す
ることができる。
タ７エイスを受持つ装置で、ＣＰＵはこの装置を経由し
てＭＡＳＫ ＲＥＧ、 １．２に任意のデータを設定す
ることができる。
第５図はこのように構成された画像表示装置に供給すベ
ーきデータ構造の１つの例である。このデータ形式は第
５図のように構成されていてもよい。
ーきデータ構造の１つの例である。このデータ形式は第
５図のように構成されていてもよい。
次にこの画像表示装置の動作を説明する。
イメージ・データをフレーム・メモリに転送するにＬ１
第５図のｎ−１と、トの情報のうち上位（左側）のｎ−
ｍビ、トは、イメージには無関係であるからこれらのフ
レームメモリの内容が影響をうけないよう、 ＲＥＧＩ
の上位のｎ−ｍビットに０を書き込んでおく。このよう
にしてＣＰＵからフレームメモリにＤｈｉＡ転送を行な
うと画像処理装置のイメージ・メモリの部分のみが書き
替えられる。文字デーｉやグラフィ、り・データも同様
の手ハハで、所望のフレームメモリにのみ転送できる。
第５図のｎ−１と、トの情報のうち上位（左側）のｎ−
ｍビ、トは、イメージには無関係であるからこれらのフ
レームメモリの内容が影響をうけないよう、 ＲＥＧＩ
の上位のｎ−ｍビットに０を書き込んでおく。このよう
にしてＣＰＵからフレームメモリにＤｈｉＡ転送を行な
うと画像処理装置のイメージ・メモリの部分のみが書き
替えられる。文字デーｉやグラフィ、り・データも同様
の手ハハで、所望のフレームメモリにのみ転送できる。
従って、イメージ・メモリの内容を書きかえても、それ
以外の情報を壊すことはない。
以外の情報を壊すことはない。
フレームメモリの内容をＣＰＵに読出す場合には、ＭＡ
ＳＫ ＲＥｏ、 ２を所望のパターンに設定することに
より、全部のフレームメモリの内容を読み出すことも、
あるいは、イメージ、文字、グラフィックデータなどを
選択的に読み出すことが出来るので、読み出し後のＣＰ
Ｕの処理が大いに簡略化される。
ＳＫ ＲＥｏ、 ２を所望のパターンに設定することに
より、全部のフレームメモリの内容を読み出すことも、
あるいは、イメージ、文字、グラフィックデータなどを
選択的に読み出すことが出来るので、読み出し後のＣＰ
Ｕの処理が大いに簡略化される。
第６図は本発明の他の実施例を示すもので、ＲＥＧＩ及
びＲＥｏ２ を同一のマスクレジスタで共用し九例で
あり、フレーム・メモリへの同時書込み。
びＲＥｏ２ を同一のマスクレジスタで共用し九例で
あり、フレーム・メモリへの同時書込み。
読出しを行なわない場合これで充分でろる。
第７図はフレームメモリの回路構成例である。
ＭＲｌはマスクレジスタの１番目の出力で、この値が１
のときはＣｈｉｐ ８ｅｌｅｃｔ信号（Ｃ８）及びＷｒ
ｉｔｅ Ｅｎａｂｌｅ信号（ＷＥ）が有効となシ、又、
メモリ（列と行をアドレス指定しデータの書き込み及び
読出しのできる通常のダイナミックラム（ｄｙｎａｍｉ
ｃ ＲＡＭ） ） ＤＲの出力もＤＭＡへ供給される。
のときはＣｈｉｐ ８ｅｌｅｃｔ信号（Ｃ８）及びＷｒ
ｉｔｅ Ｅｎａｂｌｅ信号（ＷＥ）が有効となシ、又、
メモリ（列と行をアドレス指定しデータの書き込み及び
読出しのできる通常のダイナミックラム（ｄｙｎａｍｉ
ｃ ＲＡＭ） ） ＤＲの出力もＤＭＡへ供給される。
つまり、ＭＲｌが１のときのみこのフレームメモリは動
作する。
作する。
以上説明したように、本発明によれば、簡単な構成でイ
メージ、文字、グラフィ、りの各情報を、効率的に、デ
ィスプレイ・メモリに転送し、それをＣＲＴなどの表示
装置に表示できると共に、ディスプレイ・メモリの内容
を逆にＣＰＵの主記憶装置などに効率的に転送し、記憶
・保存させることのれを制御するためのＣＰＵのプログ
ラムも簡単化される。また、フレームメモリの内容を１
部抽出したり、マスクしたシする作業はフレームメモリ
のビット数だけ繰シ返されるので、仮に、この作業をＣ
ＰＵ Ｋ実行させると表示データの転送が大に遅くなる
が、本発明によシ、簡単なノー−ドウエア構成によシ転
送ヌビードを遅らすこともなく且つＣＰＵを効率よく使
うことができる◎
メージ、文字、グラフィ、りの各情報を、効率的に、デ
ィスプレイ・メモリに転送し、それをＣＲＴなどの表示
装置に表示できると共に、ディスプレイ・メモリの内容
を逆にＣＰＵの主記憶装置などに効率的に転送し、記憶
・保存させることのれを制御するためのＣＰＵのプログ
ラムも簡単化される。また、フレームメモリの内容を１
部抽出したり、マスクしたシする作業はフレームメモリ
のビット数だけ繰シ返されるので、仮に、この作業をＣ
ＰＵ Ｋ実行させると表示データの転送が大に遅くなる
が、本発明によシ、簡単なノー−ドウエア構成によシ転
送ヌビードを遅らすこともなく且つＣＰＵを効率よく使
うことができる◎
第１図は画面表示例、第２図は従来の画像表示装置の一
例を示す構成図、第５図は第２図において用いられるデ
ータの形式を示す図、第４図は本発明に係る画像表示装
置の一実施例を示す要部構成図、第５図は第４図におい
て用いられるデータの形式を示す図、第６図は本発明の
弛め実施例図、第７図はフレームメモリの実施例構成図
でろる＠ＣＰＵ・・・中央処理装置、ＭＭ・・・主記憶
装置、■Ｃ・・・クラフィック・ディスプレイ・コント
ローラ％Ｃ０ＮＴ・・・コントローラ、ＭＣ−・・フレ
ーム・メモリ、ＲＥＧＩ、 ＲＥｏ２・・・マスクレジ
スタ、ＤＡ・・・ＤＡ変換器、ＭＩＸ・・・混合回路、
ＣＲＴ・・・ＣＲＴ表示装置。 第 ｌ 聞
例を示す構成図、第５図は第２図において用いられるデ
ータの形式を示す図、第４図は本発明に係る画像表示装
置の一実施例を示す要部構成図、第５図は第４図におい
て用いられるデータの形式を示す図、第６図は本発明の
弛め実施例図、第７図はフレームメモリの実施例構成図
でろる＠ＣＰＵ・・・中央処理装置、ＭＭ・・・主記憶
装置、■Ｃ・・・クラフィック・ディスプレイ・コント
ローラ％Ｃ０ＮＴ・・・コントローラ、ＭＣ−・・フレ
ーム・メモリ、ＲＥＧＩ、 ＲＥｏ２・・・マスクレジ
スタ、ＤＡ・・・ＤＡ変換器、ＭＩＸ・・・混合回路、
ＣＲＴ・・・ＣＲＴ表示装置。 第 ｌ 聞
Claims (1)
- ディスプレイ情報を記憶するディスプレイメモリを、同
時に書込みと読出しのできる複数個のフレームメモリの
積み重ね構造で構成し、各フレームメモリの書込み制御
信号は予めＣＰＵから設定できるマスクレジスタによっ
て各フレームメモリ毎に選択できるようにし、各７レー
ムメモリの出力は予めＣＰＵが設定できる前記マスクレ
ジスタ又は他のｉスフレジスタによって選択的にＣＰＵ
へ転送できるように構成された画像表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58035439A JPS59162587A (ja) | 1983-03-04 | 1983-03-04 | 画像表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58035439A JPS59162587A (ja) | 1983-03-04 | 1983-03-04 | 画像表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59162587A true JPS59162587A (ja) | 1984-09-13 |
Family
ID=12441877
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58035439A Pending JPS59162587A (ja) | 1983-03-04 | 1983-03-04 | 画像表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59162587A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62280795A (ja) * | 1986-05-29 | 1987-12-05 | ジーイー横河メディカルシステム株式会社 | 画像表示制御回路 |
| JPS63121890A (ja) * | 1986-10-31 | 1988-05-25 | インターナシヨナル・ビジネス・マシーンズ・コーポレーシヨン | 図形表示端末装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5439524A (en) * | 1977-09-05 | 1979-03-27 | Hitachi Ltd | Display unit with next screen display function |
-
1983
- 1983-03-04 JP JP58035439A patent/JPS59162587A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5439524A (en) * | 1977-09-05 | 1979-03-27 | Hitachi Ltd | Display unit with next screen display function |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62280795A (ja) * | 1986-05-29 | 1987-12-05 | ジーイー横河メディカルシステム株式会社 | 画像表示制御回路 |
| JPS63121890A (ja) * | 1986-10-31 | 1988-05-25 | インターナシヨナル・ビジネス・マシーンズ・コーポレーシヨン | 図形表示端末装置 |
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