JPS59135600A - プロセス信号の処理装置 - Google Patents
プロセス信号の処理装置Info
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- JPS59135600A JPS59135600A JP866683A JP866683A JPS59135600A JP S59135600 A JPS59135600 A JP S59135600A JP 866683 A JP866683 A JP 866683A JP 866683 A JP866683 A JP 866683A JP S59135600 A JPS59135600 A JP S59135600A
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- input
- devices
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明はアナログ値であたえられる複数のプロセス信・
号を選択的（二人力して４１埋１−るプロセス信号の処
理装置（二関するものである。
号を選択的（二人力して４１埋１−るプロセス信号の処
理装置（二関するものである。
プロセス制御（＝おいては、複数のアナログ信号が選択
的（二且つ排他的（二用いちれることがあるが、この場
合従来は各アナログ信号ごと（二信号調螢装置を設けて
いるので、システムが冗長（ユなっている。
的（二且つ排他的（二用いちれることがあるが、この場
合従来は各アナログ信号ごと（二信号調螢装置を設けて
いるので、システムが冗長（ユなっている。
このような従来構成の一例を第１図ｔ：示す。
第１図（二おいてセンサ１−１〜１−３の出力信号はそ
れぞれ信号調整装置２−１〜２−３、選択スイッチａ−
ｉ〜３−３、プロセス入力装置４−１〜４−３を介して
演算装置６（二人力される。
れぞれ信号調整装置２−１〜２−３、選択スイッチａ−
ｉ〜３−３、プロセス入力装置４−１〜４−３を介して
演算装置６（二人力される。
また選択スイッチ３−１〜３−３の選択状態は接点入力
装置５−１〜５−３を介して上記演′ｘ、装置６（二人
力され、上記各選択信号および選択された１つのアナロ
グ信号が記憶装置７に入力される。
装置５−１〜５−３を介して上記演′ｘ、装置６（二人
力され、上記各選択信号および選択された１つのアナロ
グ信号が記憶装置７に入力される。
センサ１−１〜１−３の特性は一般し互（二異なってお
ｐ、それぞれ例えは第２図の曲１Ａ−Ｃで示すことがで
きる。
ｐ、それぞれ例えは第２図の曲１Ａ−Ｃで示すことがで
きる。
第３図は上記演算装置６の演典概狭を示すもので、プロ
セス入力装置４−１〜４−３および接点入力装置５−１
〜５−３の出力信号はそれぞれプロセス情報格納域１１
−１〜１１−３および接点情報格納域臣−１−１２−３
（二格納されさらにＡＮＤ回蕗１３−１〜１３−３で論
理積されて信号処理回路１４）二人力されている。
セス入力装置４−１〜４−３および接点入力装置５−１
〜５−３の出力信号はそれぞれプロセス情報格納域１１
−１〜１１−３および接点情報格納域臣−１−１２−３
（二格納されさらにＡＮＤ回蕗１３−１〜１３−３で論
理積されて信号処理回路１４）二人力されている。
すなわち上記従来の方法では、信号の数だけ信号調整装
置やプロセス入力装置を必要とするので、用品の数が多
くなってその使用率が低下すると共（＝、コスト上昇を
招くという問題がある。
置やプロセス入力装置を必要とするので、用品の数が多
くなってその使用率が低下すると共（＝、コスト上昇を
招くという問題がある。
本発明は同種の装置を多数含み、複数のアナログ信号が
選択的（二処理されるプロセスＣ二おいて、選、択処理
されるアナログ信号のグループとと（二信号調整装置お
よびプロセス入力装置を共用とし、これによってシステ
ムのコストダウンをはかった合理的なプロセス信号の処
理装置を提供するものである。
選択的（二処理されるプロセスＣ二おいて、選、択処理
されるアナログ信号のグループとと（二信号調整装置お
よびプロセス入力装置を共用とし、これによってシステ
ムのコストダウンをはかった合理的なプロセス信号の処
理装置を提供するものである。
本発明は、同種の装置を多数含み複数のアナログ信号が
選択的（＝処理されるプロセスの各信号グループごとに
１つの信号を選択する選択スイッチと、各信号グループ
ごとζ二共通に設けられた信号イツテの選択状態を判別
する接点入力装置を備え、濡択石れ信号調整されたアナ
ログ信号を接点入力信号に対応し・て演算装置に入力し
、これによってプロセス入力装置の数を低減しシステム
の合理化をはかったプロセス信号の処理装置である。
選択的（＝処理されるプロセスの各信号グループごとに
１つの信号を選択する選択スイッチと、各信号グループ
ごとζ二共通に設けられた信号イツテの選択状態を判別
する接点入力装置を備え、濡択石れ信号調整されたアナ
ログ信号を接点入力信号に対応し・て演算装置に入力し
、これによってプロセス入力装置の数を低減しシステム
の合理化をはかったプロセス信号の処理装置である。
本発明の一実施例を第４図（二示す。
第４図（二おいて、２は共用の信号調整装置、４は共用
のプロセス入力装置であり、ｑ；センサ１−１〜１−３
の出力は選択スイッチ３−１〜３−３で切換えられてか
ら共用の＝＋Ｍ号副整装置２およびプロセス出力装置４
を介して演Ｘ装置６（二人力されておシ、他は第１図と
同じである。
のプロセス入力装置であり、ｑ；センサ１−１〜１−３
の出力は選択スイッチ３−１〜３−３で切換えられてか
ら共用の＝＋Ｍ号副整装置２およびプロセス出力装置４
を介して演Ｘ装置６（二人力されておシ、他は第１図と
同じである。
第５図は第４図における演算装置の動作を示すもので、
選択されたアナログ信号および選択信号はそれぞれプロ
セス情報格納域１１および接点情報格納域１２−１〜１
２−３に格納され、さら４二ＡＮＬ）回路１３−１〜１
３−３を介してそれぞれ論理積され、選択されたアナロ
グ信号が選択信号に応じてそれぞれのプロセス情報格納
域１５−１〜１５−３に格納され信号処理回路１４Ｃ二
人力される。
選択されたアナログ信号および選択信号はそれぞれプロ
セス情報格納域１１および接点情報格納域１２−１〜１
２−３に格納され、さら４二ＡＮＬ）回路１３−１〜１
３−３を介してそれぞれ論理積され、選択されたアナロ
グ信号が選択信号に応じてそれぞれのプロセス情報格納
域１５−１〜１５−３に格納され信号処理回路１４Ｃ二
人力される。
これ（＝よって信号調整装置およびプロセス入力装置を
選択されて用いられる同種の信号グループ（二対して共
用とす）ことができる。
選択されて用いられる同種の信号グループ（二対して共
用とす）ことができる。
また第６図（二本発明の他の実施例を示す。
第６図は第４図（二情報の出力回路を附加したもので、
入力処理回路１６は第５図ζ二おけるプロセス情報格納
域１５以前の全部を示している。
入力処理回路１６は第５図ζ二おけるプロセス情報格納
域１５以前の全部を示している。
すなわち入力処理回路１６から信号処理回路１４＋二人
力されて処理された出力情報はそれぞれ出力情報格納域
１７−１〜１７−３を経てＡＮＤ回路１８−１〜１８−
３に入力され、出力信号選択スイッチ２ｏ−１〜２０−
３の選択状態（＝応じて接点入力装置２１−１〜２１−
３および接点情報格納域２２−ｉ−２２−ａｌ介して入
力された選択信号と論理積され、これによって排他的４
二選択されたアナログ信号がプロセス出力装置１９およ
び前記した出力信号選択スイッチ加−１〜２０−３の１
つを通って出力される。
力されて処理された出力情報はそれぞれ出力情報格納域
１７−１〜１７−３を経てＡＮＤ回路１８−１〜１８−
３に入力され、出力信号選択スイッチ２ｏ−１〜２０−
３の選択状態（＝応じて接点入力装置２１−１〜２１−
３および接点情報格納域２２−ｉ−２２−ａｌ介して入
力された選択信号と論理積され、これによって排他的４
二選択されたアナログ信号がプロセス出力装置１９およ
び前記した出力信号選択スイッチ加−１〜２０−３の１
つを通って出力される。
この場合、入力情報格納域の情報を用いて、信号処理に
よる各センナの非線形出力特性を補正し各プロセス量と
アナログ出方値の関係を線形化することが可能でおる。
よる各センナの非線形出力特性を補正し各プロセス量と
アナログ出方値の関係を線形化することが可能でおる。
またアナログ出力鴫ニメータ、レコーダ等を接続すると
、センーサごとくニリンア２イザを用意しなくても、セ
ンナの特性（二かかわらずプロセス量を線形化されたデ
ータとして監視および記録することができる。
、センーサごとくニリンア２イザを用意しなくても、セ
ンナの特性（二かかわらずプロセス量を線形化されたデ
ータとして監視および記録することができる。
以上説明したよう（二本発明によれば、四種の装置を多
数含み、複数のアナログ信号が選択的（二処理されるプ
ロセスにおいて選択処理されるアナログ信号のグループ
ごと（二信号処理装置とプロセス入出力装置を共用とし
、これ（＝よってシステムコンポーネントを削減して省
資源、コスト低下を実現する合理的なプロセス信号の処
理装置が得られる。
数含み、複数のアナログ信号が選択的（二処理されるプ
ロセスにおいて選択処理されるアナログ信号のグループ
ごと（二信号処理装置とプロセス入出力装置を共用とし
、これ（＝よってシステムコンポーネントを削減して省
資源、コスト低下を実現する合理的なプロセス信号の処
理装置が得られる。
第１図は従来のプロセス信号の処理装置の一判を示す系
統９図、第２図はセンサの一般的な特性な示す図、第３
図は第２図における処理動作を示す図、第４図は本発明
の一実施例を示す系統図、第５因は第４図Ｃ二おける処
理動作を示す図、第６−は本発明の他の実施例を示す系
統図で−ある。 １−１〜１−３ センサ ２．２−１〜２−３信号調整装置 ３−１〜３−３ 人力信号選択スイッチ４．４−１〜４
−３ プロセス入力装置５−１〜５−３ 、２１−１〜
２１−３ 接点入力装置６ 演算装置 ７ 記憶装置 １１．１１−１〜１１−３．１５−１〜１５−３．１７
−１〜１７−３プロセス情報格納域 １２−１−１２−３ 、２２−１−２２−３ 接点情
報格納域１３−１〜１３−３．１８−１〜１８−３
ＡＮＤ回路１９ プロセス出力装置 加−１−２０−３出力信号選択スイッチ第１図 第２図 ２ンザ 比−〇 第３図 第４図 第５図 第６図
統９図、第２図はセンサの一般的な特性な示す図、第３
図は第２図における処理動作を示す図、第４図は本発明
の一実施例を示す系統図、第５因は第４図Ｃ二おける処
理動作を示す図、第６−は本発明の他の実施例を示す系
統図で−ある。 １−１〜１−３ センサ ２．２−１〜２−３信号調整装置 ３−１〜３−３ 人力信号選択スイッチ４．４−１〜４
−３ プロセス入力装置５−１〜５−３ 、２１−１〜
２１−３ 接点入力装置６ 演算装置 ７ 記憶装置 １１．１１−１〜１１−３．１５−１〜１５−３．１７
−１〜１７−３プロセス情報格納域 １２−１−１２−３ 、２２−１−２２−３ 接点情
報格納域１３−１〜１３−３．１８−１〜１８−３
ＡＮＤ回路１９ プロセス出力装置 加−１−２０−３出力信号選択スイッチ第１図 第２図 ２ンザ 比−〇 第３図 第４図 第５図 第６図
Claims (1)
- 同珈の装置を多数含み複数のアナログ信号が選択的に処
理されるプロセスの各８号グループごとに１つの信号を
選択する選択スイッチと、各信号グループごと１：共通
に設けられた信号調整装置およびプロセス人力装置と、
上記選択スイッチの選択状態を判別する接点入力装置と
を備え、上記選択され信号調整されたアナログ信号を上
記接点入力信号ｌ二対応して演算装置（二人力すること
を特徴とするプロセス信号の処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP866683A JPS59135600A (ja) | 1983-01-24 | 1983-01-24 | プロセス信号の処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP866683A JPS59135600A (ja) | 1983-01-24 | 1983-01-24 | プロセス信号の処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59135600A true JPS59135600A (ja) | 1984-08-03 |
Family
ID=11699254
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP866683A Pending JPS59135600A (ja) | 1983-01-24 | 1983-01-24 | プロセス信号の処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59135600A (ja) |
Cited By (10)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03185600A (ja) * | 1989-12-14 | 1991-08-13 | Yokogawa Electric Corp | 多点測定装置 |
| US8558699B2 (en) | 2005-12-09 | 2013-10-15 | Tego Inc. | Multiple radio frequency network node RFID tag |
| US8941470B2 (en) | 2005-12-09 | 2015-01-27 | Tego Inc. | Methods and systems of a radio frequency network node RFID tag with hardened memory system |
| US8988223B2 (en) | 2005-12-09 | 2015-03-24 | Tego Inc. | RFID drive management facility |
| US9117128B2 (en) | 2005-12-09 | 2015-08-25 | Tego, Inc. | External access to memory on an RFID tag |
| US9361568B2 (en) | 2005-12-09 | 2016-06-07 | Tego, Inc. | Radio frequency identification tag with hardened memory system |
| US9418263B2 (en) | 2005-12-09 | 2016-08-16 | Tego, Inc. | Operating systems for an RFID tag |
| US9430732B2 (en) | 2014-05-08 | 2016-08-30 | Tego, Inc. | Three-dimension RFID tag with opening through structure |
| US9542577B2 (en) | 2005-12-09 | 2017-01-10 | Tego, Inc. | Information RFID tagging facilities |
| US9953193B2 (en) | 2014-09-30 | 2018-04-24 | Tego, Inc. | Operating systems for an RFID tag |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS547963A (en) * | 1977-06-20 | 1979-01-20 | Takeda Riken Ind Co Ltd | Multiipoint measuring device |
-
1983
- 1983-01-24 JP JP866683A patent/JPS59135600A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS547963A (en) * | 1977-06-20 | 1979-01-20 | Takeda Riken Ind Co Ltd | Multiipoint measuring device |
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| US9390362B2 (en) | 2005-12-09 | 2016-07-12 | Tego, Inc. | Radio frequency identification tag with emulated multiple-time programmable memory |
| US9405950B2 (en) | 2005-12-09 | 2016-08-02 | Tego, Inc. | External access to memory on an RFID tag |
| US9418263B2 (en) | 2005-12-09 | 2016-08-16 | Tego, Inc. | Operating systems for an RFID tag |
| US9424447B2 (en) | 2005-12-09 | 2016-08-23 | Tego, Inc. | RFID tag facility with access to a sensor |
| US10691992B2 (en) | 2005-12-09 | 2020-06-23 | Tego, Inc. | RF tag with memory management |
| US8558699B2 (en) | 2005-12-09 | 2013-10-15 | Tego Inc. | Multiple radio frequency network node RFID tag |
| US9594998B2 (en) | 2005-12-09 | 2017-03-14 | Tego, Inc. | Radio frequency identification tag with hardened memory system |
| US9542577B2 (en) | 2005-12-09 | 2017-01-10 | Tego, Inc. | Information RFID tagging facilities |
| US9471821B2 (en) | 2005-12-09 | 2016-10-18 | Tego, Inc. | External access to memory on an RFID tag |
| US9710682B2 (en) | 2005-12-09 | 2017-07-18 | Tego, Inc. | Operating systems for an RFID tag |
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| US9858452B2 (en) | 2005-12-09 | 2018-01-02 | Tego, Inc. | Information RFID tagging facilities |
| US10430702B2 (en) | 2005-12-09 | 2019-10-01 | Tego, Inc. | RF tag network connectivity through gateway facility |
| US9430732B2 (en) | 2014-05-08 | 2016-08-30 | Tego, Inc. | Three-dimension RFID tag with opening through structure |
| US10204244B2 (en) | 2014-09-30 | 2019-02-12 | Tego, Inc. | Data aggregating radio frequency tag |
| US9953193B2 (en) | 2014-09-30 | 2018-04-24 | Tego, Inc. | Operating systems for an RFID tag |
| US10445536B2 (en) | 2014-09-30 | 2019-10-15 | Tego, Inc. | Operating system for an RF tag |
| US10891449B2 (en) | 2014-09-30 | 2021-01-12 | Tego, Inc. | Self-monitoring wireless computing device |
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