JPS5856125A - バイトマ−ク生成方式 - Google Patents
バイトマ−ク生成方式Info
- Publication number
- JPS5856125A JPS5856125A JP56155895A JP15589581A JPS5856125A JP S5856125 A JPS5856125 A JP S5856125A JP 56155895 A JP56155895 A JP 56155895A JP 15589581 A JP15589581 A JP 15589581A JP S5856125 A JPS5856125 A JP S5856125A
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- Japan
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本楯明はハードウェア菫の少なくて7むバイトマーク生
成方式に関Tる。
成方式に関Tる。
弗1図にボTテータ処理装−において、中央処**tm
−cp’aの1−により入出力装置としてのティスフD
8に、磁気テープM丁、7J−ドCD等のデータlチャ
ふル011な介して生紀憶装衡輩8にストアTる。スタ
ートエ0命令8rOKよりデータ転送全開始Tる。OA
T チャネルアドレスワードによりチャ本ルコマンドワ
ードOCWが指示される。このCOWのフォーマットハ
定めら刺ていて豐込み・絞出しの区別、データアドレス
、バイト1ウン)’%−tんでいる。主記憶装−M8は
通常4バイトなl飴、 16バイトケ1つの単位としニ
スドア動作″Ik−管理している。チャネルCjHKは
データケ一時蓄えるレジスタDBRと、バイトマーク生
成回路BM01に−有し入出力回路〃1らのデータにバ
イト!−りを付して主記憶装龜MBK送る。バイトマー
クBsa+w!h2因に示Tようにアクセスのワード9
gに付けらjている。第2凶に不Tものはデータアドレ
スの墳界BDケ殖えて、転込管理ケし易くしている。ν
すち16バイト単位で境界BDケ実−のように定め、デ
ータが1点@紐内でとるとTtlは、 16バ1ト卑位
のデータムb分の当初バイトはデータがないため、主紀
憶装%に蓄積さゼる必要がなく、そのことンyrCTた
ぬ、各バイトデータの顧にバイトデーフ1Mケ“0′と
付しておく・そして正規データの第0バイトη為らバイ
トマーク“l”となってII分の第lOパイトム、1l
SllバイトB、・・・弔15バイトplでかバイトマ
ーク”1”でトる@バイトマーフケ生成Tる従来手段は
バイトマーク生成用フリップフロップを主記憶抄成アク
セス単位分だけの数・(即ち16個)データバッファレ
ジスタDBRK近く設け、当初は4JJル1状態として
おぎ、データバッツァストレージDB8からレジスタD
BRKデータY−tクトTる4B、に順次フリツプフロ
ツプンセットして付くことであるが、単純な一理回路で
はトつても7リツプフロツプの数な多数ヤ下る。従来の
第2千股は主記惜装−への最初のアクtス時KFIスト
ア開始アドレスを用い、終了アドレスは生記憶装−゛ア
クセス前[残金バイトカウント量により決定し、王記憶
表−′アクセス時にバイトマークをkE、成し、最初或
いは最後のアクセスでない場合は主記憶装置アクセス単
位分だけのバイトマークな生成Tることである。この場
合比較的複雑な演算処理が必安どなる。
−cp’aの1−により入出力装置としてのティスフD
8に、磁気テープM丁、7J−ドCD等のデータlチャ
ふル011な介して生紀憶装衡輩8にストアTる。スタ
ートエ0命令8rOKよりデータ転送全開始Tる。OA
T チャネルアドレスワードによりチャ本ルコマンドワ
ードOCWが指示される。このCOWのフォーマットハ
定めら刺ていて豐込み・絞出しの区別、データアドレス
、バイト1ウン)’%−tんでいる。主記憶装−M8は
通常4バイトなl飴、 16バイトケ1つの単位としニ
スドア動作″Ik−管理している。チャネルCjHKは
データケ一時蓄えるレジスタDBRと、バイトマーク生
成回路BM01に−有し入出力回路〃1らのデータにバ
イト!−りを付して主記憶装龜MBK送る。バイトマー
クBsa+w!h2因に示Tようにアクセスのワード9
gに付けらjている。第2凶に不Tものはデータアドレ
スの墳界BDケ殖えて、転込管理ケし易くしている。ν
すち16バイト単位で境界BDケ実−のように定め、デ
ータが1点@紐内でとるとTtlは、 16バ1ト卑位
のデータムb分の当初バイトはデータがないため、主紀
憶装%に蓄積さゼる必要がなく、そのことンyrCTた
ぬ、各バイトデータの顧にバイトデーフ1Mケ“0′と
付しておく・そして正規データの第0バイトη為らバイ
トマーク“l”となってII分の第lOパイトム、1l
SllバイトB、・・・弔15バイトplでかバイトマ
ーク”1”でトる@バイトマーフケ生成Tる従来手段は
バイトマーク生成用フリップフロップを主記憶抄成アク
セス単位分だけの数・(即ち16個)データバッファレ
ジスタDBRK近く設け、当初は4JJル1状態として
おぎ、データバッツァストレージDB8からレジスタD
BRKデータY−tクトTる4B、に順次フリツプフロ
ツプンセットして付くことであるが、単純な一理回路で
はトつても7リツプフロツプの数な多数ヤ下る。従来の
第2千股は主記惜装−への最初のアクtス時KFIスト
ア開始アドレスを用い、終了アドレスは生記憶装−゛ア
クセス前[残金バイトカウント量により決定し、王記憶
表−′アクセス時にバイトマークをkE、成し、最初或
いは最後のアクセスでない場合は主記憶装置アクセス単
位分だけのバイトマークな生成Tることである。この場
合比較的複雑な演算処理が必安どなる。
X発明の目的はハードウェア倉が少ないバイトマーク生
&方式を提供することにある。
&方式を提供することにある。
以下内面に不T本発明の実施例について説明する。主記
憶装にのアクセス単位が16バイトの場合1!I/91
!にとる。9PJ5I2.lは厚発1によるバイトマー
ク生成方式の一実施例#に成ブロック図でとる。DAB
mデータアドレスバッファで。
憶装にのアクセス単位が16バイトの場合1!I/91
!にとる。9PJ5I2.lは厚発1によるバイトマー
ク生成方式の一実施例#に成ブロック図でとる。DAB
mデータアドレスバッファで。
DABI Kは人出力表1とのデータ転送開始前にスト
アアドレスケセットTる。バッファDAB2の当初はD
ABlと同じ鎗がセットさj、デ″″クパッファストレ
ージDB8η鳥もデータバッファレジスタDBRo〜D
BR5Kデータがセットされる毎に1ずつ更新さする4
ビツト1ウンタとなっている。斐耕か+1.−1とTK
ることは前進読出のとぎ÷1.彼退1出のとき−lとT
る。そしてワード刀つンタWCが設けら11. 4ワー
ド(16バイト)のデータがMBK対しlワード送Wさ
する毎に+1されるような2ビツトηウンタとTる。即
ちワード刀つンタWCが+lされる毎にデータはDBR
3→DBF12→I)Bl’ll→DBR・→M8 と
シフトされてバイトマークはそのS貫ψ新されて打く。
アアドレスケセットTる。バッファDAB2の当初はD
ABlと同じ鎗がセットさj、デ″″クパッファストレ
ージDB8η鳥もデータバッファレジスタDBRo〜D
BR5Kデータがセットされる毎に1ずつ更新さする4
ビツト1ウンタとなっている。斐耕か+1.−1とTK
ることは前進読出のとぎ÷1.彼退1出のとき−lとT
る。そしてワード刀つンタWCが設けら11. 4ワー
ド(16バイト)のデータがMBK対しlワード送Wさ
する毎に+1されるような2ビツトηウンタとTる。即
ちワード刀つンタWCが+lされる毎にデータはDBR
3→DBF12→I)Bl’ll→DBR・→M8 と
シフトされてバイトマークはそのS貫ψ新されて打く。
バイトマーク年数回路は以上の条件により次表に示T真
理偵表O)ように主としてゲート回路により生成さnパ
IJティチェックビットPヶ付して主記憶装@−MBに
伝送される0 一−−−−−−−−−=−−−−−−−7\ X印のパターンは存在しない なお表甲1stXとは最初のアクセスであることな不T
(s 埒で、優初のアクセスが終了するとリセットさ
FlΦ0 ム:”(VC@1=DAB1のビットo、 1) ・l
st!B=py((w自11=DAB2のol )(D
AB22+DAB21)+ ((WCgl )= (D
ABzのor )−1) ・DABtz・DABzs
)+RB((WC(11=DAB2のol)(DAB2
2+DAB2B) 番+ (lWOol )=
1DAB2のot )”l) ・DAB22・DAB
211ここでFIIFは前進1出虻作 FIBに俵退読出電1作 ムFのセット条件 (wo 更新タイミング)・ム・l WeO+WCj
)ムアのリセット4に件 #初のアクセス終了時 BlFのセット条件 (We Ej!新タイイング)・B・twc、)+v
c1)BPのリセット優性 (WO更新タイミング)・WCQ−WCIDABl、D
AB2の各2.3の数字はバッファの各1位2ビツトケ
示T。
理偵表O)ように主としてゲート回路により生成さnパ
IJティチェックビットPヶ付して主記憶装@−MBに
伝送される0 一−−−−−−−−−=−−−−−−−7\ X印のパターンは存在しない なお表甲1stXとは最初のアクセスであることな不T
(s 埒で、優初のアクセスが終了するとリセットさ
FlΦ0 ム:”(VC@1=DAB1のビットo、 1) ・l
st!B=py((w自11=DAB2のol )(D
AB22+DAB21)+ ((WCgl )= (D
ABzのor )−1) ・DABtz・DABzs
)+RB((WC(11=DAB2のol)(DAB2
2+DAB2B) 番+ (lWOol )=
1DAB2のot )”l) ・DAB22・DAB
211ここでFIIFは前進1出虻作 FIBに俵退読出電1作 ムFのセット条件 (wo 更新タイミング)・ム・l WeO+WCj
)ムアのリセット4に件 #初のアクセス終了時 BlFのセット条件 (We Ej!新タイイング)・B・twc、)+v
c1)BPのリセット優性 (WO更新タイミング)・WCQ−WCIDABl、D
AB2の各2.3の数字はバッファの各1位2ビツトケ
示T。
このようKしてム兄明によると、バイトマーク1作成す
るとさ終了バイト刀つンタな設けることは必要でなく
Txる。バイトマーク作成回路はフリップフロップを1
細根度便用Tるのみで他はゲート回路で構成T心から、
#Iめて簡易でτむという効果がと壱〇
るとさ終了バイト刀つンタな設けることは必要でなく
Txる。バイトマーク作成回路はフリップフロップを1
細根度便用Tるのみで他はゲート回路で構成T心から、
#Iめて簡易でτむという効果がと壱〇
兜1図はデータ処理装−の捨欣例を示T図、第2内は主
配憶装−とバイトマークの汐明図、第S図は本発明の実
施例の構成ケ示T図である。 CPU・・・甲央佑理装@ OH・・−チャネル
M8・・・主紀憶装− D B 8−−−データバッファストレージDBR・−
データバッファレジスタ BMG・・・バイトマーク庄成回路 WC・・・ワード刀つンタ DAB・・・データアドレスバッファ 特計出1人 菖士通株式会社 代 理 人 弁理士鰹木栄祐
配憶装−とバイトマークの汐明図、第S図は本発明の実
施例の構成ケ示T図である。 CPU・・・甲央佑理装@ OH・・−チャネル
M8・・・主紀憶装− D B 8−−−データバッファストレージDBR・−
データバッファレジスタ BMG・・・バイトマーク庄成回路 WC・・・ワード刀つンタ DAB・・・データアドレスバッファ 特計出1人 菖士通株式会社 代 理 人 弁理士鰹木栄祐
Claims (1)
- データ処畑システムの主記tjI装鮪とチャネルとの間
で主記憶装置にストア丁ぺぎ入出カ装−からのデータケ
チャネルが−Hチャネル内のデータバッファストレージ
にスト了し、データバッファストレージから主記憶製画
のアクセス時にチャネル内のレジスタにそのデータlチ
ャしてから、王紀憎装阪のアクセスワード毎にストアT
べとデータにバイトマークン付して送出Tるためのバイ
トマーク生成方式において、ストア開始のアドレスと、
データバッファストレージから主記惜装−アクセスのた
ぬにチャネル内レジスタにデータケ膀出て毎に更新され
るカウンタと、主ホシ惜装轟°のストア時にアクセスワ
ード毎に史倉さねるワードカウンタとKよりパイトマー
クンケ成することを特徴とTるバイトマーク生成方式。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56155895A JPS5856125A (ja) | 1981-09-30 | 1981-09-30 | バイトマ−ク生成方式 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56155895A JPS5856125A (ja) | 1981-09-30 | 1981-09-30 | バイトマ−ク生成方式 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5856125A true JPS5856125A (ja) | 1983-04-02 |
JPH0348542B2 JPH0348542B2 (ja) | 1991-07-24 |
Family
ID=15615846
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP56155895A Granted JPS5856125A (ja) | 1981-09-30 | 1981-09-30 | バイトマ−ク生成方式 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5856125A (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6254688A (ja) * | 1985-09-02 | 1987-03-10 | 三菱電機株式会社 | 産業用ロボツトの制御装置 |
JPS631688A (ja) * | 1986-06-19 | 1988-01-06 | 三菱電機株式会社 | ロボツト制御装置 |
-
1981
- 1981-09-30 JP JP56155895A patent/JPS5856125A/ja active Granted
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS6254688A (ja) * | 1985-09-02 | 1987-03-10 | 三菱電機株式会社 | 産業用ロボツトの制御装置 |
JPS631688A (ja) * | 1986-06-19 | 1988-01-06 | 三菱電機株式会社 | ロボツト制御装置 |
Also Published As
Publication number | Publication date |
---|---|
JPH0348542B2 (ja) | 1991-07-24 |
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