JPS5836046A - デ−タハイウエイ - Google Patents
デ−タハイウエイInfo
- Publication number
- JPS5836046A JPS5836046A JP56132791A JP13279181A JPS5836046A JP S5836046 A JPS5836046 A JP S5836046A JP 56132791 A JP56132791 A JP 56132791A JP 13279181 A JP13279181 A JP 13279181A JP S5836046 A JPS5836046 A JP S5836046A
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- station
- transmission line
- signal
- loop transmission
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L12/00—Data switching networks
- H04L12/28—Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
- H04L12/42—Loop networks
- H04L12/437—Ring fault isolation or reconfiguration
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、データ・・イウエイに係り、特に、２重系相
互バックアップに好適なデータハイウェイに関する。
互バックアップに好適なデータハイウェイに関する。
コンピュータ間のデータ交換の手段として、従来よりシ
リアル伝送路データハイウェイという方法が採られてい
る。このデータハイウェイは一対のループ状ケーブル番
用いて各機器を接続するものであり、この方法によると
配線の効率化が得られるという利点があるが、ハイウェ
イ上の１つのコンポーネントが故障すると通信が全面的
にストップしてしまうという欠点を有しており、この欠
点を解消するため従来より多くの方法が採られている。
リアル伝送路データハイウェイという方法が採られてい
る。このデータハイウェイは一対のループ状ケーブル番
用いて各機器を接続するものであり、この方法によると
配線の効率化が得られるという利点があるが、ハイウェ
イ上の１つのコンポーネントが故障すると通信が全面的
にストップしてしまうという欠点を有しており、この欠
点を解消するため従来より多くの方法が採られている。
例えば第１図（Ａ）に示す如く、故障の大半が電気的な
変換の介在するステーションにあることに着目し、故障
ステーションを発見し該故障ステーションをバイパスさ
せるというのがそれである。また、このステーションの
故障を発見し、バイパスする方法にも種々の方法が考案
されてぃ 。
変換の介在するステーションにあることに着目し、故障
ステーションを発見し該故障ステーションをバイパスさ
せるというのがそれである。また、このステーションの
故障を発見し、バイパスする方法にも種々の方法が考案
されてぃ 。
る。しかしながら、このステーションの故障を発見し該
ステーションをバイパスする方法は回線自体の障害の障
害（断線、短絡など）やバイパス路自体に故障が生じた
場合にはシステム全体がダウンしてしまい、これら回路
自体の障害やバイパス路自体の故障によるシステムダウ
ンに対する保護がなされていないという欠点を有してい
る。このような欠点を解消するため第１図（Ｂ）に示す
如くループ伝送路自体を２重化して一方のループ伝送路
がダウンしたときは他のループ伝送路を用いることによ
りシステム全体のダウンを来たすことがないようにする
方法が考えられている。この２重化の方法は、一方のル
ープ伝送路を待期系にし、常時使用せず故障発見時に回
線全体まだは、ステーション間の１区間のみを待期系に
移して通信を継続する方法、各ｃｐｕが自由にどちらの
回線も利用する方法があるが、前者は一方のループ伝送
路のダウンの際直ちに待期系が使用に耐えられるように
常に待期系が働くようにチェックを行なわねばならない
という欠点を有しており、２重系にしても効率としては
１重系と変るところはない。
ステーションをバイパスする方法は回線自体の障害の障
害（断線、短絡など）やバイパス路自体に故障が生じた
場合にはシステム全体がダウンしてしまい、これら回路
自体の障害やバイパス路自体の故障によるシステムダウ
ンに対する保護がなされていないという欠点を有してい
る。このような欠点を解消するため第１図（Ｂ）に示す
如くループ伝送路自体を２重化して一方のループ伝送路
がダウンしたときは他のループ伝送路を用いることによ
りシステム全体のダウンを来たすことがないようにする
方法が考えられている。この２重化の方法は、一方のル
ープ伝送路を待期系にし、常時使用せず故障発見時に回
線全体まだは、ステーション間の１区間のみを待期系に
移して通信を継続する方法、各ｃｐｕが自由にどちらの
回線も利用する方法があるが、前者は一方のループ伝送
路のダウンの際直ちに待期系が使用に耐えられるように
常に待期系が働くようにチェックを行なわねばならない
という欠点を有しており、２重系にしても効率としては
１重系と変るところはない。
また、後者は、大形システムにおいて多く用いられてい
る方法であるが、ハードウェアのコスト、回線制御ソフ
トウェアの複雑さなどの点で、小規模な伝送ンステムに
適さないという欠点を有している。
る方法であるが、ハードウェアのコスト、回線制御ソフ
トウェアの複雑さなどの点で、小規模な伝送ンステムに
適さないという欠点を有している。
本発明の目的は、正常時には２重化回線の双方を利用す
ると共に回線の部分的故障が生じた場合に１重系並のス
ループットを得ることのできるデータハイウェイを提供
することにある。
ると共に回線の部分的故障が生じた場合に１重系並のス
ループットを得ることのできるデータハイウェイを提供
することにある。
本発明は各ステーションをループ状に結合する２本のル
ープ伝送路を設け、該２本のループ伝送路を逆方向に伝
送させ、一方にあらかじめ定められたステーションに伝
送する信号を、他方にあらかじめ定められたステーショ
ンが受信する信号を伝送させると共に、ステーションの
故障や回線部分の故障等によって伝送不能になったとき
に該故障箇所を挾む２つのステーションにおいて上記２
本のループ伝送路を接続することにより、正常時には２
重化回線の双方を利用すると共に回線の部分的故障が生
じた場合に１重系並のスループットを得ようというもの
である。
ープ伝送路を設け、該２本のループ伝送路を逆方向に伝
送させ、一方にあらかじめ定められたステーションに伝
送する信号を、他方にあらかじめ定められたステーショ
ンが受信する信号を伝送させると共に、ステーションの
故障や回線部分の故障等によって伝送不能になったとき
に該故障箇所を挾む２つのステーションにおいて上記２
本のループ伝送路を接続することにより、正常時には２
重化回線の双方を利用すると共に回線の部分的故障が生
じた場合に１重系並のスループットを得ようというもの
である。
以下、本発明の実施例について説明する。
第・２図には、本発明の一実施例が示されている。
図において、相互に送信方向の異なる２つのループ伝送
路１１９，１２０が設けられておシ、このループ伝送路
１１９には、入力アンプ１０１が接続されている。この
入力アンプ１０１の出力端子には、アンド回路ＡＮＤＩ
、ＡＮＩ）２．ＡＮＤ３、オア回路ＯＲＩによって構成
される切換回路１０５のアンド回路ＡＮＤ１の一方の入
力端子が接続されている。この切換回路１０５のオア回
路ＯＲＩの出力端子には復調回路１０７とタイムアウト
検出回路１１４が接続されている。この復調回路１０７
には通信制御回路１１１が接続されている。この通信制
御回路１１１には変調回路１０９を介してアンド回路Ａ
ＮＤ４．ＡＮＤ５．ＡＮＤ６とオア回路ＯＲ２によって
構成される切換回路１０６のアンド回路ＡＮＤ４の一方
の入力端子が接続されている。この切換回路１０６のア
ンド回路ＡＮＤ４の他方の入力端子にはタイムアウトフ
リップフロップ１１５のＱ端子が接続されている。
路１１９，１２０が設けられておシ、このループ伝送路
１１９には、入力アンプ１０１が接続されている。この
入力アンプ１０１の出力端子には、アンド回路ＡＮＤＩ
、ＡＮＩ）２．ＡＮＤ３、オア回路ＯＲＩによって構成
される切換回路１０５のアンド回路ＡＮＤ１の一方の入
力端子が接続されている。この切換回路１０５のオア回
路ＯＲＩの出力端子には復調回路１０７とタイムアウト
検出回路１１４が接続されている。この復調回路１０７
には通信制御回路１１１が接続されている。この通信制
御回路１１１には変調回路１０９を介してアンド回路Ａ
ＮＤ４．ＡＮＤ５．ＡＮＤ６とオア回路ＯＲ２によって
構成される切換回路１０６のアンド回路ＡＮＤ４の一方
の入力端子が接続されている。この切換回路１０６のア
ンド回路ＡＮＤ４の他方の入力端子にはタイムアウトフ
リップフロップ１１５のＱ端子が接続されている。
また、切換回路１０６のアンド回路ＡＮＤ４の出力端子
には出力アンプ１０３が接続されている。
には出力アンプ１０３が接続されている。
この出力アンプ１０３にはウォッチドッグタイマ１１８
からの信号が入力するように構成されている。
からの信号が入力するように構成されている。
また、ループ伝送路１２０に接続される入力アンプ１０
２の出力端子には切換回路１０６のアンド回路ＡＮＤ６
の一方の入力端子が接続されている。このアンド回路Ａ
ＮＤ６の他方の入力端子にはタイムアウト・フリップフ
ロップ１１５のＱ端子が接続されている。このタイムア
ウト・フリップフロップ１１５のＱ端子にはアンド回路
ＡＮＤ４の一方の入力端子に接続されている。また、こ
のタイムアウトフリップフロップ１１５のＱ端子にはア
ンド回路ＡＮＤ５の一方の入力端子が接続されている。
２の出力端子には切換回路１０６のアンド回路ＡＮＤ６
の一方の入力端子が接続されている。このアンド回路Ａ
ＮＤ６の他方の入力端子にはタイムアウト・フリップフ
ロップ１１５のＱ端子が接続されている。このタイムア
ウト・フリップフロップ１１５のＱ端子にはアンド回路
ＡＮＤ４の一方の入力端子に接続されている。また、こ
のタイムアウトフリップフロップ１１５のＱ端子にはア
ンド回路ＡＮＤ５の一方の入力端子が接続されている。
また、タイムアウトフリップフロップ１１５のＳ端子に
はタイムアウト検出回路１１３が接続されており、この
タイムアウト検出回路１１３には切換回路１０６の出力
端子が接続されている。また、この切換回路１０６の出
力端子には復調回路１０８を介して通信制御回路１１２
が接続されている。この通信制御回路１１２の出力端子
には、変調回路１１０を介して切換回路１０６のアンド
回路ＡＮＤ３の一方の入力端子とアンド回路Ａ Ｎ Ｄ
’２の一方の入力端子が接続されている。
はタイムアウト検出回路１１３が接続されており、この
タイムアウト検出回路１１３には切換回路１０６の出力
端子が接続されている。また、この切換回路１０６の出
力端子には復調回路１０８を介して通信制御回路１１２
が接続されている。この通信制御回路１１２の出力端子
には、変調回路１１０を介して切換回路１０６のアンド
回路ＡＮＤ３の一方の入力端子とアンド回路Ａ Ｎ Ｄ
’２の一方の入力端子が接続されている。
このＡＮＤ３の他の入力端子には、タイムアウトフリッ
プフロップ１１６のＱ端子が接続されており、このタイ
ムアウトフリップフロップ１１６のＱ端子にはアンド回
路ＡＮＤ１の他の入力端子が、Ｑ端子にはアンド回路Ａ
ＮＤ２の他方の入力端子がそれぞれ接続されている。こ
のタイムアウトフリップフロップ１１６の８端子にはタ
イムアウト検出回路１１４が接続されており、このタイ
ムアウト検出回路１１４の入力端子には切換回路１０５
のオア回路ＯＲ，１の出力端子が接続されている。
プフロップ１１６のＱ端子が接続されており、このタイ
ムアウトフリップフロップ１１６のＱ端子にはアンド回
路ＡＮＤ１の他の入力端子が、Ｑ端子にはアンド回路Ａ
ＮＤ２の他方の入力端子がそれぞれ接続されている。こ
のタイムアウトフリップフロップ１１６の８端子にはタ
イムアウト検出回路１１４が接続されており、このタイ
ムアウト検出回路１１４の入力端子には切換回路１０５
のオア回路ＯＲ，１の出力端子が接続されている。
一方、通信制御回路１１１の入力端子にはアンド回路Ａ
ＮＤ７の出力端子が、出力端子にはアンド回路ＡＮＤ８
の一方の入力端子がそれぞれ接続されている。このアン
ド回路Ａ、 Ｎ Ｄ ７の一方の入力端子にはライトデ
ータ１２３が、他方の入力端子には相手アドレスフリッ
プフロップ１２２のＱ端子がそれぞれ接続されている。
ＮＤ７の出力端子が、出力端子にはアンド回路ＡＮＤ８
の一方の入力端子がそれぞれ接続されている。このアン
ド回路Ａ、 Ｎ Ｄ ７の一方の入力端子にはライトデ
ータ１２３が、他方の入力端子には相手アドレスフリッ
プフロップ１２２のＱ端子がそれぞれ接続されている。
また、アンド回路Ａ、 Ｎ Ｄ ８の他方の入力端子に
は自己アドレス１２１が入力するように構成されている
と共に、出力端子には、オア回路ＯＲ，３の一方の入力
端子がそれぞれ接続されている。また、通信制御回路１
１２の入力端子には、アンド回路Ａ、ＮＤ１０の出力端
子が、また、入力端子にはアンド回路ＡＮＤ９の一方の
入力端子がそれぞれ接続されている。
は自己アドレス１２１が入力するように構成されている
と共に、出力端子には、オア回路ＯＲ，３の一方の入力
端子がそれぞれ接続されている。また、通信制御回路１
１２の入力端子には、アンド回路Ａ、ＮＤ１０の出力端
子が、また、入力端子にはアンド回路ＡＮＤ９の一方の
入力端子がそれぞれ接続されている。
このアンド回路ＡＮＤ１０の一方の入力端子には相手ア
ドレスフリップフロップ１２２のＱ端子が、また、他方
の入力端子にはライトデータ１２３が入力するように構
成されている。また、アンド回路Ａ、ＮＤ９の他方の入
力端子には、インバータＩＮ１に介して自己アドレス１
２１が入力するように構成されている。また、アンド回
路ＡＮＤ ９の出力端子には、オア回路Ｏ几３の他方の
入力端子が接続されており、このオア回路ＯＲ３の出力
端子よりリードデータ１２４が出力される。
ドレスフリップフロップ１２２のＱ端子が、また、他方
の入力端子にはライトデータ１２３が入力するように構
成されている。また、アンド回路Ａ、ＮＤ９の他方の入
力端子には、インバータＩＮ１に介して自己アドレス１
２１が入力するように構成されている。また、アンド回
路ＡＮＤ ９の出力端子には、オア回路Ｏ几３の他方の
入力端子が接続されており、このオア回路ＯＲ３の出力
端子よりリードデータ１２４が出力される。
このように構成されるものであるから、本ステーション
が、例えば、偶数アドレスを有しているような場合、ル
ープ伝送路１１９よりのみ受信するように構成される。
が、例えば、偶数アドレスを有しているような場合、ル
ープ伝送路１１９よりのみ受信するように構成される。
すなわち、通信制御回路１１１に人力してきた信号のう
ち、自己アドレスのみの信号を選択回路１１７のＡＮＤ
８に入力し、自己アドレス信号１２１との論理和によっ
て、リードデータ１２４が取り込まれる。また、他のス
テーションを指定した信号は、通信制御回路１１１を素
通りしていく。また、他のステーションに送信するとき
には、そのステーションが、偶数アドレスステーション
か、奇数アドレスステーションかによってループ伝送路
１１９，１２０が決定される。そのアドレス指定は、図
示されていないＣＰＵによってなされるが、それと同時
に、相手アドレスフリップ７０ツブ１２２によってル−
プ伝送路の指定がなされる。例えば、偶数アドレスステ
ーションに信号を送信するときには、相手アドレスフリ
ップフロップ１２２の互端子よシ信号を出力し、奇数ア
ドレスステーションに信号を送信するときには、アドレ
スフリップフロップ１２２のＱ端子より信号を出力して
やる。
ち、自己アドレスのみの信号を選択回路１１７のＡＮＤ
８に入力し、自己アドレス信号１２１との論理和によっ
て、リードデータ１２４が取り込まれる。また、他のス
テーションを指定した信号は、通信制御回路１１１を素
通りしていく。また、他のステーションに送信するとき
には、そのステーションが、偶数アドレスステーション
か、奇数アドレスステーションかによってループ伝送路
１１９，１２０が決定される。そのアドレス指定は、図
示されていないＣＰＵによってなされるが、それと同時
に、相手アドレスフリップ７０ツブ１２２によってル−
プ伝送路の指定がなされる。例えば、偶数アドレスステ
ーションに信号を送信するときには、相手アドレスフリ
ップフロップ１２２の互端子よシ信号を出力し、奇数ア
ドレスステーションに信号を送信するときには、アドレ
スフリップフロップ１２２のＱ端子より信号を出力して
やる。
また、本回路は、偶数ステーション、奇数ステーション
に共通して使えるように構成されているため、本ステー
ションが奇数アドレスステーションのときは、ループ伝
送路１２０からのみ信号受信を行ない、復調回路１０８
から出力されてくる信号からのみ受信することになる。
に共通して使えるように構成されているため、本ステー
ションが奇数アドレスステーションのときは、ループ伝
送路１２０からのみ信号受信を行ない、復調回路１０８
から出力されてくる信号からのみ受信することになる。
一方、出力は、偶数アドレスステーションにはアンド回
路ＡＮＤ７、通信制御回路１１１．変調回路１０９を通
ってループ伝送路１１９へ出力し、奇数アドレスステー
ションにはアンド回路ＡＮＤＩＯ，！信制御回路１１２
．変調回路１１０を通ってループ伝送路１２０へ出力す
る。
路ＡＮＤ７、通信制御回路１１１．変調回路１０９を通
ってループ伝送路１１９へ出力し、奇数アドレスステー
ションにはアンド回路ＡＮＤＩＯ，！信制御回路１１２
．変調回路１１０を通ってループ伝送路１２０へ出力す
る。
このステーションにおいて故障が生じると、すなわち、
本ステーション自体が故障を生じると、ウォッチドッグ
タイマ１１８が作動して出力アンプ１０３，１０４をオ
フする。これによって、両サイドのステーションに信号
が入力されなくなる。
本ステーション自体が故障を生じると、ウォッチドッグ
タイマ１１８が作動して出力アンプ１０３，１０４をオ
フする。これによって、両サイドのステーションに信号
が入力されなくなる。
まだ、隣りのステーションに故障が生じた場合は、隣の
ステーションからの信号が人ってこないため、タイムア
ウト検出器１１３，１１４が作動する。
ステーションからの信号が人ってこないため、タイムア
ウト検出器１１３，１１４が作動する。
すなわち、例えば、図の左側に接続されるステーション
に故障が生じると、切換回路１０５のオア回路ＯＲＩか
らの出力が所定時間ないため、その時間の検出によって
タイムアウト検出器１１４が作動し、タイムアウト７リ
ツプ７０ツブ１１６がセットされ、今まで、Ｑ端子より
ＬＯＷ信号が互端子より）（ｉｇｈ信号が出力されてい
たものが、Ｑ端子よりｉ（ｉｇｈ信号か、Ｑ端子よりＬ
ＯＷ信号が出力されるため、切換回路１０５のアンド回
路ＡＮＤＩ、ＡＮＤ３は、出力信号を出力しなくなり、
かわりに、アンド回路ＡＮＤ２が開く。そこで、変調回
路１１０より出力されてくる信号は、アンド回路ＡＮＤ
２ 、オア回路ＯＲ，１，復調回路１０７を通って、
通信制御回路１１１．変調回路１０９、アンド回路ＡＮ
Ｄ ４ 、出力アンプ１０３を通ってループ伝送路１１
９に送出される。このようにしてループ伝送路１２０か
ら入ってきた信号が、本ステーションを折り返し点とし
てループ伝送路１１９に送出されることになる。これは
、本ステーションの右側ステーションに故障が生じダウ
ンした場合も同様に、ループ伝送路１２０から入力され
る信号が所定時間ないことを検出し、（１１） タイムアウトフリップフロップ１１５゛力ヌセツトされ
、変調回路１０９から出力される信号がアンド回路ＡＮ
Ｄ５．オア回路ＯＲ２，復調回路１０８というように通
って折り返してループ伝送路１２０に送出してやる。
に故障が生じると、切換回路１０５のオア回路ＯＲＩか
らの出力が所定時間ないため、その時間の検出によって
タイムアウト検出器１１４が作動し、タイムアウト７リ
ツプ７０ツブ１１６がセットされ、今まで、Ｑ端子より
ＬＯＷ信号が互端子より）（ｉｇｈ信号が出力されてい
たものが、Ｑ端子よりｉ（ｉｇｈ信号か、Ｑ端子よりＬ
ＯＷ信号が出力されるため、切換回路１０５のアンド回
路ＡＮＤＩ、ＡＮＤ３は、出力信号を出力しなくなり、
かわりに、アンド回路ＡＮＤ２が開く。そこで、変調回
路１１０より出力されてくる信号は、アンド回路ＡＮＤ
２ 、オア回路ＯＲ，１，復調回路１０７を通って、
通信制御回路１１１．変調回路１０９、アンド回路ＡＮ
Ｄ ４ 、出力アンプ１０３を通ってループ伝送路１１
９に送出される。このようにしてループ伝送路１２０か
ら入ってきた信号が、本ステーションを折り返し点とし
てループ伝送路１１９に送出されることになる。これは
、本ステーションの右側ステーションに故障が生じダウ
ンした場合も同様に、ループ伝送路１２０から入力され
る信号が所定時間ないことを検出し、（１１） タイムアウトフリップフロップ１１５゛力ヌセツトされ
、変調回路１０９から出力される信号がアンド回路ＡＮ
Ｄ５．オア回路ＯＲ２，復調回路１０８というように通
って折り返してループ伝送路１２０に送出してやる。
これを図式すると第３図の如くなる。すなわち、第３図
（Ａ）か、ステーションｂがダウンしたときを現わし、
その後第３図（Ｂ）に示す如く、ステーションａ、Ｃが
信号折り返しステーションとなる。
（Ａ）か、ステーションｂがダウンしたときを現わし、
その後第３図（Ｂ）に示す如く、ステーションａ、Ｃが
信号折り返しステーションとなる。
次に、ループ伝送路に障害が生じた場合を説明する。ル
ープ伝送路の一方が断線等を生じた場合には、第２図の
切換回路１０５，１０６のいずれかに信号が出力されな
くなるため、隣ステーションのダウンのときと同様、当
該ステーションにおいて信号を折り返してやる。これを
図式すると第４図の如くなる。すなわち、第４図（Ａ）
において、いま、ａｂステーション間でループ伝送路が
断線すると、第４図（Ｂ）の如く、ｂス子−ションで折
り返し動作が行われると同時に、第４図（１２） （Ｃ）に示す如くＣステーションにおいても折り返し動
作が行われる。
ープ伝送路の一方が断線等を生じた場合には、第２図の
切換回路１０５，１０６のいずれかに信号が出力されな
くなるため、隣ステーションのダウンのときと同様、当
該ステーションにおいて信号を折り返してやる。これを
図式すると第４図の如くなる。すなわち、第４図（Ａ）
において、いま、ａｂステーション間でループ伝送路が
断線すると、第４図（Ｂ）の如く、ｂス子−ションで折
り返し動作が行われると同時に、第４図（１２） （Ｃ）に示す如くＣステーションにおいても折り返し動
作が行われる。
このようにして、ステーションダウンの際の信号の動き
は、いま、ｂステーションがダウンした場合、第５図に
示す如きものとなる。第５図（Ａ）はＣステーションか
らＣステーションへの通信状態を示し、第５図（Ｂ）は
ＣステーションからＣステーションへの通信状態を、第
５図（Ｃ）はＣステーションからＣステーションへの通
信状態を、第５図（Ｄ）はＣステーションからＣステー
ションへの通信状態を示すものであり、各矢印で示した
如くなされる。
は、いま、ｂステーションがダウンした場合、第５図に
示す如きものとなる。第５図（Ａ）はＣステーションか
らＣステーションへの通信状態を示し、第５図（Ｂ）は
ＣステーションからＣステーションへの通信状態を、第
５図（Ｃ）はＣステーションからＣステーションへの通
信状態を、第５図（Ｄ）はＣステーションからＣステー
ションへの通信状態を示すものであり、各矢印で示した
如くなされる。
したがって、本実施例によれば、ステーションのいずれ
かがダウンしても、当該ダウンしたステーションを除い
て、どこのステーション間でも通信が可能となる。
かがダウンしても、当該ダウンしたステーションを除い
て、どこのステーション間でも通信が可能となる。
また、本実施例によれば、ループ伝送路の２重化を図り
、２つのループ伝送路を常時利用しているため、チェッ
クする必要はない。
、２つのループ伝送路を常時利用しているため、チェッ
クする必要はない。
また、本実施例によれば、２つのループ伝送路（１３）
全同時に使用することができ効率を向上することができ
る。
る。
以上説明したように、本発明によれば、正常時には２重
化回線の双方を利用すると共に回線の部分的故障が生じ
た場合に１重系並のスルーグツトを得ることができる。
化回線の双方を利用すると共に回線の部分的故障が生じ
た場合に１重系並のスルーグツトを得ることができる。
第１図（Ａ）はリレーバイパス法を示す図、第１図（Ｂ
）はループ２重化法を示す図、第２図は本発明の実施例
を示す図、第３図（Ａ）（Ｂ）はステーションダウン時
の本実施例の動作を示す図、第４図（Ａ）〜（Ｃ）はス
テーション間ルーフ伝送路断線時の本実施例の動作を示
す図、第５図（Ａ）〜（Ｄ）はステーションダウン時の
各ステ−７ヨン間の伝送を示す図である。 １０３．１０４・・・出力アンプ、１０５，１０６・・
・切換回路、１１１，１１２・・・通信制御回路、１１
３゜１１４・・・タイムアウト検出器、１１５，１１６
・・・（１４） 手続補正書（方式） 特許庁長 官 島 １）春樹 殿 事件の表示 昭和５６年 特許願第１３２７９１ 号発明の名称 データハイウェイ 補正をする者 剃１との関係 特許出願人 住 所 東京都千代田区丸の内−丁目５番１号名
称（５］０１株式会社 日 立 製 作所代表者 三
１）勝 茂 代 理 人 居 所 東京都千代田区丸の内−丁目５番１号株式会
社日立製イ乍所内 電話東京４３５−４２２１ （大代
表）氏 名（５＋８９）弁 理 士 高 橋
明 夫補正命令の日付 昭和５７ｉ１月２６日補正
の対象 図面め茅１１灯 補正の内容 ヌ°Ｊｔ民のＡ／−＋−ソ ＄１ 図 ＜Ａ） ／／／
）はループ２重化法を示す図、第２図は本発明の実施例
を示す図、第３図（Ａ）（Ｂ）はステーションダウン時
の本実施例の動作を示す図、第４図（Ａ）〜（Ｃ）はス
テーション間ルーフ伝送路断線時の本実施例の動作を示
す図、第５図（Ａ）〜（Ｄ）はステーションダウン時の
各ステ−７ヨン間の伝送を示す図である。 １０３．１０４・・・出力アンプ、１０５，１０６・・
・切換回路、１１１，１１２・・・通信制御回路、１１
３゜１１４・・・タイムアウト検出器、１１５，１１６
・・・（１４） 手続補正書（方式） 特許庁長 官 島 １）春樹 殿 事件の表示 昭和５６年 特許願第１３２７９１ 号発明の名称 データハイウェイ 補正をする者 剃１との関係 特許出願人 住 所 東京都千代田区丸の内−丁目５番１号名
称（５］０１株式会社 日 立 製 作所代表者 三
１）勝 茂 代 理 人 居 所 東京都千代田区丸の内−丁目５番１号株式会
社日立製イ乍所内 電話東京４３５−４２２１ （大代
表）氏 名（５＋８９）弁 理 士 高 橋
明 夫補正命令の日付 昭和５７ｉ１月２６日補正
の対象 図面め茅１１灯 補正の内容 ヌ°Ｊｔ民のＡ／−＋−ソ ＄１ 図 ＜Ａ） ／／／
Claims (1)
- １、 コンピュータ間、またはコンピュータ端末装置で
あるステーション間をループ状に結合するデータハイウ
ェイにおいて、上記各ステーションをループ状に結合し
相互に逆方向に伝送させる２本のループ伝送路を設け、
前記２本のループ伝送路の一方に予め定められたステー
ションに伝送する信号を他方に予め定められたステーシ
ョンが受信する信号を伝送させる第１の手段と、前記ス
テーションの故障や回線部分の故障等によって伝送不能
になったときに該故障箇所を挾む２つのステーションで
各々上記２本のループ伝送路を接続する第２の手段を設
けたことを特徴とするデータ・・イウエイ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56132791A JPS5836046A (ja) | 1981-08-26 | 1981-08-26 | デ−タハイウエイ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56132791A JPS5836046A (ja) | 1981-08-26 | 1981-08-26 | デ−タハイウエイ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5836046A true JPS5836046A (ja) | 1983-03-02 |
Family
ID=15089628
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56132791A Pending JPS5836046A (ja) | 1981-08-26 | 1981-08-26 | デ−タハイウエイ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5836046A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02121547A (ja) * | 1988-10-31 | 1990-05-09 | Toshiba Corp | ローカルエリアネットワーク |
-
1981
- 1981-08-26 JP JP56132791A patent/JPS5836046A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02121547A (ja) * | 1988-10-31 | 1990-05-09 | Toshiba Corp | ローカルエリアネットワーク |
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