JPS5832415A - コンタクト抵抗低減方法 - Google Patents

コンタクト抵抗低減方法

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JPS5832415A
JPS5832415A JP13096181A JP13096181A JPS5832415A JP S5832415 A JPS5832415 A JP S5832415A JP 13096181 A JP13096181 A JP 13096181A JP 13096181 A JP13096181 A JP 13096181A JP S5832415 A JPS5832415 A JP S5832415A
Authority
JP
Japan
Prior art keywords
contact
contact resistance
melting point
point metal
silicon substrate
Prior art date
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Pending
Application number
JP13096181A
Other languages
English (en)
Inventor
Nobuyasu Taino
田井野 伸泰
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sanyo Electric Co Ltd
Sanyo Denki Co Ltd
Original Assignee
Sanyo Electric Co Ltd
Sanyo Denki Co Ltd
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Filing date
Publication date
Application filed by Sanyo Electric Co Ltd, Sanyo Denki Co Ltd filed Critical Sanyo Electric Co Ltd
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Publication of JPS5832415A publication Critical patent/JPS5832415A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/28Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268

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  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Electrodes Of Semiconductors (AREA)
  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は、シリコン基板と高融点金属との接触抵抗を低
減するコンタクト抵抗低減方法rc関する・近年集積−
路の配線抵抗の減少や微細化を行うため、配線金属とし
て高融点金属を用いる傾向にある。ところが、この場合
、高融点金属とシリコン基板とのダイレクトコンタクト
を採ると、七の後の熱処理に依ってコンタクト面でコン
タクト抵抗が高くなろと云う難点があった。また、この
ときのコンタクトがオーミンク接触とならないと云う問
題点もあった。
本発明はこのような点に鑑みて為さnたものであって高
融点金属とシリコン基板とのコンタクト抵抗を低減する
と共にオーオツクなものとするコンタクト抵抗低減方法
を提供するものである。
以下図に基づいて本発明方法を詳述する。まず。
シリコン基板11】に例えばNfiの不純物拡散層+2
11一つくりその上にシリコン酸化膜(3) を形成し
たのが第1図である・次にコンタクトホール(41ヲエ
ツチングに依って形成したのが第2図であり、さらに0
ム形成し穴のが第3図である。さらにモリブデン(5)
を通して拡散層121と同導電型の不純物例えば燐イオ
ンをモリブデン(5)と不純物拡散層(2)のコンタク
ト面近傍にイオン注入法を用いて5X10”(lose
/3.150KsV のエネルギーで注入す・る・その
後#C900°Cで15分間熱処理を行うと、拡散層(
21とモリブデン(5)との間の接触抵抗は約50にΩ
/μmとなった。
こ九に対し、上記と同じ条件で不純物の燐を注入しなか
った場合、コンタクト面における電圧−電流特性にOv
から10Vの範囲でにt随が流れずそn以上の電圧でl
−X1000に41/μmの接触抵抗が得らfL 7t
 oこのときのモリブデンを通して燐を注入した場合の
電圧−ta%性を@4図kに、しなかった場合の電圧−
電流特性を第4図Bに示す。このようにモリブデンを通
してコンタクト面近傍に燐を注入する◆に依って、接触
抵抗tオーミックなものにするとともにその抵抗[k下
げる手が出来る・ 以上の如く本発明コンタクト抵抗低減方法は、高融点金
属を通して%融点金属とシリコンとのコンタクト面近傍
に不純物をイオン注入法を用いて注入しているので、熱
処理後も接触抵抗が高くなったりオーはツクな抵抗が得
られなくなったり。
する事がなく、*融点金属とシリコンとのコンタクトの
形成後鳴熱処理?する事が、出来、半導体装置の種々の
製造工程に対応が可能となる。
【図面の簡単な説明】
$1図乃至jg3図はモリブデンとシリコン基板とのコ
ンタクトの形成方法全工程順に示した断面図、第4図A
、Bib大々モリブデンとシリコン基板とのコンタクト
面に燐イオンを注入したときと。 注入しなかったときのコンタクト面での電圧−電流特性
図である。 +11・・・シリコン基板、(2)・・・不純物拡散層
、(3)・・・シリコン酸化膜%(4)・・・コンタク
トホール、(5)・・・モリブデン・ 第1図 第3図 手  続  補  正  書(方式) 昭和57年2月タ 日 特許庁長官殿 1、事件の表示 昭和56年特許願第130961号 2、発明の名称 コンタクト抵抗低減方法 6、補正をする者 特許出願人 住所 守口市京阪本通2丁目18番地 名称(188)三洋電機株式会社 代表者 井 植   薫 4、代理人 住所 守口市京阪本通2丁目18番地 4 補正の対象 明細書中、図面の簡単な説明、の欄 7、補正の内容 明細書、第4頁第4行目乃至同頁第9行目までを下記の
とおり補正する。 記

Claims (1)

    【特許請求の範囲】
  1. シリコン基板に不純物拡散層を形成し、この不純物拡散
    層上にシリコン酸化屓をつくり、このシリコン酸化膜t
    エツチングしてコンタクトホールを形属し、コンタクト
    ホールrc高融点金属を形成してシリコン基板と高融点
    金属とのコンタク、トラ得る牛導体装置に於いて、該高
    融点金属を通して高融点金属とシリコン基板とのコンタ
    クト面近傍に不純物を注入するI#に依って、高融点金
    属とシリコン基板との接触抵抗を低減せしめるat特黴
    としたコンタクト抵抗低減方法。
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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS59181571A (ja) * 1983-03-31 1984-10-16 Fujitsu Ltd 半導体装置
CN104253015A (zh) * 2013-06-25 2014-12-31 中国科学院微电子研究所 降低二维晶体材料接触电阻的方法

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Publication number Priority date Publication date Assignee Title
JPS55151334A (en) * 1979-05-16 1980-11-25 Matsushita Electric Ind Co Ltd Fabricating method of semiconductor device
JPS5658229A (en) * 1979-10-16 1981-05-21 Chiyou Lsi Gijutsu Kenkyu Kumiai Manufacture of semiconductor device

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