JPS5828738B2 - 半導体装置 - Google Patents

半導体装置

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JPS5828738B2
JPS5828738B2 JP53021912A JP2191278A JPS5828738B2 JP S5828738 B2 JPS5828738 B2 JP S5828738B2 JP 53021912 A JP53021912 A JP 53021912A JP 2191278 A JP2191278 A JP 2191278A JP S5828738 B2 JPS5828738 B2 JP S5828738B2
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JP
Japan
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layer
insulating film
semiconductor substrate
wiring
semiconductor
Prior art date
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Expired
Application number
JP53021912A
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English (en)
Other versions
JPS54114190A (en
Inventor
潤治 桜井
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP53021912A priority Critical patent/JPS5828738B2/ja
Priority to US06/015,427 priority patent/US4353085A/en
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Publication of JPS5828738B2 publication Critical patent/JPS5828738B2/ja
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Description

【発明の詳細な説明】 本発明は、集積性が向上するように構造を改善した埋込
酸化層型MIS集積回路装置のような半導体装置に関す
る。
従来、埋込酸化層型MIS集積回路装置(以下BO−M
ISと略称する)として第1図に見られる構造のものが
知られている。
図に於いて、1はp十型シリコン半導体基板、2はフィ
ールド用酸化膜、3はチャネル領域となるp−型単結晶
シリコン半導体層、4及びlはn半型多結晶シリコン及
び単結晶シリコンのソース領域、5及び5′はn半型多
結晶シリコン及び単結晶シリコンのドレイン領域、6は
ゲート酸化膜、7はシリコン・ゲートをそれぞれ示す。
この装置では、フィールド用酸化膜2をパターニングし
て開口を形成してから通常のエピタキシャル成長法を適
用することに依って基板1上には単結晶シリコンを、そ
して、酸化膜2上には多結晶シリコンをそれぞれ成長さ
せ、そこに各素子領域を形成すること、また、酸化膜2
上に於いて多結晶シリコンのソース領域或いはドレイン
領域とアルミニウムの配線とオーミック・コンタクトさ
せること等が大きな特徴になっている。
このような構成を有するBO−MISは、その絶縁構造
からSO8−MIS集積回路装置と同様な集積度を得る
ことができるとともに接合面積の減少による高速化を期
待できるとされている。
しかしながら、このBO−MISであっても、配線に関
しては、従来のバルクMIS集積回路装置と同様に、ソ
ース領域及びドレイン領域と共通の拡散層、ゲートと共
通の多結晶シリコン層、蒸着後パターニングされたアル
ミニウム層の三層からなる配線に依存してきた。
そして、これ以上集積度を向上するには、配線を更に多
層化しなげればならないが、それには、必ず層間絶縁層
を要し、また、配線層間上下のコンタクトを採る為の工
程も必要になってくる。
このような工程の増加が製造歩留りに悪影響を及ぼすこ
とは云うまでもない。
本発明は、工程を複雑化することなく BO−MISの配線を更に多層化して、集積度及び高周
波特性を一層向上できるようにするものであり、以下こ
れを詳細に説明する。
第2図は本発明一実施例の要部側断面図である。
尚、第1図に関して説明した部分と同部分は同記号で指
示しである。
本発明埋込酸化層型MIS集積回路装置が従来のそれと
構造的に相違する点は基板1に同導電型或いは反対導電
型の不純物導入層からなる下層配線8を形成したことで
ある(図示例はn半型)。
下層配線8を基板1内に複数設ける場合には各下層配線
間の分離を確保するためその導電型は基板とは反対型に
する方が良いことは勿論である。
尚、図に於いて、9は多結晶シリコンからなる上層配線
、10は燐硅酸ガラス(PSG)からなるカバー・ガラ
ス膜、11はアルミニウム配線である。
このように、埋込酸化層である酸化膜2の下に在る基板
1の部分に形成された下層配線8は、酸化膜2上に形成
された多結晶シリコンからなるソース領域4或いはドレ
イン領域5と容易に接続することができる。
下層配線8の形成時期はソース・ドレイン拡散工程以前
に適宜選択できる。
本発明に於いて、下層配線8を形成できる理由はBO−
MISのその特殊な構造に依存している。
即ち、SO8型では当然不可能であるし、バルク型では
基板にソース領域、ドレイン領域を形成するので、下層
配線8を形成する余裕はない。
従って、基板1中を利用できるのはBO−MISのみで
ある。
そして、下層配線8を形成するには基板1に配線を形成
する為のマスクを設け、不純物をイオン注入したり、気
相でデポジションするだけで済み、所要導入深さを得る
為の熱処理は埋込酸化層である酸化膜2を形成するとき
の熱処理を利用することができる。
また、上層の不純拡散層とのコンタクトを採るにはBO
−MISを形成する為の酸化膜2に対する窓開き、シリ
コン半導体層のエピタキシャル成長、ソース領域及びド
レイン領域等の拡散等の工程中に同時に実行できるから
それ独自の工程を別設する必要はない。
因に、従来の通常の多層配線で適用されている二重多結
晶シリコン層方式や二重アルミニウム配線方式では、第
2の多結晶シリコン層やアルミニウム層を全く別個の工
程として新たに設けなげればならないばかりでなく、第
1及び第2の配線層間に絶縁層を設ける工程及び接続の
為の電極コンタクト窓形成の工程を余分に行なわなけれ
ばならない。
以上の説明で判るように、本発明に依れば、BO・MI
Sは半導体基板上に形成した単結晶半導体層及び半導体
基板を覆う酸化層上に形成した多結晶半導体層に素子が
形成され、半導体基板自体には何も形成されていない点
に着目し、そこに下層配線を形成することに依り、BO
−MISの特徴の一つである高集積性を更に向上するこ
とができ、しかも、その形成工程はBO−MIS形成工
程と共通にすることができる場合が多く、工程数増加を
招来しない点でも卓効があり、その実施は容易である。
尚、フィールド部に埋込む酸化膜はシリコン窒化膜等の
他の絶縁膜に替え得ることは勿論である。
【図面の簡単な説明】
第1図は従来例の要部側断面図、第2図は本発明一実施
例の要部側断面図である。 図に於いて、1は基板、2は酸化膜、3は単結晶シリコ
ン半導体層、4及びlはソース領域、5及び5′はドレ
イン領域、6はゲート酸化膜、7はシリコン・ゲート、
8は下層配線、9は上層配線、10はカバー・ガラス膜
、11はアルミニウム配線である。

Claims (1)

    【特許請求の範囲】
  1. 1 半導体基板上に形成され且つ開口を有する絶縁膜と
    、前記開口内に露出された前記半導体基板面及び前記絶
    縁膜上に同時に成長された単結晶半導体層及び多結晶半
    導体層の該単結晶半導体層に存在するチャネル領域及び
    前記多結晶半導体層に形成されたソース領域並びにドレ
    イン領域と、前記絶縁膜上に延在された半導体層よりな
    る上層配線層と、前記絶縁膜下の半導体基板に高濃度に
    導入された該半導体基板と同導電型或いは反対導電型の
    不純物導入層で形成され前記絶縁膜上の上層配線層と該
    絶縁膜を介して交差する如く配設された下層配線とを含
    んでなることを特徴とする半導体装置。
JP53021912A 1978-02-27 1978-02-27 半導体装置 Expired JPS5828738B2 (ja)

Priority Applications (2)

Application Number Priority Date Filing Date Title
JP53021912A JPS5828738B2 (ja) 1978-02-27 1978-02-27 半導体装置
US06/015,427 US4353085A (en) 1978-02-27 1979-02-26 Integrated semiconductor device having insulated gate field effect transistors with a buried insulating film

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP53021912A JPS5828738B2 (ja) 1978-02-27 1978-02-27 半導体装置

Publications (2)

Publication Number Publication Date
JPS54114190A JPS54114190A (en) 1979-09-06
JPS5828738B2 true JPS5828738B2 (ja) 1983-06-17

Family

ID=12068294

Family Applications (1)

Application Number Title Priority Date Filing Date
JP53021912A Expired JPS5828738B2 (ja) 1978-02-27 1978-02-27 半導体装置

Country Status (1)

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JP (1) JPS5828738B2 (ja)

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS49112574A (ja) * 1973-02-24 1974-10-26
JPS50107871A (ja) * 1974-01-30 1975-08-25

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS49112574A (ja) * 1973-02-24 1974-10-26
JPS50107871A (ja) * 1974-01-30 1975-08-25

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JPS54114190A (en) 1979-09-06

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