JPS58210740A - デ−タ伝送制御装置 - Google Patents

デ−タ伝送制御装置

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Publication number
JPS58210740A
JPS58210740A JP9455282A JP9455282A JPS58210740A JP S58210740 A JPS58210740 A JP S58210740A JP 9455282 A JP9455282 A JP 9455282A JP 9455282 A JP9455282 A JP 9455282A JP S58210740 A JPS58210740 A JP S58210740A
Authority
JP
Japan
Prior art keywords
station
slot
data transmission
loop
control
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP9455282A
Other languages
English (en)
Inventor
Youjirou Mino
三野 容志郎
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP9455282A priority Critical patent/JPS58210740A/ja
Publication of JPS58210740A publication Critical patent/JPS58210740A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L12/00Data switching networks
    • H04L12/28Data switching networks characterised by path configuration, e.g. LAN [Local Area Networks] or WAN [Wide Area Networks]
    • H04L12/42Loop networks
    • H04L12/427Loop networks with decentralised control
    • H04L12/43Loop networks with decentralised control with synchronous transmission, e.g. time division multiplex [TDM], slotted rings

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 この発111:Iは、flIえばループ状の伝送路によ
って互に接続された窄数の局間でデータ転送を行うデー
タ伝送システムにおけるデータ伝送制御装置に関するも
のである。
21図は従来のデータ伝送システムのデータ伝送制御の
一例を示すブロック結線図である。図において(1)は
ステーションA(記号をSTAとする)、(2)はステ
ーションB(記号をSTBとするり、+31はステーシ
ョンC(記号全STcとする)、14+はステーション
D(記号k SToとする)、+51はループコントロ
ーラ(記号t−LCとする)、+61はステーションA
 (11のターミナル、(7)はステーションB12)
のターミナル、18)はステーションC(31のターミ
ナル、(9)はステーションD(4)のターミナル、1
1〜a4は各ステーション!11〜f41 及ヒループ
コントローラf5)kループ状に接続する同軸あるいは
光フアイバケーブル等の伝送路である。
上記のように構成されたデータ伝送システムにおいては
、ループコントローラ(5)はループ上の制御局に1台
設置されループ全体の制御をつかさどっている。ループ
コントローラ(5)がループ全体の制御音つかさどるに
は、第2図に示したようなデータ伝送信号を送っている
。ここで第2図は従来のデータ伝送制御装置のフレーム
構成の一例を示すフレーム構成図である。図において(
2o)は同期スロット、(21)はパケットNO1% 
 (22)はパケットNo 2である。ループコントロ
ーラ(5)ハループ全体のクロック源とな9、同期スロ
ット(20) を定周期で送出する。各ステーション(
11〜(4:はこの1if1期スロット(20) 全検
出し、続くデータからパケットNol (2υが始まる
ことを知る。各パケットは決められたビット数で構成さ
れ、次の同期スロット■まで一定数のパケットが1フレ
ーム中に存在する。
各ステーション(11〜(4)では、データ転送要求が
発生すると、伝送路1[1〜α4上金送られてくる各パ
ケットの使用中フラグを検索し、空パケットを検出する
と、所定の形態に従って使用中フラグをセットして宛先
ステーションアドレス及びデータを送信する。
各ステーションでは、使用中のパケットの宛先ステーシ
ョンアドレスを常に監視し、自局宛ならとそのバケツ)
f[り込み、使用中フラグをクリヤする。この時1つの
ステーションで固有のアドレス以外にプログラムで設定
可能な1数のステーションアドレスを持っている場合に
は、それらについてもアドレス一致全監視しなけれはな
らない。
例工ばステーションA(1)では、アドレスA以外にI
u y A2の2つのプログラム設定アドレスを持って
いるような場合である。
送信したステーションでは、自局が送出したパケットが
、そのまま戻ってきた時には、使用中フラグをクリアし
、宛先バイパス中で終了する。
従来のデータ伝送装置は、上記のように構成されていた
ので、各ステーションでは空スロツtt−検知してデー
タ全送信し、常に使用中パケットの宛先ステーションア
ドレス全監視して、自局宛の時には、直ちに受信しなけ
ればならず、自局が送出したパケットが戻ってきた時に
は、そのパケットヲ消去することが必要であるため、各
ステーションのルW量が多く、リアルタイム性が要求さ
れるなどの欠点がめった。またルーフコントローラ15
1は伝送トラヒック量やステーション間のリンク情報を
知ることができず、保守に不便でめるという欠点があっ
た。
この発明は上記のような従来装置の欠点を除去するため
になされたもので、各ステーションからのデータ転送要
求に対して、制御局では空スロットを常に検知し送信局
に通知することにより各ステーションの)l/W量を少
くシ、リアルタイム性をなくし保守に便利なデータ伝送
制御装置in得ることを目的とするものであろう 第3図にこの発明の一実施fII’に示すブロック結線
図であり、(1)〜α4は上記第1図の同一符号と同−
又は和尚部分を示すものであるう図において(処は各ス
テーションと通信を行ったり、リンクを確立したりする
ループ制御プロセッサ(記号tLPとする)である。
上記のように構成されたデータ伝送システムにおいて、
ループコントローラ(5)はループ全体のクロック源と
なり、定められた伝送方式に従って第4図のような伝送
フレームを形成する。ここで第4図はこの全開のフレー
ム構成の一実施例を示すフレーム構成図であり、(20
)は第2図の同一符号と同−又は相当部分を示すもので
ある。
図(でおいて(41) iループコントローラX削・■
スロット、(42)はステーション制御スロット、(4
3)j−1mブロードキャストスロット、(44)〜(
47,) U 各々コンミュニケーションスロットであ
る。
上記L/−1ようVClフレームはn”4ビツト(nは
正の整数ンで構成され、各フレームの同一ビット位置上
つなぎ合せて各スロットが形成される。
ループコントローラt51:、tフレームの最初のヒツ
ト位置に同期コードをヤう入し、各ステーション’11
〜141はこの同期コードを検mしてlフレームの最初
であることを知る。各スロットはそれぞれ独自の伝送方
式をとっている。
第5図は伝送システムの制御信号の伝送形態図であり、
第5図(a)はループ制愉プロセッサ(3o)からステ
ーションA(1)への伝送形態図、第5図(b)はステ
ーションA(11からループtffl:aプロセッサ(
30)への要求の伝送形態図、第5図(c)にブロード
キャストの伝送形態図、第5図(d)はステーション間
のコミュニケー7ヨン伝送形態図でめる−図にお層て(
1)〜t51、(30)は第3図の同一符号と同−又は
相当部分を示すものである。
ループコントローラ制御スロツ) (4υUff 5 
図(alのように伝送され、リンク確立指令、ステータ
ス収集指令などがある。ステーション?lV制御スロツ
) (42)は第5図(b)に示すようにステーション
からループ制御プロセッサ(30)への要求であり、回
線接続要求、アドレス登録要求などがある。ブロードキ
ャストスロツ) (43)は第5図(e)に示すように
ルーフ”11プロセツサ(30)から全ステーション(
1)〜(4)へのステータス送信であり、各ステーショ
ンでは無東件に受信する。コミュニケーションスロット
(44)〜(47)はn個あり、11個のスロットを使
用して1対のステーション間の通信が可能である。
第5図(d)はステーションA(1)とステーションB
(2)、ステーションC(3)とステーションD t4
12>E 通m L でいる図である。
ループ制御プロセッサ(30)ハ、定周期で各ステーシ
ョンに対してループコントローラ制御スロット(41)
 rAじてステータス送信指令全送信する。
各ステーションは自局に対するステータス送信指令全受
信すれば、ステータスをステーション制御スロット(4
2)にのゼてループ制御プロセッサ(30)に知らせる
うループ制御プロセッサ(30)IL−1全ステーシヨ
ン(11〜(4)のステータス全収集しおえると、その
結果をブロードキャストスロット(43) ffi A
 L。
て全ステーション(11〜(4)に伝える、各ステーシ
ョンでは、ブロードキャストスロツ) (43) e受
信し、ループ上の全ステーション(11〜(41の状態
変化を知る。ステータスには、ターミナルダウン、ステ
ーションダウン、バイパス甲などがあり、これにより2
重化切替を行ったり、保守情報のトレース全行なったす
する。
各ステーション(1)〜(4)には、固有のアドレス以
外にプログラムで設定ができる複数のステーションアド
レスを持つこともでき、このアドレスによって通1言す
ることかできる。たとえば、ステーションA(1)は、
固有のアドレス人以外にA1A2というプログラムで設
定されたアドレス以外ち、AIというアドレスで送信し
た9、A1というアドレスに対するデータを受信するこ
とができる、ステーションA)1)はターミナル16)
からAA2のアドレス登録要求があると、アドレス登録
要求をステーション制御スロット(42)を通じて送信
する。ループ制御10セツサ(30)はこれ全受信する
と、すでにループ上の他のステーションが同一アドレス
を登録済みでないことを確認して、登録受付の応答をル
ープコントローラ制御スロット(41) k通じてステ
ーションA)1)に知らせる。これにより同一アドレス
の2重登録全防止することができる。
各ステーション(1)〜(4)がデータ転送全行いたい
時は、宛先ステーションを指定して回線接続要求をステ
ーション制御スロット(42)にのせる。ループ制御プ
ロセッサ(30)は11回線接続要求を受けるト、宛先
ステーションのステータスが異常の時、あるいは他のス
テーションとリンクを確立している時、6るいはコミニ
ュケーションスロット(43)〜(47)がすべて使用
中の時には、回線接続不可の応答全速り元スチーション
に対してループコントローラ制御スロット(4リヲ通じ
て返送するーこの時リンクは確立せずコミュニケーショ
ンスロット(43)〜(47)は割当てられない、回線
接続が可能な時に(1空コミユニケーシヨンスロツトを
割当てて、両ステーションに対シてリンク確立指令全ル
ープコントローラ制御スロット(4υを通じて返送する
。この時割当てたコミュニケーションスロット番号も知
らせる。宛先ステーションアドレスがプログラム設定す
したアドレスならば、ループ制御プロセッサ(30)で
アドレス登録テーブルヲ参照して、そのステーションの
空いている固有のアドレスに変換してリンク確立指令全
返送すれば、ステーション側の負荷のバランスを取るこ
とができる− リンク確立指令を受けた両ステーションは、指定された
コミュニケーションスロットt[用してデータ転送を行
う。この様にループ制御プロセッサ(30)には、全ス
テーション(1)〜14)のステータス情報・アドレス
登録情報・リンク情報か集中管理されているので、ルー
プのトラヒックや保守に必要な情報を知るここが容易で
ある。またステーン戸ン叫の簡易化にもつながる。
なお上記実施例でに、ループ伝送システムの制御装置に
ついて述べたが、第6図のようなマルチドロップ形デー
タ伝送システムの匍I御装置についても同様に適用でき
ることはいうまでもない。ここで第6図はマルチドロッ
プ形データ伝送システムのデータ伝送制御の一例を示す
ブロック結線図であり、(1)〜(10)、 (30)
は第3図の同一符号と同−又は相当部分を示すものであ
る。
また伝送方法として第4図に示すようなビット多重の時
分割方式について述べたが、ブロック多重方式、周波数
多重方式、波長多重方式についても同様である。
この発明は以上説明したとおり、データ転送を行いたい
局から回線割当要求に対して空スロットを割当て、この
割当てられた空スロツ)k便用してデータ転送を行いた
い局とデータを受信する局との間でデータ転送するよう
に構成したのでステーション側の装置iは)i/Wfi
が少く、且つリアルタイム性の少いもので艮< 411
.1(fii1局では伝送トラヒック看やリンク情報の
集中管理ができるという効果がある。
【図面の簡単な説明】
21図は従来のデータ伝送システムのデータ伝送辱制御
の一例を示すブロック結線図、第2図は従来のデータ伝
送制御装置のフレーム構成の一例を示すフレーム構成図
、第3図はこの発明の一実施9++Q示すブロック結線
図、第4図にこの発明のフレーム構成4成の一実弛例を
示すフレーム構成図、第5図はこの発明の伝送システム
の制御信号の伝送形態図、76図はマルチドロップ形デ
ータ伝送システムのデータ伝送制御の一例を示すブロッ
ク結線図である。 晒ニ2いテ111〜(41にステーション、15)i’
ff1.ループコントローラ+61〜(91Hターミナ
ル、:m 〜CL4は伝送路、(2o)は同期スロット
、(30)はループ制御フ゛ロセツサ、(41)はルー
プコントローラ、制御スロット、(42)はステーショ
ン制御スロット、(43)はブロードキャストスロット
、(44)〜(47) Hコミュニケーションスロット
でアル。 なお各図中同一符号は同−又は相当部分を示すものとす
る。 代理人  葛 野 信 − 第1図 第2図 欝3図 第5 図 (0)                   (b)
(C)                    (d
)第6図

Claims (1)

    【特許請求の範囲】
  1. 伝送路により互に接続された複数の局間で制御局の制御
    装置から送出される同期信号全基準としてデータ伝送を
    行うデータ伝送システムのデータ伝送制御装置において
    、データ転送全行いたい局からの回線割当要求に対して
    空スロットを割当てる手段、この割当てられた空スロッ
    ト1−便用して上記データ転送を行いたい局とデータを
    受信する局との間でデータ転送が行なわれるように上記
    両局に対し空スロット金通知する回線通知手段金偏えた
    こと全特徴とするデータ伝送制御装置。
JP9455282A 1982-06-02 1982-06-02 デ−タ伝送制御装置 Pending JPS58210740A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP9455282A JPS58210740A (ja) 1982-06-02 1982-06-02 デ−タ伝送制御装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP9455282A JPS58210740A (ja) 1982-06-02 1982-06-02 デ−タ伝送制御装置

Publications (1)

Publication Number Publication Date
JPS58210740A true JPS58210740A (ja) 1983-12-08

Family

ID=14113474

Family Applications (1)

Application Number Title Priority Date Filing Date
JP9455282A Pending JPS58210740A (ja) 1982-06-02 1982-06-02 デ−タ伝送制御装置

Country Status (1)

Country Link
JP (1) JPS58210740A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100605136B1 (ko) * 1997-08-27 2007-04-25 소니 가부시끼 가이샤 무선통신시스템,송신장치,무선통신제어장치,수신장치및무선통신방법

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100605136B1 (ko) * 1997-08-27 2007-04-25 소니 가부시끼 가이샤 무선통신시스템,송신장치,무선통신제어장치,수신장치및무선통신방법

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