JPS5818681A - フルドット形グラフィック・ディスプレイ装置 - Google Patents
フルドット形グラフィック・ディスプレイ装置Info
- Publication number
- JPS5818681A JPS5818681A JP56117983A JP11798381A JPS5818681A JP S5818681 A JPS5818681 A JP S5818681A JP 56117983 A JP56117983 A JP 56117983A JP 11798381 A JP11798381 A JP 11798381A JP S5818681 A JPS5818681 A JP S5818681A
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- Japan
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- pixels
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、フルドツト形のグラフィ、!・ディスプVイ
メグの改嵐に関するものeある。さらに詳しくは、ディ
スプレイ両画の全画素数よ勤多い画素から1−為画像を
表示するとき、原画像會表示−〇画素数に合わせて縮小
表示することと、MII僚を等倍率で表示することがど
ちらでも行え為ようにした、フルドF)*0グツフィ、
り・ディスプレイ俟置に関するもOである・ 文書中間面等(以下ド命、メントという)を計算機で処
理するシステムとして、7アクシR讐壜九社それと同等
till置を端末機として用い、±れを通じて計算機に
ドdP&メントO入出力を行うようにしえもOがあゐ。
メグの改嵐に関するものeある。さらに詳しくは、ディ
スプレイ両画の全画素数よ勤多い画素から1−為画像を
表示するとき、原画像會表示−〇画素数に合わせて縮小
表示することと、MII僚を等倍率で表示することがど
ちらでも行え為ようにした、フルドF)*0グツフィ、
り・ディスプレイ俟置に関するもOである・ 文書中間面等(以下ド命、メントという)を計算機で処
理するシステムとして、7アクシR讐壜九社それと同等
till置を端末機として用い、±れを通じて計算機に
ドdP&メントO入出力を行うようにしえもOがあゐ。
このようなシステムKかいては、ドキ、メントの内容を
表わす情報は、計算機の内容ではビデオ信漫O形に−a
れ、記憶メグに配憶1れゐ。記憶俟置の内容性、必11
に応じてグラフィ、り・ディスプレイ偏置に表示され、
オペレータがド會、メン)oWIkjを見るととかで1
為ようにして−る。グラフィ、/・ディスプVイメグと
しては、フルドツト形のもOが用いられ、微小な画素O
集オ)からなるドキ島メy卜OIIを、志11に表示で
■ゐようになりている0CIITを用いたζoswoグ
ッフイV/−ディスプレイ値置の−装IIWの画素は、
横方向の一走査幽pの1024個が現在e1MI的な限
度である。これに対して、ドキ轟メント入カ端末として
、G肩紐の7アクV(す・リーグを用い九とき、ビデオ
信号の画素は、横方向の一滝査蟲112048儒になる
ので、このビデオ信号をCRTグッフイッタ・ディスプ
レイ装置に与えると、ド命、メント像の−II (1/
4程度)しか表示1れない。したがりて、映俸0IIs
轡度は高いが、ドdP1メントの全貌は見ることがで自
1にい。
表わす情報は、計算機の内容ではビデオ信漫O形に−a
れ、記憶メグに配憶1れゐ。記憶俟置の内容性、必11
に応じてグラフィ、り・ディスプレイ偏置に表示され、
オペレータがド會、メン)oWIkjを見るととかで1
為ようにして−る。グラフィ、/・ディスプVイメグと
しては、フルドツト形のもOが用いられ、微小な画素O
集オ)からなるドキ島メy卜OIIを、志11に表示で
■ゐようになりている0CIITを用いたζoswoグ
ッフイV/−ディスプレイ値置の−装IIWの画素は、
横方向の一走査幽pの1024個が現在e1MI的な限
度である。これに対して、ドキ轟メント入カ端末として
、G肩紐の7アクV(す・リーグを用い九とき、ビデオ
信号の画素は、横方向の一滝査蟲112048儒になる
ので、このビデオ信号をCRTグッフイッタ・ディスプ
レイ装置に与えると、ド命、メント像の−II (1/
4程度)しか表示1れない。したがりて、映俸0IIs
轡度は高いが、ドdP1メントの全貌は見ることがで自
1にい。
本実80@的は、ドキュメントの一部の1書な映像と、
ドキ、メyトの金暁の櫃観的な映像のどちらでも表示で
自るグラフィ、り・ディスプレイ装置を提供することK
ある。
ドキ、メyトの金暁の櫃観的な映像のどちらでも表示で
自るグラフィ、り・ディスプレイ装置を提供することK
ある。
本実−は、す7し、シ、メ毫すを2iA統設け、一方の
97vy V&メモ9には、表示器の画素数に会わせて
画素削減部層をしたビデオ信号を書込み嘔他方の97レ
ツシーメ篭りに#i、そのような処理をし′&いビデオ
信号を書込み、これらリレッシ、メ峰りの内容を、オペ
レータの指走に応じて切換えて表示するようKしたもの
である@以下、図INKよって、本発明を詳細IKII
@すゐ。
97vy V&メモ9には、表示器の画素数に会わせて
画素削減部層をしたビデオ信号を書込み嘔他方の97レ
ツシーメ篭りに#i、そのような処理をし′&いビデオ
信号を書込み、これらリレッシ、メ峰りの内容を、オペ
レータの指走に応じて切換えて表示するようKしたもの
である@以下、図INKよって、本発明を詳細IKII
@すゐ。
第1Eは、本発明のグラフィツタ・ディスプレイ装置が
組合わされるドキュメント処理システムO概念的構威図
である。第1図において、1はメインプロセ、t%意は
メインメモリ、基はディスプレイ制御回路、4は補助記
憶制御回路、Sはド午島メント入出力制御回路、6はビ
デオプロ七、1である。これらはデータバス7によりて
、相互に接続されて、1つのシステムを構成している。
組合わされるドキュメント処理システムO概念的構威図
である。第1図において、1はメインプロセ、t%意は
メインメモリ、基はディスプレイ制御回路、4は補助記
憶制御回路、Sはド午島メント入出力制御回路、6はビ
デオプロ七、1である。これらはデータバス7によりて
、相互に接続されて、1つのシステムを構成している。
このシステムは、メインメモリ、?1によって管制慣れ
る0ディスプレイ制御g11113は、CRT等による
グラフィ、り・ディスプレイ装置31を配下に持ち、そ
れを制御する。補助記憶制御回路4は、磁気ディスク装
置41を配下に持ち、それを制御する。ドキュメント入
出力制御回路Sは、ドdPhメント入力装置51とド會
1メント出力装置52を配下に持ち、それらを制御する
。ド命、メント入力装置51は、7アクシ4曹・リーダ
tたはそれと同等の装置であって、それにかけられたド
キ暴メント上の記事の像を、微小な画素の集まりからな
ゐビデオ信号に変換して、ド命、メント入出力制御回路
5に与えるものである。ドキュメント出力羨置52は、
フアクタt9・プリンタを九はそれと同等の装置であり
て、ドdP、メント入出力制御回路藻から与えド命島メ
yト入力装置51から、その制御回路5を鏝で入力され
えドキュメントのビデオ信号は1−1.メインメ峰り2
のバッファ領域に格納され丸後、ビデオプロ七、t4に
よりて圧縮躯聰峙が論1れ、補助配憶制御回路4を通じ
て磁気ディスク装置41に記憶される。磁気ディスク羨
置41Km!!健1れたビデ第1層は、必要に応じて適
宜読出され、ビデオプロ七、す6による伸張処理のうえ
、ダツツィ、り・ディスプレイ装置31またはドキ暴メ
ント出力出力52に出力されて、それぞれディスプvイ
1または書出しが行われる。グラフィツタ・ディスプレ
イ装fI131としては、高分解能のフルドツト形のも
のが用いられ、微小な画素の集合で番るド中1メントの
記事oweを、忠実に表示で自るようKなりている。
る0ディスプレイ制御g11113は、CRT等による
グラフィ、り・ディスプレイ装置31を配下に持ち、そ
れを制御する。補助記憶制御回路4は、磁気ディスク装
置41を配下に持ち、それを制御する。ドキュメント入
出力制御回路Sは、ドdPhメント入力装置51とド會
1メント出力装置52を配下に持ち、それらを制御する
。ド命、メント入力装置51は、7アクシ4曹・リーダ
tたはそれと同等の装置であって、それにかけられたド
キ暴メント上の記事の像を、微小な画素の集まりからな
ゐビデオ信号に変換して、ド命、メント入出力制御回路
5に与えるものである。ドキュメント出力羨置52は、
フアクタt9・プリンタを九はそれと同等の装置であり
て、ドdP、メント入出力制御回路藻から与えド命島メ
yト入力装置51から、その制御回路5を鏝で入力され
えドキュメントのビデオ信号は1−1.メインメ峰り2
のバッファ領域に格納され丸後、ビデオプロ七、t4に
よりて圧縮躯聰峙が論1れ、補助配憶制御回路4を通じ
て磁気ディスク装置41に記憶される。磁気ディスク羨
置41Km!!健1れたビデ第1層は、必要に応じて適
宜読出され、ビデオプロ七、す6による伸張処理のうえ
、ダツツィ、り・ディスプレイ装置31またはドキ暴メ
ント出力出力52に出力されて、それぞれディスプvイ
1または書出しが行われる。グラフィツタ・ディスプレ
イ装fI131としては、高分解能のフルドツト形のも
のが用いられ、微小な画素の集合で番るド中1メントの
記事oweを、忠実に表示で自るようKなりている。
画素が微小なだけビデオ信号の量は厖大1&るので、そ
れを処理す為ビデオプロ七、すは、高速なものが用いら
れ、グラフィ、り・ディスプレイ劃11の表示の即時性
を確保するようになってい為。
れを処理す為ビデオプロ七、すは、高速なものが用いら
れ、グラフィ、り・ディスプレイ劃11の表示の即時性
を確保するようになってい為。
磁気ディスク装置41には、ビデオ信号の他に、コード
信号からなる各種のデータやプロダラムが記憶され、必
要に応じてメインメモリ!に読出されて、メインプロ七
、す1によりて使用される。
信号からなる各種のデータやプロダラムが記憶され、必
要に応じてメインメモリ!に読出されて、メインプロ七
、す1によりて使用される。
tえ、グラフィツタ・ディスプレイ装置31も、ド命−
メントの記事の画像ばTheでなく、メインメモリ、す
1のデータ処理結果をグラフィツタ表示できるようKな
っている。グラフィVり・ディスプレイ装置31には、
中−ボードが付属して&)、その操作によってオペレー
タが種々の指令をシステムに与えることができるように
なりている@これらに関しては、通常の計算機システム
と共通である。
メントの記事の画像ばTheでなく、メインメモリ、す
1のデータ処理結果をグラフィツタ表示できるようKな
っている。グラフィVり・ディスプレイ装置31には、
中−ボードが付属して&)、その操作によってオペレー
タが種々の指令をシステムに与えることができるように
なりている@これらに関しては、通常の計算機システム
と共通である。
こOようなシステムにおいて、グラフィ、り・ディスプ
レイ装置31として用いられるのが、本発明の装置であ
って、その実施例を第2図に示す。
レイ装置31として用いられるのが、本発明の装置であ
って、その実施例を第2図に示す。
嬉2図において、311はコントローラ、312ハ大小
切換闘絡、313.314はり7し、シュメモリ、31
5は画素削減111&、 316はパラレル/シリア
ル変換器、317はCRT等からなる表示器である。
切換闘絡、313.314はり7し、シュメモリ、31
5は画素削減111&、 316はパラレル/シリア
ル変換器、317はCRT等からなる表示器である。
す7レツシ、メ毫9313 Kは、画素削減回路315
によp%表示9317に合わせて画素を削減したビデオ
信号が記憶され、リフレッシ、メ令す314には、画素
削減されないビデオ信号が記憶される。これらのり7V
yシ、メモリ313.314は、大小切換回路312に
出力信号によって、どちらか一方が出力可能状態にされ
て、コントロー23110制御のもとKv!憶内容を出
力し、パラレル/シリアル変換II 316を通じて表
示器317に与える01にお、コントローラ311と大
小切換回路312には、午−ボードi1(回路)を通じ
てオペレータの操作儒噌が与えられる〇 画素削減回路315は一種のプレセッサでありて、ビデ
オ信号を構成する画素の明暗に対応したドVト・パター
ンを、例えば、隣シ合う4ドツトずつ調べて、これら4
つのドツトをそれらの明暗O親会わせに応じて、明また
社暗の1ドツトで代表1せることを行う。これによって
、ドキ、メントO像を表わす画素の数はたてよこそれぞ
れ半分K。
によp%表示9317に合わせて画素を削減したビデオ
信号が記憶され、リフレッシ、メ令す314には、画素
削減されないビデオ信号が記憶される。これらのり7V
yシ、メモリ313.314は、大小切換回路312に
出力信号によって、どちらか一方が出力可能状態にされ
て、コントロー23110制御のもとKv!憶内容を出
力し、パラレル/シリアル変換II 316を通じて表
示器317に与える01にお、コントローラ311と大
小切換回路312には、午−ボードi1(回路)を通じ
てオペレータの操作儒噌が与えられる〇 画素削減回路315は一種のプレセッサでありて、ビデ
オ信号を構成する画素の明暗に対応したドVト・パター
ンを、例えば、隣シ合う4ドツトずつ調べて、これら4
つのドツトをそれらの明暗O親会わせに応じて、明また
社暗の1ドツトで代表1せることを行う。これによって
、ドキ、メントO像を表わす画素の数はたてよこそれぞ
れ半分K。
すなわち174 K削減される。したがりて、す7Vシ
シ轟メモリ313 Kは縮尺1/2のドキュメントの像
が記憶されることになあ(第5図(1))。このため、
01級の7丁クシきり・リーダ01横−走査画b 20
48個の画素は、横−走査画11024個O画素に削減
畜れ、高分#i@フルド、ト廖OCRT表示器の画素に
適合したものとなる。これKよりて、す7レツシ、メモ
リ313のビデオ信号を表示器317に与え九とき、ド
*、メyトo像の全貌が縮小表示で暑る(第1 II
(b) )。ただし、この像は画素が削減されているの
で分解能が低下している。
シ轟メモリ313 Kは縮尺1/2のドキュメントの像
が記憶されることになあ(第5図(1))。このため、
01級の7丁クシきり・リーダ01横−走査画b 20
48個の画素は、横−走査画11024個O画素に削減
畜れ、高分#i@フルド、ト廖OCRT表示器の画素に
適合したものとなる。これKよりて、す7レツシ、メモ
リ313のビデオ信号を表示器317に与え九とき、ド
*、メyトo像の全貌が縮小表示で暑る(第1 II
(b) )。ただし、この像は画素が削減されているの
で分解能が低下している。
他方のリフレ、シ、メ毫す314には、画素削減なしの
ビデオ信号が記憶され、これkよりて倍率10ドキ為メ
ン)會が記憶される(第S ml (#) ’)。
ビデオ信号が記憶され、これkよりて倍率10ドキ為メ
ン)會が記憶される(第S ml (#) ’)。
このため、リフレッシ1ノ4ν314の内容を表示器3
17に与えたとき、ド#、メント會の一部だけが拡大さ
れた形で映し出される(第1図(4))。こO像は、画
素が削減されていないのて、分解能はG肩7テタV々す
と岡じに維持される。
17に与えたとき、ド#、メント會の一部だけが拡大さ
れた形で映し出される(第1図(4))。こO像は、画
素が削減されていないのて、分解能はG肩7テタV々す
と岡じに維持される。
そこで、オペレータは、大小切換回路312を操作すみ
ととkよ)、分解能は低いがドキ、メyト像O食貌が見
える概観画面と、ド命九メyト像の一部しか見えfkい
が分解能が高い縮重画面とのどちらでも任意に選らんで
見ることがで龜る。どちら1)@@1)ビデオ儒4!も
それぞれリフレ、シ、メ峰讐に保持1れているので、両
画の切換えは高速に行える。縮重−爾は、命−ボード操
作によって、上下左IMKスタ闘−ルさせるととによ)
、ド命島メy)090所璽の部分を映し出すことができ
為。
ととkよ)、分解能は低いがドキ、メyト像O食貌が見
える概観画面と、ド命九メyト像の一部しか見えfkい
が分解能が高い縮重画面とのどちらでも任意に選らんで
見ることがで龜る。どちら1)@@1)ビデオ儒4!も
それぞれリフレ、シ、メ峰讐に保持1れているので、両
画の切換えは高速に行える。縮重−爾は、命−ボード操
作によって、上下左IMKスタ闘−ルさせるととによ)
、ド命島メy)090所璽の部分を映し出すことができ
為。
このように、本実−は、リフレッシ島メ毫りを28M設
け、一方のり7し、シメモリに社、表示器の画素数に会
わせて画素削減処理をしたビデオ信号を書込み、他方の
りフレッシュメモリには、そのよう龜処理をしないビデ
オ信号を書込み、これらり7しVシ、メモリの内容を、
オペソー夕の指定に応じて切換えて表示するようにした
。
け、一方のり7し、シメモリに社、表示器の画素数に会
わせて画素削減処理をしたビデオ信号を書込み、他方の
りフレッシュメモリには、そのよう龜処理をしないビデ
オ信号を書込み、これらり7しVシ、メモリの内容を、
オペソー夕の指定に応じて切換えて表示するようにした
。
この丸め、本実1!IIKよれば、ドキ島メ/トの一部
の縮重な映倫と、ドキュメントの全貌の概観的な映倫の
どちらでも表示できるグラフィVり・ディスプレイ装置
が実現できる0
の縮重な映倫と、ドキュメントの全貌の概観的な映倫の
どちらでも表示できるグラフィVり・ディスプレイ装置
が実現できる0
!s1図線、本発明の装置が組合わされるドキ。
メン)J6!Iシステムの概念的構成図、$IIf図は
、本発明実施例の概念的構成図、第1図は、動作説明図
、である。 31・・・グラフィ、り・ディスプレイ装置、311・
・・ラント冒−ツ、312・・・大小切換回路、313
.314・・・す7レツシΔメモリ、315・・・画素
削減WAll、316・・・パラレル/シリアル変換器
、317−・・表示器。
、本発明実施例の概念的構成図、第1図は、動作説明図
、である。 31・・・グラフィ、り・ディスプレイ装置、311・
・・ラント冒−ツ、312・・・大小切換回路、313
.314・・・す7レツシΔメモリ、315・・・画素
削減WAll、316・・・パラレル/シリアル変換器
、317−・・表示器。
Claims (1)
- ド命島メン)1軟轟珈Oビデオ信号の画素数よ)も少1
に一画素歇O表示器を有するフルドツト形のグラフィ、
り・ディスプレイ俟置でありて、ドキ1メント1軟轟)
Oビデオ償1を記憶する嬉10曹7しシシ、メ41と、
ドキュメント唱枚機)のビデオ儒4#O画素を表示器(
)IillK合わせて削減する画素削減mIIと、この
画素削減−路で画素が削減されえビデオ儒うを記憶する
第20リアレツジ畠メ峰すと、オペソー夕の操作に基づ
いてこれらシフしy V aメ峰すのいずれか一方OI
!出し内容の出力を可能にする大小切換囲路と、これら
97レツS’Sノ噌りOII出し内容を表示するフルド
ラ)MlO表示器とを具備するグラフィック・ディメグ
レ4義置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56117983A JPS5818681A (ja) | 1981-07-28 | 1981-07-28 | フルドット形グラフィック・ディスプレイ装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56117983A JPS5818681A (ja) | 1981-07-28 | 1981-07-28 | フルドット形グラフィック・ディスプレイ装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5818681A true JPS5818681A (ja) | 1983-02-03 |
JPS6151317B2 JPS6151317B2 (ja) | 1986-11-08 |
Family
ID=14725104
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP56117983A Granted JPS5818681A (ja) | 1981-07-28 | 1981-07-28 | フルドット形グラフィック・ディスプレイ装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5818681A (ja) |
-
1981
- 1981-07-28 JP JP56117983A patent/JPS5818681A/ja active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS6151317B2 (ja) | 1986-11-08 |
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