JPS58182388A - 競合防止方式 - Google Patents

競合防止方式

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Publication number
JPS58182388A
JPS58182388A JP6601882A JP6601882A JPS58182388A JP S58182388 A JPS58182388 A JP S58182388A JP 6601882 A JP6601882 A JP 6601882A JP 6601882 A JP6601882 A JP 6601882A JP S58182388 A JPS58182388 A JP S58182388A
Authority
JP
Japan
Prior art keywords
subscriber
signal
call
latency
circuit
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP6601882A
Other languages
English (en)
Inventor
Shinji Hayashi
林 進二
Tsuneo Taguchi
田口 恒雄
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP6601882A priority Critical patent/JPS58182388A/ja
Publication of JPS58182388A publication Critical patent/JPS58182388A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04QSELECTING
    • H04Q11/00Selecting arrangements for multiplex systems
    • H04Q11/04Selecting arrangements for multiplex systems for time-division multiplexing

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Exchange Systems With Centralized Control (AREA)
  • Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔技術分野の説明〕 本発明は、マルチプロセッサシステムの競合防止IIC
関する。
〔従来技術の説明〕
従来、この種の競合防止は信号を送信側へ返す方式が知
られている。しかし、この方式では送出側で信号を送出
した後返しの信号を受信するまでの関に別信号発生の可
能性が有る。また、信号を拾てる方式も知られている。
しかし、この方式では同期通信として送出側でタイギン
グ処理を必要とする欠点がある。
〔目的の説明〕
本発明はこの点を改良するもので、信号が処理可能にな
るまで待合せが可能となり、待合せ中にこの特定信号に
関係した他の信号を正しく処理することができる時分割
装置を提供することを目的とする。
〔発明の要旨〕
本発明は、マルチプロセッサシステムにおけるプロセッ
サ間通信において、通信受信側で受信した特定の処理が
できない時、信号に関係する装置の状態と、その信号名
を変えて待合わせ、他の信号の受信と処理を行いある程
度の時間経過後待合わせた信号を処理するように構成し
たことを特徴とする。
すなわち、本発明は、加入者回線の接続された多数の加
入者回路と、この加入者回路が接続された時分割交換回
路と、この時分割交換回路に接続された複数の数字受信
装置と、上記加入者回路および数字受信装置を制御する
インタフェースモジュールプロセッサと、上記時分割交
換回路を制御しこのインタフエースモジュー・ルプロセ
ッサト接続された基本モジュールプロセッサとを備え、
上記加入者回路の一つが発呼を検出したときその加入者
回路と上記数字受信装置の一つとを上記時分割交換回路
を介して結合するように構成された交換装置において、
上記基本モジュールプロセッサは、上記加入者回路の一
つが発呼を検出したとき上記複数の数字受信装置のいず
れにも空がないことが検出されると、その加入者回路を
9待状態として保留し周期的に数字受信装置の空を検出
し、空が検出されたときKその加入者回路とその数字受
信装置とを接続するように構成されたことを特徴とする
〔実施例による説明〕
本発明の一実施例を図面に基づいて説明する。
第1図は、本発明一実施例の要部ブロック構成図である
。電話加入者11〜1.は加入者回路2.〜2flにそ
れぞれ接続されている。この加入者回路2.〜2、は時
分割交換回路3に接続され【いる。この時分割交換回路
3には数字受信装置51〜5.がそれぞれ接続されてい
る。この加入者回路21〜2゜および数字受信装置5.
〜5.I Kはインタ7二−スモジエールプロセツサ6
、〜61がそれぞれ接続さ゛れズいる。また、上記時分
割交換回路3には基本モジュールプロセッサ7が接続さ
れている。
第2図は、上記実施例の動作を示すフローチャートであ
る。
このような回路構成で、電話加入者1.が発呼を行うと
、この発呼信号01’LGを加入者回路2mが検出する
。これをインタフェースモジュールプロセッサ61がノ
々ス8を介して基本モジュールプロセッサ7に送信する
。これにより、基本モジュールプロセッサ7は数字受信
装置5I〜5flの空きを検索し数字受信装置5.〜5
゜がすべて使用中であると判別すると、発呼信号ORG
を発呼待信号0RGWに変え発呼待キュー(周期的に実
行される)に接続する。この状態で、電話加入者11は
数字受信装置侍状1i(第2図、ORT空待)となる。
これにより、この後の電話加入者IIの信号(切断以外
)を拾てることか可能となり、異常動作(OFF−9o
ekサービスが0N−Hookサービスとして実行され
る)を防止できる。
発呼待キューの次の周期で発呼待信号0RGWは電話加
入者11が数字受信装置待状態にあり(切断により加入
者空ならば拾てられる)、数字受信装置5.〜511に
空ができ基本モジュールプロセッサ7がこれをハントす
れば数字受信中に入る。
〔効果の説明〕
以上説明したように本発萌によれば、プロセッサ間通信
の通信受信側で受信した特定の信号が処理できないとき
に信号に関係する装置の状態とその信号名を変えて待合
せ状態とし、時間経過後待合その信号を処理することと
した。したがって、信号が処理可能まで待合せが可能と
なり、しかも待合せ中の他の信号を正しく処理すること
ができる効果がある。
【図面の簡単な説明】 第1図は本発明一実施例の要部ブロック構成図。。 第2図は上記実施例の70−チャート。 1、〜1fi・・・電話加入者、2.〜20・・・加入
者回路、3−・・時分割交換回路、5.〜51・・・数
字受信装置、6、〜6.・−・4ンタフエースモジユー
ルプロセツサ、7・−S 本モジエールソr−セッサ 
B、−Aス。 ff12図

Claims (1)

    【特許請求の範囲】
  1. (1)  加入者回線の接続された多数の加入者回路と
    、この加入者回路が接続された時分割交換回路と、この
    時分割交換回路に接続された複数の数字受信装置と、上
    記加入者回路および数字受信装置を制御スるインタフェ
    ースモジュールプロセッサト、上記時分割交換回路を制
    御しこのインタフェースモジュールプロセッサと接続さ
    れた基本モジュールプロセッサとを備え、上記加入者回
    路の一つが発呼を検出したときその加入者回路と上記数
    字受信装置の一つとを上記時分割交換回路を介して結合
    するように構成された交換装置において、上記基本モジ
    エールプロセッサは、上記加入者回路の一つが発呼を検
    出したとき上記複数の数字受信装置のいずれにも空がな
    いことが検出されると、その加入者回路を9侍状態とし
    て保留し周期的に数字受信装置の空を検出し、空が検出
    されたときにその加入者回路とその数字受信装置とを接
    続するように構成されたことを特徴とする競合防止方式
JP6601882A 1982-04-19 1982-04-19 競合防止方式 Pending JPS58182388A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP6601882A JPS58182388A (ja) 1982-04-19 1982-04-19 競合防止方式

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP6601882A JPS58182388A (ja) 1982-04-19 1982-04-19 競合防止方式

Publications (1)

Publication Number Publication Date
JPS58182388A true JPS58182388A (ja) 1983-10-25

Family

ID=13303765

Family Applications (1)

Application Number Title Priority Date Filing Date
JP6601882A Pending JPS58182388A (ja) 1982-04-19 1982-04-19 競合防止方式

Country Status (1)

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JP (1) JPS58182388A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPWO2009020141A1 (ja) * 2007-08-08 2010-11-04 日本特殊陶業株式会社 スパークプラグおよびその製造方法

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPWO2009020141A1 (ja) * 2007-08-08 2010-11-04 日本特殊陶業株式会社 スパークプラグおよびその製造方法
US8476815B2 (en) 2007-08-08 2013-07-02 Ngk Spark Plug Co., Ltd. Spark plug and manufacturing method thereof

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