JPS62230251A - 共通線信号処理方式 - Google Patents
共通線信号処理方式Info
- Publication number
- JPS62230251A JPS62230251A JP7335686A JP7335686A JPS62230251A JP S62230251 A JPS62230251 A JP S62230251A JP 7335686 A JP7335686 A JP 7335686A JP 7335686 A JP7335686 A JP 7335686A JP S62230251 A JPS62230251 A JP S62230251A
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- JP
- Japan
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- common line
- line signal
- processor
- signal processing
- common
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Links
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
「産業上の利用分野」
この発明は交換局相互がディジタル伝送路により結合さ
れた交換網における交換局の選択信号、監視信号等の呼
制御情報を共通線にて伝送するための共通線信号処理方
式に関する。
れた交換網における交換局の選択信号、監視信号等の呼
制御情報を共通線にて伝送するための共通線信号処理方
式に関する。
「従来の技術」
第３図を参照して従来の共通線信号処理方式を説明する
。ネットワークＮＷに対局Ａ及びＢが２４チャンネルデ
イジタル伝送路及びディジタルトランク回路ＤＴＩを介
して収容され、シングルプロセッサーである共通制御装
置（ＣＰＵ）が交換機全体を制御している方式であり、
対局との接続に関する共通線の制御のために共通線信号
処理プロセッサー（Ｃ８Ｐ）と、信号メツセージ転送を
行・う信号リンク制御部（ＣＳＣ）とが設けられている
。また信号データリンクとしては対局とのインターフェ
ースであるディジタルトランク回路ＤＴＩの１チャンネ
ルが使用される。
。ネットワークＮＷに対局Ａ及びＢが２４チャンネルデ
イジタル伝送路及びディジタルトランク回路ＤＴＩを介
して収容され、シングルプロセッサーである共通制御装
置（ＣＰＵ）が交換機全体を制御している方式であり、
対局との接続に関する共通線の制御のために共通線信号
処理プロセッサー（Ｃ８Ｐ）と、信号メツセージ転送を
行・う信号リンク制御部（ＣＳＣ）とが設けられている
。また信号データリンクとしては対局とのインターフェ
ースであるディジタルトランク回路ＤＴＩの１チャンネ
ルが使用される。
「発明が解決しようとする問題点」
最近のＶＬＳＩ化技術により交換システム用のプロセッ
サーとして汎用マイクロコンピューターカ使用されてい
るが、これらマイクロコンピュータ−を使用して大容量
システムを実現させるためにはマルチプロセッサーシス
テムを構成する必要があり、マルチプロセッサーシステ
ムにおいて効率のよい共通線信号の処理方式を提供する
必要がある。
サーとして汎用マイクロコンピューターカ使用されてい
るが、これらマイクロコンピュータ−を使用して大容量
システムを実現させるためにはマルチプロセッサーシス
テムを構成する必要があり、マルチプロセッサーシステ
ムにおいて効率のよい共通線信号の処理方式を提供する
必要がある。
「問題点を解決するための手段」 −
この発明はプロセッサー間通信用の共通バスに対して、
ある一定量の加入者回路、トランク回路を収容し、前記
加入者回路、トランク回路の状態変化を検出する手段を
有し、回線規模に応じて増加させることができるローカ
ルプロセッサーと、そのローカルプロセッサーの状態変
化検出に伴い発生する処理要求に従って呼の分析処理及
び状態遷移処理を行い、トラフィック量に応じて増加さ
せることができるメインプロセッサーと、共通線信号処
理手段を有する共通線信号処理用プロセッサーとを接続
させ、前記共通線信号処理用プロセッサーに対し、共通
線用信号データリンクを介して対向局との間で信号メツ
セージ転送を行うための同期、誤り検出、再送機能を有
する共通線信号リンク制御回路を１つ：以上収容し、一
方交換機のスイッチネットワークに対して、対向局との
伝送路としてｎチャンネルの多重、分離機能を有し、任
意の１チャンネルに対局への送出情報を挿入し、対局か
らの受信情報を抽出する手段と、挿入、抽出情報の外部
送受信インターフェース手段とを有するディジタルトラ
ンク回路を複数収容し、前記共通線信号リンク制御回路
と前記ディジタルトランク回路内の外部インターフェー
ス手段とを接続し、信号処理する。
ある一定量の加入者回路、トランク回路を収容し、前記
加入者回路、トランク回路の状態変化を検出する手段を
有し、回線規模に応じて増加させることができるローカ
ルプロセッサーと、そのローカルプロセッサーの状態変
化検出に伴い発生する処理要求に従って呼の分析処理及
び状態遷移処理を行い、トラフィック量に応じて増加さ
せることができるメインプロセッサーと、共通線信号処
理手段を有する共通線信号処理用プロセッサーとを接続
させ、前記共通線信号処理用プロセッサーに対し、共通
線用信号データリンクを介して対向局との間で信号メツ
セージ転送を行うための同期、誤り検出、再送機能を有
する共通線信号リンク制御回路を１つ：以上収容し、一
方交換機のスイッチネットワークに対して、対向局との
伝送路としてｎチャンネルの多重、分離機能を有し、任
意の１チャンネルに対局への送出情報を挿入し、対局か
らの受信情報を抽出する手段と、挿入、抽出情報の外部
送受信インターフェース手段とを有するディジタルトラ
ンク回路を複数収容し、前記共通線信号リンク制御回路
と前記ディジタルトランク回路内の外部インターフェー
ス手段とを接続し、信号処理する。
「実施例」
以下この発明の実施例方式を図面に基づいて説明する。
第１図に示すブロック構成図はこの発明方式の実施例の
構成を示す。この実施例は電話装置を収容する加入者回
路ＬＣと、局線りを介して電話局とインターフェースす
る局線トランク回路ＣＯＴと、ディジタル伝送路を介し
て対局とインターフェースするディジタルトランク回路
ＤＴＩと、通話路系装置間の接続を行う３段構成のスイ
ッチ（１次及び３次用時分割スイッチＴＳＷ及び２次用
ハイウェイスイッチ）ＩＳＷ）と、これらの制御を行う
マルチプロセッサ一群ＬＰｉ、ＭＰｉ（ｉ＝ｏ、 １
）及びプロセッサーバス間通信の共通バスＢＵＳと、
そのプロセッサーバスインターフェース回路ＦＢＩとを
備える。
構成を示す。この実施例は電話装置を収容する加入者回
路ＬＣと、局線りを介して電話局とインターフェースす
る局線トランク回路ＣＯＴと、ディジタル伝送路を介し
て対局とインターフェースするディジタルトランク回路
ＤＴＩと、通話路系装置間の接続を行う３段構成のスイ
ッチ（１次及び３次用時分割スイッチＴＳＷ及び２次用
ハイウェイスイッチ）ＩＳＷ）と、これらの制御を行う
マルチプロセッサ一群ＬＰｉ、ＭＰｉ（ｉ＝ｏ、 １
）及びプロセッサーバス間通信の共通バスＢＵＳと、
そのプロセッサーバスインターフェース回路ＦＢＩとを
備える。
ローカルプロセッサーＬＰｉはある規定量の加入者回路
、トランク回路を収容し、その加入者回路及びトランク
回路の状態変化を検出し、その接続状態の移行を上位プ
ロセッサーに依頼するように構成されている。メインプ
ロセッサーＭＰｉはローカルプロセッサーＬＰｉに対す
る上位プロセッサーであり、ローカルプロセッサーＬＰ
ｉからの依頼に基づき呼の分析処理、状態遷移の一連の
シーケンシャル処理を行う、例えば発呼に行うダイヤル
トーン接続を行う。ローカルプロセッサーＬＰｉは回線
規模に応じて増加させられるものであり、同様にメイン
プロセッサーＭＰｉはトラフィック量に応じて増加させ
られる。共通線信号処理用プロセッサーＣ８Ｐは共通線
信号処理を行うことができ、共通線信号処理用プロセッ
サー〇ＳＰに対し、共通線用信号データリンクを介して
対向局との間で信号メツセージ転送を行うための同期、
誤り検出、再送を行うことができる共通線信号すンク制
御回路が１つ以上収容される。ディジタルトランク回路
ＤＴＩはｎチャンネルの多重、分離を行うことができ、
任意の１チャンネルは対局への送出情報を挿入し、対局
からの受信情報を抽出する手段と、その挿入、抽出情報
の外部送信インターフェース手段とを有する。そのディ
ジタルトランク回路ＤＴＩ内の外部インターフェース手
段は共通線信号リンク制御回路Ｃ８Ｃと接続されている
。
、トランク回路を収容し、その加入者回路及びトランク
回路の状態変化を検出し、その接続状態の移行を上位プ
ロセッサーに依頼するように構成されている。メインプ
ロセッサーＭＰｉはローカルプロセッサーＬＰｉに対す
る上位プロセッサーであり、ローカルプロセッサーＬＰ
ｉからの依頼に基づき呼の分析処理、状態遷移の一連の
シーケンシャル処理を行う、例えば発呼に行うダイヤル
トーン接続を行う。ローカルプロセッサーＬＰｉは回線
規模に応じて増加させられるものであり、同様にメイン
プロセッサーＭＰｉはトラフィック量に応じて増加させ
られる。共通線信号処理用プロセッサーＣ８Ｐは共通線
信号処理を行うことができ、共通線信号処理用プロセッ
サー〇ＳＰに対し、共通線用信号データリンクを介して
対向局との間で信号メツセージ転送を行うための同期、
誤り検出、再送を行うことができる共通線信号すンク制
御回路が１つ以上収容される。ディジタルトランク回路
ＤＴＩはｎチャンネルの多重、分離を行うことができ、
任意の１チャンネルは対局への送出情報を挿入し、対局
からの受信情報を抽出する手段と、その挿入、抽出情報
の外部送信インターフェース手段とを有する。そのディ
ジタルトランク回路ＤＴＩ内の外部インターフェース手
段は共通線信号リンク制御回路Ｃ８Ｃと接続されている
。
このシステムにおいては対向局Ａ、対向局Ｂとは中継線
を経由して接続されているが、この局間信号としてＣＣ
ＩＴＴ−５７の共通線信号方式が使われている。第１図
において伝送路としては２４チャンネルのディジタルト
ランク回路を使用し、その中の扁２３チャンネルを共通
線信号として割り当てている。
を経由して接続されているが、この局間信号としてＣＣ
ＩＴＴ−５７の共通線信号方式が使われている。第１図
において伝送路としては２４チャンネルのディジタルト
ランク回路を使用し、その中の扁２３チャンネルを共通
線信号として割り当てている。
ディジタルトランク回路ＤＴＩ内には対局との制御信号
を送受するための信号挿入、抽出回路（Ｄ／１．）があ
り、この回路Ｄ／Ｉ と共通線信号リンク制御回路Ｃ３
Ｃｊ （ｊ＝ｏ、 １．２）とが接続され、共通線信号
処理用プロセッサー〇ＳＰのもとに制御される。なお回
路Ｄ／’Ｉは共通線信号リンク回路Ｃ８Ｃとケーブルに
より接続されない時はその機能は除かれる回路構成とな
っている。
を送受するための信号挿入、抽出回路（Ｄ／１．）があ
り、この回路Ｄ／Ｉ と共通線信号リンク制御回路Ｃ３
Ｃｊ （ｊ＝ｏ、 １．２）とが接続され、共通線信号
処理用プロセッサー〇ＳＰのもとに制御される。なお回
路Ｄ／’Ｉは共通線信号リンク回路Ｃ８Ｃとケーブルに
より接続されない時はその機能は除かれる回路構成とな
っている。
第２図に対局Ａに発信した場合のダイヤグラムをポす。
加入者が発呼するとローカルプロセッサーＬＰが発呼検
出をし、メインプロセッサーＭＰにグイヤルトーン接続
要求を出す。メインプロセッサーＭＰはこの要求をもと
に空発信レジスタトランク回路ＯＲＴを捕捉し、発信者
にダイヤルトーンを接続させる。発信者がダイヤルを完
了するとローカルプロセッサーＬＰは数字情報とともに
メインプロセッサーＭＰに接続要求を送出するが、メイ
ンプロセッサーＭＰは数字分析後発信先が中継線であり
且つ共通線信号方式であると判断すると対局Ａへの空出
トランク回路ＯＧＴを捕掘し、共通線信号処理用プロセ
ッサーＣ８Ｐにダイヤル番号、捕捉量トランク回路ＯＧ
Ｔ等の情報を含ん ′だ接続依頼情報であるＩＡＭメ
ツセージを送るように依頼する。共通線信号処理用プロ
セッサーＣ８Ｐはこの情報をＣＣＩＴＴ−Ａ７の信号ユ
ニットに構成し、対向局Ａに割り当てられた共通線信号
リンク制御回路Ｃ８Ｃに送り、この信号はディジタルト
ランク回路ＤＴＩを経由して対局へ送られる。
出をし、メインプロセッサーＭＰにグイヤルトーン接続
要求を出す。メインプロセッサーＭＰはこの要求をもと
に空発信レジスタトランク回路ＯＲＴを捕捉し、発信者
にダイヤルトーンを接続させる。発信者がダイヤルを完
了するとローカルプロセッサーＬＰは数字情報とともに
メインプロセッサーＭＰに接続要求を送出するが、メイ
ンプロセッサーＭＰは数字分析後発信先が中継線であり
且つ共通線信号方式であると判断すると対局Ａへの空出
トランク回路ＯＧＴを捕掘し、共通線信号処理用プロセ
ッサーＣ８Ｐにダイヤル番号、捕捉量トランク回路ＯＧ
Ｔ等の情報を含ん ′だ接続依頼情報であるＩＡＭメ
ツセージを送るように依頼する。共通線信号処理用プロ
セッサーＣ８Ｐはこの情報をＣＣＩＴＴ−Ａ７の信号ユ
ニットに構成し、対向局Ａに割り当てられた共通線信号
リンク制御回路Ｃ８Ｃに送り、この信号はディジタルト
ランク回路ＤＴＩを経由して対局へ送られる。
対局ではこのＩＡＭメツセージ信号を受信することによ
り入トランク回路ＩＣＴを捕捉し、被呼加入者の空／話
中を調べ、空であれば被呼者を呼出すとともに入トラン
ク回路ＩＣＴＫ対し、ＲＢＴ（リングバックトーン）を
返送し、被呼加入者呼出し状態信号としてＡＣＭメツセ
ージを発信局へ送出する。
り入トランク回路ＩＣＴを捕捉し、被呼加入者の空／話
中を調べ、空であれば被呼者を呼出すとともに入トラン
ク回路ＩＣＴＫ対し、ＲＢＴ（リングバックトーン）を
返送し、被呼加入者呼出し状態信号としてＡＣＭメツセ
ージを発信局へ送出する。
発信局でこのＡＣＭメツセージは共通線信号リンク回路
Ｃ８Ｃにて受信され、共通線信号処理用プロセッサー〇
ＳＰへ転送される。共通線信号処理用プロセッサーＣ８
Ｐにおいてはこの情報をメインプロセッサーＭＰへ送る
こととなるが、この情報はあたかも発信トランクが収容
されるローカルプロセッサーＬＰから送出されて来る要
求と同等の処理構造となっている。
Ｃ８Ｃにて受信され、共通線信号処理用プロセッサー〇
ＳＰへ転送される。共通線信号処理用プロセッサーＣ８
Ｐにおいてはこの情報をメインプロセッサーＭＰへ送る
こととなるが、この情報はあたかも発信トランクが収容
されるローカルプロセッサーＬＰから送出されて来る要
求と同等の処理構造となっている。
さらに対局にて被呼者が応答した時は応答信号としてＡ
、ＮＣメツセージを受信するが、これもＡＣＭメツセー
ジと同等のシーケンスにより処理される。
、ＮＣメツセージを受信するが、これもＡＣＭメツセー
ジと同等のシーケンスにより処理される。
即チこのマルチプロセッサーシステムにおケル共通線信
号処理用プロセッサーＣ８Ｐの処理は負荷分散されたロ
ーカルプロセッサーＬＰに対して擬似的に代行処理をす
るように構成されている。
号処理用プロセッサーＣ８Ｐの処理は負荷分散されたロ
ーカルプロセッサーＬＰに対して擬似的に代行処理をす
るように構成されている。
「発明の効果」
以上説明したようにこの発明は個別信号線、共通信号線
にかかわらず同一な交換処理を行えるようなマルチプロ
セッサーの階層構成となっており、効率よい交換システ
ムを構築できる。
にかかわらず同一な交換処理を行えるようなマルチプロ
セッサーの階層構成となっており、効率よい交換システ
ムを構築できる。
第１図はこの発明方式の実施例を示すブロック図、第２
図はこの実施例における共通線信号の流れ図、第３図は
従来方式を示すブロック図である。 ＬＰ、ローカルプロセッサー、ＭＰ：メインプロセッサ
ー、ＦＢＩニア’ロセッサーバスインターフェース、置
：電話機、ＬＣニライン回路、ＣＯＴ ：局線トラン
ク回路、ＯＲＴ：発信レジスタトランク回路、Ｄ’ｒＩ
：ディジクルトランク回路、ＴＳＷ：時分割スイッチ、
Ｈ８Ｗ：ハイウェイスイッチ、Ｈ８ＷＣ：ハイウェイス
イッチ制御部、ＤＭ：データメモリ、Ｌ：局線ライン、
Ｃ８Ｐ ：共通線信号処理用プロセッサー、Ｃ８Ｃ：共
通線信号リンク制御回路、ＭＭ：メインメモリ、ＳＰＣ
：通話路制御部、ＮＷ°ネ・リワーク、ＣＰ、Ｕ ：中
央制御装置、ＢＵＳ ：共通バス。
図はこの実施例における共通線信号の流れ図、第３図は
従来方式を示すブロック図である。 ＬＰ、ローカルプロセッサー、ＭＰ：メインプロセッサ
ー、ＦＢＩニア’ロセッサーバスインターフェース、置
：電話機、ＬＣニライン回路、ＣＯＴ ：局線トラン
ク回路、ＯＲＴ：発信レジスタトランク回路、Ｄ’ｒＩ
：ディジクルトランク回路、ＴＳＷ：時分割スイッチ、
Ｈ８Ｗ：ハイウェイスイッチ、Ｈ８ＷＣ：ハイウェイス
イッチ制御部、ＤＭ：データメモリ、Ｌ：局線ライン、
Ｃ８Ｐ ：共通線信号処理用プロセッサー、Ｃ８Ｃ：共
通線信号リンク制御回路、ＭＭ：メインメモリ、ＳＰＣ
：通話路制御部、ＮＷ°ネ・リワーク、ＣＰ、Ｕ ：中
央制御装置、ＢＵＳ ：共通バス。
Claims (1)
- （１）マルチプロセッサーシステムの電話交換機がディ
ジタル伝送路により結合された局間の共通線信号処理方
式において、 プロセッサー間通信用の共通バスに対して、ある規定量
の加入者回路、トランク回路を収容し、これら加入者回
路、トランク回路の状態変化を検出することができ、回
線規模に応じて増加させられるローカルプロセッサーと
、 そのローカルプロセッサーの状態変化検出に伴い発生す
る処理要求に従って呼の分析処理及び状態遷移処理を行
い、トラフィック量に応じて増加させられるメインプロ
セッサーと、 共通線信号処理機能を有する共通線信号処理用プロセッ
サーとが接続され、 前記共通線信号処理用プロセッサーに対し、共通線用信
号データリンクを介して対向局との間で信号メッセージ
転送を行うための同期、誤り検出再送を行うことができ
る共通線信号リンク制御回路が１つ以上収容され、 交換機のスイッチネットワークに対して、対向局との伝
送路としてｎチャンネルの多重、分離を行うことができ
、任意の１チャンネルに対局への送出情報を挿入し、対
局からの受信情報を抽出する手段と、その挿入、抽出情
報の外部送受信インターフェース手段とを有するディジ
タルトランク回路が複数収容され、 前記共通線信号リンク制御回路と前記ディジタルトラン
ク回路内の外部インターフェース手段とを接続し、信号
処理をすることを特徴とする共通線信号処理方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7335686A JPS62230251A (ja) | 1986-03-31 | 1986-03-31 | 共通線信号処理方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7335686A JPS62230251A (ja) | 1986-03-31 | 1986-03-31 | 共通線信号処理方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62230251A true JPS62230251A (ja) | 1987-10-08 |
Family
ID=13515802
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7335686A Pending JPS62230251A (ja) | 1986-03-31 | 1986-03-31 | 共通線信号処理方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62230251A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH10210156A (ja) * | 1997-01-24 | 1998-08-07 | Nec Corp | 分散ノード交換ネットワークの呼制御方法、分散ノード 交換機及び分散ノード交換ネットワーク |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60232762A (ja) * | 1984-05-02 | 1985-11-19 | Nec Corp | 共通線信号リンク制御方法 |
-
1986
- 1986-03-31 JP JP7335686A patent/JPS62230251A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60232762A (ja) * | 1984-05-02 | 1985-11-19 | Nec Corp | 共通線信号リンク制御方法 |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH10210156A (ja) * | 1997-01-24 | 1998-08-07 | Nec Corp | 分散ノード交換ネットワークの呼制御方法、分散ノード 交換機及び分散ノード交換ネットワーク |
| US6507580B1 (en) | 1997-01-24 | 2003-01-14 | Nec Corporation | Method of controlling a calling in distributed node exchange network, distributed node exchange and distributed node exchange network |
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