JPS58165109A - シ−ケンス図面作成装置 - Google Patents
シ−ケンス図面作成装置Info
- Publication number
- JPS58165109A JPS58165109A JP4787182A JP4787182A JPS58165109A JP S58165109 A JPS58165109 A JP S58165109A JP 4787182 A JP4787182 A JP 4787182A JP 4787182 A JP4787182 A JP 4787182A JP S58165109 A JPS58165109 A JP S58165109A
- Authority
- JP
- Japan
- Prior art keywords
- circuit diagram
- information
- storage device
- sequence control
- input
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B19/00—Programme-control systems
- G05B19/02—Programme-control systems electric
- G05B19/04—Programme control other than numerical control, i.e. in sequence controllers or logic controllers
- G05B19/10—Programme control other than numerical control, i.e. in sequence controllers or logic controllers using selector switches
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Automation & Control Theory (AREA)
- Numerical Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はシーケンス図面作成装置、ｌｌ１Ｋプログラマ
フルコントローラ用のシーケンス制御回路図を作成する
装置に関するものである。
フルコントローラ用のシーケンス制御回路図を作成する
装置に関するものである。
従来、この種装置として第１図に示すものが提案されて
いる。即ち、１１）はグログ２マブルコントロー５本体
りるいはそのコントローラのプログラムメモリ内容を記
憶できるグログラム入出力周辺装置、１２は周辺装置ｌ
ｏのインター７エイスユニツト１４を介して得られる信
号を処理するコンピュータ、１６はコンピュータ１２の
出方を作図するｌリンク、ｉｌｌ、２０＃ｉ接続ケーブ
ルである。
いる。即ち、１１）はグログ２マブルコントロー５本体
りるいはそのコントローラのプログラムメモリ内容を記
憶できるグログラム入出力周辺装置、１２は周辺装置ｌ
ｏのインター７エイスユニツト１４を介して得られる信
号を処理するコンピュータ、１６はコンピュータ１２の
出方を作図するｌリンク、ｉｌｌ、２０＃ｉ接続ケーブ
ルである。
以上の従来装置の動作を説明すると、コントローラ本体
１０のプログラムメモリ内容をコンピュータ１３に送る
と共に該コンピュータ１２にキーが一ドによって前記プ
ログラムメモリ内容に含まれていない情報例えばコント
ローラの人出方部に関する情報、各接点、コイルの役割
に関する情報等を入力するととｋよ）、両者をコンビ二
−タ１２内で結合処理して例えば第２図ム、Ｂ及びＣ第
３図ム、Ｂ及びＯ［示すようなコントロー５１゜の各接
点、コイルの役割等を付加したコントローラ１０の内部
回路図、コントローラ１ｏの入力接点と外部機器との接
続を示す入力回路図及びコンドロー２１０の出力コイル
と外部機器との接続を示す出力回路図等の画像情報を作
成し、これらを７” リフタ１６で図形化する。なお、
作成された画像情報はコンピューター２内の記憶装置に
記憶される。
１０のプログラムメモリ内容をコンピュータ１３に送る
と共に該コンピュータ１２にキーが一ドによって前記プ
ログラムメモリ内容に含まれていない情報例えばコント
ローラの人出方部に関する情報、各接点、コイルの役割
に関する情報等を入力するととｋよ）、両者をコンビ二
−タ１２内で結合処理して例えば第２図ム、Ｂ及びＣ第
３図ム、Ｂ及びＯ［示すようなコントロー５１゜の各接
点、コイルの役割等を付加したコントローラ１０の内部
回路図、コントローラ１ｏの入力接点と外部機器との接
続を示す入力回路図及びコンドロー２１０の出力コイル
と外部機器との接続を示す出力回路図等の画像情報を作
成し、これらを７” リフタ１６で図形化する。なお、
作成された画像情報はコンピューター２内の記憶装置に
記憶される。
以上の従来装置においては、単にコンピューター２の記
憶装置に第２図及び第３図に示す複数のシーケンス制御
回路を表わす画像情報を記憶させる機能を有するだけで
あり、記憶され九複数の画像情報を結合、編集して新九
な画像情報を作成することができない欠点を有してい丸
。即ち第８図及び第３図に示すシーケンス制御回路を結
合、編□ 集して第４図に示すシークてス制御回路を作成するには
、第４図の回路Ｋ１１ｔ′る情報を全てキーＩぐ゛ 一ドによってコンビエータ１２に入力してその人、・［
： 力情報を演算し直さなければならないものであった。
、］′・、１．。
憶装置に第２図及び第３図に示す複数のシーケンス制御
回路を表わす画像情報を記憶させる機能を有するだけで
あり、記憶され九複数の画像情報を結合、編集して新九
な画像情報を作成することができない欠点を有してい丸
。即ち第８図及び第３図に示すシーケンス制御回路を結
合、編□ 集して第４図に示すシークてス制御回路を作成するには
、第４図の回路Ｋ１１ｔ′る情報を全てキーＩぐ゛ 一ドによってコンビエータ１２に入力してその人、・［
： 力情報を演算し直さなければならないものであった。
、］′・、１．。
本発明は前述した従来の課題に鑑み為されたものであり
、その目的祉コンピュータの記憶装置に記憶された複数
のシーケンス制御回路を表わす画像情報を利用してそれ
らを演算することによって、直接各シーケンス制御回路
を結合、編集した新たなシーケンス制御回路図を作成し
得るシーケンス図面作成装置を提供することにある・ 上記目的を達成するために、本発明は、プログラマフル
コントローラのプログラムメモリ内容を図形化して作図
する図面作成装置において、既成のシーケンス制御回路
を表わす画像情報を複数種記憶し得る記憶装置、入力キ
ーが一ド、図形表示部及びそれらの制御部を有するコン
ピュータと、該コンビエータの出力を作図処理するプリ
ンタとから構成され、上記記憶装置に記憶されたシーケ
ンス制御回路を―わす複数の画像情報を編集して新丸な
シーケンス制御回路図を作成するようＫしたことを特徴
とする。
、その目的祉コンピュータの記憶装置に記憶された複数
のシーケンス制御回路を表わす画像情報を利用してそれ
らを演算することによって、直接各シーケンス制御回路
を結合、編集した新たなシーケンス制御回路図を作成し
得るシーケンス図面作成装置を提供することにある・ 上記目的を達成するために、本発明は、プログラマフル
コントローラのプログラムメモリ内容を図形化して作図
する図面作成装置において、既成のシーケンス制御回路
を表わす画像情報を複数種記憶し得る記憶装置、入力キ
ーが一ド、図形表示部及びそれらの制御部を有するコン
ピュータと、該コンビエータの出力を作図処理するプリ
ンタとから構成され、上記記憶装置に記憶されたシーケ
ンス制御回路を―わす複数の画像情報を編集して新丸な
シーケンス制御回路図を作成するようＫしたことを特徴
とする。
□、：！□
以下、図面に基づいて本発明の好適な実施例を、１）、
。
。
説明する。 ・。
本発明においては、第Ｓ図に示すようにコンピュータ１
２がシーケンス制御回路を表わす複数の画像情報を記憶
する記憶装置２２、入カキ−が一ド２４、表示部２６、
制御部２８を有し、記憶装置２２に記憶されているシー
ケンス制御回路を表わす複数の画像情報中の任意の回路
の任意部分同志を結合する情報及びその際に修正する入
出力記号情報等をキーが−ド２４で入力することにより
、それらの情報に基づき演算処理を行な一入出力記号を
修正すると共に複数のシーケンス制御回路を結合した内
部回路図、この内部回路図に対応する入出力回路図等を
作成し得るように構成されている。
２がシーケンス制御回路を表わす複数の画像情報を記憶
する記憶装置２２、入カキ−が一ド２４、表示部２６、
制御部２８を有し、記憶装置２２に記憶されているシー
ケンス制御回路を表わす複数の画像情報中の任意の回路
の任意部分同志を結合する情報及びその際に修正する入
出力記号情報等をキーが−ド２４で入力することにより
、それらの情報に基づき演算処理を行な一入出力記号を
修正すると共に複数のシーケンス制御回路を結合した内
部回路図、この内部回路図に対応する入出力回路図等を
作成し得るように構成されている。
次に以上の本発明装置の動作を説明する。例えば、記憶
装置２２に第２図及び第３図に示すシーケンス制御回路
を表わす画像情報が記憶されているものとして、これら
を元にして第４図に示す新たなシーケンス制御回路を編
集作成する場合には、先ず第２図ムの内部回路図の上２
段の部分と第３図ムの内部回路の２段目以降の部分とを
結合する結合情報、第３図のＹＢ１１．Ｙ３雪 Ｏ記号
をＹ１２゜Ｙ１３［修正する修正情報及び第２図の記号
Ｍ２をＭ５に修正する修正情報勢をキー＆−１’２４で
入力する。
装置２２に第２図及び第３図に示すシーケンス制御回路
を表わす画像情報が記憶されているものとして、これら
を元にして第４図に示す新たなシーケンス制御回路を編
集作成する場合には、先ず第２図ムの内部回路図の上２
段の部分と第３図ムの内部回路の２段目以降の部分とを
結合する結合情報、第３図のＹＢ１１．Ｙ３雪 Ｏ記号
をＹ１２゜Ｙ１３［修正する修正情報及び第２図の記号
Ｍ２をＭ５に修正する修正情報勢をキー＆−１’２４で
入力する。
この入力情報に基づき演算処理が実行され、第５図ムに
示す内部回路図が作成され、この内部回路の結合、編集
に応じて第２図Ｂに示す入力回路図のｘ（１，ｚｌと第
３図Ｂに示す入力回路図の１２１％Ｘ２２とを結合した
第５図Ｂに示す入力回路図が作成されると共に第２図Ｃ
に示す出力回路図のＹＩＯ％Ｙｌｌと第３図ＯＫ示す出
力回路図のＹＢ２、ＹＢ２、をＹ１２、Ｙ１３に修正し
たものとを結合した第５図ＯＫ示す出力回路図が作成さ
れる。
示す内部回路図が作成され、この内部回路の結合、編集
に応じて第２図Ｂに示す入力回路図のｘ（１，ｚｌと第
３図Ｂに示す入力回路図の１２１％Ｘ２２とを結合した
第５図Ｂに示す入力回路図が作成されると共に第２図Ｃ
に示す出力回路図のＹＩＯ％Ｙｌｌと第３図ＯＫ示す出
力回路図のＹＢ２、ＹＢ２、をＹ１２、Ｙ１３に修正し
たものとを結合した第５図ＯＫ示す出力回路図が作成さ
れる。
又このようにした結合、編集され九新たなシーケンス制
御回路図が！リンク１６で図形化し得ると共に記憶装置
２２に記憶し得る。
御回路図が！リンク１６で図形化し得ると共に記憶装置
２２に記憶し得る。
以上のように本発明和よれば、記憶装置に記憶された既
成のシーケンス制御回路を表わす複数の画像情報に基づ
門それらを結合、編集して新たなシーケンス制御回路を
表わす画像情報を結合情報、修正情報等を入力するだ叶
で容易に作成することができる優れた効果を有する。
成のシーケンス制御回路を表わす複数の画像情報に基づ
門それらを結合、編集して新たなシーケンス制御回路を
表わす画像情報を結合情報、修正情報等を入力するだ叶
で容易に作成することができる優れた効果を有する。
第１図は従来装置の概略構成図、第２図ム、Ｂ及びＣ１
第３図ム、Ｂ及びＣは従来装置による作図例を示す図、
第４図４．Ｂ及びＣは本発明によって結合された作図例
を示す図、第５図は本発明の実施例を示す構成図である
１゜ 各図中同一部材には同一符号を付し、１Ｇはゾロクラマ
プルコントローｙ本体、ｘｚはコンピュータ、１６はプ
リンタ、２２は記憶装置、２４はキーが−ド、２６は表
示部、２８は制御部である１代理人 弁理士 葛 野
信 − （ほか１名） 第１図 第２図Ａ 第２図Ｂ 第３図Ａ 第３図Ｂ し 第４図Ａ 第４図Ｂ 第５図 手続補正書 （自発） 特許庁長官殿 １、事件。表示 特願昭 ５７−０４７８７１号
２、発明の名称 シーケンス図面作成装置３、補正をす
る者 特許請求の範囲 （１）プログラマブルコントローラのプログラムメモリ
内容を図形化して作図する図面作成装置において、既成
のシーケンス制御回路を表わす画像情報を複数種記憶し
得る記憶装置、入力キーボード、図形表示部及びそれら
の制御部を有するコンピュータと、該コンピュータの出
力を作図処理すれ、上記記憶装置に記憶されたシーケン
ス制御回路を表わす複数の画像情報を編集して新たなシ
ーケンス制御回路図を作成するようにしたことを特徴と
するシーケンス図面作成装置。
第３図ム、Ｂ及びＣは従来装置による作図例を示す図、
第４図４．Ｂ及びＣは本発明によって結合された作図例
を示す図、第５図は本発明の実施例を示す構成図である
１゜ 各図中同一部材には同一符号を付し、１Ｇはゾロクラマ
プルコントローｙ本体、ｘｚはコンピュータ、１６はプ
リンタ、２２は記憶装置、２４はキーが−ド、２６は表
示部、２８は制御部である１代理人 弁理士 葛 野
信 − （ほか１名） 第１図 第２図Ａ 第２図Ｂ 第３図Ａ 第３図Ｂ し 第４図Ａ 第４図Ｂ 第５図 手続補正書 （自発） 特許庁長官殿 １、事件。表示 特願昭 ５７−０４７８７１号
２、発明の名称 シーケンス図面作成装置３、補正をす
る者 特許請求の範囲 （１）プログラマブルコントローラのプログラムメモリ
内容を図形化して作図する図面作成装置において、既成
のシーケンス制御回路を表わす画像情報を複数種記憶し
得る記憶装置、入力キーボード、図形表示部及びそれら
の制御部を有するコンピュータと、該コンピュータの出
力を作図処理すれ、上記記憶装置に記憶されたシーケン
ス制御回路を表わす複数の画像情報を編集して新たなシ
ーケンス制御回路図を作成するようにしたことを特徴と
するシーケンス図面作成装置。
Claims (1)
- （１） ！ログラマプルコントローラのプログラムメ
モリ内容を図形化して作図する図面作成装置において、
既成のシーケンス制御回路を表わす画像情報を複数種記
憶し得る記憶装置、入カキ−が一ド、図形表示部及びそ
れらの制御部を有するコンビ二一タと、該コンピュータ
の出力を作図処理するブリンクとから構成され、上記記
憶装置に記憶されたシーケンス制御回路を表わす複数の
画像情報を編集して新たなシーケンス制御回路図を作成
するようＫしたことを特徴とするシーケンス図面作成装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4787182A JPS58165109A (ja) | 1982-03-25 | 1982-03-25 | シ−ケンス図面作成装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4787182A JPS58165109A (ja) | 1982-03-25 | 1982-03-25 | シ−ケンス図面作成装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58165109A true JPS58165109A (ja) | 1983-09-30 |
Family
ID=12787439
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4787182A Pending JPS58165109A (ja) | 1982-03-25 | 1982-03-25 | シ−ケンス図面作成装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58165109A (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61155901U (ja) * | 1985-03-15 | 1986-09-27 | ||
| JPS62202202A (ja) * | 1986-03-03 | 1987-09-05 | Hitachi Ltd | シ−ケンス制御プログラム作成装置 |
| JPH01273104A (ja) * | 1988-04-25 | 1989-11-01 | Mitsubishi Electric Corp | デイジタル制御機器用プログラミング装置 |
| WO1990008988A1 (en) * | 1989-01-25 | 1990-08-09 | Hitachi, Ltd. | Method and apparatus for automatically generating control program for computer controlled systems |
| WO1994006065A1 (fr) * | 1992-09-10 | 1994-03-17 | Fanuc Ltd | Systeme d'edition pour programme sequentiel |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5750008A (en) * | 1980-09-08 | 1982-03-24 | Hitachi Ltd | Sequence generator |
-
1982
- 1982-03-25 JP JP4787182A patent/JPS58165109A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5750008A (en) * | 1980-09-08 | 1982-03-24 | Hitachi Ltd | Sequence generator |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61155901U (ja) * | 1985-03-15 | 1986-09-27 | ||
| JPS62202202A (ja) * | 1986-03-03 | 1987-09-05 | Hitachi Ltd | シ−ケンス制御プログラム作成装置 |
| JPH01273104A (ja) * | 1988-04-25 | 1989-11-01 | Mitsubishi Electric Corp | デイジタル制御機器用プログラミング装置 |
| WO1990008988A1 (en) * | 1989-01-25 | 1990-08-09 | Hitachi, Ltd. | Method and apparatus for automatically generating control program for computer controlled systems |
| US6334076B1 (en) | 1989-01-25 | 2001-12-25 | Hitachi, Ltd. | Method of and apparatus for automatically generating control programs for computer controlled systems |
| WO1994006065A1 (fr) * | 1992-09-10 | 1994-03-17 | Fanuc Ltd | Systeme d'edition pour programme sequentiel |
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