JPS58155461A - マイクロコンピユ−タの異常処理機構 - Google Patents
マイクロコンピユ−タの異常処理機構Info
- Publication number
- JPS58155461A JPS58155461A JP57038778A JP3877882A JPS58155461A JP S58155461 A JPS58155461 A JP S58155461A JP 57038778 A JP57038778 A JP 57038778A JP 3877882 A JP3877882 A JP 3877882A JP S58155461 A JPS58155461 A JP S58155461A
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- JP
- Japan
- Prior art keywords
- output
- microcomputer
- relay
- oscillator
- controlled
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/0703—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
- G06F11/0706—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation the processing taking place on a specific hardware platform or in a specific software environment
- G06F11/0721—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation the processing taking place on a specific hardware platform or in a specific software environment within a central processing unit [CPU]
-
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- General Physics & Mathematics (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は機器を制御するマイクロコンピュータの異常時
に該機器の不具合な動作を防止する機構に関する。
に該機器の不具合な動作を防止する機構に関する。
マイクロコンピュータは半導体からなる構成体であるた
め故障しやすく、然も万一故障した場合では制御される
機器が不具合な動作する不都合がある。
め故障しやすく、然も万一故障した場合では制御される
機器が不具合な動作する不都合がある。
本発明は上記の点に鑑みて為されたもので、異’１時に
マイクロコンピュータの出力ポートがすべて同一の出力
状態となる特性を利用し、異常時での出力ポートの信号
によりマイクロコンピュータの出力管制御される機器か
ら遮断するスイッチング素子を設けることにより、上記
従来の不都合を解消するものである。
マイクロコンピュータの出力ポートがすべて同一の出力
状態となる特性を利用し、異常時での出力ポートの信号
によりマイクロコンピュータの出力管制御される機器か
ら遮断するスイッチング素子を設けることにより、上記
従来の不都合を解消するものである。
以下本発明の１実施例を石油ストーブの制御にマイクロ
コンピュータを用いた場合を示す図に基づいて説明する
。図において、１は石油ストーブ等による暖房の状態を
検出するセンサ、２はセンサ１による暖房状態に応じて
所望暖房に必要な各種の条件を算出するマイクロコンピ
ュータで、複数の出カポ−）ａ、ｂ、ｃを有し後述する
発振器４の異常時或いはマイクロコンピュータに内蔵す
れ九発振器部等の異常時に同一なあるレベルの出力状態
となる。３はマイクロコンピュータ２を動作開始させる
操作キー、４はマイクロコンピュータ２に時間データを
入力する発振器、５はマイクロコンピュータ２の出力ポ
ートｂに接続されたリレー駆動回路、６はリレー駆動回
路５を介して出カポ−）ｂの信号により制御される機器
としてのリレー、１はマイクロコンピュータ２の出力ポ
ートｃに接続された表示駆動回路、８は表示駆動回路Ｔ
を介して出力ポートｃの信号により制御される機器とし
て暖房状態等を表示する表示部、Ｓはマイクロコンピュ
ータ２の出カポ−）ａに接続され九インバータで、発振
器４或いはマイクロコンピュータ２に内蔵された発振器
部等が正常な場合での出力ボート龜の零出力を高出力に
変換して正常な時では後述する自己保持リレー１０をオ
ン状態に保持する一方、前記発振器４或いは発振器部等
が異常な場合では出力ポートａのあるレベルの出力を零
出力に変換して異常な時では自己保持リレー１０をオフ
状態にする。１０はインバータ９を介して出カポ−）ａ
の信号により制御される自己保持リレーで、オフとなる
とすべての電源を遮断し−１オフとなると別に設けたス
イッチを投入するまではオフ状態を維持し前記インバー
タＳと制御される機器から遮断するスイッチング素子と
して作用する。
コンピュータを用いた場合を示す図に基づいて説明する
。図において、１は石油ストーブ等による暖房の状態を
検出するセンサ、２はセンサ１による暖房状態に応じて
所望暖房に必要な各種の条件を算出するマイクロコンピ
ュータで、複数の出カポ−）ａ、ｂ、ｃを有し後述する
発振器４の異常時或いはマイクロコンピュータに内蔵す
れ九発振器部等の異常時に同一なあるレベルの出力状態
となる。３はマイクロコンピュータ２を動作開始させる
操作キー、４はマイクロコンピュータ２に時間データを
入力する発振器、５はマイクロコンピュータ２の出力ポ
ートｂに接続されたリレー駆動回路、６はリレー駆動回
路５を介して出カポ−）ｂの信号により制御される機器
としてのリレー、１はマイクロコンピュータ２の出力ポ
ートｃに接続された表示駆動回路、８は表示駆動回路Ｔ
を介して出力ポートｃの信号により制御される機器とし
て暖房状態等を表示する表示部、Ｓはマイクロコンピュ
ータ２の出カポ−）ａに接続され九インバータで、発振
器４或いはマイクロコンピュータ２に内蔵された発振器
部等が正常な場合での出力ボート龜の零出力を高出力に
変換して正常な時では後述する自己保持リレー１０をオ
ン状態に保持する一方、前記発振器４或いは発振器部等
が異常な場合では出力ポートａのあるレベルの出力を零
出力に変換して異常な時では自己保持リレー１０をオフ
状態にする。１０はインバータ９を介して出カポ−）ａ
の信号により制御される自己保持リレーで、オフとなる
とすべての電源を遮断し−１オフとなると別に設けたス
イッチを投入するまではオフ状態を維持し前記インバー
タＳと制御される機器から遮断するスイッチング素子と
して作用する。
かかる構成では、発振器４或いはマイクロコンピュータ
２内の発振器部等が正常であればマイクロコンピュータ
２は出力ポートａを零出力とする一方、センサ１による
暖房状１１に応じて得られた各種の信号を出カポ−）ｂ
、ｃに夫々出力する。
２内の発振器部等が正常であればマイクロコンピュータ
２は出力ポートａを零出力とする一方、センサ１による
暖房状１１に応じて得られた各種の信号を出カポ−）ｂ
、ｃに夫々出力する。
この時では出力ポートａの零出力はインバータ９により
高出力に変換され自己保持リレー１０をオン状態に維持
するのでリレー６並びに表示部８の制御が可能となる。
高出力に変換され自己保持リレー１０をオン状態に維持
するのでリレー６並びに表示部８の制御が可能となる。
一方、発振器４或いはマイクロコンピュータ２内の発振
器部等が異常であれば、マイクロコンピュータ２の出カ
ポ−）ａ、ｂ、ｃがあるレベルの出力となシリレー駆動
回路５並びに表示駆動回路７を介してリレー６及び表示
部８を動作させようとするがインバータ９により自己保
持リレー１０がオフとなるのでマイクロコンピュータ２
の電源を含め九すべての電源が遮断され、リレー６遊び
に表示部Ｓが作動不能となる。従って、石油ストーブの
電源が遮断され、石油ストーブの不具合な動作を防止で
きる。
器部等が異常であれば、マイクロコンピュータ２の出カ
ポ−）ａ、ｂ、ｃがあるレベルの出力となシリレー駆動
回路５並びに表示駆動回路７を介してリレー６及び表示
部８を動作させようとするがインバータ９により自己保
持リレー１０がオフとなるのでマイクロコンピュータ２
の電源を含め九すべての電源が遮断され、リレー６遊び
に表示部Ｓが作動不能となる。従って、石油ストーブの
電源が遮断され、石油ストーブの不具合な動作を防止で
きる。
尚、上記実施例では異常時でのマイクロコンピュータの
出力ポートのすべてが同一のあるレベルの出力状態とカ
る特性のものとしたが、出力ポートのすべてが零出力と
なる特性のものにも本発明が適用できること明らかであ
シ、この時では正常時での出力ポートを高レベルに保持
させるようにするとともに零出力でオン状態になる一方
高出力でオフ状態となるスイッチング素子を設ければ良
い。
出力ポートのすべてが同一のあるレベルの出力状態とカ
る特性のものとしたが、出力ポートのすべてが零出力と
なる特性のものにも本発明が適用できること明らかであ
シ、この時では正常時での出力ポートを高レベルに保持
させるようにするとともに零出力でオン状態になる一方
高出力でオフ状態となるスイッチング素子を設ければ良
い。
以上説明し友ように本発明によれば異常時にマイクロコ
ンピュータの出力ポートがすべて同一の出力状態となる
特性を利用し、異常時での出カポ−Ｆの信号によりマイ
クロコンピュータの出力を制御される機器から遮断する
スイッチング素子を設けたので、異常時での前記機器の
不具合な動作を防止でき、ひいては前記機器の暴走を防
止でき安全性が向上する。
ンピュータの出力ポートがすべて同一の出力状態となる
特性を利用し、異常時での出カポ−Ｆの信号によりマイ
クロコンピュータの出力を制御される機器から遮断する
スイッチング素子を設けたので、異常時での前記機器の
不具合な動作を防止でき、ひいては前記機器の暴走を防
止でき安全性が向上する。
図は本発明の１実施例である、石油ストーブにマイクロ
コンピュータを適用した時での異常処理機構を含めた制
御ブロック図である。 ２・・・マイクロコンピュータ ４・・・発振器５・
・・リレー駆動回路 ６・・・リレー ７・・・表
示駆動回路 ８・・・表示部 ９・・・インバータ
１０・・・自己保持リレー 代理人葛野信−（１１か１名）
コンピュータを適用した時での異常処理機構を含めた制
御ブロック図である。 ２・・・マイクロコンピュータ ４・・・発振器５・
・・リレー駆動回路 ６・・・リレー ７・・・表
示駆動回路 ８・・・表示部 ９・・・インバータ
１０・・・自己保持リレー 代理人葛野信−（１１か１名）
Claims (1)
- 少なくとも１つを除いた他の残シに制御される機器が接
続される複数の出力ポートを備え、異常時にはこれら出
力ポートすべてが同一の出力状態となるマイクロコンピ
ュータにおいて、前記機器が接続されない少なくとも１
つの出力ポートに、前記異常時に出力ポートから出力さ
れる信号を受けてマイクロコンピュータの出力を前記機
器から遮断するスイッチング素子を設けたことを特徴と
するマイクロコンピュータの異常処理機構。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57038778A JPS58155461A (ja) | 1982-03-11 | 1982-03-11 | マイクロコンピユ−タの異常処理機構 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57038778A JPS58155461A (ja) | 1982-03-11 | 1982-03-11 | マイクロコンピユ−タの異常処理機構 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58155461A true JPS58155461A (ja) | 1983-09-16 |
Family
ID=12534744
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57038778A Pending JPS58155461A (ja) | 1982-03-11 | 1982-03-11 | マイクロコンピユ−タの異常処理機構 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58155461A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60126738A (ja) * | 1983-12-14 | 1985-07-06 | Matsushita Electric Works Ltd | プログラマブルｉｃの誤動作防止回路 |
| JPS6380601U (ja) * | 1986-11-10 | 1988-05-27 | ||
| US9639093B2 (en) | 2009-05-07 | 2017-05-02 | Parker-Hannifin Corporation | Self-aligning axially constrained regulator valve assembly |
-
1982
- 1982-03-11 JP JP57038778A patent/JPS58155461A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60126738A (ja) * | 1983-12-14 | 1985-07-06 | Matsushita Electric Works Ltd | プログラマブルｉｃの誤動作防止回路 |
| JPS6380601U (ja) * | 1986-11-10 | 1988-05-27 | ||
| US9639093B2 (en) | 2009-05-07 | 2017-05-02 | Parker-Hannifin Corporation | Self-aligning axially constrained regulator valve assembly |
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