JPS58154026A - 情報処理装置のエラ−処理方式 - Google Patents
情報処理装置のエラ−処理方式Info
- Publication number
- JPS58154026A JPS58154026A JP57035237A JP3523782A JPS58154026A JP S58154026 A JPS58154026 A JP S58154026A JP 57035237 A JP57035237 A JP 57035237A JP 3523782 A JP3523782 A JP 3523782A JP S58154026 A JPS58154026 A JP S58154026A
- Authority
- JP
- Japan
- Prior art keywords
- terminal device
- circuit
- breaker
- power supply
- input
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/0703—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
- G06F11/0751—Error or fault detection not based on redundancy
- G06F11/0754—Error or fault detection not based on redundancy by exceeding limits
- G06F11/0757—Error or fault detection not based on redundancy by exceeding limits by exceeding a time limit, i.e. time-out, e.g. watchdogs
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/26—Power supply means, e.g. regulation thereof
- G06F1/30—Means for acting in the event of power-supply failure or interruption, e.g. power-supply fluctuations
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
発明の対象
本発ｆ！１ＪＦｉ端末装置に関し、特に電源の切離れ時
に自動的に装置電源を切断する省エネルキ−に好適な端
末装置に関する。
に自動的に装置電源を切断する省エネルキ−に好適な端
末装置に関する。
従来技術
従来の端末装置、特Ｋ ＣｐＵ周辺装置においてはＣＮ
Ｊからの電源投入および切断指示の信号をインタフェー
ス線を用いて電源の制御を行ない。
Ｊからの電源投入および切断指示の信号をインタフェー
ス線を用いて電源の制御を行ない。
その電源制御の為の補助電源を用いて行なっていたので
２通信回線を使用する端末装置にお匹てはインタフェー
ス線を設ける仁とは距離的な問題があった。その他の方
法として１通信回線のデータの中に電源切断指示をする
コマンドを設けることも考えられるが９通信回線上のト
ラプルが発生した場合には切断不能あるいは誤動作する
という欠点があった。
２通信回線を使用する端末装置にお匹てはインタフェー
ス線を設ける仁とは距離的な問題があった。その他の方
法として１通信回線のデータの中に電源切断指示をする
コマンドを設けることも考えられるが９通信回線上のト
ラプルが発生した場合には切断不能あるいは誤動作する
という欠点があった。
発明の目的
本発明の目的は、 ＡＣ入力用ブレーカ−と連動するＸ
電圧印加用ブレーカ−とで構成する多極形サーキットブ
レーカーを使用して１通信回線との送受信データを監視
することで、端末装着自身が電源供給の適、不適を判定
することで。
電圧印加用ブレーカ−とで構成する多極形サーキットブ
レーカーを使用して１通信回線との送受信データを監視
することで、端末装着自身が電源供給の適、不適を判定
することで。
電源の切り忘れ時のエネルギー消費を避ける端末装置を
提供することにある。
提供することにある。
発明の実施例
以下１本発明の一実施例を図面に基づいて説明する。
第１図は本発明の一実施例である端末装置のシステムブ
ロック図である。図において１は端末装置、２はすτキ
ットブレーカー９５はＡＣ入力線、４はサーキットブレ
ーカを経由したＡＣ入力線、 １１．１７はＸ電圧線
とＸドライブ線である。
ロック図である。図において１は端末装置、２はすτキ
ットブレーカー９５はＡＣ入力線、４はサーキットブレ
ーカを経由したＡＣ入力線、 １１．１７はＸ電圧線
とＸドライブ線である。
第２図は端末装置ｆ１とサーキットブレーカ−２のイン
タフェース回路図である。図においてＡＣ入力纏Ｓはプ
レーカーフを経由してスイッチ９に通じて電源に接続さ
れている。ブレーカ−８は電源１０のＸ出力であるＸ電
圧線１１に接続され、他の端子はトランジスタ１５．抵
抗１６で構成されたドライブ回路１４にＸドライブ線１
７に接続される。ドライブ回路はフ１□リップフロツカ
５Ｋ。
タフェース回路図である。図においてＡＣ入力纏Ｓはプ
レーカーフを経由してスイッチ９に通じて電源に接続さ
れている。ブレーカ−８は電源１０のＸ出力であるＸ電
圧線１１に接続され、他の端子はトランジスタ１５．抵
抗１６で構成されたドライブ回路１４にＸドライブ線１
７に接続される。ドライブ回路はフ１□リップフロツカ
５Ｋ。
フリップフロップ１５は信号バス１２に接続される。
第５図は端末装置１の論理ブロック図である。
図において送受信回路１８．マイクロプロセッサ１９、
ＲＯＭ２０． カウンタ２１．ツリツブフロップ１
３は信号バス１２に接続されている。送受信回路１８は
通信回線６に接続されている。
ＲＯＭ２０． カウンタ２１．ツリツブフロップ１
３は信号バス１２に接続されている。送受信回路１８は
通信回線６に接続されている。
上述の如く構成された本実施例の動作について以下に説
明する。
明する。
端末装置に供給するＡＣ入力はＡＣ入力線Ｓからサーキ
ットプレーカーフを経由して端末装置のスイッチ９を通
じて電源１０に供給される。
ットプレーカーフを経由して端末装置のスイッチ９を通
じて電源１０に供給される。
端末装置にＡＣ入力を供給するにはサーキットプレーカ
ーフ、８をＯＮにしたのちスイッチ９を投入することで
あシ、プレーカーフと８は多極形プレーカーであシ連動
して動作する。
ーフ、８をＯＮにしたのちスイッチ９を投入することで
あシ、プレーカーフと８は多極形プレーカーであシ連動
して動作する。
この時フリップフロップ１５の出力はＬ（ＩＩ’レベル
となりておυトランジスター５はカットオフされている
。
となりておυトランジスター５はカットオフされている
。
ＡＣ入力が供給されると電源１０からＸ電圧が出・１１
１１’。
１１’。
力され、端末装置の動作が開始される。この時前述の如
くトランジスター５はカットオフされておシ、サーキッ
トブレーカ−８のＸ電圧線１１に電圧が印加されている
か、サーキットブレーカー８の両端子間に電位差は生じ
ない。
くトランジスター５はカットオフされておシ、サーキッ
トブレーカ−８のＸ電圧線１１に電圧が印加されている
か、サーキットブレーカー８の両端子間に電位差は生じ
ない。
通常の端末装置１の電源投入、切断操作はスイッチ９に
１よって行なうか又はサーキットプレーカーフ、８の操
作のいずれかによって可能となるものである。
１よって行なうか又はサーキットプレーカーフ、８の操
作のいずれかによって可能となるものである。
端末装置１０基本的な動作は２通信回ｌｌ１Ｉ６との間
のデータ送受信を送受□信回１１１１８を通じて。
のデータ送受信を送受□信回１１１１８を通じて。
マイクロプロセッサ１９の処理の元に制御される。
その他１０機器を外部に接続すれば１０機器の処理を行
なえることはもちろんである。
なえることはもちろんである。
マイクロプロセッサ１９０マイクロ命令ｉＪ ＲＯＭ２
０に格納されておシ、このマイクロ命令に従って動作す
る。
０に格納されておシ、このマイクロ命令に従って動作す
る。
端末装置１の上記の如く基本的な動作の他に。
次の如く機能を有している。
カウンタ２１Ｆｉ一定周期でカウントアツプされる。カ
ウントアツプする方法としてはマイクロプロセッサから
ｉイクロ命令でカウントアツプする方法、あるいは、一
定周期毎“に発生するクロックによりて行なうことが考
えられ′る。′通常マイクロプロセッサを有する端末装
置にはインターバルタイマー等のりｐツク発生機能を有
しておシ、それら適当なものを使用すればよい。
ウントアツプする方法としてはマイクロプロセッサから
ｉイクロ命令でカウントアツプする方法、あるいは、一
定周期毎“に発生するクロックによりて行なうことが考
えられ′る。′通常マイクロプロセッサを有する端末装
置にはインターバルタイマー等のりｐツク発生機能を有
しておシ、それら適当なものを使用すればよい。
カウンタ２１けマイクロプロセッサ１９および！イクｐ
命令２０を格納するＲＯＭによって、送受信回路を経由
してデータを送受信するとクリアする。
命令２０を格納するＲＯＭによって、送受信回路を経由
してデータを送受信するとクリアする。
この様に通信図＠６を通じてデータ送受信を行なってい
る間はカウンタ２１がカウントアツプとクリアをくり返
すことになる。
る間はカウンタ２１がカウントアツプとクリアをくり返
すことになる。
したがって予めカウント値を定めておけば。
あるカウント値に達するというむとは、そのカウント値
に至るまでの間１通信回線６との間にデータ送受信がな
かりたと−うことを意味する。
に至るまでの間１通信回線６との間にデータ送受信がな
かりたと−うことを意味する。
このカウント値は、予め端末装置で決定しておくかある
いは外部にスイッチを設ける等の手段によって任意に決
定させるかいずれの方法でも容易である。
いは外部にスイッチを設ける等の手段によって任意に決
定させるかいずれの方法でも容易である。
カプント値が予め定めた値になると前記ツリツブフロッ
プ１５をセットし、その出力を８１０１しペルにする。
プ１５をセットし、その出力を８１０１しペルにする。
すなわちドライブ回路１４のトランジスタ１５に抵抗１
６から電流が流れ込みトランジスタ１５をＯＮに転極さ
せる。
６から電流が流れ込みトランジスタ１５をＯＮに転極さ
せる。
トランジスタ１５がＯＮになるとサーキットブレーカ−
８の端子の両端に電圧が印加され、サーキットブレーカ
−８が投入される。このサーキットブレーカ−８に連動
してサーキットプレーカーフも切断され、鴻末装ａ１の
ＡＣ入力が遮断される。
８の端子の両端に電圧が印加され、サーキットブレーカ
−８が投入される。このサーキットブレーカ−８に連動
してサーキットプレーカーフも切断され、鴻末装ａ１の
ＡＣ入力が遮断される。
発明の効果
本発明によれば２通信回線に接続される端末装置におい
て、補助電源を有することなく、自動的にサーキットブ
レーカ−ｙｔｌｌ断できるの二電源切りわすれ時の省エ
ネルギーの効果がある。
て、補助電源を有することなく、自動的にサーキットブ
レーカ−ｙｔｌｌ断できるの二電源切りわすれ時の省エ
ネルギーの効果がある。
第１図は本発明の一実施例であ乞端末装置のシステムズ
ｌツク図、第２図は端末装置とサーキットブレーカ−の
インタフェース回路図、第５図は端末装置の論理ブロッ
ク図である。 １・・・端末装置 ２．７．８・・・サーキットブレーカ−１３，４・・・
ＡＣ入力蔵、 ６・・・通信回線。 ９・・・スイッチ、 １０・・・電源。 １１・・・ＤＣ′ｔｌＬ圧線、 １２・・・信号パ
ス。 １５・・・フリップフロップ、 １４・・・ドライブ回路、１５・・・トランジスタ、１
６・・・抵抗、 １７・・＆ドライブ線、１８
轡送受信回路。 １９・・・マイクロプロセッサ。 ２０・・・ＲＯＭ ２１・・・カウンタ。
ｌツク図、第２図は端末装置とサーキットブレーカ−の
インタフェース回路図、第５図は端末装置の論理ブロッ
ク図である。 １・・・端末装置 ２．７．８・・・サーキットブレーカ−１３，４・・・
ＡＣ入力蔵、 ６・・・通信回線。 ９・・・スイッチ、 １０・・・電源。 １１・・・ＤＣ′ｔｌＬ圧線、 １２・・・信号パ
ス。 １５・・・フリップフロップ、 １４・・・ドライブ回路、１５・・・トランジスタ、１
６・・・抵抗、 １７・・＆ドライブ線、１８
轡送受信回路。 １９・・・マイクロプロセッサ。 ２０・・・ＲＯＭ ２１・・・カウンタ。
Claims (1)
- １、 ＡＣ入力を投入、切断するサーキットブレーカ
−を経由してＡＣ入力電源を供給する通信回線に接続さ
れる端末装置において、前記サーキットブレーカ−をＡ
Ｃ入力用ブレーカ−とＤＣ電圧印加用ブレーカ−を組合
せた多極形サーキットブレーカ−で構成し、一定周期毎
にインクルメントレ１通信回線とのデータ送受信を行な
うとクリアする様に制御するカウンタを設け、そのカウ
ンタ値が規定値に遍すると７リツプ７μツブをセットし
、前記Ｘ電圧印加用ブレーカ−にＸ電圧を供給し、切断
すると共に前記ＡＣ入力用プレーカーも連動し、 ＡＣ
入力電源供給を通断することを特徴とした端末装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57035237A JPS58154026A (ja) | 1982-03-08 | 1982-03-08 | 情報処理装置のエラ−処理方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57035237A JPS58154026A (ja) | 1982-03-08 | 1982-03-08 | 情報処理装置のエラ−処理方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58154026A true JPS58154026A (ja) | 1983-09-13 |
Family
ID=12436229
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57035237A Pending JPS58154026A (ja) | 1982-03-08 | 1982-03-08 | 情報処理装置のエラ−処理方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58154026A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0187159A1 (en) * | 1984-06-07 | 1986-07-16 | Motorola, Inc. | External interface control circuitry for microcomputer systems |
| US4794525A (en) * | 1984-06-07 | 1988-12-27 | Motorola, Inc. | External interface control circuitry for microcomputer systems |
| US5059961A (en) * | 1989-08-21 | 1991-10-22 | Cheng Te J | Screen blanker for a monitor of a computer system |
| JP5099132B2 (ja) * | 2007-06-20 | 2012-12-12 | 富士通株式会社 | 複数のスレッドを同時に処理する演算装置 |
-
1982
- 1982-03-08 JP JP57035237A patent/JPS58154026A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0187159A1 (en) * | 1984-06-07 | 1986-07-16 | Motorola, Inc. | External interface control circuitry for microcomputer systems |
| US4794525A (en) * | 1984-06-07 | 1988-12-27 | Motorola, Inc. | External interface control circuitry for microcomputer systems |
| US5059961A (en) * | 1989-08-21 | 1991-10-22 | Cheng Te J | Screen blanker for a monitor of a computer system |
| JP5099132B2 (ja) * | 2007-06-20 | 2012-12-12 | 富士通株式会社 | 複数のスレッドを同時に処理する演算装置 |
| US8516303B2 (en) | 2007-06-20 | 2013-08-20 | Fujitsu Limited | Arithmetic device for concurrently processing a plurality of threads |
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