JPS58153276A - アクセス制御回路 - Google Patents
アクセス制御回路Info
- Publication number
- JPS58153276A JPS58153276A JP3385182A JP3385182A JPS58153276A JP S58153276 A JPS58153276 A JP S58153276A JP 3385182 A JP3385182 A JP 3385182A JP 3385182 A JP3385182 A JP 3385182A JP S58153276 A JPS58153276 A JP S58153276A
- Authority
- JP
- Japan
- Prior art keywords
- access
- speed
- subtractor
- speed command
- output
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B5/00—Recording by magnetisation or demagnetisation of a record carrier; Reproducing by magnetic means; Record carriers therefor
- G11B5/48—Disposition or mounting of heads or head supports relative to record carriers ; arrangements of heads, e.g. for scanning the record carrier to increase the relative speed
- G11B5/54—Disposition or mounting of heads or head supports relative to record carriers ; arrangements of heads, e.g. for scanning the record carrier to increase the relative speed with provision for moving the head into or out of its operative position or across tracks
- G11B5/55—Track change, selection or acquisition by displacement of the head
- G11B5/5521—Track change, selection or acquisition by displacement of the head across disk tracks
- G11B5/5526—Control therefor; circuits, track configurations or relative disposition of servo-information transducers and servo-information tracks for control thereof
Landscapes
- Moving Of Head For Track Selection And Changing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
発明の対象
本発明はディスク装置のアクセス制御回路に関ｌ）し、
特にアクセスタイムを短縮可能としたアクセ。
特にアクセスタイムを短縮可能としたアクセ。
大制御回路に関する。
従来技術
従来のディスク装置のアクセス制御回路の一例。
を第１図に示した。この回路においては、速度命令信号
は減算器２の出力が読み出し専用メモリ（以下「ＲＯＭ
」という。）３．Ｄ／ム変換器番・全通って発生し、実
速度検出回路５によって検出された実速度信号と比較さ
れ、その出力はパワー増幅ＷＩ７を介してボイスコイル
モータ（以下「ＴＯＭＪという。）８に電流を流してヘ
ッドを移動させる。そして、ヘッドが移動してディスク
面にのシリンダを通過するごとに前記減算器２の内容が
減り前記速度命令信号が変化し、前記減算器２・の内容
が０になるとアクセスが終了するというもＯのである。
は減算器２の出力が読み出し専用メモリ（以下「ＲＯＭ
」という。）３．Ｄ／ム変換器番・全通って発生し、実
速度検出回路５によって検出された実速度信号と比較さ
れ、その出力はパワー増幅ＷＩ７を介してボイスコイル
モータ（以下「ＴＯＭＪという。）８に電流を流してヘ
ッドを移動させる。そして、ヘッドが移動してディスク
面にのシリンダを通過するごとに前記減算器２の内容が
減り前記速度命令信号が変化し、前記減算器２・の内容
が０になるとアクセスが終了するというもＯのである。
上記動作における速度命令信号９と実速度信号１０ｔ−
グラフに示すと、第２図または第３図のよ。
グラフに示すと、第２図または第３図のよ。
うになる。ここで、第２図は小移動量アクセスの場合、
第３図は大移動量アクセスの場合を示すも５のである。
第３図は大移動量アクセスの場合を示すも５のである。
両図において、人は加速領域、Ｂは減速領域、また０は
目標シリンダ到達を示している。。
目標シリンダ到達を示している。。
この回路においては、小移動量アクセスの場合に、減速
領域Ｂに入ったとき実速度がオー共−シュー。
領域Ｂに入ったとき実速度がオー共−シュー。
トして速度命令信号９に追従できなくなってアｌＩ１０
七スエラーを起すのを防止するため、第２図に示す如く
、速度命令信号９は目標シリンダ付近での肇化にゆるや
かにしている。ところが、これを大移動量アクセスにそ
の１重適用すると、第３１１！Ｉに示す如く、減速領域
１の時間も長くなり、速度命令信号９をゆるやかにする
以前に、実速度が速度命令信号に追従してしまうため、
いたずらにアクセスタイムを長くすることになるという
問題があった。
七スエラーを起すのを防止するため、第２図に示す如く
、速度命令信号９は目標シリンダ付近での肇化にゆるや
かにしている。ところが、これを大移動量アクセスにそ
の１重適用すると、第３１１！Ｉに示す如く、減速領域
１の時間も長くなり、速度命令信号９をゆるやかにする
以前に、実速度が速度命令信号に追従してしまうため、
いたずらにアクセスタイムを長くすることになるという
問題があった。
発明の目的
本発明は上記事情に鑑みてなされたもので、その目的と
するところは、従来のディスク装置のアクセス制御回路
における上述の如き問題を解消し、小移動量アクセスに
おいて実速度のオーバーシュートによるアクセスエラー
を防止すると同時に、大移動量アクセスにおいてアクセ
スタイムの増加を防止することが可能なアクセス制御回
路を提供することにある。
するところは、従来のディスク装置のアクセス制御回路
における上述の如き問題を解消し、小移動量アクセスに
おいて実速度のオーバーシュートによるアクセスエラー
を防止すると同時に、大移動量アクセスにおいてアクセ
スタイムの増加を防止することが可能なアクセス制御回
路を提供することにある。
本発明の要点はディスク装置のアクセス制御Ｉ’ｌ１１
路において、アクセスの移動量により速度命令信号を２
種類以上切換えて制御するようにした点にある。
路において、アクセスの移動量により速度命令信号を２
種類以上切換えて制御するようにした点にある。
以下、本発明の実施例を図面に基づいて詳細に・説明す
る。
る。
発明の実施例とその効果
第４図は本発明の一実施例を示すアクセス制御回路のブ
ロック図である。図において、符号１〜８は第１図に示
したと同じ構成要素を示しており、１１は速度カーブ切
換回路、９Ａは速度命令信号、１０は実速度信号である
。
ロック図である。図において、符号１〜８は第１図に示
したと同じ構成要素を示しており、１１は速度カーブ切
換回路、９Ａは速度命令信号、１０は実速度信号である
。
シリンダパルス発生回路ｌはヘッドが移動する際、シリ
ンダを通過するごとにパルスを発生する。
ンダを通過するごとにパルスを発生する。
減算器２は上位装置から送られるアクセス移動量を記憶
し、前記シリンダパルス発生回路１からのパルスにより
その値を減算する。ＲＯＭ３は少なくとも２種の速度命
令を記憶しており、該速度命令は、例えば目標シリンダ
までの距離（シリンダ数）とそれに対応する速度との組
合せから成っている。
し、前記シリンダパルス発生回路１からのパルスにより
その値を減算する。ＲＯＭ３は少なくとも２種の速度命
令を記憶しており、該速度命令は、例えば目標シリンダ
までの距離（シリンダ数）とそれに対応する速度との組
合せから成っている。
速度カーブ切換回路１１は前記上位装置から浚算器２に
入力されたアクセス移動量を見て、前記：ＲＯＭ３に記
憶されている複数の速度命令のうちのどの速度命令を用
いるかを決定する。ＲＯＭ３は上記決定に従って選択さ
れた速度命令に基づき、減算ｌ１２の内容に応じた速度
命令信号全ディジタルで出力する。この信号はＤ ／
Ａ変換器４でアナログの速度命令信号９Ａに賢換され比
較藩６に送。
入力されたアクセス移動量を見て、前記：ＲＯＭ３に記
憶されている複数の速度命令のうちのどの速度命令を用
いるかを決定する。ＲＯＭ３は上記決定に従って選択さ
れた速度命令に基づき、減算ｌ１２の内容に応じた速度
命令信号全ディジタルで出力する。この信号はＤ ／
Ａ変換器４でアナログの速度命令信号９Ａに賢換され比
較藩６に送。
られる。比較６１６でけ前記速度命令信号９Ａと、実速
度検出回路６から送られる実捺度信号ｌＯとを比較する
。パワー増＄１８１７は比較ｌ１１６の出力に応じた電
流を前記ＶＯＭ５３に流してヘッドの移動を制御する。
度検出回路６から送られる実捺度信号ｌＯとを比較する
。パワー増＄１８１７は比較ｌ１１６の出力に応じた電
流を前記ＶＯＭ５３に流してヘッドの移動を制御する。
上述の如く構成された本実施例回路の動作について以下
説明する。
説明する。
ＲＯＭ３の内容がアクセス移動量のある値を基準として
、これより大きい場合用の速度命令α）、小さい場合用
の速度命令２）の２種類であるとする。
、これより大きい場合用の速度命令α）、小さい場合用
の速度命令２）の２種類であるとする。
速度命令α）は、第６図に示す如き、時間とともに一様
に変化する速度命令、速度命令■は第２図に示した如く
、目標シリンダ付近で変化がゆるや力になる速度命令で
ある。
に変化する速度命令、速度命令■は第２図に示した如く
、目標シリンダ付近で変化がゆるや力になる速度命令で
ある。
前記上位装置から減算器２に入力されたアクセス移動量
が前記基準値を越えている場合には、該減算［１２の出
力により速度カーブ切換回路１１０よって、前記速度命
令α）が選択される。減算器２゜速度カーブ切換回路１
１の出力は、１０Ｍ３に入力され、これから出力される
ディジタル速度命令はＤ ／ Ａ変換器４により前述の
如くアナ田グ速度命令信号ＯＡに変換され、’ＶＯＭ［
を駆動する。
が前記基準値を越えている場合には、該減算［１２の出
力により速度カーブ切換回路１１０よって、前記速度命
令α）が選択される。減算器２゜速度カーブ切換回路１
１の出力は、１０Ｍ３に入力され、これから出力される
ディジタル速度命令はＤ ／ Ａ変換器４により前述の
如くアナ田グ速度命令信号ＯＡに変換され、’ＶＯＭ［
を駆動する。
これにより、ヘッドが移動し、シリンダを横切るごとに
シリンダパルス発生回路１によりパルス【発生し、減算
器２の内容が減算され、その結果、速度命令信号９Ａが
逐次変化して行く。実速度信号１０がこれに追従して行
き、減算器２の内容が０になった時点でアクセスが終了
し、アクセスタイムの増加（第６図△ｔ）が防止できる
。
シリンダパルス発生回路１によりパルス【発生し、減算
器２の内容が減算され、その結果、速度命令信号９Ａが
逐次変化して行く。実速度信号１０がこれに追従して行
き、減算器２の内容が０になった時点でアクセスが終了
し、アクセスタイムの増加（第６図△ｔ）が防止できる
。
前記上位装置から減算６１２に入力されたアクセス移動
量が、前記基準値以下の場合には、速度カーブ切換回路
１１によって前記速度命令■が選択される。この場合の
動作は、前記第２図に示した如くなり、小移動量アクセ
スにおける実速度のオーバーシュートを防止するような
速度命令が与えられる。
量が、前記基準値以下の場合には、速度カーブ切換回路
１１によって前記速度命令■が選択される。この場合の
動作は、前記第２図に示した如くなり、小移動量アクセ
スにおける実速度のオーバーシュートを防止するような
速度命令が与えられる。
上記実施例回路においては、速度命令の記憶手段として
ＲＯＭを用いたが、これｔ−ＲＡＭとして速度命令の種
類を変更可能としても良い。
ＲＯＭを用いたが、これｔ−ＲＡＭとして速度命令の種
類を変更可能としても良い。
発明の効果
以上述べた如く、本発明によれば、アクセス制御回路に
おいて、アクセスの移動量により速度台・ｌ令信号を２
種類以上切換えて制御するようにした。
おいて、アクセスの移動量により速度台・ｌ令信号を２
種類以上切換えて制御するようにした。
ので、小移動量アクセスにおいて実速度のオーバーシュ
ーＦによるアクセスエラーを防止すると同時に、大移動
量アクセスにおいてアクセスタイムの増加を防止するこ
とがアクセス制御回路全実現するという顕著な効果を奏
するものである。
ーＦによるアクセスエラーを防止すると同時に、大移動
量アクセスにおいてアクセスタイムの増加を防止するこ
とがアクセス制御回路全実現するという顕著な効果を奏
するものである。
第１図は従来のアクセス制御回路を示すプルツク図、第
２図、第３図は従来のアクセス制御回路による小移動量
アクセス、大移動量アクセスの場合の速度命令信号と実
速度信号を示すグラフ、第４図は本発明の一実施列を示
すプワツク図、第６図は本発明における大移動量アクセ
スの場合の速度命令信号と実速度信号全示すグラフであ
る。 １；シリンダパルス発生回路、２：減算器、３：ＲＯＭ
、４：Ｄ／人人捜換器５：実速度検出回路、６：比較器
、７：パワー増幅器、８：ＶＯＭ。 ９．９ム：速度命令信号、１０：実速度信号、１１：ｌ
！！度カーブ切換回路。 特許出願人 株式会社 日立製作所 第１図 第２図 第３図 を− 第４図
２図、第３図は従来のアクセス制御回路による小移動量
アクセス、大移動量アクセスの場合の速度命令信号と実
速度信号を示すグラフ、第４図は本発明の一実施列を示
すプワツク図、第６図は本発明における大移動量アクセ
スの場合の速度命令信号と実速度信号全示すグラフであ
る。 １；シリンダパルス発生回路、２：減算器、３：ＲＯＭ
、４：Ｄ／人人捜換器５：実速度検出回路、６：比較器
、７：パワー増幅器、８：ＶＯＭ。 ９．９ム：速度命令信号、１０：実速度信号、１１：ｌ
！！度カーブ切換回路。 特許出願人 株式会社 日立製作所 第１図 第２図 第３図 を− 第４図
Claims (1)
- 【特許請求の範囲】 シリンダパルス発生回路と減算器と速度命令記）懐手段
およびＤ／ム変換器から成る速度命令発生回路【有する
ディスク装置のアクセス制御回路に・おいて、前記速度
命令記憶手段を複数個の速度命令を記憶させるとともに
、前記減算器の出力によ・り前記記憶手段中の複数個の
速度命令のうちから・・いずれか１個の速度命令を選択
する速度命令選択９回路を設けたことを特徴とするアク
セス制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3385182A JPS58153276A (ja) | 1982-03-05 | 1982-03-05 | アクセス制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3385182A JPS58153276A (ja) | 1982-03-05 | 1982-03-05 | アクセス制御回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58153276A true JPS58153276A (ja) | 1983-09-12 |
Family
ID=12398003
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3385182A Pending JPS58153276A (ja) | 1982-03-05 | 1982-03-05 | アクセス制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58153276A (ja) |
Cited By (7)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61276185A (ja) * | 1985-05-31 | 1986-12-06 | Nec Corp | ヘツド移動装置 |
| JPS6242373A (ja) * | 1985-08-20 | 1987-02-24 | Fujitsu Ltd | 磁気デイスク装置におけるシ−ク用モ−タの速度制御装置 |
| JPS6450286A (en) * | 1987-08-20 | 1989-02-27 | Sony Corp | Optical disk device |
| JPH01253881A (ja) * | 1988-04-04 | 1989-10-11 | Hitachi Ltd | 磁気ヘッド位置決め速度制御方式 |
| US5016126A (en) * | 1988-09-02 | 1991-05-14 | Sharp Kabushiki Kaisha | Device for controlling an access operation of an information recording and reproducing device |
| JPH05266613A (ja) * | 1992-03-18 | 1993-10-15 | Sharp Corp | ディスク装置のシーク速度制御方法 |
| JPH05325449A (ja) * | 1992-05-20 | 1993-12-10 | Sharp Corp | キャリッジの速度制御装置 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5295207A (en) * | 1976-02-05 | 1977-08-10 | Nec Corp | Transducer positioning method for magnetic memory device |
| JPS5335879A (en) * | 1976-09-14 | 1978-04-03 | Nec Corp | Voice coil motor control system |
-
1982
- 1982-03-05 JP JP3385182A patent/JPS58153276A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5295207A (en) * | 1976-02-05 | 1977-08-10 | Nec Corp | Transducer positioning method for magnetic memory device |
| JPS5335879A (en) * | 1976-09-14 | 1978-04-03 | Nec Corp | Voice coil motor control system |
Cited By (9)
| Publication number | Priority date | Publication date | Assignee | Title |
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| JPH0519786B2 (ja) * | 1985-05-31 | 1993-03-17 | Nippon Electric Co | |
| JPS6242373A (ja) * | 1985-08-20 | 1987-02-24 | Fujitsu Ltd | 磁気デイスク装置におけるシ−ク用モ−タの速度制御装置 |
| JPH0522989B2 (ja) * | 1985-08-20 | 1993-03-31 | Fujitsu Ltd | |
| JPS6450286A (en) * | 1987-08-20 | 1989-02-27 | Sony Corp | Optical disk device |
| JPH01253881A (ja) * | 1988-04-04 | 1989-10-11 | Hitachi Ltd | 磁気ヘッド位置決め速度制御方式 |
| US5016126A (en) * | 1988-09-02 | 1991-05-14 | Sharp Kabushiki Kaisha | Device for controlling an access operation of an information recording and reproducing device |
| JPH05266613A (ja) * | 1992-03-18 | 1993-10-15 | Sharp Corp | ディスク装置のシーク速度制御方法 |
| JPH05325449A (ja) * | 1992-05-20 | 1993-12-10 | Sharp Corp | キャリッジの速度制御装置 |
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