JPS58137931A - オフデイレ−型リレ−の駆動回路 - Google Patents
オフデイレ−型リレ−の駆動回路Info
- Publication number
- JPS58137931A JPS58137931A JP2075482A JP2075482A JPS58137931A JP S58137931 A JPS58137931 A JP S58137931A JP 2075482 A JP2075482 A JP 2075482A JP 2075482 A JP2075482 A JP 2075482A JP S58137931 A JPS58137931 A JP S58137931A
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- JP
- Japan
- Prior art keywords
- capacitor
- transistor
- switch
- circuit
- relay
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発Ij11はスイッチkOFFしてがら予め設定され
だ一定時間を経過した後VCOF F動作するオフディ
レー型リレーの部製回路VC関し、その目的とするとこ
ろはラッチングリレーを用いることによってON状m
vcおける電力の節減を図9、しかも構成か簡単なリレ
ー駆動回路會提供するCとvCめる0 以下1図に沿って不発明t−観明する0図は本発明の一
実施例をボアものでめ91図において交流電源ACの両
端1CにスイッチSW會介してサージ吸収−ZNが接続
され、その両端にはサージ電流からの保賎用の抵抗Rs
?!−介してタイオードブリッジからなる全波整流回
路DBが飯枕芒れているO この全波整流回路DBの出力端子間には、別電圧回路を
構成するトランジスタTrI、 Tryのコレクタ、エ
ミッタ、ダイオ−)’ D、 、コンデンサC3および
1巻龍形のラッチングリレーLyが順次1夕1jVc接
続嘔れてν9、トランジスタTr、のコレクタ、ベース
間には抵抗R1か、またこのベースとトランジスタTr
、のベースとの間には抵抗R1か黴枕されている0更に
トランジスタTr!のベースと全波整流1g回路DBの
負極出力端との閾にはツェナーダイオードZDかil!
絖される。
だ一定時間を経過した後VCOF F動作するオフディ
レー型リレーの部製回路VC関し、その目的とするとこ
ろはラッチングリレーを用いることによってON状m
vcおける電力の節減を図9、しかも構成か簡単なリレ
ー駆動回路會提供するCとvCめる0 以下1図に沿って不発明t−観明する0図は本発明の一
実施例をボアものでめ91図において交流電源ACの両
端1CにスイッチSW會介してサージ吸収−ZNが接続
され、その両端にはサージ電流からの保賎用の抵抗Rs
?!−介してタイオードブリッジからなる全波整流回
路DBが飯枕芒れているO この全波整流回路DBの出力端子間には、別電圧回路を
構成するトランジスタTrI、 Tryのコレクタ、エ
ミッタ、ダイオ−)’ D、 、コンデンサC3および
1巻龍形のラッチングリレーLyが順次1夕1jVc接
続嘔れてν9、トランジスタTr、のコレクタ、ベース
間には抵抗R1か、またこのベースとトランジスタTr
、のベースとの間には抵抗R1か黴枕されている0更に
トランジスタTr!のベースと全波整流1g回路DBの
負極出力端との閾にはツェナーダイオードZDかil!
絖される。
トランジスタTrtのエミッタと全波整fi19JMD
Bの負極出力端との間には、平滑用および遅延回路を構
成するコンデンサQと、分圧用の抵抗Rs、Raの直り
II 1gJMとが並列に接続されており、抵抗Kae
亀相互の接続点に、エミッタt−m配負極出力端に接続
してなるトランジスタTr3のペースに接続される。
Bの負極出力端との間には、平滑用および遅延回路を構
成するコンデンサQと、分圧用の抵抗Rs、Raの直り
II 1gJMとが並列に接続されており、抵抗Kae
亀相互の接続点に、エミッタt−m配負極出力端に接続
してなるトランジスタTr3のペースに接続される。
コンデンサCmの一端とトランジスタTr1のコレクタ
との間には、ダイオードD。抵抗R,j?よひトランジ
スタTr4のベース、エミッタの匣列回路と、タイオー
ドD1.抵抗R#およびトランジスタTryのコレクタ
、エミッタの匝列(ロ)路とが接続されているO タイオードD1のカソード扛トランジスタTr、のベー
スvc接幌され、そのエミッタはダイオードDIのカン
ードに接続されており、トランジスタTr@のコレクタ
はトランジスタTr、のペースおよびトランジスタTr
aのコレクタに夫々級枕されているOlた、トランジス
タTr−のエミッタ、コレクタ間には高抵抗としての抵
抗Rvが接軟芒れている。
との間には、ダイオードD。抵抗R,j?よひトランジ
スタTr4のベース、エミッタの匣列回路と、タイオー
ドD1.抵抗R#およびトランジスタTryのコレクタ
、エミッタの匝列(ロ)路とが接続されているO タイオードD1のカソード扛トランジスタTr、のベー
スvc接幌され、そのエミッタはダイオードDIのカン
ードに接続されており、トランジスタTr@のコレクタ
はトランジスタTr、のペースおよびトランジスタTr
aのコレクタに夫々級枕されているOlた、トランジス
タTr−のエミッタ、コレクタ間には高抵抗としての抵
抗Rvが接軟芒れている。
なお、トランジスタTr4 Inスイッチング回路ケ構
成してi?り、後述する如くトランジスタTr@ 。
成してi?り、後述する如くトランジスタTr@ 。
Tr−からなるサイリスタ構造k fi制御するもので
ある0 次にこの動作音詳述する0 先ず、スイッチ5Wt−閉じると、父m*圧框全波整t
lLl!ll!l路DBにて整流され、トラン7スタT
rl。
ある0 次にこの動作音詳述する0 先ず、スイッチ5Wt−閉じると、父m*圧框全波整t
lLl!ll!l路DBにて整流され、トラン7スタT
rl。
Trl s抵抗RI#Rtj?よびツェナーダイオード
zDからなる定電圧回路會鯰てコンデンサCtにより平
滑される。この@流亀圧に抵抗R1およびR,によって
分圧され、抵抗Ra両端の電圧が0.6〜0.7■に達
するとトランジスタTr3にONし、コンデンサCIの
光電電流が図中、a点からタ′イオードD1.コンデン
サC3+ラッチングリレー町およびトランジスタTry
へと流れてリレーはセット、すなわちON動作する0 このとき、ダイオードD1によりトランジスタTr・は
逆バイアスされているのでこのトランジスタTr。
zDからなる定電圧回路會鯰てコンデンサCtにより平
滑される。この@流亀圧に抵抗R1およびR,によって
分圧され、抵抗Ra両端の電圧が0.6〜0.7■に達
するとトランジスタTr3にONし、コンデンサCIの
光電電流が図中、a点からタ′イオードD1.コンデン
サC3+ラッチングリレー町およびトランジスタTry
へと流れてリレーはセット、すなわちON動作する0 このとき、ダイオードD1によりトランジスタTr・は
逆バイアスされているのでこのトランジスタTr。
はOFF、1良トツンジスタTr−%OFFしており、
トランジスタTr−はダイオードIhおよび抵抗R1【
介しペース電流か供給されてON状態になっている。
トランジスタTr−はダイオードIhおよび抵抗R1【
介しペース電流か供給されてON状態になっている。
コンデンtC1の充電か完了すると充電電rlLは流れ
なくなるが、ラッチングダレ−Lyはセット状態を維持
している0 次に、スイッチ5wtgm<とコンデンサへの電荷に抵
抗R1およびRat介し放電するか、この間、抵抗R,
の一端の電圧が次第に降下し、その甑か略0.6v以)
になるとトランジスタTrgはOFF’する。この、ス
イッチ8WtOFFしてからトランジスタTryかOF
Fするまでの時間は、コンデンサへおよび抵抗kLs−
’B4による時定数の選択により自由に設電することが
できるのは言う菫で%にない0トラツジスタTryのO
FFと共に、スイッチング囲路を構成するトランジスタ
Tr4 % OF F L、そのコレクタの電位は急激
に上昇する。1iなわち。
なくなるが、ラッチングダレ−Lyはセット状態を維持
している0 次に、スイッチ5wtgm<とコンデンサへの電荷に抵
抗R1およびRat介し放電するか、この間、抵抗R,
の一端の電圧が次第に降下し、その甑か略0.6v以)
になるとトランジスタTrgはOFF’する。この、ス
イッチ8WtOFFしてからトランジスタTryかOF
Fするまでの時間は、コンデンサへおよび抵抗kLs−
’B4による時定数の選択により自由に設電することが
できるのは言う菫で%にない0トラツジスタTryのO
FFと共に、スイッチング囲路を構成するトランジスタ
Tr4 % OF F L、そのコレクタの電位は急激
に上昇する。1iなわち。
トランジスタTr−およびTrlからなるサイリスタ構
造のゲート(−中、b点)に正パルスが加わつ大ことと
なり、トランジスタTr@ 、 Tr・は急速にONし
、コンデンサCIの電荷はトランジスタTr@ 、 T
rlを介して放電される。
造のゲート(−中、b点)に正パルスが加わつ大ことと
なり、トランジスタTr@ 、 Tr・は急速にONし
、コンデンサCIの電荷はトランジスタTr@ 、 T
rlを介して放電される。
従ってラッチングリレーLyKtXコンテンサC1の放
電電流が流れ、リレー社リセット、すなわちOFF動作
するものである。
電電流が流れ、リレー社リセット、すなわちOFF動作
するものである。
以上のように本発明によれは、交流電源にスイッチを介
して接続された全波整tIL1g回路と、定電圧−路と
、遅延回路と、サイリスタ構造と、スイッチング四路と
%コンデンサおよびラッチングリレーの直列回路とから
411成し、前記スイッチの開成によるコンデンサの充
電11tlLによってラッチングリレーをセット−作せ
しめ、前記スイッチを開成し遅延回路を介して一足時間
軒遇した後にスイッチング1路を介してサイリスタ構@
’(ON動作させ、コンデンサ會放電せしめてラツテン
クリレーtリセット動作せしめ゛るようにしたから、ラ
ッチングリレーの採用によりリレーのON状態における
電力消費かなく経隣的であり1回路構成も簡牟であると
共に、コンデンサの光放電を利用しているためフリップ
70ツ71!l!l1ilIil)t−用いた駆動1路
に比してノイズにも強い郷の効果がある0
して接続された全波整tIL1g回路と、定電圧−路と
、遅延回路と、サイリスタ構造と、スイッチング四路と
%コンデンサおよびラッチングリレーの直列回路とから
411成し、前記スイッチの開成によるコンデンサの充
電11tlLによってラッチングリレーをセット−作せ
しめ、前記スイッチを開成し遅延回路を介して一足時間
軒遇した後にスイッチング1路を介してサイリスタ構@
’(ON動作させ、コンデンサ會放電せしめてラツテン
クリレーtリセット動作せしめ゛るようにしたから、ラ
ッチングリレーの採用によりリレーのON状態における
電力消費かなく経隣的であり1回路構成も簡牟であると
共に、コンデンサの光放電を利用しているためフリップ
70ツ71!l!l1ilIil)t−用いた駆動1路
に比してノイズにも強い郷の効果がある0
図は本発明の一実施例を示す一路図であるOAC・・・
・・・交流電−、SW・・・・・・スイッチ,DB・・
・・・・全波整流回路* Trs〜Tr@ }ランジス
タ% R1〜島・・・・・・抵抗.ZN・・・・・・サ
ージ吸収器.ZD・・・・・・ツェナーダイオードsc
rec*・・・・・・コンデンサ% DI〜i・・・・
・・ダイオード、Ly・・・・・・ラッチングリレー特
許出願人 松下電工株式会社
・・・交流電−、SW・・・・・・スイッチ,DB・・
・・・・全波整流回路* Trs〜Tr@ }ランジス
タ% R1〜島・・・・・・抵抗.ZN・・・・・・サ
ージ吸収器.ZD・・・・・・ツェナーダイオードsc
rec*・・・・・・コンデンサ% DI〜i・・・・
・・ダイオード、Ly・・・・・・ラッチングリレー特
許出願人 松下電工株式会社
Claims (1)
- 父流電諒にスイッチ−を介して接続された全波整流回路
の出力−に定電圧−路を接続し、その出力軸rc ji
!!延回路と、サイリスタ構造と、スイッチング回路と
、コンデンサおよびラッチングリレーの直列−路と管順
次接続してなり、前記スイッチの閉成ycよって前記コ
ンデンサを充電し、その光電電流によってラツテンクリ
レーtセット動作せしめると共に、前記スイッチを開成
し前記遅延(9)路を介して一足時間経過した後に前記
スイッチングtm*を介して前記サイリスタ構造tON
動作させることにより前記コンデンサを放電させ、その
放電電流によってラッチングリレーtリセット動作せし
めるように構成したこと11−特徴とするオフディレー
型リレーの駆−1路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2075482A JPS58137931A (ja) | 1982-02-10 | 1982-02-10 | オフデイレ−型リレ−の駆動回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2075482A JPS58137931A (ja) | 1982-02-10 | 1982-02-10 | オフデイレ−型リレ−の駆動回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS58137931A true JPS58137931A (ja) | 1983-08-16 |
Family
ID=12035972
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2075482A Pending JPS58137931A (ja) | 1982-02-10 | 1982-02-10 | オフデイレ−型リレ−の駆動回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS58137931A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US10176950B2 (en) | 2014-03-13 | 2019-01-08 | Omron Corporation | Latching relay drive circuit |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS54163667A (en) * | 1978-06-15 | 1979-12-26 | Matsushita Electric Works Ltd | Bistable relay control circuit |
-
1982
- 1982-02-10 JP JP2075482A patent/JPS58137931A/ja active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS54163667A (en) * | 1978-06-15 | 1979-12-26 | Matsushita Electric Works Ltd | Bistable relay control circuit |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US10176950B2 (en) | 2014-03-13 | 2019-01-08 | Omron Corporation | Latching relay drive circuit |
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