JPS58132927A - パタ−ン形成方法 - Google Patents

パタ−ン形成方法

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JPS58132927A
JPS58132927A JP1608982A JP1608982A JPS58132927A JP S58132927 A JPS58132927 A JP S58132927A JP 1608982 A JP1608982 A JP 1608982A JP 1608982 A JP1608982 A JP 1608982A JP S58132927 A JPS58132927 A JP S58132927A
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JP
Japan
Prior art keywords
layer
resist
pattern
exposed
resist layer
Prior art date
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Pending
Application number
JP1608982A
Other languages
English (en)
Inventor
Katsunobu Nakagawa
中川 勝信
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electronics Corp
Matsushita Electric Industrial Co Ltd
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Filing date
Publication date
Application filed by Matsushita Electronics Corp, Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electronics Corp
Priority to JP1608982A priority Critical patent/JPS58132927A/ja
Publication of JPS58132927A publication Critical patent/JPS58132927A/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/027Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34
    • H01L21/0271Making masks on semiconductor bodies for further photolithographic processing not provided for in group H01L21/18 or H01L21/34 comprising organic layers

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  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Electron Beam Exposure (AREA)
  • Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)
  • Photosensitive Polymer And Photoresist Processing (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は半導体装置の製法に関し、主として電子ビーム
の照射による微細パターンの形成を対象とするものであ
る。
一般に電子ビームの照射による微細パターンの形成にお
いては、使用する放射線感応性皮膜(以後レジストと記
す)の特性によって、形成されるパターンに限界が生じ
る。通常ポジ型レジストは高解像性を有するが、電子ビ
ームに対する感度が低かったり、耐エツチング性が劣っ
たシする。ネガ型レジストは感度、耐エツチング性とも
ポジ型レジストよりも優れているが、解像性に劣るとい
う欠点をもっていることが原因である。
本発明は上記の問題を解決するためなされたもので、そ
の目的とするところは、高解像性であ\り且つ、耐エツ
チング性の良い微細パターン形成法を提供しようとする
ものである。
本発明の基本的な構成は、第1および第2のレジスト層
を順次、半導体、絶縁膜゛または金属膜」二に塗布し、
前記第2層のレジス、トを露光現像し、露出した前記第
1層のレジストの表面を変質させた後、前記露出面領域
以外にある第1.第2のレジスト層を除去し、微細なパ
ターンを形成するというものである。すなわち、本発明
の特徴とする点は、前記第1層レジストの露出面を変質
させる点にある。
以下実施例にそって図面を参照しながら、本発明の構成
を具体的に説明する。第1図〜第3図はパターン形成法
の工程を示した工程断面図である。
半導体、絶縁体あるいは金属等よシなる基板1上に第1
層のレジスト層2としてネガ型しジストPGMム(ポリ
グリシジルメタクリレート)、第2層のレジスト層3と
してポジ型しジストPMMム(ポリメチルメタクリレー
ト)を塗布する(第1図)。次に、前記第2層のレジス
ト層3を所定のパターンに露光現像し、前記第1層のレ
ジスト層2の露出面4を形成した後、濃硫酸中に浸漬す
る(第2図)。次に、上記の所定パターンを有する前記
両しンスト層2,3面を酸素プラズマ中にさらすと、第
1層のフォトレジスト層2の露出面4以外の個所に存す
る前記第1層および第2層の両レジスト層2,3が除去
され、かくして、前記第1層のレジスト層2が所望パタ
ーン6を形成する(第3図)。
第3図において露出面4の部分に存する第1Mのレジス
ト層2が残る理由は明確でないが、前記第1層のレジス
ト層2を濃硫酸に浸漬するとその種類によって挙動が異
なることがわかった。表にPCMム、PMMムの硫酸浸
漬処理と酸素プラズマによる除去時間の関係を示す。
表 表かられかるごとく、PMMムは硫酸中に浸漬されると
それだけで分解されるが、PCMムの方は硫酸中に浸漬
することによシ酸素プラズマ耐性が増す。すなわち、酸
素プラズマによりPCMムが灰化される時間は硫酸に浸
漬することにより20分から40分になる。
従って、第1層にPCMム、第2層にPMMムを形成し
て、゛第2図のごとき第2層のPMMムのパターンを形
成し、濃硫酸中に浸漬すると、濃硫酸にさらされた第1
層のPCMムの露出面4はプラズマ耐性が増し、同時に
第2層のPMMムは分解除去される。第2層のPMMム
が除去された後の状態は第1層のPGM五表面表面択的
にプラズマ耐性が増した様になる。この後、プラズマ処
理をすると第2図の露出面4以外の第1層のPCMムが
除去される。
以上の様に、第3図で示すパターン5を形成するに要す
る時間は硫酸浸漬を行なわないPCMムの除去のだめの
プラズマ処理時間(灰化時間)と同じく20分で良いこ
とが理解できる。
本発明の方法によれば、第2層に用いるボン型レジスト
層の厚みは薄くてすむので、高解像のパターンが得られ
る。第1層へ第2層のパターンを転写する手段として、
平行平板型プラズマ装置による異方性エツチングを用い
れば、第1層が厚くても解像性を低下させることなく処
理出来る。従って、第1層の厚みを増すことが出来るの
で、電子ビーム露光の際に起る後方散乱効果が押えられ
、いっそう第2層のパターンの解像性が向上する。
電子線感光性皮膜では一般にポジ型よりネガ型の方が、
CF4 、CCJ14 系ガスのプラズマに対して耐エ
ツチング性がよい。第1層に厚いネガ型レジストを使用
することによって、基板あるいは絶縁膜。
金属膜をエツチングする工程における耐エツチング性を
向上させることができる。
尚、本発明は上記した実施例以外に下記の態様で実施で
きる。すなわち、本実施例では一第1層としてPCMム
を用いたが、ポジ型あるいはネガ型の紫外線感光性レジ
ストを使用することができる。第2層としてPMMムを
用いたが、PBS 。
FBM等の高感度、高解像性であるが、プラズマ中で分
解し易い電子線感光性レジストを用いることができる。
また、硫酸浸漬の代りに、イオン注入、イオンビーム照
射、プラズマ照射を用いて変質処理を行なうことができ
る。
以上、本発明による方法は高解像かつ耐エツチング性に
すぐれたレジストパターンを形成出来るので工業的価値
が高い。
【図面の簡単な説明】
第1図〜第3図は本発明によるレジストパターンの形成
法の工程断面図を示したものである。 1・・・・・・基板、2・・・・・・第1層レジスト、
3・・・・・・第2層レジスト、4・・・・・・第1層
レジストの露出面、5・・・・・・形成パターン。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名II
II図 第 3rI!J

Claims (4)

    【特許請求の範囲】
  1. (1)基板表面に第1および第2のレジスト層を順次被
    覆する工程と、前記第2のレジスト層に所望のパターン
    を形成して前記第1層のフォトレジスト層を露出する工
    程と、露出した前記第1のレジスト層表面を変質処理す
    る工程を有することを特徴とするパターン形^。
  2. (2)第1のレジスト層にPCMムを、第2のレジスト
    層にPMMムを用いることを特徴とする特許請求範囲第
    1項に記載のパターン形請し。
  3. (3)第1のレジスト層露出面の変質処理を化学組成溶
    液に浸漬して行うことを特徴とする特許請求範囲第1項
    に記載のパターン形at。
  4. (4)第1のレジスト層露出面の変質処理をイオンビー
    ム照射或いはプラズマ照射にて行うことを特徴とする特
    許請求範囲第1項に記載のパターン形−瞥。
JP1608982A 1982-02-03 1982-02-03 パタ−ン形成方法 Pending JPS58132927A (ja)

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