JPH1185138A - 多階調表示装置 - Google Patents
多階調表示装置Info
- Publication number
- JPH1185138A JPH1185138A JP9248061A JP24806197A JPH1185138A JP H1185138 A JPH1185138 A JP H1185138A JP 9248061 A JP9248061 A JP 9248061A JP 24806197 A JP24806197 A JP 24806197A JP H1185138 A JPH1185138 A JP H1185138A
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- Japan
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- rgb
- display
- sets
- unit
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- Pending
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- Controls And Circuits For Display Device (AREA)
- Video Image Reproduction Devices For Color Tv Systems (AREA)
- Processing Of Color Television Signals (AREA)
Abstract
(57)【要約】
【課題】 階調数を上げようとすると、その分、ＲＧＢ
の各データ幅を増やさなければならず、そのために配線
数が増加し、ラインメモリのメモリ容量も増加するとい
う問題点を有する。 【解決手段】 ＲＧＢ各々ＮビットのデータをＲＧＢ各
々（Ｎ−１）ビットの２組のデータに変換するＲＧＢデ
ータ変換部２と、フィールドを検出するフィールド検出
部３と、前記フィールド検出部３で検出したフィールド
毎に前記ＲＧＢデータ変換部２で変換された２組のデー
タを交互に書き込む表示データ書き込み部４とからなる
多階調表示装置を提供する。
の各データ幅を増やさなければならず、そのために配線
数が増加し、ラインメモリのメモリ容量も増加するとい
う問題点を有する。 【解決手段】 ＲＧＢ各々ＮビットのデータをＲＧＢ各
々（Ｎ−１）ビットの２組のデータに変換するＲＧＢデ
ータ変換部２と、フィールドを検出するフィールド検出
部３と、前記フィールド検出部３で検出したフィールド
毎に前記ＲＧＢデータ変換部２で変換された２組のデー
タを交互に書き込む表示データ書き込み部４とからなる
多階調表示装置を提供する。
Description
【０００１】
【発明の属する技術分野】本発明はＲＧＢの情報を表示
装置に表示するための多階調表示装置に関するものであ
る。
装置に表示するための多階調表示装置に関するものであ
る。
【０００２】
【従来の技術】近年、パーソナルコンピュータなどの普
及に伴い、多階調のＲＧＢデータを表示する多階調表示
装置が製品化されている。
及に伴い、多階調のＲＧＢデータを表示する多階調表示
装置が製品化されている。
【０００３】以下に従来の多階調表示装置について説明
する。図２は従来の多階調表示装置の構成を示すもので
ある。図２において、７は表示するＲＧＢデータを記憶
するための表示メモリ、８は前記表示メモリ７のデータ
を表示するためのＲＧＢデータとして、順次、後段のラ
インメモリ９に書き込む表示データ書き込み部、９は前
記表示データ書き込み部８により書き込まれたＲＧＢデ
ータを１ライン分記憶し、順次、表示クロック毎に該当
するＲＧＢデータを出力するラインメモリ部、１０は前
記ラインメモリ部５から出力されたＲＧＢの各々のデー
タをデジタルからアナログに変換するデジタルアナログ
変換部である。
する。図２は従来の多階調表示装置の構成を示すもので
ある。図２において、７は表示するＲＧＢデータを記憶
するための表示メモリ、８は前記表示メモリ７のデータ
を表示するためのＲＧＢデータとして、順次、後段のラ
インメモリ９に書き込む表示データ書き込み部、９は前
記表示データ書き込み部８により書き込まれたＲＧＢデ
ータを１ライン分記憶し、順次、表示クロック毎に該当
するＲＧＢデータを出力するラインメモリ部、１０は前
記ラインメモリ部５から出力されたＲＧＢの各々のデー
タをデジタルからアナログに変換するデジタルアナログ
変換部である。
【０００４】以上のように構成された多階調表示装置に
ついて、以下その動作について説明する。
ついて、以下その動作について説明する。
【０００５】まず、表示メモリ７にはＲＧＢ各Ｎビット
の表示データが記憶されており、表示データ書き込み部
８は表示タイミングに応じて該当する１ライン分のＲＧ
Ｂ各データを表示メモリ７から読みだし、ラインメモリ
９に順次書き込む。この時、ラインメモリ９の１ワード
はＮ×３ビットである。すなわち、１画素当たりのＲＧ
Ｂデータを１ワードとして処理する。
の表示データが記憶されており、表示データ書き込み部
８は表示タイミングに応じて該当する１ライン分のＲＧ
Ｂ各データを表示メモリ７から読みだし、ラインメモリ
９に順次書き込む。この時、ラインメモリ９の１ワード
はＮ×３ビットである。すなわち、１画素当たりのＲＧ
Ｂデータを１ワードとして処理する。
【０００６】ラインメモリ９は表示データ書き込み部８
により書き込まれた１ライン分のＲＧＢ表示データを表
示タイミングに応じて出力する。出力されたＲＧＢ各Ｎ
ビットのデータは各々ＲＧＢ用のデジタルアナログ変換
部１０で各々ＲＧＢアナログ信号に変換されて出力され
る。
により書き込まれた１ライン分のＲＧＢ表示データを表
示タイミングに応じて出力する。出力されたＲＧＢ各Ｎ
ビットのデータは各々ＲＧＢ用のデジタルアナログ変換
部１０で各々ＲＧＢアナログ信号に変換されて出力され
る。
【０００７】
【発明が解決しようとする課題】しかしながら上記の従
来の構成では、階調数を上げようとすると、その分、Ｒ
ＧＢの各データ幅を増やさなければならず、そのために
配線数が増加し、ラインメモリのメモリ容量も増加する
という問題点を有していた。
来の構成では、階調数を上げようとすると、その分、Ｒ
ＧＢの各データ幅を増やさなければならず、そのために
配線数が増加し、ラインメモリのメモリ容量も増加する
という問題点を有していた。
【０００８】本発明は上記従来の問題点を解決するもの
で、ＲＧＢの各データ幅を増やすことなく、ほぼ２倍の
階調を表現することが可能な多階調表示装置を提供する
ことを目的とするものである。
で、ＲＧＢの各データ幅を増やすことなく、ほぼ２倍の
階調を表現することが可能な多階調表示装置を提供する
ことを目的とするものである。
【０００９】
【課題を解決するための手段】この目的を達成するため
に本発明の多階調表示装置は、ＲＧＢ各々Ｎビットのデ
ータをＲＧＢ各々（Ｎ−１）ビットの２組のデータに変
換するＲＧＢデータ変換部とフィールドを検出するフィ
ールド検出部と前記フィールド検出部で検出したフィー
ルド毎に前記ＲＧＢ変換部で変換された２組のデータを
交互に書き込む表示データ書き込み部からなる構成を有
している。
に本発明の多階調表示装置は、ＲＧＢ各々Ｎビットのデ
ータをＲＧＢ各々（Ｎ−１）ビットの２組のデータに変
換するＲＧＢデータ変換部とフィールドを検出するフィ
ールド検出部と前記フィールド検出部で検出したフィー
ルド毎に前記ＲＧＢ変換部で変換された２組のデータを
交互に書き込む表示データ書き込み部からなる構成を有
している。
【００１０】
【発明の実施の形態】本発明の多階調表示装置は、ＲＧ
Ｂ各々Ｎビットの画像データを表示するインターレース
表示において、ＲＧＢ各々ＮビットのデータをＲＧＢ各
々（Ｎ−１）ビットの２組のデータに変換するＲＧＢデ
ータ変換部と、フィールドを検出するフィールド検出部
と、前記フィールド検出部で検出したフィールド毎に前
記ＲＧＢデータ変換部で変換された２組のデータを交互
に書き込む表示データ書き込み部とからなるものであ
り、この構成によって、２つのフィールドのＲＧＢデー
タで１つのＲＧＢの輝度レベルを表すことが可能とな
り、ＲＧＢ各Ｎ−１ビットのデータ幅でＲＧＢ各Ｎビッ
トのデータ幅で表現できる階調数から１少ない階調数の
表示が可能となる。
Ｂ各々Ｎビットの画像データを表示するインターレース
表示において、ＲＧＢ各々ＮビットのデータをＲＧＢ各
々（Ｎ−１）ビットの２組のデータに変換するＲＧＢデ
ータ変換部と、フィールドを検出するフィールド検出部
と、前記フィールド検出部で検出したフィールド毎に前
記ＲＧＢデータ変換部で変換された２組のデータを交互
に書き込む表示データ書き込み部とからなるものであ
り、この構成によって、２つのフィールドのＲＧＢデー
タで１つのＲＧＢの輝度レベルを表すことが可能とな
り、ＲＧＢ各Ｎ−１ビットのデータ幅でＲＧＢ各Ｎビッ
トのデータ幅で表現できる階調数から１少ない階調数の
表示が可能となる。
【００１１】（実施の形態１）以下本発明の一実施例に
ついて、図面を参照しながら説明する。
ついて、図面を参照しながら説明する。
【００１２】図１において、１は表示するＲＧＢデータ
を記憶するための表示メモリ、２はＲＧＢ各々Ｎビット
のデータをＲＧＢ各々Ｎ−１ビットの２組のデータに変
換するＲＧＢデータ変換部、３はフィールドを検出する
フィールド検出部、４は前記フィールド検出部で検出し
たフィールド毎に前記ＲＧＢ変換部で変換された２組の
データを交互に書き込む表示データ書き込み部、５は前
記表示データ書き込み部４により書き込まれたＲＧＢデ
ータを１ライン分記憶し、順次、表示クロック毎に該当
するＲＧＢデータを出力するラインメモリ部、６は前記
ラインメモリ部から出力されたＲＧＢの各々のデータを
デジタルからアナログに変換するデジタルアナログ変換
部である以上のように構成された多階調表示装置におい
て、その動作を説明する。まず、表示メモリにはＲＧＢ
各々Ｎビットのデータを記憶している。このデータをＲ
ＧＢデータ変換部でＲＧＢ各々ＮビットのデータをＲＧ
Ｂ各々Ｎ−１ビットの第１フィールドと第２フィールド
の２組のデータに変換する。例えば、Ｎ＝３でＲデータ
については、
を記憶するための表示メモリ、２はＲＧＢ各々Ｎビット
のデータをＲＧＢ各々Ｎ−１ビットの２組のデータに変
換するＲＧＢデータ変換部、３はフィールドを検出する
フィールド検出部、４は前記フィールド検出部で検出し
たフィールド毎に前記ＲＧＢ変換部で変換された２組の
データを交互に書き込む表示データ書き込み部、５は前
記表示データ書き込み部４により書き込まれたＲＧＢデ
ータを１ライン分記憶し、順次、表示クロック毎に該当
するＲＧＢデータを出力するラインメモリ部、６は前記
ラインメモリ部から出力されたＲＧＢの各々のデータを
デジタルからアナログに変換するデジタルアナログ変換
部である以上のように構成された多階調表示装置におい
て、その動作を説明する。まず、表示メモリにはＲＧＢ
各々Ｎビットのデータを記憶している。このデータをＲ
ＧＢデータ変換部でＲＧＢ各々ＮビットのデータをＲＧ
Ｂ各々Ｎ−１ビットの第１フィールドと第２フィールド
の２組のデータに変換する。例えば、Ｎ＝３でＲデータ
については、
【００１３】
【表１】
【００１４】のように変換する。Ｇデータ及びＢデータ
についても同様である。ＲＧＢデータ変換部により第１
フィールドと第２フィールドの２組のデータに変換され
たデータはフィールド検出部で検出されたフィールドに
応じて２組のデータのどちらかのデータを表示データ書
き込み部によりラインメモリ部に書き込まれる。ライン
メモリ部からは表示タイミングに応じてＲＧＢの各デー
タがアナログデジタル変換部に出力され、アナログＲＧ
Ｂ信号として出力される。
についても同様である。ＲＧＢデータ変換部により第１
フィールドと第２フィールドの２組のデータに変換され
たデータはフィールド検出部で検出されたフィールドに
応じて２組のデータのどちらかのデータを表示データ書
き込み部によりラインメモリ部に書き込まれる。ライン
メモリ部からは表示タイミングに応じてＲＧＢの各デー
タがアナログデジタル変換部に出力され、アナログＲＧ
Ｂ信号として出力される。
【００１５】以上のように本実施例によれば、ＲＧＢ各
々ＮビットのデータをＲＧＢ各々Ｎー１ビットの２組の
データに変換するＲＧＢデータ変換部とフィールドを検
出するフィールド検出部と前記フィールド検出部で検出
したフィールド毎に前記ＲＧＢ変換部で変換された２組
のデータを交互に書き込む表示データ書き込み部を設け
ることにより、２フィールドで１つの画素の階調を表現
することでＲＧＢ各々Ｎー１ビットのデータ幅でＲＧＢ
各Ｎビットのデータ幅で表現できる階調数とほぼ等価な
表示が可能となる。
々ＮビットのデータをＲＧＢ各々Ｎー１ビットの２組の
データに変換するＲＧＢデータ変換部とフィールドを検
出するフィールド検出部と前記フィールド検出部で検出
したフィールド毎に前記ＲＧＢ変換部で変換された２組
のデータを交互に書き込む表示データ書き込み部を設け
ることにより、２フィールドで１つの画素の階調を表現
することでＲＧＢ各々Ｎー１ビットのデータ幅でＲＧＢ
各Ｎビットのデータ幅で表現できる階調数とほぼ等価な
表示が可能となる。
【００１６】
【発明の効果】以上のように本発明は、ＲＧＢ各々Ｎビ
ットのデータをＲＧＢ各々Ｎ−１ビットの２組のデータ
に変換するＲＧＢデータ変換部とフィールドを検出する
フィールド検出部と前記フィールド検出部で検出したフ
ィールド毎に前記ＲＧＢ変換部で変換された２組のデー
タを交互に書き込む表示データ書き込み部を設けること
により、ＲＧＢの各データ幅を増やすことなく、ほぼ２
倍の階調を表現することが可能となり、配線数やライン
メモリのメモリ容量を増加させることなく階調数の増加
が可能な多階調表示装置を実現できるものである。
ットのデータをＲＧＢ各々Ｎ−１ビットの２組のデータ
に変換するＲＧＢデータ変換部とフィールドを検出する
フィールド検出部と前記フィールド検出部で検出したフ
ィールド毎に前記ＲＧＢ変換部で変換された２組のデー
タを交互に書き込む表示データ書き込み部を設けること
により、ＲＧＢの各データ幅を増やすことなく、ほぼ２
倍の階調を表現することが可能となり、配線数やライン
メモリのメモリ容量を増加させることなく階調数の増加
が可能な多階調表示装置を実現できるものである。
【図１】本発明の一実施の形態例における多階調表示装
置の構成を示す図
置の構成を示す図
【図２】従来の多階調表示装置の構成を示す図
１、７ 表示メモリ ２、８ ＲＧＢデータ変換部 ３ フィールド検出部 ４ 表示データ書き込み部 ５、９ ラインメモリ部 ６、１０ デジタルアナログ変換部
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.6 識別記号 ＦＩ Ｈ０４Ｎ 9/64 Ｈ０４Ｎ 9/64 Ｆ
Claims (1)
- 【請求項１】 ＲＧＢ各々Ｎビットの画像データを表示
するインターレース表示において、ＲＧＢ各々Ｎビット
のデータをＲＧＢ各々（Ｎ−１）ビットの２組のデータ
に変換するＲＧＢデータ変換部と、フィールドを検出す
るフィールド検出部と、前記フィールド検出部で検出し
たフィールド毎に前記ＲＧＢデータ変換部で変換された
２組のデータを交互に書き込む表示データ書き込み部と
からなる多階調表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9248061A JPH1185138A (ja) | 1997-09-12 | 1997-09-12 | 多階調表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9248061A JPH1185138A (ja) | 1997-09-12 | 1997-09-12 | 多階調表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH1185138A true JPH1185138A (ja) | 1999-03-30 |
Family
ID=17172630
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9248061A Pending JPH1185138A (ja) | 1997-09-12 | 1997-09-12 | 多階調表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH1185138A (ja) |
-
1997
- 1997-09-12 JP JP9248061A patent/JPH1185138A/ja active Pending
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