JPH11194367A - 表示装置 - Google Patents
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- JPH11194367A JPH11194367A JP28708398A JP28708398A JPH11194367A JP H11194367 A JPH11194367 A JP H11194367A JP 28708398 A JP28708398 A JP 28708398A JP 28708398 A JP28708398 A JP 28708398A JP H11194367 A JPH11194367 A JP H11194367A
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- display
- display device
- drive circuit
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- film transistor
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Abstract
(57)【要約】
【課題】 ドライバーを内蔵したＬＣＤにおいて、周縁
シール材によりドライバーが動作不良となることを防
ぐ。 【解決手段】 シール材３が水平シフトレジスタ６１及
びサンプリング部６２からなるドレインドライバー上を
通過するが、水平シフトレジスタ６１上領域においてシ
ール材３の縁線が直線状にされている。シール材３直下
ではＴＦＴ素子の動作特性が変化するので、シール材３
の領域外のＴＦＴ素子と動作特性が異なるが、段間で動
作特性が異なることが無くなり、表示に悪影響がでるこ
とが防がれる。
シール材によりドライバーが動作不良となることを防
ぐ。 【解決手段】 シール材３が水平シフトレジスタ６１及
びサンプリング部６２からなるドレインドライバー上を
通過するが、水平シフトレジスタ６１上領域においてシ
ール材３の縁線が直線状にされている。シール材３直下
ではＴＦＴ素子の動作特性が変化するので、シール材３
の領域外のＴＦＴ素子と動作特性が異なるが、段間で動
作特性が異なることが無くなり、表示に悪影響がでるこ
とが防がれる。
Description
【０００１】
【発明の属する技術分野】本発明は、液晶等の光学部材
を用いた表示装置に関し、特に、駆動回路を内蔵した表
示装置に関する。
を用いた表示装置に関し、特に、駆動回路を内蔵した表
示装置に関する。
【０００２】
【従来の技術】所定の電極配線が形成された一組の基板
を細隙をもって貼り合わせ、その細隙に液晶を封入する
ことで、表示画素として液晶を誘電層とした容量を構成
してなる液晶表示装置（ＬＣＤ）、あるいは、電流量に
より発光量が制御できる有機エレクトロルミネッセンス
（ＥＬ）を用いた有機ＥＬ表示装置は、小型、薄型、低
消費電力の利点から、ＯＡ機器、ＡＶ機器の分野におい
て、ディスプレイとして広く用いられている。特に、Ｌ
ＣＤにおいて、各表示画素容量に表示信号電圧の書き込
みと保持を制御するためにスイッチング素子として薄膜
トランジスタ（ＴＦＴ）を接続形成したアクティブマト
リクス型は、高精細な表示を行うことができ、主流とな
っている。
を細隙をもって貼り合わせ、その細隙に液晶を封入する
ことで、表示画素として液晶を誘電層とした容量を構成
してなる液晶表示装置（ＬＣＤ）、あるいは、電流量に
より発光量が制御できる有機エレクトロルミネッセンス
（ＥＬ）を用いた有機ＥＬ表示装置は、小型、薄型、低
消費電力の利点から、ＯＡ機器、ＡＶ機器の分野におい
て、ディスプレイとして広く用いられている。特に、Ｌ
ＣＤにおいて、各表示画素容量に表示信号電圧の書き込
みと保持を制御するためにスイッチング素子として薄膜
トランジスタ（ＴＦＴ）を接続形成したアクティブマト
リクス型は、高精細な表示を行うことができ、主流とな
っている。
【０００３】図１１は、ＬＣＤの全容を示す平面図であ
る。（１）は紙面向こう側に位置するＴＦＴ基板、
（２）は紙面手前に位置する対向基板、（３）は基板
（１）と基板（２）とを貼り合わせる周縁シール材であ
り、エポキシ樹脂等の熱硬化性の接着材、ＵＶ光の照射
により硬化する樹脂等からなる。ＴＦＴ基板（１）と対
向基板（２）との間には、不図示のスペーサにより支持
された細隙があり、また、シール材（３）は一部が切り
欠かれて注入孔（３１）となっている。この注入孔（３
１）より内部の細隙に液晶を注入し、注入孔（３１）を
封止材（３２）で塞ぐことにより液晶が密封されてい
る。
る。（１）は紙面向こう側に位置するＴＦＴ基板、
（２）は紙面手前に位置する対向基板、（３）は基板
（１）と基板（２）とを貼り合わせる周縁シール材であ
り、エポキシ樹脂等の熱硬化性の接着材、ＵＶ光の照射
により硬化する樹脂等からなる。ＴＦＴ基板（１）と対
向基板（２）との間には、不図示のスペーサにより支持
された細隙があり、また、シール材（３）は一部が切り
欠かれて注入孔（３１）となっている。この注入孔（３
１）より内部の細隙に液晶を注入し、注入孔（３１）を
封止材（３２）で塞ぐことにより液晶が密封されてい
る。
【０００４】ＴＦＴ基板（１）は、基板上にチャンネル
層として多結晶シリコン（ｐ−Ｓｉ）を用いたＴＦＴが
形成されてなる。この基板（１）上には、複数のゲート
ライン（ＧＬ）とドレインライン（ＤＬ）が交差配置さ
れ、これらの交差部には画素ＴＦＴ（ＳＥ）及び画素Ｔ
ＦＴ（ＳＥ）に接続された表示画素容量の一方を成す画
素電極（ＰＸ）が形成されてなる表示領域（４）と、表
示領域（４）の周辺に、主として双方向シフトレジスタ
からなり画素ＴＦＴ（ＳＥ）に走査信号を供給するゲー
トドライバー（５）、および、主として双方向シフトレ
ジスタとアナログスイッチからなりゲートドライバー
（５）の走査に同期して画素ＴＦＴ（ＳＥ）に表示信号
電圧を供給するドレインドライバー（６）、さらには、
シフトレジスタのシフト方向を切り換えて各ドライバー
（５，６）の動作方向を切り換える制御回路（７）が形
成されている。これらドライバー（５，６）は、表示領
域（４）と同じ構造のｐ−ＳｉＴＦＴから構成される
が、ｐ−ＳｉＴＦＴは動作速度が十分に速いため、この
ように画素ＴＦＴ（ＳＥ）としてのみならず、これを駆
動するための周辺ドライバーをも構成することができ、
ドライバーを表示パネルに内蔵形成したドライバー内蔵
型ＬＣＤが可能となっている。これらのＴＦＴはアクリ
ル樹脂、ＳＯＧ（SPIN ON GLASS）、ＢＰＳＧ（BORO-PH
OSPHO SILICATE GLASS）等の平坦化絶縁膜により覆われ
ており、表示領域（４）においては、画素電極（ＰＸ）
がこの上に形成されて、平坦化絶縁膜に開けられたコン
タクトホールを介して画素ＴＦＴ（ＳＥ）に接続された
構造となっている。（８）はこれらドライバーの信号入
力端子である。
層として多結晶シリコン（ｐ−Ｓｉ）を用いたＴＦＴが
形成されてなる。この基板（１）上には、複数のゲート
ライン（ＧＬ）とドレインライン（ＤＬ）が交差配置さ
れ、これらの交差部には画素ＴＦＴ（ＳＥ）及び画素Ｔ
ＦＴ（ＳＥ）に接続された表示画素容量の一方を成す画
素電極（ＰＸ）が形成されてなる表示領域（４）と、表
示領域（４）の周辺に、主として双方向シフトレジスタ
からなり画素ＴＦＴ（ＳＥ）に走査信号を供給するゲー
トドライバー（５）、および、主として双方向シフトレ
ジスタとアナログスイッチからなりゲートドライバー
（５）の走査に同期して画素ＴＦＴ（ＳＥ）に表示信号
電圧を供給するドレインドライバー（６）、さらには、
シフトレジスタのシフト方向を切り換えて各ドライバー
（５，６）の動作方向を切り換える制御回路（７）が形
成されている。これらドライバー（５，６）は、表示領
域（４）と同じ構造のｐ−ＳｉＴＦＴから構成される
が、ｐ−ＳｉＴＦＴは動作速度が十分に速いため、この
ように画素ＴＦＴ（ＳＥ）としてのみならず、これを駆
動するための周辺ドライバーをも構成することができ、
ドライバーを表示パネルに内蔵形成したドライバー内蔵
型ＬＣＤが可能となっている。これらのＴＦＴはアクリ
ル樹脂、ＳＯＧ（SPIN ON GLASS）、ＢＰＳＧ（BORO-PH
OSPHO SILICATE GLASS）等の平坦化絶縁膜により覆われ
ており、表示領域（４）においては、画素電極（ＰＸ）
がこの上に形成されて、平坦化絶縁膜に開けられたコン
タクトホールを介して画素ＴＦＴ（ＳＥ）に接続された
構造となっている。（８）はこれらドライバーの信号入
力端子である。
【０００５】対向基板（２）は、表示画素容量の他方を
成す共通電極（９）が表示領域（４）に対応して全面的
に形成されている。表示画素容量は、液晶および共通電
極（９）が画素電極に区画された形で構成されている。
共通電極（９）の一部は、基板（２）の角部に引き出さ
れて第２の対極接続端子（９１）とされている。また、
ＴＦＴ基板（１）には、共通電極（９）用の対極信号入
力端子（９１）が設けられており、引き回し線（８２）
により対極接続端子（９１）に対応する領域に形成され
た第１の対極接続端子（８３）へと引き回され、これら
第１および第２の対極接続端子（９１，８３）が導電性
接着材（９２）により接続されている。
成す共通電極（９）が表示領域（４）に対応して全面的
に形成されている。表示画素容量は、液晶および共通電
極（９）が画素電極に区画された形で構成されている。
共通電極（９）の一部は、基板（２）の角部に引き出さ
れて第２の対極接続端子（９１）とされている。また、
ＴＦＴ基板（１）には、共通電極（９）用の対極信号入
力端子（９１）が設けられており、引き回し線（８２）
により対極接続端子（９１）に対応する領域に形成され
た第１の対極接続端子（８３）へと引き回され、これら
第１および第２の対極接続端子（９１，８３）が導電性
接着材（９２）により接続されている。
【０００６】図１２は、ＬＣＤの一部拡大平面図であ
る。ゲートドライバー（５）は、図の縦辺に沿って設け
られた垂直シフトレジスタ（５１）とバッファ部（５
２）からなる。ドレインドライバー（６）は、図の横辺
に沿って設けられた水平シフトレジスタ（６１）と、各
列毎に対応したアナログスイッチからなるサンプリング
部（６２９からなる。アナログスイッチは、水平シフト
レジスタ（６１）の各出力段によりオン／オフを制御さ
れ、各水平期間内における各列に割り当てられたドット
期間に同期して、外部から供給された原画信号より表示
信号電圧をサンプリングして各列に出力する。
る。ゲートドライバー（５）は、図の縦辺に沿って設け
られた垂直シフトレジスタ（５１）とバッファ部（５
２）からなる。ドレインドライバー（６）は、図の横辺
に沿って設けられた水平シフトレジスタ（６１）と、各
列毎に対応したアナログスイッチからなるサンプリング
部（６２９からなる。アナログスイッチは、水平シフト
レジスタ（６１）の各出力段によりオン／オフを制御さ
れ、各水平期間内における各列に割り当てられたドット
期間に同期して、外部から供給された原画信号より表示
信号電圧をサンプリングして各列に出力する。
【０００７】
【発明が解決しようとする課題】シール材（３）である
エポキシ樹脂やＵＶ樹脂中には、塗布時の乾燥後に残る
水分や、外気中の水分や不純物イオン等が含まれている
ことがあり、シール材（３）の下地となっている平坦化
絶縁膜に分極を発生させ、平坦化絶縁膜下にあるＴＦＴ
のバックチャネル効果を招いて閾値の変動をさせる。こ
のため、図１１に示すように、シール材（３）が、ゲー
トドライバー（５）やドレインドライバー（６）の領域
上を通過する構成において、特に、シフトレジスタのよ
うな論理回路がシール材（３）直下にあり、それらの各
ＴＦＴ素子の動作特性が変わると、誤動作、更には、不
動作の問題を招く。
エポキシ樹脂やＵＶ樹脂中には、塗布時の乾燥後に残る
水分や、外気中の水分や不純物イオン等が含まれている
ことがあり、シール材（３）の下地となっている平坦化
絶縁膜に分極を発生させ、平坦化絶縁膜下にあるＴＦＴ
のバックチャネル効果を招いて閾値の変動をさせる。こ
のため、図１１に示すように、シール材（３）が、ゲー
トドライバー（５）やドレインドライバー（６）の領域
上を通過する構成において、特に、シフトレジスタのよ
うな論理回路がシール材（３）直下にあり、それらの各
ＴＦＴ素子の動作特性が変わると、誤動作、更には、不
動作の問題を招く。
【０００８】更に、ＴＦＴ素子の特性変化が僅かであっ
ても、図１２に示すように、シール材（３）の特に外側
縁線が湾曲した部分がドレインドライバー（６）上にあ
るような形状になっている場合、ドレインドライバー
（６）の各出力段の中で、シール材（３）下にあるもの
とそれ以外のものとで動作に違いが生じる。この結果、
シール材（３）下にある出力段に対応する表示領域
（４）の列と、シール材（３）以外の領域にある列とで
は、表示特性が異なってしまう。ゲートドライバー
（５）側に関しても同様に、ゲートドライバー（５）の
対応する段がシール材（３）の直下にある行と、シール
材（３）以外の領域にある行とでも表示特性異なる。図
において、影部を付した領域は、ゲートドライバー
（５）またはドレインドライバー（６）の対応する段が
シール材（３）以外の領域にあり、影部を付さない領域
は対応する段がシール材（３）の直下にある。影部を付
した領域は表示特性の変動が無い領域であり、影部を付
さない領域には表示特性の変動がある領域であるが、表
示上は、影部を付した領域が他の領域と異なって見え
る。また、シール材（３）の湾曲した外側の縁部には大
きな力がかかり、その下にあるＴＦＴ素子の特性に影響
を与えるため、対応するドライバー（５，６）の段がシ
ール材（３）の湾曲部分にある領域は、他の領域と異な
って見える。このように、表示領域（４）内に、表示特
性の異なる領域が混在すると、表示品位を低下させる。
ても、図１２に示すように、シール材（３）の特に外側
縁線が湾曲した部分がドレインドライバー（６）上にあ
るような形状になっている場合、ドレインドライバー
（６）の各出力段の中で、シール材（３）下にあるもの
とそれ以外のものとで動作に違いが生じる。この結果、
シール材（３）下にある出力段に対応する表示領域
（４）の列と、シール材（３）以外の領域にある列とで
は、表示特性が異なってしまう。ゲートドライバー
（５）側に関しても同様に、ゲートドライバー（５）の
対応する段がシール材（３）の直下にある行と、シール
材（３）以外の領域にある行とでも表示特性異なる。図
において、影部を付した領域は、ゲートドライバー
（５）またはドレインドライバー（６）の対応する段が
シール材（３）以外の領域にあり、影部を付さない領域
は対応する段がシール材（３）の直下にある。影部を付
した領域は表示特性の変動が無い領域であり、影部を付
さない領域には表示特性の変動がある領域であるが、表
示上は、影部を付した領域が他の領域と異なって見え
る。また、シール材（３）の湾曲した外側の縁部には大
きな力がかかり、その下にあるＴＦＴ素子の特性に影響
を与えるため、対応するドライバー（５，６）の段がシ
ール材（３）の湾曲部分にある領域は、他の領域と異な
って見える。このように、表示領域（４）内に、表示特
性の異なる領域が混在すると、表示品位を低下させる。
【０００９】また、制御回路（７）が動作不良となる
と、ドライバー（５，６）の動作方向の切り換えを行う
ことができず、ドライバーを内蔵したＬＣＤにあって汎
用性が低下する問題がある。
と、ドライバー（５，６）の動作方向の切り換えを行う
ことができず、ドライバーを内蔵したＬＣＤにあって汎
用性が低下する問題がある。
【００１０】
【課題を解決するための手段】本発明は、前述の課題を
解決するために成され、対向面上に、行列状に配列され
た画素電極群と各画素電極に表示信号電圧を供給する第
１の薄膜トランジスタ群が形成された表示領域、前記表
示領域の周辺に形成された第２の薄膜トランジスタ群か
らなり前記第１の薄膜トランジスタを駆動する複数の駆
動回路領域及び前記駆動回路を制御するための制御回路
領域とが設けられた第１の基板と、共通電極が形成され
た第２の基板とが、周縁に設けられた接着材により光学
部材を間に挟んで貼り合わせてなる表示装置において、
前記接着材は、前記駆動回路領域上にある縁線が、前記
駆動回路領域の長辺方向に延びる直線状にされている構
成である。
解決するために成され、対向面上に、行列状に配列され
た画素電極群と各画素電極に表示信号電圧を供給する第
１の薄膜トランジスタ群が形成された表示領域、前記表
示領域の周辺に形成された第２の薄膜トランジスタ群か
らなり前記第１の薄膜トランジスタを駆動する複数の駆
動回路領域及び前記駆動回路を制御するための制御回路
領域とが設けられた第１の基板と、共通電極が形成され
た第２の基板とが、周縁に設けられた接着材により光学
部材を間に挟んで貼り合わせてなる表示装置において、
前記接着材は、前記駆動回路領域上にある縁線が、前記
駆動回路領域の長辺方向に延びる直線状にされている構
成である。
【００１１】これにより、駆動回路内において段間で接
着材により異なる影響を受けることが防がれ、表示領域
内で表示が異なる領域が混在することを無くせる。
着材により異なる影響を受けることが防がれ、表示領域
内で表示が異なる領域が混在することを無くせる。
【００１２】特に、前記接着材は、前記制御回路領域を
回避している構成である。
回避している構成である。
【００１３】これにより、駆動回路の動作方向の切り換
えが良好に行われる。
えが良好に行われる。
【００１４】また、対向面上に、行列状に配列された画
素電極群と各画素電極に表示信号電圧を供給する第１の
薄膜トランジスタ群が形成された表示領域、前記表示領
域の周辺に形成された第２の薄膜トランジスタ群からな
り前記第１の薄膜トランジスタを駆動する複数の駆動回
路領域が設けられた第１の基板と、共通電極が形成され
た第２の基板とが、周縁に設けられた接着材により光学
部材を間に挟んで貼り合わせてなる表示装置において、
前記接着材は、前記駆動回路領域上にある前記接着材の
縁線が、前記駆動回路領域の長辺方向に延びる直線状に
設けられている構成である。
素電極群と各画素電極に表示信号電圧を供給する第１の
薄膜トランジスタ群が形成された表示領域、前記表示領
域の周辺に形成された第２の薄膜トランジスタ群からな
り前記第１の薄膜トランジスタを駆動する複数の駆動回
路領域が設けられた第１の基板と、共通電極が形成され
た第２の基板とが、周縁に設けられた接着材により光学
部材を間に挟んで貼り合わせてなる表示装置において、
前記接着材は、前記駆動回路領域上にある前記接着材の
縁線が、前記駆動回路領域の長辺方向に延びる直線状に
設けられている構成である。
【００１５】これにより、駆動回路内において段間で接
着材により異なる影響を受けることが防がれ、表示領域
内で表示が異なる領域が混在することを無くせる。
着材により異なる影響を受けることが防がれ、表示領域
内で表示が異なる領域が混在することを無くせる。
【００１６】また、対向面上に、行列状に配列された画
素電極群と各画素電極に表示信号電圧を供給する第１の
薄膜トランジスタ群が形成された表示領域、前記表示領
域の周辺に形成された第２の薄膜トランジスタ群からな
り前記第１の薄膜トランジスタを駆動する複数の駆動回
路領域が設けられた第１の基板と、共通電極が形成され
た第２の基板とが、周縁に設けられた接着材により光学
部材を間に挟んで貼り合わせてなる表示装置において、
前記接着材は、前記駆動回路領域上を回避して設けられ
ている構成である。
素電極群と各画素電極に表示信号電圧を供給する第１の
薄膜トランジスタ群が形成された表示領域、前記表示領
域の周辺に形成された第２の薄膜トランジスタ群からな
り前記第１の薄膜トランジスタを駆動する複数の駆動回
路領域が設けられた第１の基板と、共通電極が形成され
た第２の基板とが、周縁に設けられた接着材により光学
部材を間に挟んで貼り合わせてなる表示装置において、
前記接着材は、前記駆動回路領域上を回避して設けられ
ている構成である。
【００１７】これにより、シフトレジスタが接着材によ
る影響を受けて動作不良となることが防がれる。
る影響を受けて動作不良となることが防がれる。
【００１８】また、対向面上に、行列状に配列された画
素電極群と各画素電極に表示信号電圧を供給する第１の
薄膜トランジスタ群が形成された表示領域、前記表示領
域の周辺に形成された第２の薄膜トランジスタ群からな
り前記第１の薄膜トランジスタを駆動する複数の駆動回
路領域及び前記駆動回路を制御するための制御回路領域
とが設けられた第１の基板と、共通電極が形成された第
２の基板とが、周縁に設けられた接着材により光学部材
を間に挟んで貼り合わせてなる表示装置において、前記
接着材は、前記駆動回路領域上または／及び前記制御回
路領域上を回避して設けられている構成である。
素電極群と各画素電極に表示信号電圧を供給する第１の
薄膜トランジスタ群が形成された表示領域、前記表示領
域の周辺に形成された第２の薄膜トランジスタ群からな
り前記第１の薄膜トランジスタを駆動する複数の駆動回
路領域及び前記駆動回路を制御するための制御回路領域
とが設けられた第１の基板と、共通電極が形成された第
２の基板とが、周縁に設けられた接着材により光学部材
を間に挟んで貼り合わせてなる表示装置において、前記
接着材は、前記駆動回路領域上または／及び前記制御回
路領域上を回避して設けられている構成である。
【００１９】これにより、シフトレジスタや制御回路が
接着材による影響を受けて動作不良となることが防がれ
る。
接着材による影響を受けて動作不良となることが防がれ
る。
【００２０】特に、前記駆動回路は、少なくともシフト
レジスタ及びシフトレジスタの各出力段からの出力に基
づく駆動信号出力部とからなり、前記接着材は、前記シ
フトレジスタ領域または／及び前記制御回路領域を回避
して設けられている構成である。
レジスタ及びシフトレジスタの各出力段からの出力に基
づく駆動信号出力部とからなり、前記接着材は、前記シ
フトレジスタ領域または／及び前記制御回路領域を回避
して設けられている構成である。
【００２１】これにより、シフトレジスタや制御回路が
接着材による影響を受けて動作不良となることが防がれ
る。
接着材による影響を受けて動作不良となることが防がれ
る。
【００２２】更に、対向面上に、行列状に配列された画
素電極群と各画素電極に表示信号電圧を供給する第１の
薄膜トランジスタ群が形成された表示領域、前記表示領
域の周辺に形成された第２の薄膜トランジスタ群からな
り前記第１の薄膜トランジスタを駆動する複数の駆動回
路領域及び前記駆動回路を制御するための制御回路領域
とが設けられた第１の基板と、共通電極が形成された第
２の基板とが、周縁に設けられた接着材により光学部材
を間に挟んで貼り合わせてなる表示装置において、前記
駆動回路は、少なくともシフトレジスタ及びシフトレジ
スタの各出力段からの出力に基づく駆動信号出力部とか
らなり、前記接着材は、前記シフトレジスタ領域または
前記駆動信号出力部のいずれかの領域を全て覆う構成で
ある。
素電極群と各画素電極に表示信号電圧を供給する第１の
薄膜トランジスタ群が形成された表示領域、前記表示領
域の周辺に形成された第２の薄膜トランジスタ群からな
り前記第１の薄膜トランジスタを駆動する複数の駆動回
路領域及び前記駆動回路を制御するための制御回路領域
とが設けられた第１の基板と、共通電極が形成された第
２の基板とが、周縁に設けられた接着材により光学部材
を間に挟んで貼り合わせてなる表示装置において、前記
駆動回路は、少なくともシフトレジスタ及びシフトレジ
スタの各出力段からの出力に基づく駆動信号出力部とか
らなり、前記接着材は、前記シフトレジスタ領域または
前記駆動信号出力部のいずれかの領域を全て覆う構成で
ある。
【００２３】これにより、シフトレジスタ内の全ての段
に関して、接着材により受ける影響が等しくなり、全て
の段の動作特性が均一になるので、表示領域内において
表示が異なる領域が混在することが防がれる。
に関して、接着材により受ける影響が等しくなり、全て
の段の動作特性が均一になるので、表示領域内において
表示が異なる領域が混在することが防がれる。
【００２４】特に、前記接着材は、前記駆動回路領域の
全てを覆う構成である。
全てを覆う構成である。
【００２５】これにより、駆動回路内の全ての段に関し
て、接着材により受ける影響が等しくなり、全ての段の
動作特性が均一になるので、表示領域内において表示が
異なる領域が混在することが防がれる。
て、接着材により受ける影響が等しくなり、全ての段の
動作特性が均一になるので、表示領域内において表示が
異なる領域が混在することが防がれる。
【００２６】
【発明の実施の形態】図１は、本発明の第１の実施の形
態にかかる液晶表示装置の一部平面図である。（１）及
び（２）は各々、ｐ−ＳｉＴＦＴが形成されたＴＦＴ基
板と対向基板で、平面的にエッジを一致させている。Ｔ
ＦＴ基板（１）は、複数のゲートライン（ＧＬ）及びド
レインライン（ＤＬ）が互いに交差して配置され、それ
らの交差部には画素ＴＦＴ（ＳＥ）及び画素ＴＦＴ（Ｓ
Ｅ）に接続され表示画素容量の一方を成す画素電極（Ｐ
Ｘ）がマトリクス状に配列されてなる表示領域（４）を
有している。また、表示領域（４）の周辺には、双方向
の垂直シフトレジスタ（５１）とその出力部であるバッ
ファ部（５２）からなるゲートドライバー、及び、双方
向の水平シフトレジスタ（６１）とこれに制御される出
力部であるサンプリング部（５２）からなるドレインド
ライバーが設けられている。更に、表示領域（４９の周
辺には、これらシフトレジスタ（５１，６１）のシフト
方向を切り換えて、ドライバーの動作方向を正逆に切り
換えるための制御回路（７）が設けられている。対向基
板（２）には不図示である共通電極が設けられている。
図２は、ゲートドライバー部（５１，５２）の等価回路
図である。下段が垂直シフトレジスタ（５１）部であ
り、上段が出力バッファ部（５２）である。垂直シフト
レジスタ（５１）の各段は、第１のクロックドインバー
タ（５３）とインバータ（５４）及びインバータ（５
４）に逆方向に並列接続された第２のクロックドインバ
ータ（５５）からなる。これら隣接する各段からの出力
はＡＮＤゲート（５６）により論理積が取られて出力さ
れる。これらの垂直シフトレジスタ（５１）からの各出
力段からの段出力は、複数のインバータ（５７）が直列
接続されてなるバッファ部（５２）を介して、所望の振
幅を有した走査信号として、表示領域（４）の対応する
各行のゲートライン（ＧＬ）へと出力され、同一行の各
画素ＴＦＴ（ＳＥ）のゲートへ共通に入力される。
態にかかる液晶表示装置の一部平面図である。（１）及
び（２）は各々、ｐ−ＳｉＴＦＴが形成されたＴＦＴ基
板と対向基板で、平面的にエッジを一致させている。Ｔ
ＦＴ基板（１）は、複数のゲートライン（ＧＬ）及びド
レインライン（ＤＬ）が互いに交差して配置され、それ
らの交差部には画素ＴＦＴ（ＳＥ）及び画素ＴＦＴ（Ｓ
Ｅ）に接続され表示画素容量の一方を成す画素電極（Ｐ
Ｘ）がマトリクス状に配列されてなる表示領域（４）を
有している。また、表示領域（４）の周辺には、双方向
の垂直シフトレジスタ（５１）とその出力部であるバッ
ファ部（５２）からなるゲートドライバー、及び、双方
向の水平シフトレジスタ（６１）とこれに制御される出
力部であるサンプリング部（５２）からなるドレインド
ライバーが設けられている。更に、表示領域（４９の周
辺には、これらシフトレジスタ（５１，６１）のシフト
方向を切り換えて、ドライバーの動作方向を正逆に切り
換えるための制御回路（７）が設けられている。対向基
板（２）には不図示である共通電極が設けられている。
図２は、ゲートドライバー部（５１，５２）の等価回路
図である。下段が垂直シフトレジスタ（５１）部であ
り、上段が出力バッファ部（５２）である。垂直シフト
レジスタ（５１）の各段は、第１のクロックドインバー
タ（５３）とインバータ（５４）及びインバータ（５
４）に逆方向に並列接続された第２のクロックドインバ
ータ（５５）からなる。これら隣接する各段からの出力
はＡＮＤゲート（５６）により論理積が取られて出力さ
れる。これらの垂直シフトレジスタ（５１）からの各出
力段からの段出力は、複数のインバータ（５７）が直列
接続されてなるバッファ部（５２）を介して、所望の振
幅を有した走査信号として、表示領域（４）の対応する
各行のゲートライン（ＧＬ）へと出力され、同一行の各
画素ＴＦＴ（ＳＥ）のゲートへ共通に入力される。
【００２７】図３は、ドレインドライバー部（６１，６
２）の等価回路図である。下段が双方向の水平シフトレ
ジスタ（６１）、上段がサンプリング部（６２）であ
る。水平シフトレジスタ（６１）の各段は、第１のクロ
ックドインバータ（６３）とインバータ（６４）及びイ
ンバータ（６４）に逆方向に並列接続された第２のクロ
ックドインバータ（６５）からなる。これら各出力段か
らの出力は、複数のインバータ（６６）が直列接続され
てなるバッファ部を介してサンプリング部（６２）へと
送られる。サンプリング部（６２）は、ゲートをバッフ
ァ部（６６）の対応する各段に接続したアナログスイッ
チ（６７）と、外部からの原画信号が乗せられたビデオ
ライン（６８）とよりなる。アナログスイッチ（６７）
はビデオライン（６８）に接続されているとともに、水
平シフトレジスタ（６１）部の各段からの出力によりオ
ン／オフが制御され、原画信号から各表示画素へ供給す
べき表示信号をサンプリングし、表示領域（４）の対応
する各列のドレインライン（ＤＬ）へ出力し、同一列の
画素ＴＦＴ（ＳＥ）へ供給される。
２）の等価回路図である。下段が双方向の水平シフトレ
ジスタ（６１）、上段がサンプリング部（６２）であ
る。水平シフトレジスタ（６１）の各段は、第１のクロ
ックドインバータ（６３）とインバータ（６４）及びイ
ンバータ（６４）に逆方向に並列接続された第２のクロ
ックドインバータ（６５）からなる。これら各出力段か
らの出力は、複数のインバータ（６６）が直列接続され
てなるバッファ部を介してサンプリング部（６２）へと
送られる。サンプリング部（６２）は、ゲートをバッフ
ァ部（６６）の対応する各段に接続したアナログスイッ
チ（６７）と、外部からの原画信号が乗せられたビデオ
ライン（６８）とよりなる。アナログスイッチ（６７）
はビデオライン（６８）に接続されているとともに、水
平シフトレジスタ（６１）部の各段からの出力によりオ
ン／オフが制御され、原画信号から各表示画素へ供給す
べき表示信号をサンプリングし、表示領域（４）の対応
する各列のドレインライン（ＤＬ）へ出力し、同一列の
画素ＴＦＴ（ＳＥ）へ供給される。
【００２８】本発明では、図１に示されるように、シー
ル材（３）は、一部がドレインドライバー、特に、水平
シフトレジスタ（６１）上を通過するが、その縁線は、
水平シフトレジスタ（６１）上の領域においては直線状
になっている。水平シフトレジスタ（６１）は、一つの
シフトレジスタ回路が図における表示領域（４）の横辺
について全域にわたって設けられているか、複数のシフ
トレジスタ回路が直列に接続された形で横辺の全域にわ
たって設けられている。いずれにしても、シール材
（３）は、同一辺に関して水平シフトレジスタ（６１）
上の全域にわたって、直線状の縁線をもって水平シフト
レジスタ（６１）上を通過している。このため、たとえ
シール材（３）直下のＴＦＴ素子の特性が変動して、シ
ール材（３）直下とそれ以外の領域のＴＦＴ素子の特性
に違いが生じても、水平シフトレジスタ（６１）の段間
で動作特性が異なることは防がれる。従って、表示領域
（４）においても列間方向に関して表示が異なる領域が
混在することが無くされる。
ル材（３）は、一部がドレインドライバー、特に、水平
シフトレジスタ（６１）上を通過するが、その縁線は、
水平シフトレジスタ（６１）上の領域においては直線状
になっている。水平シフトレジスタ（６１）は、一つの
シフトレジスタ回路が図における表示領域（４）の横辺
について全域にわたって設けられているか、複数のシフ
トレジスタ回路が直列に接続された形で横辺の全域にわ
たって設けられている。いずれにしても、シール材
（３）は、同一辺に関して水平シフトレジスタ（６１）
上の全域にわたって、直線状の縁線をもって水平シフト
レジスタ（６１）上を通過している。このため、たとえ
シール材（３）直下のＴＦＴ素子の特性が変動して、シ
ール材（３）直下とそれ以外の領域のＴＦＴ素子の特性
に違いが生じても、水平シフトレジスタ（６１）の段間
で動作特性が異なることは防がれる。従って、表示領域
（４）においても列間方向に関して表示が異なる領域が
混在することが無くされる。
【００２９】同様に、ゲートドライバー側についても、
シール材（３）は、一部が図における表示領域（４）の
縦辺の全域にわたって垂直シフトレジスタ（５１）上を
通過するが、その縁線は垂直シフトレジスタ（５１）上
では直線状になっている。このため、シール材（３）直
下のＴＦＴ素子の特性が変動しても、垂直シフトレジス
タ（５１）の段間で動作特性が異なることが防がれ、表
示領域（４）においても行間方向に関して表示が異なる
領域が混在することが無くされる。
シール材（３）は、一部が図における表示領域（４）の
縦辺の全域にわたって垂直シフトレジスタ（５１）上を
通過するが、その縁線は垂直シフトレジスタ（５１）上
では直線状になっている。このため、シール材（３）直
下のＴＦＴ素子の特性が変動しても、垂直シフトレジス
タ（５１）の段間で動作特性が異なることが防がれ、表
示領域（４）においても行間方向に関して表示が異なる
領域が混在することが無くされる。
【００３０】また、シール材（３）は、制御回路（７）
上を回避しているので、制御回路（７）の動作不良とな
ることが防がれ、ドライバー（５，６）の動作方向の切
り換えを自在に行うことができる。
上を回避しているので、制御回路（７）の動作不良とな
ることが防がれ、ドライバー（５，６）の動作方向の切
り換えを自在に行うことができる。
【００３１】更に、シール材（３）の湾曲部分が、ドラ
イバー（５，６）上、制御回路（７）上のいずれの領域
にも無いので、シール材（３）の湾曲部分に応力がかか
っても表示に影響を及ぼすことが防がれる。
イバー（５，６）上、制御回路（７）上のいずれの領域
にも無いので、シール材（３）の湾曲部分に応力がかか
っても表示に影響を及ぼすことが防がれる。
【００３２】図４は、本発明の第２の実施の形態にかか
る液晶表示装置の一部平面図である。本実施の形態で
は、シール材（３）は、全幅が、水平シフトレジスタ
（６１）とサンプリング部（６２）からなるドレインド
ライバー上を通過しているが、これらドレインドライバ
ー（６１，６２）上領域におけるシール材（３）の縁線
は直線状とされている。このため、シール材（３）の直
下領域とそれ以外の領域でＴＦＴ素子の特性が異なって
いても、ドレインドライバー（６１，６２）の段間での
動作に差が生じることは無く、表示領域（４）内におい
て列間で表示が異なることが防がれる。
る液晶表示装置の一部平面図である。本実施の形態で
は、シール材（３）は、全幅が、水平シフトレジスタ
（６１）とサンプリング部（６２）からなるドレインド
ライバー上を通過しているが、これらドレインドライバ
ー（６１，６２）上領域におけるシール材（３）の縁線
は直線状とされている。このため、シール材（３）の直
下領域とそれ以外の領域でＴＦＴ素子の特性が異なって
いても、ドレインドライバー（６１，６２）の段間での
動作に差が生じることは無く、表示領域（４）内におい
て列間で表示が異なることが防がれる。
【００３３】特に、本実施の形態では、図４におけるシ
ール材（３）の外側の縁線は、より詳細には図３のＸ線
にて示すように水平シフトレジスタ（６１）部のシフト
レジスタ回路部（６３，６４，６５）とバッファ部（６
６）の間に位置している。即ち、バッファ部（６６）は
シール材（３）の直下領域にあり、シフトレジスタ回路
部（６３，６４，６５）はシール材（３）の領域外にあ
る。シール材（３）の直下においてＴＦＴ素子の閾値が
変動すると論理動作に影響を及ぼすことがあるが、バッ
ファ部（６６）では、段間で差が無い限りにおいて、シ
フトレジスタ回路部（６３，６４，６５）程には閾値変
動の影響を受けない。また、サンプリング部（６７）も
同様に、閾値の変動の影響を受けにくい。このため、た
とえシール材（３）がドレインドライバー（６１，６
２）上を通過しても、シフトレジスタ回路（６３，６
４，６５）上を回避している場合は特に、シフトレジス
タ回路（６３，６４，６５）の正常な論理動作が行われ
るとともに、バッファ部（６６）及びサンプリング部
（６２）において正確な振幅の表示信号の出力が行わ
れ、ドレインドライバー（６１，６２）全体として良好
な動作が行われる。
ール材（３）の外側の縁線は、より詳細には図３のＸ線
にて示すように水平シフトレジスタ（６１）部のシフト
レジスタ回路部（６３，６４，６５）とバッファ部（６
６）の間に位置している。即ち、バッファ部（６６）は
シール材（３）の直下領域にあり、シフトレジスタ回路
部（６３，６４，６５）はシール材（３）の領域外にあ
る。シール材（３）の直下においてＴＦＴ素子の閾値が
変動すると論理動作に影響を及ぼすことがあるが、バッ
ファ部（６６）では、段間で差が無い限りにおいて、シ
フトレジスタ回路部（６３，６４，６５）程には閾値変
動の影響を受けない。また、サンプリング部（６７）も
同様に、閾値の変動の影響を受けにくい。このため、た
とえシール材（３）がドレインドライバー（６１，６
２）上を通過しても、シフトレジスタ回路（６３，６
４，６５）上を回避している場合は特に、シフトレジス
タ回路（６３，６４，６５）の正常な論理動作が行われ
るとともに、バッファ部（６６）及びサンプリング部
（６２）において正確な振幅の表示信号の出力が行わ
れ、ドレインドライバー（６１，６２）全体として良好
な動作が行われる。
【００３４】ゲートドライバー側においても同様に、シ
ール材（３）は、全幅が、垂直シフトレジスタ（５１）
とサンプリング部（５２）からなるゲートドライバー上
を通過しているが、これらゲートドライバー（５１，５
２）上領域におけるシール材（３）の縁線は直線状とさ
れている。従って、シール材（３）直下とそれ以外の領
域とでＴＦＴ素子の特性が異なっていても段間で動作に
違いが生じることが無く、表示領域（４）内において行
間で表示が異なることが防がれる。また、特に、図２に
おいてＸ線にて示すようにシール材（３）の外側の縁線
は、シフトレジスタ回路部（５３，５４，５５）よりも
内側にされている。従って、ＴＦＴ素子の閾値変動がシ
フトレジスタ（５３，５４，５５）の論理動作に影響を
及ぼすことが防がれる。更に、シール材（３）の外側縁
線がＡＮＤゲート（５６）よりも内側とすることでより
安定性がより高まる。また、シール材（３）がバッファ
部（５２）上にかかっていても閾値変動の影響は無い。
ール材（３）は、全幅が、垂直シフトレジスタ（５１）
とサンプリング部（５２）からなるゲートドライバー上
を通過しているが、これらゲートドライバー（５１，５
２）上領域におけるシール材（３）の縁線は直線状とさ
れている。従って、シール材（３）直下とそれ以外の領
域とでＴＦＴ素子の特性が異なっていても段間で動作に
違いが生じることが無く、表示領域（４）内において行
間で表示が異なることが防がれる。また、特に、図２に
おいてＸ線にて示すようにシール材（３）の外側の縁線
は、シフトレジスタ回路部（５３，５４，５５）よりも
内側にされている。従って、ＴＦＴ素子の閾値変動がシ
フトレジスタ（５３，５４，５５）の論理動作に影響を
及ぼすことが防がれる。更に、シール材（３）の外側縁
線がＡＮＤゲート（５６）よりも内側とすることでより
安定性がより高まる。また、シール材（３）がバッファ
部（５２）上にかかっていても閾値変動の影響は無い。
【００３５】図５は本発明の第３の実施の形態にかかる
液晶表示装置の一部平面図である。本実施の形態では、
シール材（３）はドレインドライバー上を通過している
が、特に、全幅が水平シフトレジスタ（６１）上に位置
しており、かつ、水平シフトレジスタ（６１）上領域に
おいてはシール材（３）の縁線が直線状とされている。
ゲートドライバー側においても同様に、シール材（３）
は、全幅が、垂直シフトレジスタ（５１）上に位置して
おり、かつ垂直シフトレジスタ（５１）上領域において
はシール材（３）の縁線は直線状とされている。従っ
て、シール材（３）直下とそれ以外の領域とでＴＦＴ素
子の特性が異なっていても段間で動作に違いが生じるこ
とが無く、表示領域（４）内で表示が異なることが防が
れる。
液晶表示装置の一部平面図である。本実施の形態では、
シール材（３）はドレインドライバー上を通過している
が、特に、全幅が水平シフトレジスタ（６１）上に位置
しており、かつ、水平シフトレジスタ（６１）上領域に
おいてはシール材（３）の縁線が直線状とされている。
ゲートドライバー側においても同様に、シール材（３）
は、全幅が、垂直シフトレジスタ（５１）上に位置して
おり、かつ垂直シフトレジスタ（５１）上領域において
はシール材（３）の縁線は直線状とされている。従っ
て、シール材（３）直下とそれ以外の領域とでＴＦＴ素
子の特性が異なっていても段間で動作に違いが生じるこ
とが無く、表示領域（４）内で表示が異なることが防が
れる。
【００３６】図６は本発明の第４の実施の形態にかかる
液晶表示装置の一部平面図である。本実施の形態では、
シール材（３）はドレインドライバー上を通過している
が、特に、サンプリング部（６２）上を全て覆うように
位置している。アナログスイッチ（６７）の動作が段間
で違いが生じない限り、閾値が変動してもサンプリング
に影響を及ぼすことはなく、表示が列間で異なることが
防がれる。また、シール材（３）はゲートドライバーの
バッファ部（５２）上を全て覆うように位置している
が、この場合も、インバータ（５７）を構成するＴＦＴ
素子の閾値が変動しても表示に影響を及ぼすことはな
い。
液晶表示装置の一部平面図である。本実施の形態では、
シール材（３）はドレインドライバー上を通過している
が、特に、サンプリング部（６２）上を全て覆うように
位置している。アナログスイッチ（６７）の動作が段間
で違いが生じない限り、閾値が変動してもサンプリング
に影響を及ぼすことはなく、表示が列間で異なることが
防がれる。また、シール材（３）はゲートドライバーの
バッファ部（５２）上を全て覆うように位置している
が、この場合も、インバータ（５７）を構成するＴＦＴ
素子の閾値が変動しても表示に影響を及ぼすことはな
い。
【００３７】更に、シール材（３）は制御回路（７）上
を回避しているので、ドライバーの切換動作が不良とな
ることが防がれる。
を回避しているので、ドライバーの切換動作が不良とな
ることが防がれる。
【００３８】図７は本発明の第５の実施の形態にかかる
液晶表示装置の一部平面図である。本実施の形態では、
シール材（３）はドレインドライバー上を通過している
が、水平シフトレジスタ（６１）を全て覆うように設け
られている。このため、水平シフトレジスタ（６１）内
の全てのＴＦＴ素子が同様の閾値変動の影響を受けるの
で、段間で動作に違いが生じることが無く、結果的に、
表示領域（４）内において列間で表示の異なる領域が混
在することが防がれる。また、ゲートドライバーについ
ても同様に垂直シフトレジスタ（５１）を全て覆うよう
に設けられているので、表示領域（４）において行間で
表示の異なる領域が混在することが防がれる。
液晶表示装置の一部平面図である。本実施の形態では、
シール材（３）はドレインドライバー上を通過している
が、水平シフトレジスタ（６１）を全て覆うように設け
られている。このため、水平シフトレジスタ（６１）内
の全てのＴＦＴ素子が同様の閾値変動の影響を受けるの
で、段間で動作に違いが生じることが無く、結果的に、
表示領域（４）内において列間で表示の異なる領域が混
在することが防がれる。また、ゲートドライバーについ
ても同様に垂直シフトレジスタ（５１）を全て覆うよう
に設けられているので、表示領域（４）において行間で
表示の異なる領域が混在することが防がれる。
【００３９】図８は本発明の第６の実施の形態にかかる
液晶表示装置の一部平面図である。本実施の形態では、
シール材（３）は、水平シフトレジスタ（６１）及びサ
ンプリング部（６２）からなるドレインドライバーの全
てを覆うように設けられている。このため、ドレインド
ライバー（６１，６２）内の全てのＴＦＴ素子が同様の
閾値変動の影響を受けるので、段間で動作に違いが生じ
ることが無く、結果的に、表示領域（４）内において列
間で表示の異なる領域が混在することが防がれる。ま
た、シール材（３）は、垂直シフトレジスタ（５１）及
びバッファ部（６６）からなるゲートドライバーの全て
を覆うように設けられている。このため、ゲートドライ
バー（５１，５２）内の全てのＴＦＴ素子が同様の閾値
変動の影響を受けるので、段間で動作に違いが生じるこ
とが無く、結果的に、表示領域（４）内において行間で
表示の異なる領域が混在することが防がれる。
液晶表示装置の一部平面図である。本実施の形態では、
シール材（３）は、水平シフトレジスタ（６１）及びサ
ンプリング部（６２）からなるドレインドライバーの全
てを覆うように設けられている。このため、ドレインド
ライバー（６１，６２）内の全てのＴＦＴ素子が同様の
閾値変動の影響を受けるので、段間で動作に違いが生じ
ることが無く、結果的に、表示領域（４）内において列
間で表示の異なる領域が混在することが防がれる。ま
た、シール材（３）は、垂直シフトレジスタ（５１）及
びバッファ部（６６）からなるゲートドライバーの全て
を覆うように設けられている。このため、ゲートドライ
バー（５１，５２）内の全てのＴＦＴ素子が同様の閾値
変動の影響を受けるので、段間で動作に違いが生じるこ
とが無く、結果的に、表示領域（４）内において行間で
表示の異なる領域が混在することが防がれる。
【００４０】図９は本発明の第７の実施の形態にかかる
液晶表示装置の一部平面図である。本実施の形態では、
シール材（３）はドレインドライバー（６１，６２）あ
るいはゲートドライバー（５１，５２）の外側を迂回し
て設けられているので、シール材（３）によるＴＦＴ素
子の閾値変動が全くなく、表示に悪影響を及ぼすことが
完全に防がれる。また、シール材（３）は制御回路
（７）上を回避しているので、ドライバーの動作方向の
切換が不能となることが防がれる。
液晶表示装置の一部平面図である。本実施の形態では、
シール材（３）はドレインドライバー（６１，６２）あ
るいはゲートドライバー（５１，５２）の外側を迂回し
て設けられているので、シール材（３）によるＴＦＴ素
子の閾値変動が全くなく、表示に悪影響を及ぼすことが
完全に防がれる。また、シール材（３）は制御回路
（７）上を回避しているので、ドライバーの動作方向の
切換が不能となることが防がれる。
【００４１】図１０は本発明の第８の実施の形態にかか
る液晶表示装置の一部平面図である。本実施の形態で
は、シール材（３）はドレインドライバー（６１，６
２）あるいはゲートドライバー（５１，５２）の内側を
迂回して設けられているので、シール材（３）によるＴ
ＦＴ素子の閾値変動が全く無く、表示に悪影響を及ぼす
ことが完全に防がれる。また、シール材（３）は制御回
路（７）上を回避しているので、ドライバーの動作方向
の切換が不能となることが防がれる。
る液晶表示装置の一部平面図である。本実施の形態で
は、シール材（３）はドレインドライバー（６１，６
２）あるいはゲートドライバー（５１，５２）の内側を
迂回して設けられているので、シール材（３）によるＴ
ＦＴ素子の閾値変動が全く無く、表示に悪影響を及ぼす
ことが完全に防がれる。また、シール材（３）は制御回
路（７）上を回避しているので、ドライバーの動作方向
の切換が不能となることが防がれる。
【００４２】なお、上述の本発明の各実施の形態におい
ては制御回路を設けた場合について説明したが、制御回
路を設けない場合においてもシフトレジスタが接着材に
よる影響を受けて動作不良となることが防止できるとい
う本発明の効果を奏することができる。
ては制御回路を設けた場合について説明したが、制御回
路を設けない場合においてもシフトレジスタが接着材に
よる影響を受けて動作不良となることが防止できるとい
う本発明の効果を奏することができる。
【００４３】
【発明の効果】本発明により、駆動回路を内蔵した表示
装置において、対向する一組の電極基板を貼り合わせる
ための接着材により、駆動回路が動作不良となることが
防がれ、良好な表示を行うことができるようになった。
装置において、対向する一組の電極基板を貼り合わせる
ための接着材により、駆動回路が動作不良となることが
防がれ、良好な表示を行うことができるようになった。
【図１】本発明の第１の実施の形態にかかる液晶表示装
置の一部平面図である。
置の一部平面図である。
【図２】本発明の実施の形態にかかる液晶表示装置の一
部等価回路図である。
部等価回路図である。
【図３】本発明の実施の形態にかかる液晶表示装置の一
部等価回路図である。
部等価回路図である。
【図４】本発明の第２の実施の形態にかかる液晶表示装
置の一部平面図である。
置の一部平面図である。
【図５】本発明の第３の実施の形態にかかる液晶表示装
置の一部平面図である。
置の一部平面図である。
【図６】本発明の第４の実施の形態にかかる液晶表示装
置の一部平面図である。
置の一部平面図である。
【図７】本発明の第５の実施の形態にかかる液晶表示装
置の一部平面図である。
置の一部平面図である。
【図８】本発明の第６の実施の形態にかかる液晶表示装
置の一部平面図である。
置の一部平面図である。
【図９】本発明の第７の実施の形態にかかる液晶表示装
置の一部平面図である。
置の一部平面図である。
【図１０】本発明の第８の実施の形態にかかる液晶表示
装置の一部平面図である。
装置の一部平面図である。
【図１１】液晶表示装置の平面図である。
【図１２】従来の液晶表示装置の一部平面図である。
１ ＴＦＴ基板 ２ 対向基板 ３ シール材 ４ 表示領域 ５ ゲートドライバー ６ ドレインドライバー ７ 制御回路 ８ 入力端子 ９ 共通電極 ５１ 垂直シフトレジスタ ５２ 出力バッファ部 ６１ 水平シフトレジスタ ６２ サンプリング部
Claims (8)
- 【請求項１】 対向面上に、行列状に配列された画素電
極群と各画素電極に表示信号電圧を供給する第１の薄膜
トランジスタ群が形成された表示領域、前記表示領域の
周辺に形成された第２の薄膜トランジスタ群からなり前
記第１の薄膜トランジスタを駆動する複数の駆動回路領
域及び前記駆動回路を制御するための制御回路領域とが
設けられた第１の基板と、共通電極が形成された第２の
基板とが、周縁に設けられた接着材により光学部材を間
に挟んで貼り合わせてなる表示装置において、 前記接着材は、前記駆動回路領域上にある前記接着材の
縁線が、前記駆動回路領域の長辺方向に延びる直線状に
設けられていることを特徴とする表示装置。 - 【請求項２】 前記接着材は、前記制御回路領域を回避
していることを特徴とする請求項１記載の表示装置。 - 【請求項３】 対向面上に、行列状に配列された画素電
極群と各画素電極に表示信号電圧を供給する第１の薄膜
トランジスタ群が形成された表示領域、前記表示領域の
周辺に形成された第２の薄膜トランジスタ群からなり前
記第１の薄膜トランジスタを駆動する複数の駆動回路領
域が設けられた第１の基板と、共通電極が形成された第
２の基板とが、周縁に設けられた接着材により光学部材
を間に挟んで貼り合わせてなる表示装置において、 前記接着材は、前記駆動回路領域上にある前記接着材の
縁線が、前記駆動回路領域の長辺方向に延びる直線状に
設けられていることを特徴とする表示装置。 - 【請求項４】 対向面上に、行列状に配列された画素電
極群と各画素電極に表示信号電圧を供給する第１の薄膜
トランジスタ群が形成された表示領域、前記表示領域の
周辺に形成された第２の薄膜トランジスタ群からなり前
記第１の薄膜トランジスタを駆動する複数の駆動回路領
域が設けられた第１の基板と、共通電極が形成された第
２の基板とが、周縁に設けられた接着材により光学部材
を間に挟んで貼り合わせてなる表示装置において、 前記接着材は、前記駆動回路領域上を回避して設けられ
ていることを特徴とする表示装置。 - 【請求項５】 対向面上に、行列状に配列された画素電
極群と各画素電極に表示信号電圧を供給する第１の薄膜
トランジスタ群が形成された表示領域、前記表示領域の
周辺に形成された第２の薄膜トランジスタ群からなり前
記第１の薄膜トランジスタを駆動する複数の駆動回路領
域及び前記駆動回路を制御するための制御回路領域とが
設けられた第１の基板と、共通電極が形成された第２の
基板とが、周縁に設けられた接着材により光学部材を間
に挟んで貼り合わせてなる表示装置において、 前記接着材は、前記駆動回路領域上または／及び前記制
御回路領域上を回避して設けられていることを特徴とす
る表示装置。 - 【請求項６】 前記駆動回路は、少なくともシフトレジ
スタ及びシフトレジスタの各出力段からの出力に基づく
駆動信号出力部とからなり、前記接着材は、前記シフト
レジスタ領域または／及び前記制御回路領域を回避して
設けられていることを特徴とする請求項３乃至５のうち
いずれか１項記載の表示装置。 - 【請求項７】 対向面上に、行列状に配列された画素電
極群と各画素電極に表示信号電圧を供給する第１の薄膜
トランジスタ群が形成された表示領域、前記表示領域の
周辺に形成された第２の薄膜トランジスタ群からなり前
記第１の薄膜トランジスタを駆動する複数の駆動回路領
域及び前記駆動回路を制御するための制御回路領域とが
設けられた第１の基板と、共通電極が形成された第２の
基板とが、周縁に設けられた接着材により光学部材を間
に挟んで貼り合わせてなる表示装置において、 前記駆動回路は、少なくともシフトレジスタ及びシフト
レジスタの各出力段からの出力に基づく駆動信号出力部
とからなり、前記接着材は、前記シフトレジスタ領域ま
たは前記駆動信号出力部のいずれかの領域を全て覆うこ
とを特徴とする表示装置。 - 【請求項８】 前記接着材は、前記駆動回路領域の全て
を覆うことを特徴とする請求項７記載の表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP28708398A JPH11194367A (ja) | 1997-10-13 | 1998-10-08 | 表示装置 |
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9-279018 | 1997-10-13 | ||
| JP27901897 | 1997-10-13 | ||
| JP28708398A JPH11194367A (ja) | 1997-10-13 | 1998-10-08 | 表示装置 |
Related Child Applications (2)
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|---|---|---|---|
| JP2003359338A Division JP2004151716A (ja) | 1997-10-13 | 2003-10-20 | 表示装置 |
| JP2003359339A Division JP2004118215A (ja) | 1997-10-13 | 2003-10-20 | 表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH11194367A true JPH11194367A (ja) | 1999-07-21 |
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Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
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1998
- 1998-10-08 JP JP28708398A patent/JPH11194367A/ja active Pending
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