JPH11164205A - 固体撮像装置およびその駆動方法 - Google Patents
固体撮像装置およびその駆動方法Info
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- JPH11164205A JPH11164205A JP9327486A JP32748697A JPH11164205A JP H11164205 A JPH11164205 A JP H11164205A JP 9327486 A JP9327486 A JP 9327486A JP 32748697 A JP32748697 A JP 32748697A JP H11164205 A JPH11164205 A JP H11164205A
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N25/00—Circuitry of solid-state image sensors [SSIS]; Control thereof
- H04N25/70—SSIS architectures; Circuits associated therewith
- H04N25/71—Charge-coupled device [CCD] sensors; Charge-transfer registers specially adapted for CCD sensors
- H04N25/73—Charge-coupled device [CCD] sensors; Charge-transfer registers specially adapted for CCD sensors using interline transfer [IT]
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
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- H04N25/70—SSIS architectures; Circuits associated therewith
- H04N25/701—Line sensors
Abstract
(57)【要約】
【課題】 画素列間距離を縮めることで簡単な構成でも
色ずれを低減できるようにすること。 【解決手段】 本発明の固体撮像装置は、少なくとも２
本のセンサ列ｅ、ｆ、ｇが隣り合って配置される画像取
り込み手段と、画像取り込み手段に隣接して配置され少
なくとも２本のセンサ列ｅ、ｆ、ｇの各々に対応して設
けられた少なくとも２本の水平レジスタｈ、ｉ、ｊから
構成される水平電荷転送手段とを備えている。また、本
発明の固体撮像装置の駆動方法は、このセンサ列ｅ、
ｆ、ｇの各画素で取り込んだ電荷を各々対応した水平レ
ジスタｈ、ｉ、ｊへ転送し、この水平レジスタｈ、ｉ、
ｊへ各センサ列ｅ、ｆ、ｇの各画素で取り込んだ電荷を
全て転送した後、その各電荷を水平方向へ順次転送する
ものである。
色ずれを低減できるようにすること。 【解決手段】 本発明の固体撮像装置は、少なくとも２
本のセンサ列ｅ、ｆ、ｇが隣り合って配置される画像取
り込み手段と、画像取り込み手段に隣接して配置され少
なくとも２本のセンサ列ｅ、ｆ、ｇの各々に対応して設
けられた少なくとも２本の水平レジスタｈ、ｉ、ｊから
構成される水平電荷転送手段とを備えている。また、本
発明の固体撮像装置の駆動方法は、このセンサ列ｅ、
ｆ、ｇの各画素で取り込んだ電荷を各々対応した水平レ
ジスタｈ、ｉ、ｊへ転送し、この水平レジスタｈ、ｉ、
ｊへ各センサ列ｅ、ｆ、ｇの各画素で取り込んだ電荷を
全て転送した後、その各電荷を水平方向へ順次転送する
ものである。
Description
【０００１】
【発明の属する技術分野】本発明は、画素列で取り込ん
だ電荷を転送して画像信号を得る固体撮像装置およびそ
の駆動方法に関する。
だ電荷を転送して画像信号を得る固体撮像装置およびそ
の駆動方法に関する。
【０００２】
【従来の技術】１チップ内に複数のセンサ列を備えた固
体撮像装置（以下、「ＣＣＤセンサ」と言う。）におい
ては、センサ列の各画素で取り込んだ信号電荷を電荷電
圧変換部において読み出すため、各センサ列毎に電荷転
送用の水平レジスタが設けられている。
体撮像装置（以下、「ＣＣＤセンサ」と言う。）におい
ては、センサ列の各画素で取り込んだ信号電荷を電荷電
圧変換部において読み出すため、各センサ列毎に電荷転
送用の水平レジスタが設けられている。
【０００３】図１３は従来のＣＣＤセンサの構成を示す
模式平面図である。すなわち、このＣＣＤセンサは、例
えばＲ（赤）、Ｇ（緑）、Ｂ（青）の３原色に対応した
センサ列ｅ、ｆ、ｇと、各センサ列ｅ、ｆ、ｇの各画素
におけるｏｄｄ側とｅｖｅｎ側との各々の電荷を別々に
転送するため各センサ列ｅ、ｆ、ｇの両側にそれぞれ２
本ずつ設けられた水平レジスタｈ、ｉ、ｊ、ｋ、ｌ、ｍ
とを備えている。
模式平面図である。すなわち、このＣＣＤセンサは、例
えばＲ（赤）、Ｇ（緑）、Ｂ（青）の３原色に対応した
センサ列ｅ、ｆ、ｇと、各センサ列ｅ、ｆ、ｇの各画素
におけるｏｄｄ側とｅｖｅｎ側との各々の電荷を別々に
転送するため各センサ列ｅ、ｆ、ｇの両側にそれぞれ２
本ずつ設けられた水平レジスタｈ、ｉ、ｊ、ｋ、ｌ、ｍ
とを備えている。
【０００４】このようなＣＣＤセンサでは、各センサ列
ｅ、ｆ、ｇの各画素で入力光に応じた電荷を取り込んだ
後、例えば各センサ列ｅ、ｆ、ｇのｅｖｅｎ側の画素に
対応した電荷を水平レジスタｈ、ｊ、ｌへ各々送り、そ
の後、各センサ列ｅ、ｆ、ｇのｏｄｄ側の画素に対応し
た電荷を水平レジスタｉ、ｋ、ｍへ各々送る。
ｅ、ｆ、ｇの各画素で入力光に応じた電荷を取り込んだ
後、例えば各センサ列ｅ、ｆ、ｇのｅｖｅｎ側の画素に
対応した電荷を水平レジスタｈ、ｊ、ｌへ各々送り、そ
の後、各センサ列ｅ、ｆ、ｇのｏｄｄ側の画素に対応し
た電荷を水平レジスタｉ、ｋ、ｍへ各々送る。
【０００５】そして、全ての画素の電荷が水平レジスタ
ｈ、ｉ、ｊ、ｋ、ｌ、ｍに送られた後、φｈ１、φｈ２
に順次電圧を印加して電荷を順に水平方向へ転送する。
この転送された電荷は電荷電圧変換部（図示せず）で出
力信号として取り出されることになる。
ｈ、ｉ、ｊ、ｋ、ｌ、ｍに送られた後、φｈ１、φｈ２
に順次電圧を印加して電荷を順に水平方向へ転送する。
この転送された電荷は電荷電圧変換部（図示せず）で出
力信号として取り出されることになる。
【０００６】
【発明が解決しようとする課題】しかしながら、従来の
ＣＣＤセンサでは、各センサ列間に電荷転送用の水平レ
ジスタが配置されていることから、各センサ間の画素中
心間距離はセンササイズの数倍になってしまう。特に電
荷をｏｄｄ側とｅｖｅｎ側とに分けて転送するＣＣＤセ
ンサでは、各センサ間に２本の水平レジスタが配置さ
れ、さらに画素中心間距離が広がってしまう。
ＣＣＤセンサでは、各センサ列間に電荷転送用の水平レ
ジスタが配置されていることから、各センサ間の画素中
心間距離はセンササイズの数倍になってしまう。特に電
荷をｏｄｄ側とｅｖｅｎ側とに分けて転送するＣＣＤセ
ンサでは、各センサ間に２本の水平レジスタが配置さ
れ、さらに画素中心間距離が広がってしまう。
【０００７】例えば図１３の例ではセンサ列ｅ、ｆ間お
よびセンサ列ｆ、ｇ間が８ｌｉｎｅ間隔となっている。
このため、画像を読み取った場合、同じタイミングで読
み取った各センサ列の出力信号が空間的にずれてしまう
ため（図１３の例では８ｌｉｎｅ分）、色ずれ等の不具
合を生じることになる。
よびセンサ列ｆ、ｇ間が８ｌｉｎｅ間隔となっている。
このため、画像を読み取った場合、同じタイミングで読
み取った各センサ列の出力信号が空間的にずれてしまう
ため（図１３の例では８ｌｉｎｅ分）、色ずれ等の不具
合を生じることになる。
【０００８】そこで、この各センサ列の出力信号におけ
る空間的なずれを回避するため、電荷電圧変換部の後段
にメモリーを用意しておき、このメモリーに出力信号を
一旦蓄積してから取り出すようにすることで空間的なず
れを補正する必要がある。しかし、各センサ列の間隔が
広がるほど、その分メモリー容量を多くしなければなら
ず、コストアップを招くことになる。
る空間的なずれを回避するため、電荷電圧変換部の後段
にメモリーを用意しておき、このメモリーに出力信号を
一旦蓄積してから取り出すようにすることで空間的なず
れを補正する必要がある。しかし、各センサ列の間隔が
広がるほど、その分メモリー容量を多くしなければなら
ず、コストアップを招くことになる。
【０００９】
【課題を解決するための手段】本発明はこのような課題
を解決するために成された固体撮像装置およびその駆動
方法である。すなわち、本発明の固体撮像装置は、少な
くとも２本の画素列が隣り合って配置される画像取り込
み手段と、画像取り込み手段に隣接して配置され少なく
とも２本の画素列の各々に対応して設けられた少なくと
も２本の水平電荷転送列から構成される水平電荷転送手
段とを備えているものである。
を解決するために成された固体撮像装置およびその駆動
方法である。すなわち、本発明の固体撮像装置は、少な
くとも２本の画素列が隣り合って配置される画像取り込
み手段と、画像取り込み手段に隣接して配置され少なく
とも２本の画素列の各々に対応して設けられた少なくと
も２本の水平電荷転送列から構成される水平電荷転送手
段とを備えているものである。
【００１０】また、本発明の固体撮像装置の駆動方法
は、少なくとも２本の画素列が隣り合って配置される画
像取り込み手段と、画像取り込み手段に隣接して配置さ
れ少なくとも２本の画素列の各々に対応して設けられた
少なくとも２本の水平電荷転送列から構成される水平電
荷転送手段とを備える固体撮像装置の駆動方法であり、
少なくとも２本の画素列の各画素で電荷を取り込む工程
と、少なくとも２本の画素列の各画素で取り込んだ電荷
を各々対応した少なくとも２本の水平電荷転送列へ転送
する工程と、少なくとも２本の水平電荷転送列へ各画素
列の各画素で取り込んだ電荷を全て転送した後、その各
電荷を水平方向へ順次転送する工程とを備えている。
は、少なくとも２本の画素列が隣り合って配置される画
像取り込み手段と、画像取り込み手段に隣接して配置さ
れ少なくとも２本の画素列の各々に対応して設けられた
少なくとも２本の水平電荷転送列から構成される水平電
荷転送手段とを備える固体撮像装置の駆動方法であり、
少なくとも２本の画素列の各画素で電荷を取り込む工程
と、少なくとも２本の画素列の各画素で取り込んだ電荷
を各々対応した少なくとも２本の水平電荷転送列へ転送
する工程と、少なくとも２本の水平電荷転送列へ各画素
列の各画素で取り込んだ電荷を全て転送した後、その各
電荷を水平方向へ順次転送する工程とを備えている。
【００１１】本発明の固体撮像装置では、画像取り込み
手段が少なくとも２本の画素列を隣り合わせた構成とな
っており、この画像取り込み手段に隣接して少なくとも
２本の画素列に各々対応した少なくとも２本の水平電荷
転送列から構成される平電荷転送手段を配置しているこ
とから、少なくとも２本の画素列の間に水平電荷転送手
段を設ける必要がなくなり、画素列間距離を縮めること
ができるようになる。
手段が少なくとも２本の画素列を隣り合わせた構成とな
っており、この画像取り込み手段に隣接して少なくとも
２本の画素列に各々対応した少なくとも２本の水平電荷
転送列から構成される平電荷転送手段を配置しているこ
とから、少なくとも２本の画素列の間に水平電荷転送手
段を設ける必要がなくなり、画素列間距離を縮めること
ができるようになる。
【００１２】また、本発明の固体撮像装置の駆動方法で
は、隣り合って配置される少なくとも２本の画素列の各
画素で取り込んだ電荷を各々対応する２本の水平電荷転
送列へ送っており、少なくとも２本の画素列の各画素で
取り込んだ電荷を全て水平電荷転送列へ転送した後に、
各電荷を順次水平方向へ転送しているため、少なくとも
２本の画素列間の時差を発生させずに信号出力を行うこ
とができるようになる。
は、隣り合って配置される少なくとも２本の画素列の各
画素で取り込んだ電荷を各々対応する２本の水平電荷転
送列へ送っており、少なくとも２本の画素列の各画素で
取り込んだ電荷を全て水平電荷転送列へ転送した後に、
各電荷を順次水平方向へ転送しているため、少なくとも
２本の画素列間の時差を発生させずに信号出力を行うこ
とができるようになる。
【００１３】
【発明の実施の形態】以下に、本発明の固体撮像装置お
よびその駆動方法における実施の形態を図に基づいて説
明する。なお、本実施形態では、主として３ラインのセ
ンサ列を備えたＣＣＤセンサへの適用例を説明する。
よびその駆動方法における実施の形態を図に基づいて説
明する。なお、本実施形態では、主として３ラインのセ
ンサ列を備えたＣＣＤセンサへの適用例を説明する。
【００１４】図１は第１実施形態を説明する模式平面図
である。すなわち、このＣＣＤセンサは、例えばＲ
（赤）、Ｇ（緑）、Ｂ（青）の３原色に対応して順に隣
り合って配置されるたセンサ列ｅ、ｆ、ｇと、センサ列
ｅと隣接して配置されセンサ列ｅの各画素から電荷を受
けて転送を行う水平レジスタｈと、センサ列ｇと隣接し
て配置されセンサ列ｆの各画素から電荷を受けて転送を
行う水平レジスタｉと、水平レジスタｉと隣接して配置
されセンサ列ｇの各画素から電荷を受けて転送を行う水
平レジスタｊとを備えている。
である。すなわち、このＣＣＤセンサは、例えばＲ
（赤）、Ｇ（緑）、Ｂ（青）の３原色に対応して順に隣
り合って配置されるたセンサ列ｅ、ｆ、ｇと、センサ列
ｅと隣接して配置されセンサ列ｅの各画素から電荷を受
けて転送を行う水平レジスタｈと、センサ列ｇと隣接し
て配置されセンサ列ｆの各画素から電荷を受けて転送を
行う水平レジスタｉと、水平レジスタｉと隣接して配置
されセンサ列ｇの各画素から電荷を受けて転送を行う水
平レジスタｊとを備えている。
【００１５】また、本実施形態のＣＣＤセンサでは、中
央に配置されるセンサ列ｆの各画素から水平レジスタｉ
へ各々電荷を転送するため垂直レジスタｎと、水平レジ
スタｉと水平レジスタｊとの間に配置される水平レジス
タ間転送用レジスタｋとを備えている。
央に配置されるセンサ列ｆの各画素から水平レジスタｉ
へ各々電荷を転送するため垂直レジスタｎと、水平レジ
スタｉと水平レジスタｊとの間に配置される水平レジス
タ間転送用レジスタｋとを備えている。
【００１６】各水平レジスタｈ、ｉ、ｊには２相の駆動
電圧φｈ１、φｈ２が印加され電荷を水平方向へ順次転
送するようになっている。また、水平レジスタ間転送用
レジスタｋにはφｈｈ１が印加され、水平レジスタｉか
ら水平レジスタｊへの電荷の流れを制御している。
電圧φｈ１、φｈ２が印加され電荷を水平方向へ順次転
送するようになっている。また、水平レジスタ間転送用
レジスタｋにはφｈｈ１が印加され、水平レジスタｉか
ら水平レジスタｊへの電荷の流れを制御している。
【００１７】また、センサ列ｅの各画素と水平レジスタ
ｈとの間およびセンサ列ｇの各画素と水平レジスタｉと
の間には各々転送ゲートが設けられ、ここに印加される
φｒ１によって各画素で取り込んだ電荷を水平レジスタ
ｈおよび水平レジスタｉへ転送できるようになってい
る。
ｈとの間およびセンサ列ｇの各画素と水平レジスタｉと
の間には各々転送ゲートが設けられ、ここに印加される
φｒ１によって各画素で取り込んだ電荷を水平レジスタ
ｈおよび水平レジスタｉへ転送できるようになってい
る。
【００１８】さらに、垂直レジスタｎには２相の駆動電
圧φｖ１、φｖ２が印加され、センサ列ｆの各画素で取
り込んだ電荷を水平レジスタｉへ転送できるようになっ
ている。
圧φｖ１、φｖ２が印加され、センサ列ｆの各画素で取
り込んだ電荷を水平レジスタｉへ転送できるようになっ
ている。
【００１９】このように、本実施形態では３本のセンサ
列ｅ、ｆ、ｇが順に隣り合って配置されていることか
ら、取り込んだ電荷の読み出しにおける空間的なずれを
非常に少なくすることができるようになっている。な
お、この３本のセンサ列ｅ、ｆ、ｇは隣接して配置され
ていることが望ましいが、必ずしも隣接していなくても
２〜３ライン程度離れて配置されていてもよい。
列ｅ、ｆ、ｇが順に隣り合って配置されていることか
ら、取り込んだ電荷の読み出しにおける空間的なずれを
非常に少なくすることができるようになっている。な
お、この３本のセンサ列ｅ、ｆ、ｇは隣接して配置され
ていることが望ましいが、必ずしも隣接していなくても
２〜３ライン程度離れて配置されていてもよい。
【００２０】次に、このＣＣＤセンサにおける具体的な
駆動方法を説明する。図２は主要部の転送例を順に説明
する模式図、図３は転送のタイミングチャートである。
この図２では、センサ列ｆ、ｇで蓄積した電荷の転送を
示している。また、図２では、説明上電荷を楕円形で示
している。
駆動方法を説明する。図２は主要部の転送例を順に説明
する模式図、図３は転送のタイミングチャートである。
この図２では、センサ列ｆ、ｇで蓄積した電荷の転送を
示している。また、図２では、説明上電荷を楕円形で示
している。
【００２１】先ず、図３（ａ）に示すタイミングのよう
に、φｈ１がＬｏｗ、φｈ２がＨｉｇｈ、φｈｈ１がＨ
ｉｇｈ、φｒ１がＨｉｇｈ、φｖ１がＨｉｇｈ、φｖ２
がＬｏｗとなると、図２（ａ）に示すように、センサ列
ｆの各画素から電荷が垂直レジスタｎへ送られ、センサ
列ｇの各画素から電荷が水平レジスタ間転送用レジスタ
ｋまで送られる。
に、φｈ１がＬｏｗ、φｈ２がＨｉｇｈ、φｈｈ１がＨ
ｉｇｈ、φｒ１がＨｉｇｈ、φｖ１がＨｉｇｈ、φｖ２
がＬｏｗとなると、図２（ａ）に示すように、センサ列
ｆの各画素から電荷が垂直レジスタｎへ送られ、センサ
列ｇの各画素から電荷が水平レジスタ間転送用レジスタ
ｋまで送られる。
【００２２】なお、このタイミングでφｒ１がＨｉｇｈ
となることによって、図１に示すセンサ列ｅの各画素の
電荷が水平レジスタｈへ転送されることになる。
となることによって、図１に示すセンサ列ｅの各画素の
電荷が水平レジスタｈへ転送されることになる。
【００２３】次に、図３（ｂ）に示すタイミングのよう
に、φｈ１がＬｏｗ、φｈ２がＬｏｗ、φｈｈ１がＨｉ
ｇｈ、φｒ１がＬｏｗ、φｖ１がＬｏｗ、φｖ２がＨｉ
ｇｈとなると、図２（ｂ）に示すように、垂直レジスタ
ｎへ送られた電荷が水平レジスタｉの手前まで転送され
る。
に、φｈ１がＬｏｗ、φｈ２がＬｏｗ、φｈｈ１がＨｉ
ｇｈ、φｒ１がＬｏｗ、φｖ１がＬｏｗ、φｖ２がＨｉ
ｇｈとなると、図２（ｂ）に示すように、垂直レジスタ
ｎへ送られた電荷が水平レジスタｉの手前まで転送され
る。
【００２４】次いで、図３（ｃ）に示すタイミングのよ
うに、φｈ１がＨｉｇｈ、φｈ２がＬｏｗ、φｈｈ１が
Ｈｉｇｈ、φｒ１がＬｏｗ、φｖ１がＬｏｗ、φｖ２が
Ｈｉｇｈとなると、図２（ｃ）に示すように、垂直レジ
スタｎから水平レジスタｉへ電荷が転送されるととも
に、水平レジスタ間転送用レジスタｋに送られた電荷が
水平レジスタｊへ転送される。
うに、φｈ１がＨｉｇｈ、φｈ２がＬｏｗ、φｈｈ１が
Ｈｉｇｈ、φｒ１がＬｏｗ、φｖ１がＬｏｗ、φｖ２が
Ｈｉｇｈとなると、図２（ｃ）に示すように、垂直レジ
スタｎから水平レジスタｉへ電荷が転送されるととも
に、水平レジスタ間転送用レジスタｋに送られた電荷が
水平レジスタｊへ転送される。
【００２５】これによって、各センサ列の各画素で取り
込んだ電荷が全て対応する水平レジスタへ送られる状態
となる。この後は、φｈ１、φｈ２を順に印加すること
で各電荷を水平方向へ転送できるようになる。
込んだ電荷が全て対応する水平レジスタへ送られる状態
となる。この後は、φｈ１、φｈ２を順に印加すること
で各電荷を水平方向へ転送できるようになる。
【００２６】このような転送により、各センサ列の各画
素で取り込んだ電荷を各センサ列間の時差を発生させる
ことなく出力できるようになる。また、各センサ列が隣
り合って配置されていることから、電荷の読み出しにお
ける空間的なずれを非常に少なくすることができ、電荷
電圧変換部（図示せず）の後段にメモリーや補正回路を
設けなくても色ずれ等を発生させずに済むようになる。
素で取り込んだ電荷を各センサ列間の時差を発生させる
ことなく出力できるようになる。また、各センサ列が隣
り合って配置されていることから、電荷の読み出しにお
ける空間的なずれを非常に少なくすることができ、電荷
電圧変換部（図示せず）の後段にメモリーや補正回路を
設けなくても色ずれ等を発生させずに済むようになる。
【００２７】次に、第２実施形態の説明を行う。図４は
第２実施形態を説明する模式平面図である。すなわち、
このＣＣＤセンサは、例えばＲ（赤）、Ｇ（緑）、Ｂ
（青）の３原色に対応して順に隣り合って配置されるた
センサ列ｅ、ｆ、ｇと、センサ列ｅと隣接して配置され
センサ列ｅの各画素におけるｏｄｄ側とｅｖｅｎ側との
各々の電荷を受けて各々転送を行う水平レジスタｈ’、
ｉ’と、センサ列ｇと隣接して配置されセンサ列ｆの各
画素におけるｏｄｄ側とｅｖｅｎ側との各々の電荷を受
けて各々転送を行う水平レジスタｊ’、ｋ’と、水平レ
ジスタｋ’と隣接して配置されセンサ列ｇの各画素にお
けるｏｄｄ側とｅｖｅｎ側との各々の電荷を受けて各々
転送を行う水平レジスタｌ’、ｍ’とを備えている。
第２実施形態を説明する模式平面図である。すなわち、
このＣＣＤセンサは、例えばＲ（赤）、Ｇ（緑）、Ｂ
（青）の３原色に対応して順に隣り合って配置されるた
センサ列ｅ、ｆ、ｇと、センサ列ｅと隣接して配置され
センサ列ｅの各画素におけるｏｄｄ側とｅｖｅｎ側との
各々の電荷を受けて各々転送を行う水平レジスタｈ’、
ｉ’と、センサ列ｇと隣接して配置されセンサ列ｆの各
画素におけるｏｄｄ側とｅｖｅｎ側との各々の電荷を受
けて各々転送を行う水平レジスタｊ’、ｋ’と、水平レ
ジスタｋ’と隣接して配置されセンサ列ｇの各画素にお
けるｏｄｄ側とｅｖｅｎ側との各々の電荷を受けて各々
転送を行う水平レジスタｌ’、ｍ’とを備えている。
【００２８】また、本実施形態におけるＣＣＤセンサで
は、中央に配置されるセンサ列ｆの各画素から水平レジ
スタｊ’ｋ’へ各々電荷を転送するため垂直レジスタｎ
と、水平レジスタｈ’、ｉ’間に配置される水平レジス
タ間転送用レジスタｏと、水平レジスタｊ’、ｋ’間に
配置される水平レジスタ間転送用レジスタｐと、水平レ
ジスタｌ’、ｍ’間に配置される水平レジスタ間転送用
レジスタｒとを備えている。
は、中央に配置されるセンサ列ｆの各画素から水平レジ
スタｊ’ｋ’へ各々電荷を転送するため垂直レジスタｎ
と、水平レジスタｈ’、ｉ’間に配置される水平レジス
タ間転送用レジスタｏと、水平レジスタｊ’、ｋ’間に
配置される水平レジスタ間転送用レジスタｐと、水平レ
ジスタｌ’、ｍ’間に配置される水平レジスタ間転送用
レジスタｒとを備えている。
【００２９】各水平レジスタｈ’、ｉ’、ｊ’、ｋ’、
ｌ’、ｍ’には２相の駆動電圧φｈ１、φｈ２が印加さ
れ電荷を水平方向へ順次転送するようになっている。ま
た、水平レジスタ間転送用レジスタｐにはφｈｈ１が印
加され、水平レジスタ間転送用レジスタｑにはφｈｈ２
が印加され、水平レジスタ間転送用レジスタｏおよび水
平レジスタ間転送用レジスタｒにはφｈｈ３が印加さ
れ、各々水平レジスタ間の電荷の流れを制御している。
ｌ’、ｍ’には２相の駆動電圧φｈ１、φｈ２が印加さ
れ電荷を水平方向へ順次転送するようになっている。ま
た、水平レジスタ間転送用レジスタｐにはφｈｈ１が印
加され、水平レジスタ間転送用レジスタｑにはφｈｈ２
が印加され、水平レジスタ間転送用レジスタｏおよび水
平レジスタ間転送用レジスタｒにはφｈｈ３が印加さ
れ、各々水平レジスタ間の電荷の流れを制御している。
【００３０】また、センサ列ｅの各画素と水平レジスタ
ｉ’との間およびセンサ列ｇの各画素と水平レジスタ
ｊ’との間には各々転送ゲートが設けられ、ここに印加
されるφｒ１、φｒ２によって各画素で取り込んだ電荷
を水平レジスタｉ’、ｈ’および水平レジスタｌ’、
ｍ’へ各々転送できるようになっている。
ｉ’との間およびセンサ列ｇの各画素と水平レジスタ
ｊ’との間には各々転送ゲートが設けられ、ここに印加
されるφｒ１、φｒ２によって各画素で取り込んだ電荷
を水平レジスタｉ’、ｈ’および水平レジスタｌ’、
ｍ’へ各々転送できるようになっている。
【００３１】さらに、垂直レジスタｎには２相の駆動電
圧φｖ１、φｖ２とφｖ１、φｖ３とが一つおきに印加
され、センサ列ｆの各画素におけるｏｄｄ側とｅｖｅｎ
側とで取り込んだ電荷を水平レジスタｊ’、ｋ’へ転送
できるようになっている。
圧φｖ１、φｖ２とφｖ１、φｖ３とが一つおきに印加
され、センサ列ｆの各画素におけるｏｄｄ側とｅｖｅｎ
側とで取り込んだ電荷を水平レジスタｊ’、ｋ’へ転送
できるようになっている。
【００３２】このように、本実施形態においても第１実
施形態と同様、３本のセンサ列ｅ、ｆ、ｇが順に隣り合
って配置されていることから、取り込んだ電荷の読み出
しにおける空間的なずれを非常に少なくすることができ
るようになっている。なお、この３本のセンサ列ｅ、
ｆ、ｇは隣接して配置されていることが望ましいが、必
ずしも隣接していなくても２〜３ライン程度離れて配置
されていてもよい。
施形態と同様、３本のセンサ列ｅ、ｆ、ｇが順に隣り合
って配置されていることから、取り込んだ電荷の読み出
しにおける空間的なずれを非常に少なくすることができ
るようになっている。なお、この３本のセンサ列ｅ、
ｆ、ｇは隣接して配置されていることが望ましいが、必
ずしも隣接していなくても２〜３ライン程度離れて配置
されていてもよい。
【００３３】次に、このＣＣＤセンサにおける具体的な
駆動方法を説明する。図５〜図７は主要部の転送例を順
に説明する模式図、図８は転送のタイミングチャートで
ある。この図５〜図７では、センサ列ｆ、ｇで蓄積した
電荷の転送を示している。また、図５〜図７では、説明
上電荷を楕円形で示している。
駆動方法を説明する。図５〜図７は主要部の転送例を順
に説明する模式図、図８は転送のタイミングチャートで
ある。この図５〜図７では、センサ列ｆ、ｇで蓄積した
電荷の転送を示している。また、図５〜図７では、説明
上電荷を楕円形で示している。
【００３４】先ず、図８（ａ）に示すタイミングのよう
に、φｈ１がＨｉｇｈ、φｈ２がＬｏｗ、φｈｈ１がＨ
ｉｇｈ、φｈｈ２がＨｉｇｈ、φｈｈ３がＨｉｇｈ、φ
ｒ１がＨｉｇｈ、φｒ２がＬｏｗ、φｖ１がＨｉｇｈ、
φｖ２がＬｏｗ、φｖ３がＬｏｗとなると、図５（ａ）
に示すように、センサ列ｆの各画素から電荷が垂直レジ
スタｎへ送られ、センサ列ｇのｏｄｄ側の画素における
電荷が水平レジスタ間転送用レジスタｐまで送られる。
に、φｈ１がＨｉｇｈ、φｈ２がＬｏｗ、φｈｈ１がＨ
ｉｇｈ、φｈｈ２がＨｉｇｈ、φｈｈ３がＨｉｇｈ、φ
ｒ１がＨｉｇｈ、φｒ２がＬｏｗ、φｖ１がＨｉｇｈ、
φｖ２がＬｏｗ、φｖ３がＬｏｗとなると、図５（ａ）
に示すように、センサ列ｆの各画素から電荷が垂直レジ
スタｎへ送られ、センサ列ｇのｏｄｄ側の画素における
電荷が水平レジスタ間転送用レジスタｐまで送られる。
【００３５】なお、このタイミングでφｒ１がＨｉｇｈ
となることによって、図４に示すセンサ列ｅのｅｖｅｎ
側の画素における電荷が水平レジスタｉ’へ転送される
ことになる。
となることによって、図４に示すセンサ列ｅのｅｖｅｎ
側の画素における電荷が水平レジスタｉ’へ転送される
ことになる。
【００３６】次に、図８（ｂ）に示すタイミングのよう
に、φｈ１がＬｏｗ、φｈ２がＨｉｇｈ、φｈｈ１がＨ
ｉｇｈ、φｈｈ２がＨｉｇｈ、φｈｈ３がＨｉｇｈ、φ
ｒ１がＬｏｗ、φｒ２がＨｉｇｈ、φｖ１がＨｉｇｈ、
φｖ２がＬｏｗ、φｖ３がＬｏｗとなると、図５（ｂ）
に示すように、センサ列ｇのｅｖｅｎ側の画素における
電荷が水平レジスタ間転送用レジスタｐまで送られる。
に、φｈ１がＬｏｗ、φｈ２がＨｉｇｈ、φｈｈ１がＨ
ｉｇｈ、φｈｈ２がＨｉｇｈ、φｈｈ３がＨｉｇｈ、φ
ｒ１がＬｏｗ、φｒ２がＨｉｇｈ、φｖ１がＨｉｇｈ、
φｖ２がＬｏｗ、φｖ３がＬｏｗとなると、図５（ｂ）
に示すように、センサ列ｇのｅｖｅｎ側の画素における
電荷が水平レジスタ間転送用レジスタｐまで送られる。
【００３７】なお、このタイミングでφｒ２がＨｉｇｈ
となることによって、図４に示すセンサ列ｅのｏｄｄ側
の画素における電荷が水平レジスタｈ’へ転送されるこ
とになる。
となることによって、図４に示すセンサ列ｅのｏｄｄ側
の画素における電荷が水平レジスタｈ’へ転送されるこ
とになる。
【００３８】次いで、図８（ｃ）に示すタイミングのよ
うに、φｈ１がＬｏｗ、φｈ２がＬｏｗ、φｈｈ１がＬ
ｏｗ、φｈｈ２がＬｏｗ、φｈｈ３がＨｉｇｈ、φｒ１
がＬｏｗ、φｒ２がＬｏｗ、φｖ１がＬｏｗ、φｖ２が
Ｈｉｇｈ、φｖ３がＨｉｇｈとなると、図６（ａ）に示
すように、垂直レジスタｎへ送られた電荷が水平レジス
タｊ’の手前まで転送されるとともに、水平レジスタ間
転送用レジスタｐに送られた電荷が水平レジスタ間転送
用レジスタｒまで転送される。
うに、φｈ１がＬｏｗ、φｈ２がＬｏｗ、φｈｈ１がＬ
ｏｗ、φｈｈ２がＬｏｗ、φｈｈ３がＨｉｇｈ、φｒ１
がＬｏｗ、φｒ２がＬｏｗ、φｖ１がＬｏｗ、φｖ２が
Ｈｉｇｈ、φｖ３がＨｉｇｈとなると、図６（ａ）に示
すように、垂直レジスタｎへ送られた電荷が水平レジス
タｊ’の手前まで転送されるとともに、水平レジスタ間
転送用レジスタｐに送られた電荷が水平レジスタ間転送
用レジスタｒまで転送される。
【００３９】続いて、図８（ｄ）に示すタイミングのよ
うに、φｈ１がＨｉｇｈ、φｈ２がＬｏｗ、φｈｈ１が
Ｈｉｇｈ、φｈｈ２がＬｏｗ、φｈｈ３がＨｉｇｈ、φ
ｒ１がＬｏｗ、φｒ２がＬｏｗ、φｖ１がＬｏｗ、φｖ
２がＨｉｇｈ、φｖ３がＬｏｗとなると、図６（ｂ）に
示すように、垂直レジスタｎへ送られた電荷のうちｏｄ
ｄ側に対応するもののみが水平レジスタ間転送用レジス
タｐへ転送される。
うに、φｈ１がＨｉｇｈ、φｈ２がＬｏｗ、φｈｈ１が
Ｈｉｇｈ、φｈｈ２がＬｏｗ、φｈｈ３がＨｉｇｈ、φ
ｒ１がＬｏｗ、φｒ２がＬｏｗ、φｖ１がＬｏｗ、φｖ
２がＨｉｇｈ、φｖ３がＬｏｗとなると、図６（ｂ）に
示すように、垂直レジスタｎへ送られた電荷のうちｏｄ
ｄ側に対応するもののみが水平レジスタ間転送用レジス
タｐへ転送される。
【００４０】次に、図８（ｅ）に示すタイミングのよう
に、φｈ１がＬｏｗ、φｈ２がＨｉｇｈ、φｈｈ１がＬ
ｏｗ、φｈｈ２がＬｏｗ、φｈｈ３がＬｏｗ、φｒ１が
Ｌｏｗ、φｒ２がＬｏｗ、φｖ１がＬｏｗ、φｖ２がＬ
ｏｗ、φｖ３がＬｏｗとなると、図７に示すように、水
平レジスタ間転送用レジスタｐへ転送された電荷が水平
レジスタｋ’へ転送され、垂直レジスタｎに残っていた
ｅｖｅｎ側の電荷が水平レジスタｊ’へ転送されるとと
もに、水平レジスタ間転送用レジスタｒに待機していた
電荷のうちｏｄｄ側に対応するものが水平レジスタｍ’
へ転送され、ｅｖｅｎ側に対応するものが水平レジスタ
ｌ’へ転送される。
に、φｈ１がＬｏｗ、φｈ２がＨｉｇｈ、φｈｈ１がＬ
ｏｗ、φｈｈ２がＬｏｗ、φｈｈ３がＬｏｗ、φｒ１が
Ｌｏｗ、φｒ２がＬｏｗ、φｖ１がＬｏｗ、φｖ２がＬ
ｏｗ、φｖ３がＬｏｗとなると、図７に示すように、水
平レジスタ間転送用レジスタｐへ転送された電荷が水平
レジスタｋ’へ転送され、垂直レジスタｎに残っていた
ｅｖｅｎ側の電荷が水平レジスタｊ’へ転送されるとと
もに、水平レジスタ間転送用レジスタｒに待機していた
電荷のうちｏｄｄ側に対応するものが水平レジスタｍ’
へ転送され、ｅｖｅｎ側に対応するものが水平レジスタ
ｌ’へ転送される。
【００４１】これにより、センサ列ｆ、ｇの各画素にお
ける電荷が、ｅｖｅｎ側、ｏｄｄ側に分かれて各々水平
レジスタｊ’、ｋ’、ｌ’、ｍ’に転送されることにな
る。この状態で、φｈ１、φｈ２を順に印加することで
各電荷を水平方向へ転送できるようになる。
ける電荷が、ｅｖｅｎ側、ｏｄｄ側に分かれて各々水平
レジスタｊ’、ｋ’、ｌ’、ｍ’に転送されることにな
る。この状態で、φｈ１、φｈ２を順に印加することで
各電荷を水平方向へ転送できるようになる。
【００４２】このような転送により、各センサ列の各画
素で取り込んだ電荷をｅｖｅｎ側、ｏｄｄ側に分けて各
センサ列間の時差を発生させることなく出力できるよう
になる。また、各センサ列が隣り合って配置されている
ことから、電荷の読み出しにおける空間的なずれを非常
に少なくすることができ、電荷電圧変換部（図示せず）
の後段にメモリーや補正回路を設けなくても色ずれ等を
発生させずに済むようになる。
素で取り込んだ電荷をｅｖｅｎ側、ｏｄｄ側に分けて各
センサ列間の時差を発生させることなく出力できるよう
になる。また、各センサ列が隣り合って配置されている
ことから、電荷の読み出しにおける空間的なずれを非常
に少なくすることができ、電荷電圧変換部（図示せず）
の後段にメモリーや補正回路を設けなくても色ずれ等を
発生させずに済むようになる。
【００４３】次に、第３実施形態の説明を行う。図９は
第３実施形態を説明する模式平面図である。すなわち、
このＣＣＤセンサは、例えばＲ（赤）、Ｇ（緑）、Ｂ
（青）の３原色に対応して順に隣り合って配置されるた
センサ列ｅ、ｆ、ｇと、センサ列ｅと隣接して配置され
センサ列ｆの各画素におけるｏｄｄ側の電荷を受けて転
送を行う水平レジスタｊ’’と、この水平レジスタ
ｊ’’に隣接して配置されセンサ列ｅの各画素における
ｅｖｅｎ側とｏｄｄ側との各々の電荷を受けて各々転送
を行う水平レジスタｈ’’、ｉ’’と、センサ列ｇと隣
接して配置されセンサ列ｆの各画素におけるｅｖｅｎ側
の電荷を受けて転送を行う水平レジスタｋ’’と、この
水平レジスタｋ’’に隣接して配置されセンサ列ｇの各
画素におけるｏｄｄ側とｅｖｅｎ側との各々の電荷を受
けて各々転送を行う水平レジスタｌ’’、ｍ’’とを備
えている。
第３実施形態を説明する模式平面図である。すなわち、
このＣＣＤセンサは、例えばＲ（赤）、Ｇ（緑）、Ｂ
（青）の３原色に対応して順に隣り合って配置されるた
センサ列ｅ、ｆ、ｇと、センサ列ｅと隣接して配置され
センサ列ｆの各画素におけるｏｄｄ側の電荷を受けて転
送を行う水平レジスタｊ’’と、この水平レジスタ
ｊ’’に隣接して配置されセンサ列ｅの各画素における
ｅｖｅｎ側とｏｄｄ側との各々の電荷を受けて各々転送
を行う水平レジスタｈ’’、ｉ’’と、センサ列ｇと隣
接して配置されセンサ列ｆの各画素におけるｅｖｅｎ側
の電荷を受けて転送を行う水平レジスタｋ’’と、この
水平レジスタｋ’’に隣接して配置されセンサ列ｇの各
画素におけるｏｄｄ側とｅｖｅｎ側との各々の電荷を受
けて各々転送を行う水平レジスタｌ’’、ｍ’’とを備
えている。
【００４４】また、本実施形態におけるＣＣＤセンサで
は、中央に配置されるセンサ列ｆの各画素におけるｏｄ
ｄ側の電荷を水平レジスタｊ’’へ送るための垂直レジ
スタｎ１と、ｅｖｅｎ側の電荷を水平レジスタｋ’’へ
送るための垂直レジスタｎ２とを備えるとともに、水平
レジスタｈ’’、ｉ’’間に配置される水平レジスタ間
転送用レジスタｏ’と、水平レジスタｉ’’、ｊ’’間
に配置される水平レジスタ間転送用レジスタｐ’と、水
平レジスタｋ’’、ｌ’’間に配置される水平レジスタ
間転送用レジスタｑ’と、水平レジスタｌ’’、ｍ’’
間に配置される水平レジスタ間転送用レジスタｒ’とを
備えている。
は、中央に配置されるセンサ列ｆの各画素におけるｏｄ
ｄ側の電荷を水平レジスタｊ’’へ送るための垂直レジ
スタｎ１と、ｅｖｅｎ側の電荷を水平レジスタｋ’’へ
送るための垂直レジスタｎ２とを備えるとともに、水平
レジスタｈ’’、ｉ’’間に配置される水平レジスタ間
転送用レジスタｏ’と、水平レジスタｉ’’、ｊ’’間
に配置される水平レジスタ間転送用レジスタｐ’と、水
平レジスタｋ’’、ｌ’’間に配置される水平レジスタ
間転送用レジスタｑ’と、水平レジスタｌ’’、ｍ’’
間に配置される水平レジスタ間転送用レジスタｒ’とを
備えている。
【００４５】各水平レジスタｈ’’、ｉ’’、ｊ’’、
ｋ’’、ｌ’’、ｍ’’には２相の駆動電圧φｈ１、φ
ｈ２が印加され電荷を水平方向へ順次転送するようにな
っている。また、水平レジスタ間転送用レジスタｐ’、
ｑ’にはφｈｈ１が印加され、水平レジスタ間転送用レ
ジスタｏ’、ｒ’にはφｈｈ２が印加され、各々水平レ
ジスタ間の電荷の流れを制御している。
ｋ’’、ｌ’’、ｍ’’には２相の駆動電圧φｈ１、φ
ｈ２が印加され電荷を水平方向へ順次転送するようにな
っている。また、水平レジスタ間転送用レジスタｐ’、
ｑ’にはφｈｈ１が印加され、水平レジスタ間転送用レ
ジスタｏ’、ｒ’にはφｈｈ２が印加され、各々水平レ
ジスタ間の電荷の流れを制御している。
【００４６】また、センサ列ｅの各画素と水平レジスタ
ｊ’’との間およびセンサ列ｇの各画素と水平レジスタ
ｋ’’との間には各々転送ゲートが設けられ、ここに印
加されるφｒ１、φｒ２によって各画素で取り込んだ電
荷を水平レジスタｈ’’、ｉ’’および水平レジスタ
ｌ’’、ｍ’’へ各々転送できるようになっている。
ｊ’’との間およびセンサ列ｇの各画素と水平レジスタ
ｋ’’との間には各々転送ゲートが設けられ、ここに印
加されるφｒ１、φｒ２によって各画素で取り込んだ電
荷を水平レジスタｈ’’、ｉ’’および水平レジスタ
ｌ’’、ｍ’’へ各々転送できるようになっている。
【００４７】さらに、垂直レジスタｎ１、ｎ２には２相
の駆動電圧φｖ１、φｖ２が印加され、センサ列ｆの各
画素におけるｏｄｄ側とｅｖｅｎ側とで取り込んだ電荷
を水平レジスタｊ’’、ｋ’’へ転送できるようになっ
ている。
の駆動電圧φｖ１、φｖ２が印加され、センサ列ｆの各
画素におけるｏｄｄ側とｅｖｅｎ側とで取り込んだ電荷
を水平レジスタｊ’’、ｋ’’へ転送できるようになっ
ている。
【００４８】このように、本実施形態においても第１、
第２実施形態と同様、３本のセンサ列ｅ、ｆ、ｇが順に
隣り合って配置されていることから、取り込んだ電荷の
読み出しにおける空間的なずれを非常に少なくすること
ができるようになっている。なお、この３本のセンサ列
ｅ、ｆ、ｇは隣接して配置されていることが望ましい
が、必ずしも隣接していなくても２〜３ライン程度離れ
て配置されていてもよい。
第２実施形態と同様、３本のセンサ列ｅ、ｆ、ｇが順に
隣り合って配置されていることから、取り込んだ電荷の
読み出しにおける空間的なずれを非常に少なくすること
ができるようになっている。なお、この３本のセンサ列
ｅ、ｆ、ｇは隣接して配置されていることが望ましい
が、必ずしも隣接していなくても２〜３ライン程度離れ
て配置されていてもよい。
【００４９】次に、このＣＣＤセンサにおける具体的な
駆動方法を説明する。図１０〜図１１は主要部の転送例
を順に説明する模式図、図１２は転送のタイミングチャ
ートである。この図１０〜図１１では、センサ列ｆ、ｇ
で蓄積した電荷の転送を示している。また、図１０〜図
１１では、説明上電荷を楕円形で示している。
駆動方法を説明する。図１０〜図１１は主要部の転送例
を順に説明する模式図、図１２は転送のタイミングチャ
ートである。この図１０〜図１１では、センサ列ｆ、ｇ
で蓄積した電荷の転送を示している。また、図１０〜図
１１では、説明上電荷を楕円形で示している。
【００５０】先ず、図１２（ａ）に示すタイミングのよ
うに、φｈ１がＨｉｇｈ、φｈ２がＬｏｗ、φｈｈ１が
Ｈｉｇｈ、φｈｈ２がＨｉｇｈ、φｒ１がＨｉｇｈ、φ
ｒ２がＬｏｗ、φｖ１がＨｉｇｈ、φｖ２がＬｏｗとな
ると、図１０（ａ）に示すように、センサ列ｆのｅｖｅ
ｎ側の画素における電荷が垂直レジスタｎ２へ送られ、
センサ列ｇのｅｖｅｎ側の画素における電荷が水平レジ
スタｋ’’および水平レジスタ間転送用レジスタｑ’ま
で送られる。
うに、φｈ１がＨｉｇｈ、φｈ２がＬｏｗ、φｈｈ１が
Ｈｉｇｈ、φｈｈ２がＨｉｇｈ、φｒ１がＨｉｇｈ、φ
ｒ２がＬｏｗ、φｖ１がＨｉｇｈ、φｖ２がＬｏｗとな
ると、図１０（ａ）に示すように、センサ列ｆのｅｖｅ
ｎ側の画素における電荷が垂直レジスタｎ２へ送られ、
センサ列ｇのｅｖｅｎ側の画素における電荷が水平レジ
スタｋ’’および水平レジスタ間転送用レジスタｑ’ま
で送られる。
【００５１】なお、このタイミングで図９に示すセンサ
列ｅのｅｖｅｎ側の画素における電荷が水平レジスタ
ｊ’’および水平レジスタ間転送用レジスタｐ’まで送
られ、センサ列ｆのｏｄｄ側の画素における電荷が垂直
レジスタｎ１へ送られる。
列ｅのｅｖｅｎ側の画素における電荷が水平レジスタ
ｊ’’および水平レジスタ間転送用レジスタｐ’まで送
られ、センサ列ｆのｏｄｄ側の画素における電荷が垂直
レジスタｎ１へ送られる。
【００５２】次に、図１２（ｂ）に示すタイミングのよ
うに、φｈ１がＬｏｗ、φｈ２がＬｏｗ、φｈｈ１がＨ
ｉｇｈ、φｈｈ２がＨｉｇｈ、φｒ１がＬｏｗ、φｒ２
がＬｏｗ、φｖ１がＨｉｇｈ、φｖ２がＬｏｗとなる
と、図１０（ｂ）に示すように、水平レジスタｋ’’お
よび水平レジスタ間転送用レジスタｑ’に送られた電荷
が水平レジスタ間転送用レジスタｑ’に集められる。
うに、φｈ１がＬｏｗ、φｈ２がＬｏｗ、φｈｈ１がＨ
ｉｇｈ、φｈｈ２がＨｉｇｈ、φｒ１がＬｏｗ、φｒ２
がＬｏｗ、φｖ１がＨｉｇｈ、φｖ２がＬｏｗとなる
と、図１０（ｂ）に示すように、水平レジスタｋ’’お
よび水平レジスタ間転送用レジスタｑ’に送られた電荷
が水平レジスタ間転送用レジスタｑ’に集められる。
【００５３】なお、このタイミングで図９に示す水平レ
ジスタｊ’’および水平レジスタ間転送用レジスタｐ’
に送られた電荷は水平レジスタ間転送用レジスタｐ’に
集められる。
ジスタｊ’’および水平レジスタ間転送用レジスタｐ’
に送られた電荷は水平レジスタ間転送用レジスタｐ’に
集められる。
【００５４】次いで、図１２（ｃ）に示すタイミングの
ように、φｈ１がＬｏｗ、φｈ２がＨｉｇｈ、φｈｈ１
がＨｉｇｈ、φｈｈ２がＨｉｇｈ、φｒ１がＬｏｗ、φ
ｒ２がＨｉｇｈ、φｖ１がＬｏｗ、φｖ２がＨｉｇｈと
なると、図１０（ｃ）に示すように、垂直レジスタｎ２
に送られた電荷が水平レジスタｋ’’の手前まで転送さ
れ、センサ列ｇのｏｄｄ側の画素における電荷が水平レ
ジスタｋ’’および水平レジスタ間転送用レジスタｑ’
まで送られるとともに、水平レジスタ間転送用レジスタ
ｑ’にあったセンサ列ｇのｅｖｅｎ側の画素における電
荷が水平レジスタｌ’’および水平レジスタ間転送用レ
ジスタｒ’まで転送される。
ように、φｈ１がＬｏｗ、φｈ２がＨｉｇｈ、φｈｈ１
がＨｉｇｈ、φｈｈ２がＨｉｇｈ、φｒ１がＬｏｗ、φ
ｒ２がＨｉｇｈ、φｖ１がＬｏｗ、φｖ２がＨｉｇｈと
なると、図１０（ｃ）に示すように、垂直レジスタｎ２
に送られた電荷が水平レジスタｋ’’の手前まで転送さ
れ、センサ列ｇのｏｄｄ側の画素における電荷が水平レ
ジスタｋ’’および水平レジスタ間転送用レジスタｑ’
まで送られるとともに、水平レジスタ間転送用レジスタ
ｑ’にあったセンサ列ｇのｅｖｅｎ側の画素における電
荷が水平レジスタｌ’’および水平レジスタ間転送用レ
ジスタｒ’まで転送される。
【００５５】なお、このタイミングで図９に示す垂直レ
ジスタｎ１に送られた電荷が水平レジスタｊ’’の手前
まで転送され、センサ列ｅのｏｄｄ側の画素における電
荷が水平レジスタｊ’’および水平レジスタ間転送用レ
ジスタｐ’まで送られるとともに、水平レジスタ間転送
用レジスタｐ’にあったセンサ列ｅのｅｖｅｎ側の画素
における電荷が水平レジスタｉ’’および水平レジスタ
間転送用レジスタｏ’まで転送される。
ジスタｎ１に送られた電荷が水平レジスタｊ’’の手前
まで転送され、センサ列ｅのｏｄｄ側の画素における電
荷が水平レジスタｊ’’および水平レジスタ間転送用レ
ジスタｐ’まで送られるとともに、水平レジスタ間転送
用レジスタｐ’にあったセンサ列ｅのｅｖｅｎ側の画素
における電荷が水平レジスタｉ’’および水平レジスタ
間転送用レジスタｏ’まで転送される。
【００５６】次に、図１２（ｄ）に示すタイミングのよ
うに、φｈ１がＬｏｗ、φｈ２がＬｏｗ、φｈｈ１がＨ
ｉｇｈ、φｈｈ２がＨｉｇｈ、φｒ１がＬｏｗ、φｒ２
がＬｏｗ、φｖ１がＬｏｗ、φｖ２がＨｉｇｈとなる
と、図１１（ａ）に示すように、水平レジスタｋ’’お
よび水平レジスタ間転送用レジスタｑ’に送られた電荷
が水平レジスタ間転送用レジスタｑ’に集められ、水平
レジスタｌ’’および水平レジスタ間転送用レジスタ
ｒ’に転送された電荷が水平レジスタ間転送用レジスタ
ｑ’と水平レジスタ間転送用レジスタｒ’とに分けられ
る。
うに、φｈ１がＬｏｗ、φｈ２がＬｏｗ、φｈｈ１がＨ
ｉｇｈ、φｈｈ２がＨｉｇｈ、φｒ１がＬｏｗ、φｒ２
がＬｏｗ、φｖ１がＬｏｗ、φｖ２がＨｉｇｈとなる
と、図１１（ａ）に示すように、水平レジスタｋ’’お
よび水平レジスタ間転送用レジスタｑ’に送られた電荷
が水平レジスタ間転送用レジスタｑ’に集められ、水平
レジスタｌ’’および水平レジスタ間転送用レジスタ
ｒ’に転送された電荷が水平レジスタ間転送用レジスタ
ｑ’と水平レジスタ間転送用レジスタｒ’とに分けられ
る。
【００５７】なお、このタイミングで図９に示す水平レ
ジスタｊ’’および水平レジスタ間転送用レジスタｐ’
に送られた電荷が水平レジスタ間転送用レジスタｐ’に
集められ、水平レジスタｉ’’および水平レジスタ間転
送用レジスタｏ’に転送された電荷が水平レジスタ間転
送用レジスタｐ’と水平レジスタ間転送用レジスタｏ’
とに分けられる。
ジスタｊ’’および水平レジスタ間転送用レジスタｐ’
に送られた電荷が水平レジスタ間転送用レジスタｐ’に
集められ、水平レジスタｉ’’および水平レジスタ間転
送用レジスタｏ’に転送された電荷が水平レジスタ間転
送用レジスタｐ’と水平レジスタ間転送用レジスタｏ’
とに分けられる。
【００５８】次いで、図１２（ｅ）に示すタイミングの
ように、φｈ１がＬｏｗ、φｈ２がＬｏｗ、φｈｈ１が
Ｌｏｗ、φｈｈ２がＨｉｇｈ、φｒ１がＬｏｗ、φｒ２
がＬｏｗ、φｖ１がＬｏｗ、φｖ２がＨｉｇｈとなる
と、図１１（ｂ）に示すように、水平レジスタ間転送用
レジスタｑ’の各電荷が水平レジスタ間転送用レジスタ
ｒ’に集められる。
ように、φｈ１がＬｏｗ、φｈ２がＬｏｗ、φｈｈ１が
Ｌｏｗ、φｈｈ２がＨｉｇｈ、φｒ１がＬｏｗ、φｒ２
がＬｏｗ、φｖ１がＬｏｗ、φｖ２がＨｉｇｈとなる
と、図１１（ｂ）に示すように、水平レジスタ間転送用
レジスタｑ’の各電荷が水平レジスタ間転送用レジスタ
ｒ’に集められる。
【００５９】なお、このタイミングで図９に示す水平レ
ジスタ間転送用レジスタｐ’の各電荷が水平レジスタ間
転送用レジスタｏ’に集められる。
ジスタ間転送用レジスタｐ’の各電荷が水平レジスタ間
転送用レジスタｏ’に集められる。
【００６０】次いで、図１２（ｆ）に示すタイミングの
ように、φｈ１がＨｉｇｈ、φｈ２がＬｏｗ、φｈｈ１
がＬｏｗ、φｈｈ２がＨｉｇｈ、φｒ１がＬｏｗ、φｒ
２がＬｏｗ、φｖ１がＬｏｗ、φｖ２がＬｏｗとなる
と、図１１（ｃ）に示すように、垂直レジスタｎ２にあ
った電荷が水平レジスタｋ’’に転送されるとともに、
水平レジスタ間転送用レジスタｒ’に集められた電荷の
うち、ｏｄｄ側に対応するものが水平レジスタｌ’’に
転送され、ｅｖｅｎ側に対応するものが水平レジスタ
ｍ’’に転送される。
ように、φｈ１がＨｉｇｈ、φｈ２がＬｏｗ、φｈｈ１
がＬｏｗ、φｈｈ２がＨｉｇｈ、φｒ１がＬｏｗ、φｒ
２がＬｏｗ、φｖ１がＬｏｗ、φｖ２がＬｏｗとなる
と、図１１（ｃ）に示すように、垂直レジスタｎ２にあ
った電荷が水平レジスタｋ’’に転送されるとともに、
水平レジスタ間転送用レジスタｒ’に集められた電荷の
うち、ｏｄｄ側に対応するものが水平レジスタｌ’’に
転送され、ｅｖｅｎ側に対応するものが水平レジスタ
ｍ’’に転送される。
【００６１】なお、このタイミングで図９に示す垂直レ
ジスタｎ１にあった電荷が水平レジスタｊ’’に転送さ
れるとともに、水平レジスタ間転送用レジスタｏ’に集
められた電荷のうち、ｏｄｄ側に対応するものが水平レ
ジスタｉ’’に転送され、ｅｖｅｎ側に対応するものが
水平レジスタｈ’’に転送される。
ジスタｎ１にあった電荷が水平レジスタｊ’’に転送さ
れるとともに、水平レジスタ間転送用レジスタｏ’に集
められた電荷のうち、ｏｄｄ側に対応するものが水平レ
ジスタｉ’’に転送され、ｅｖｅｎ側に対応するものが
水平レジスタｈ’’に転送される。
【００６２】これにより、センサ列ｅ、ｆ、ｇの各画素
における電荷が、ｏｄｄ側、ｅｖｅｎ側に分かれて各々
水平レジスタｈ’’、ｉ’’、ｊ’’、ｋ’’、
ｌ’’、ｍ’’に転送されることになる。この状態で、
φｈ１、φｈ２を順に印加することで各電荷を水平方向
へ転送できるようになる。
における電荷が、ｏｄｄ側、ｅｖｅｎ側に分かれて各々
水平レジスタｈ’’、ｉ’’、ｊ’’、ｋ’’、
ｌ’’、ｍ’’に転送されることになる。この状態で、
φｈ１、φｈ２を順に印加することで各電荷を水平方向
へ転送できるようになる。
【００６３】このような転送により、各センサ列の各画
素で取り込んだ電荷をｅｖｅｎ側、ｏｄｄ側に分けて各
センサ列間の時差を発生させることなく出力できるよう
になる。また、各センサ列が隣り合って配置されている
ことから、電荷の読み出しにおける空間的なずれを非常
に少なくすることができ、電荷電圧変換部（図示せず）
の後段にメモリーや補正回路を設けなくても色ずれ等を
発生させずに済むようになる。
素で取り込んだ電荷をｅｖｅｎ側、ｏｄｄ側に分けて各
センサ列間の時差を発生させることなく出力できるよう
になる。また、各センサ列が隣り合って配置されている
ことから、電荷の読み出しにおける空間的なずれを非常
に少なくすることができ、電荷電圧変換部（図示せず）
の後段にメモリーや補正回路を設けなくても色ずれ等を
発生させずに済むようになる。
【００６４】なお、上記説明した各実施形態では、主と
して３ラインのセンサ列を備えたＣＣＤセンサへの適用
例を説明したが、本発明はこれに限定されずさらに多く
の本数のセンサ列を備えたＣＣＤセンサであっても同様
に適用可能である。
して３ラインのセンサ列を備えたＣＣＤセンサへの適用
例を説明したが、本発明はこれに限定されずさらに多く
の本数のセンサ列を備えたＣＣＤセンサであっても同様
に適用可能である。
【００６５】
【発明の効果】以上説明したように、本発明の固体撮像
装置およびその駆動方法によれば次のような効果があ
る。すなわち、少なくとも２本の画素列を隣り合わせる
ことで画素列間距離を縮めることが可能となり、画素列
間距離に起因する色ずれを大幅に低減させることが可能
となる。これにより、電荷電圧変換部の後段にメモリー
を用意したり色ずれ補正回路を用意する必要がなくな
り、固体撮像装置のコストダウンを図ることが可能とな
る。
装置およびその駆動方法によれば次のような効果があ
る。すなわち、少なくとも２本の画素列を隣り合わせる
ことで画素列間距離を縮めることが可能となり、画素列
間距離に起因する色ずれを大幅に低減させることが可能
となる。これにより、電荷電圧変換部の後段にメモリー
を用意したり色ずれ補正回路を用意する必要がなくな
り、固体撮像装置のコストダウンを図ることが可能とな
る。
【図１】第１実施形態を説明する模式平面図である。
【図２】第１実施形態における主要部の転送例を順に説
明する模式図である。
明する模式図である。
【図３】第１実施形態における転送のタイミングチャー
トである。
トである。
【図４】第２実施形態を説明する模式平面図である。
【図５】第２実施形態における主要部の転送例を順に説
明する図（その１）である。
明する図（その１）である。
【図６】第２実施形態における主要部の転送例を順に説
明する図（その２）である。
明する図（その２）である。
【図７】第２実施形態における主要部の転送例を順に説
明する図（その３）である。
明する図（その３）である。
【図８】第２実施形態における転送のタイミングチャー
トである。
トである。
【図９】第３実施形態を説明する模式平面図である。
【図１０】第３実施形態における主要部の転送例を順に
説明する図（その１）である。
説明する図（その１）である。
【図１１】第３実施形態における主要部の転送例を順に
説明する図（その２）である。
説明する図（その２）である。
【図１２】第３実施形態における転送のタイミングチャ
ートである。
ートである。
【図１３】従来のＣＣＤセンサの構成を示す模式平面図
である。
である。
ｅ…センサ列、ｆ…センサ列、ｇ…センサ列、ｈ…水平
レジスタ、ｉ…水平レジスタ、ｊ…水平レジスタ、ｋ…
水平レジスタ間転送用レジスタ、ｎ…垂直レジスタ
レジスタ、ｉ…水平レジスタ、ｊ…水平レジスタ、ｋ…
水平レジスタ間転送用レジスタ、ｎ…垂直レジスタ
Claims (12)
- 【請求項１】 少なくとも２本の画素列が隣り合って配
置される画像取り込み手段と、 前記画像取り込み手段に隣接して配置され前記少なくと
も２本の画素列の各々に対応して設けられた少なくとも
２本の水平電荷転送列から構成される水平電荷転送手段
とを備えていることを特徴とする固体撮像装置。 - 【請求項２】 前記少なくとも２本の画素列のうち前記
水平電荷転送手段と隣接しない画素列の各画素からその
画素列に対応した前記水平電荷転送列に各々電荷を転送
する垂直電荷転送手段を備えていることを特徴とする請
求項１記載の固体撮像装置。 - 【請求項３】 前記水平電荷転送手段は、１本の画素列
に対して２本の水平電荷転送列を備えた構成となってい
ることを特徴とする請求項１記載の固体撮像装置。 - 【請求項４】 第１画素列、第２画素列、第３画素列が
順に隣り合って配置される画像取り込み手段と、 前記画像取り込み手段の第１画素列と隣接して配置され
前記第１画素列および前記第２画素列に各々対応して設
けられた第１水平電荷転送列および第２水平電荷転送列
から構成される第１水平電荷転送手段と、 前記画像取り込み手段の第３画素列と隣接した配置され
前記第３画素列に対応して設けられた第３水平電荷転送
列から成る第２水平電荷転送手段と、 前記画像取り込み手段の第２画素列の各画素から前記第
２水平電荷転送列に各々電荷を転送する垂直電荷転送手
段とを備えていることを特徴とする固体撮像装置。 - 【請求項５】 前記第１水平電荷転送列、前記第２水平
電荷転送列および前記第３水平電荷転送列は、各々対応
する前記第１画素列、前記第２画素列および前記第３画
素列の各画素における異なる１つおきの画素の組に対応
した２本の水平電荷転送列をそれぞれ備えた構成となっ
ていることを特徴とする請求項４記載の固体撮像装置。 - 【請求項６】 第１画素列、第２画素列、第３画素列が
順に隣り合って配置される画像取り込み手段と、 前記画像取り込み手段の第１画素列および第３画素列に
各々隣接して配置され前記第２画素列の各画素における
異なる１つおきの画素の組に対応した２本の水平電荷転
送列から構成される第２水平電荷転送手段と、 前記画像取り込み手段の第１画素列に隣接する前記第２
水平電荷転送手段のうちの一方の水平電荷転送列と隣接
して配置され前記第１画素列の各画素における異なる１
つおきの画素の組に対応した２本の水平電荷転送列から
構成される第１水平電荷転送手段と、 前記画像取り込み手段の第３画素列に隣接する前記第２
水平電荷転送手段のうちの他方の水平電荷転送列と隣接
して配置され前記第３画素列の各画素における異なる１
つおきの画素の組に対応した２本の水平電荷転送列から
構成される第３水平電荷転送手段と、 前記画像取り込み手段の第２画素列の各画素から前記第
２水平電荷転送手段の対応する２本の水平電荷転送列に
各々電荷を転送する垂直電荷転送手段とを備えているこ
とを特徴とする固体撮像装置。 - 【請求項７】 少なくとも２本の画素列が隣り合って配
置される画像取り込み手段と、前記画像取り込み手段に
隣接して配置され前記少なくとも２本の画素列の各々に
対応して設けられた少なくとも２本の水平電荷転送列か
ら構成される水平電荷転送手段とを備える固体撮像装置
の駆動方法において、 前記少なくとも２本の画素列の各画素で電荷を取り込む
工程と、 前記少なくとも２本の画素列の各画素で取り込んだ電荷
を各々対応した前記少なくとも２本の水平電荷転送列へ
転送する工程と、 前記少なくとも２本の水平電荷転送列へ各画素列の各画
素で取り込んだ電荷を全て転送した後、その各電荷を水
平方向へ順次転送する工程とを備えていることを特徴と
する固体撮像装置の駆動方法。 - 【請求項８】 少なくとも２本の画素列が隣り合って配
置される画像取り込み手段と、前記画像取り込み手段に
隣接して配置され前記少なくとも２本の画素列の各々に
対応して設けられた少なくとも２本の水平電荷転送列か
ら構成される水平電荷転送手段と、前記少なくとも２本
の画素列のうち前記水平電荷転送手段と隣接しない画素
列の各画素からその画素列に対応した前記水平電荷転送
列に各々電荷を転送する垂直電荷転送手段とを備えてい
る固体撮像装置の駆動方法において、 前記少なくとも２本の画素列の各画素で電荷を取り込む
工程と、 前記少なくとも２本の画素列のうち前記水平電荷転送手
段と隣接しない画素列の各画素で取り込んだ電荷を前記
垂直電荷転送手段へ送るとともに、前記水平電荷転送手
段と隣接する画素列の各画素で取り込んだ電荷を対応す
る前記水平電荷転送列の手間まで送る工程と、 前記垂直電荷転送手段へ送られた電荷を前記少なくとも
２本の画素列のうち前記水平電荷転送手段と隣接しない
画素列と対応する前記水平電荷転送列へ送るとともに、
前記水平電荷転送手段と隣接する画素列から対応する前
記水平電荷転送列の手間まで送られた電荷をその水平電
荷転送列へ送る工程と、 前記少なくとも２本の水平電荷転送列へ各画素列の各画
素で取り込んだ電荷を全て転送した後、その各電荷を水
平方向へ順次転送する工程とを備えていることを特徴と
する固体撮像装置の駆動方法。 - 【請求項９】 少なくとも２本の画素列が隣り合って配
置される画像取り込み手段と、前記画像取り込み手段に
隣接して配置され前記少なくとも２本の画素列の各々に
対応して２本の水平電荷転送列が設けられた水平電荷転
送手段とを備えている固体撮像装置の駆動方法におい
て、 前記少なくとも２本の画素列の各画素で電荷を取り込む
工程と、 前記少なくとも２本の画素列の各画素における異なる１
つおきの画素の組に対応して前記２本の水平電荷転送列
へ各々の組の画素で取り込んだ電荷を送る工程と、 前記少なくとも２本の画素列の各画素で取り込んだ電荷
を全て前記水平電荷転送列へ転送した後、その各電荷を
水平方向へ順次転送する工程とを備えていることを特徴
とする固体撮像装置の駆動方法。 - 【請求項１０】 第１画素列、第２画素列、第３画素列
が順に隣り合って配置される画像取り込み手段と、前記
画像取り込み手段の第１画素列と隣接して配置され前記
第１画素列および前記第２画素列に各々対応して設けら
れた第１水平電荷転送列および第２水平電荷転送列から
構成される第１水平電荷転送手段と、前記画像取り込み
手段の第３画素列と隣接した配置され前記第３画素列に
対応して設けられた第３水平電荷転送列から成る第２水
平電荷転送手段と、前記画像取り込み手段の第２画素列
の各画素から前記第２水平電荷転送列に各々電荷を転送
する垂直電荷転送手段とを備えている固体撮像装置の駆
動方法において、 前記第１画素列、第２画素列、第３画素列の各画素で電
荷を取り込む工程と、 前記第１画素列の各画素で取り込んだ電荷を前記第１水
平電荷転送列の手間まで送り、前記第２画素列の各画素
で取り込んだ電荷を前記垂直電荷転送手段へ送り、さら
に前記第３画素列の各画素で取り込んだ電荷を前記第３
水平電荷転送列へ送る工程と、 前記第１水平電荷転送列の手間まで送られた電荷を前記
第１水平電荷転送列へ送り、前記垂直電荷転送手段へ送
られた電荷を前記第２水平電荷転送列へ送る工程と、 前記第１画素列、前記第２画素列、前記第３画素列の各
画素の電荷を全て前記第１水平電荷転送列、前記第２水
平電荷転送列、前記第３水平電荷転送列へ各々転送した
後、その各電荷を水平方向へ順次転送する工程とを備え
ていることを特徴とする固体撮像装置の駆動方法。 - 【請求項１１】 第１画素列、第２画素列、第３画素列
が順に隣り合って配置される画像取り込み手段と、前記
画像取り込み手段の第１画素列と隣接して配置され前記
第１画素列および前記第２画素列に各々対応して設けら
れた２本の第１水平電荷転送列および２本の第２水平電
荷転送列から構成される第１水平電荷転送手段と、前記
画像取り込み手段の第３画素列と隣接した配置され前記
第３画素列に対応して設けられた２本の第３水平電荷転
送列から成る第２水平電荷転送手段と、前記画像取り込
み手段の第２画素列の各画素から前記２本の第２水平電
荷転送列に各々電荷を転送する垂直電荷転送手段とを備
えている固体撮像装置の駆動方法において、 前記第１画素列、第２画素列、第３画素列の各画素で電
荷を取り込む工程と、 前記第１画素列の各画素で取り込んだ電荷を前記２本の
第１水平電荷転送列の間まで送り、前記第２画素列の各
画素で取り込んだ電荷を前記垂直電荷転送手段へ送り、
さらに前記第３画素列の各画素における１つおきの画素
の組で取り込んだ電荷を前記第３水平電荷転送列の一方
側へ送る工程と、 前記垂直電荷転送手段へ送られた電荷のうち前記第２画
素列の各画素における１つおきの画素の組に対応した電
荷を前記２本の第２水平電荷転送列の間まで送り、前記
第３画素列の各画素における前記１つおきの画素の組と
異なる１つおきの画素の組で取り込んだ画素を前記第３
水平電荷転送列の他方側へ送る工程と、前記２本の第１
水平電荷転送列の間まで送られた各電荷における異なる
１つおきの組毎に前記２本の第１水平電荷転送列の一方
側と他方側とに分けて送り、前記２本の第２水平電荷転
送列の間まで送られた電荷を前記２本の水平電荷転送列
の一方側へ送り、前記垂直電荷転送手段に残っている電
荷を前記２本の水平電荷転送列の他方側へ送る工程と、 前記第１画素列、前記第２画素列、前記第３画素列の各
画素の電荷を全て前記２本の第１水平電荷転送列、前記
２本の第２水平電荷転送列、前記２本の第３水平電荷転
送列へ各々転送した後、その各電荷を水平方向へ順次転
送する工程とを備えていることを特徴とする固体撮像装
置の駆動方法。 - 【請求項１２】 第１画素列、第２画素列、第３画素列
が順に隣り合って配置される画像取り込み手段と、前記
画像取り込み手段の第１画素列および第３画素列に各々
隣接して配置され前記第２画素列の各画素における異な
る１つおきの画素の組に対応した２本の水平電荷転送列
から構成される第２水平電荷転送手段と、前記画像取り
込み手段の第１画素列に隣接する前記第２水平電荷転送
手段のうちの一方の水平電荷転送列と隣接して配置され
前記第１画素列の各画素における異なる１つおきの画素
の組に対応した２本の水平電荷転送列から構成される第
１水平電荷転送手段と、前記画像取り込み手段の第３画
素列に隣接する前記第２水平電荷転送手段のうちの他方
の水平電荷転送列と隣接して配置され前記第３画素列の
各画素における異なる１つおきの画素の組に対応した２
本の水平電荷転送列から構成される第３水平電荷転送手
段と、前記画像取り込み手段の第２画素列の各画素から
前記第２水平電荷転送手段の対応する２本の水平電荷転
送列に各々電荷を転送する垂直電荷転送手段とを備えて
いる固体撮像装置の駆動方法において、 前記第１画素列、第２画素列、第３画素列の各画素で電
荷を取り込む工程と、 前記第１画素列の各画素で取り込んだ電荷を前記２本の
第１水平電荷転送列の間まで送り、前記第２画素列の各
画素で取り込んだ電荷を前記垂直電荷転送手段へ送り、
さらに前記第３画素列の各画素で取り込んだ電荷を前記
２本の第３水平電荷転送列の間まで送る工程と、 前記垂直電荷転送手段へ送られた電荷のうち前記第２画
素列の各画素における異なる１つおきの画素の組に対応
した電荷を前記２本の第２水平電荷転送列へ各々送ると
ともに、前記２本の第１水平電荷転送列の間まで送られ
た各電荷における異なる１つおきの組毎に前記２本の第
１水平電荷転送列の一方側と他方側とに分けて送り、さ
らに前記２本の第３水平電荷転送列の間まで送られた各
電荷における異なる１つおきの組毎に前記２本の第３水
平電荷転送列の一方側と他方側とに分けて送る工程と、 前記第１画素列、前記第２画素列、前記第３画素列の各
画素の電荷を全て前記２本の第１水平電荷転送列、前記
２本の第２水平電荷転送列、前記２本の第３水平電荷転
送列へ各々転送した後、その各電荷を水平方向へ順次転
送する工程とを備えていることを特徴とする固体撮像装
置の駆動方法。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9327486A JPH11164205A (ja) | 1997-11-28 | 1997-11-28 | 固体撮像装置およびその駆動方法 |
| TW087119294A TW441115B (en) | 1997-11-28 | 1998-11-20 | Solid-state image pickup device and method of driving the same |
| US09/199,300 US6781628B1 (en) | 1997-11-28 | 1998-11-25 | Solid-state image pickup device and method of driving the same |
| KR1019980051385A KR100579025B1 (ko) | 1997-11-28 | 1998-11-27 | 고체촬상장치및그구동방법 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9327486A JPH11164205A (ja) | 1997-11-28 | 1997-11-28 | 固体撮像装置およびその駆動方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH11164205A true JPH11164205A (ja) | 1999-06-18 |
Family
ID=18199701
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9327486A Pending JPH11164205A (ja) | 1997-11-28 | 1997-11-28 | 固体撮像装置およびその駆動方法 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US6781628B1 (ja) |
| JP (1) | JPH11164205A (ja) |
| KR (1) | KR100579025B1 (ja) |
| TW (1) | TW441115B (ja) |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE10331676A1 (de) * | 2002-09-12 | 2004-03-25 | Thomson Licensing S.A., Boulogne | Verfahren zur Korrektur von Videosignalen |
| US7688374B2 (en) * | 2004-12-20 | 2010-03-30 | The United States Of America As Represented By The Secretary Of The Army | Single axis CCD time gated ladar sensor |
| US7692706B2 (en) * | 2006-07-20 | 2010-04-06 | Eastman Kodak Company | Charge summing in multiple output charge-coupled devices in an image sensor |
| JP5493316B2 (ja) * | 2008-01-17 | 2014-05-14 | ソニー株式会社 | 固体撮像装置およびその製造方法 |
Family Cites Families (8)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6129462A (ja) * | 1984-07-19 | 1986-02-10 | Toshiba Corp | 情報記録再生装置の制御回路 |
| US5189498A (en) * | 1989-11-06 | 1993-02-23 | Mitsubishi Denki Kabushiki Kaisha | Charge coupled device |
| JP2891550B2 (ja) * | 1991-01-11 | 1999-05-17 | 三菱電機株式会社 | イメージセンサ |
| JP3406935B2 (ja) * | 1994-01-31 | 2003-05-19 | キヤノン株式会社 | 撮像装置 |
| DE69530874T2 (de) * | 1994-08-09 | 2004-03-11 | Canon K.K. | Farbbildlesegerät |
| US6078685A (en) * | 1994-08-22 | 2000-06-20 | Canon Kabushiki Kaisha | Image reading apparatus for reading a color image by irradiating light onto an object and photoelectrically converting light from the object |
| JP2907058B2 (ja) * | 1995-04-21 | 1999-06-21 | 富士ゼロックス株式会社 | 蓄積手段を持つイメージセンサ及び画像読取装置 |
| JP2865019B2 (ja) * | 1995-05-31 | 1999-03-08 | 日本電気株式会社 | 電荷転送固体撮像装置の駆動方法 |
-
1997
- 1997-11-28 JP JP9327486A patent/JPH11164205A/ja active Pending
-
1998
- 1998-11-20 TW TW087119294A patent/TW441115B/zh not_active IP Right Cessation
- 1998-11-25 US US09/199,300 patent/US6781628B1/en not_active Expired - Fee Related
- 1998-11-27 KR KR1019980051385A patent/KR100579025B1/ko not_active IP Right Cessation
Also Published As
| Publication number | Publication date |
|---|---|
| KR19990045660A (ko) | 1999-06-25 |
| TW441115B (en) | 2001-06-16 |
| US6781628B1 (en) | 2004-08-24 |
| KR100579025B1 (ko) | 2006-07-25 |
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