JPH10513018A - 駆動段 - Google Patents
駆動段Info
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- JPH10513018A JPH10513018A JP8515976A JP51597696A JPH10513018A JP H10513018 A JPH10513018 A JP H10513018A JP 8515976 A JP8515976 A JP 8515976A JP 51597696 A JP51597696 A JP 51597696A JP H10513018 A JPH10513018 A JP H10513018A
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04M—TELEPHONIC COMMUNICATION
- H04M19/00—Current supply arrangements for telephone systems
- H04M19/001—Current supply source at the exchanger providing current to substations
- H04M19/005—Feeding arrangements without the use of line transformers
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Signal Processing (AREA)
- Amplifiers (AREA)
- Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
- Devices For Supply Of Signal Current (AREA)
Abstract
(57)【要約】
加入者線インタフェース回路の2つの差動増幅器出力段(2、3)を駆動する駆動段(1)において、該駆動段(1)が、一方においては、該駆動段へ入力する横および縦信号ITおよびILのそれぞれに、他方においては、基準電流IRに、依存して4つの駆動電流を発生し、これらの駆動電流を対をなして前記差動増幅器出力段(2、3)の2つの入力に供給するようにされており、前記4つの駆動段電流の全てがゼロよりも大きい、前記駆動段(1)。
Description
【発明の詳細な説明】
駆動段説明
技術分野
本発明は、加入者線インタフェース回路の2つの差動増幅器出力段を駆動する
駆動段に関し、該駆動段は、一方においては、該駆動段へ入力する横および縦信
号ITおよびILのそれぞれに、他方においては、基準電流IRに、依存して4
つの駆動電流を発生し、これらの駆動電流を対をなして前記両差動増幅器出力段
の2つの入力に供給する。
発明の背景
加入者線インタフェース回路の目的は、命令により回路線に電流を供給するこ
とである。
交換局においては、加入者線は、大部分の時間の間はアイドル状態にあり、す
なわち線は開かれている。加入者線インタフェース回路における電力損失は、交
換局の全電力損失のかなりの部分を構成し、加入者線インタフェース回路におけ
る電力損失を、発呼中はもちろんアイドル状態においてもできるだけ低く保つこ
とは極めて重要である。
通常は、アナログ加入者線インタフェース回路の出力段は、プッシュプル形の
ものでAB級で動作し、それはあるアイドル電流が常に該出力段を通って流れる
ことを意味する。
伝統的には、アナログ加入者線インタフェース回路の出力段は、接地または+
5Vと、電話との関連において公称−48Vである電池電圧と、の間で通常動作
する2つの駆動段からの電流により駆動されてきた。出力段の駆動において十分
な直線性を得るために、駆動段は通常A級で動作するように設計され、それはア
イドル電流が駆動段において、常に接地または+5Vから電池電圧へ流れること
を意味する。出力段を、必要とされる最大出力電流まで駆動しうるためには、こ
のアイドル電流は、十分に大きくなければならなず、従って出力段の電流増幅に
依存する。
すなわち、加入者線インタフェース回路が電流を供給していない時にも、互い
に無関係な比較的大きい電流が、接地または+5Vから電池電圧へ、駆動段およ
び出力段を通って流れる。このアイドル状態において、加入者線インタフェース
回路の電力消費が低いことは極めて重要である。かなりの寄与は、駆動段の、ま
た出力段の、アイドル電流によりなされる。
従って、アイドル状態において駆動段および出力段により生じる電力損失は、
できるだけ低くなければならない。
さらに、駆動段は、利用可能な全電圧範囲にわたって、それぞれの出力段を駆
動しうることが極めて重要である。
発明の簡単な説明
従って、本発明は、出力段と組合わされ、従来公知の駆動段よりも電力損失を
低くし、同時に利用可能な全電圧範囲にわたって動作しうる、駆動段を実現する
ことを目的とする。
これは、本発明の駆動段により、全ての4つの駆動電流がゼロより大きい点で
達成される。
図面の簡単な説明
以下、本発明を、添付図面を参照しつつ詳述するが、添付図面においては、単
一の図が、加入者線インタフェース回路の2つの差動増幅器出力段を駆動する本
発明の駆動段の実施例を示している。
実施例
図の1は、例えば加入者ステーションである負荷4により成端された、2つの
線AおよびBを含む加入者線へ供給するための、詳細は図示されていない加入者
線インタフェース回路の、2つの差動増幅器出力段2および3を駆動する駆動段
を示す。
図示されている実施例において、駆動段1は、駆動段1へ到着した縦信号すな
わち電流ILを鏡映する電流鏡映回路SSLと、駆動段1へ到着した横信号すな
わち電流ITを鏡映する電流鏡映回路SSTと、電流鏡映回路SSLに接続され
た差動増幅器DFLと、電流鏡映回路SSTに接続された差動増幅器DFTと、
図示の実施例においては駆動段へ供給される基準電流IRを、縦および横部分電
流IRLおよびIRTのそれぞれに分割する電流分割回路SUKと、駆動段1内
の回路へ異なる電圧を供給する2つの電圧発生器V1およびV2と、を含む。
電流鏡映回路SSLおよびSSTと、差動増幅器DFLおよびDFTと、電流
分割回路SUKとは、従来のものである。従って、これに関連して、これらの回
路の設計は、たとえもし回路の実際的な実施例が、それぞれの回路に対応して図
のブロック内に図示されていても、詳述しない。
駆動段1は、入来横電流ITと、入力縦電流ILと、基準電流IRとから、4
つの駆動電流K1*IR−K2*IT−K3*IL、K1*IR+K2*IT+
K3*IL、K1*IR+K2*IT−K3*IL、およびK1*IR−K2*
IT+K3*ILを発生するようにされており、K1、K2、およびK3は比例
定数である。
本発明によれば、駆動段1により発生されたこれら4つの駆動電流は、駆動電
流K1*IR−K2*IT−K3*ILおよびK1*IR+K2*IT+K3*
ILが出力段3へ供給され、一方駆動電流K1*IR+K2*IT−K3*IL
およびK1*IR−K2*IT+K3*ILが出力段2へ供給されるように、差
動増幅器出力段2および3の2つの入力へ対をなして供給される。
この結果、出力段2からの出力電流はIL−ITに比例し、出力段3からの出
力電流はIL+ITに比例する。
すなわち、入来横電流ITは出力段2および3を逆相で駆動し、一方入力縦電
流ILは出力段2および3を同相で駆動する。
本発明によれば、駆動段1により発生せしめられた駆動電流は、全てゼロより
も大きく、すなわち、それらは全てそれぞれの差動増幅器出力段2および3へ流
れ込む。
本発明の駆動段1により、該段からの駆動電流は、それぞれの出力段2および
3を経て、それぞれの出力段の負の供給電圧端子(図示せず)へ供給され、それ
ぞれの出力段におけるアイドル動作点を変位させる。その結果、プッシュプル形
出力段の上半分におけるアイドル電流は、駆動段のアイドル電流の和の関数とし
て減少する。このようにして、駆動段のアイドル電流の全部または大部分は、出
力段におけるアイドル電流として「回復」され、その結果、駆動段および出力段
における全アイドル電力損失は低下される。
─────────────────────────────────────────────────────
フロントページの続き
(81)指定国 EP(AT,BE,CH,DE,
DK,ES,FR,GB,GR,IE,IT,LU,M
C,NL,PT,SE),OA(BF,BJ,CF,CG
,CI,CM,GA,GN,ML,MR,NE,SN,
TD,TG),AP(KE,LS,MW,SD,SZ,U
G),AM,AT,AU,BB,BG,BR,BY,C
A,CH,CN,CZ,DE,DK,EE,ES,FI
,GB,GE,HU,IS,JP,KE,KG,KP,
KR,KZ,LK,LR,LT,LU,LV,MD,M
G,MN,MW,MX,NO,NZ,PL,PT,RO
,RU,SD,SE,SG,SI,SK,TJ,TM,
TT,UA,UG,US,UZ,VN
(72)発明者 ヘルベルグ,ヘンリク ヘルマー
スウェーデン国 エス−171 40 ソルナ,
ビレベルグスベーゲン 26,3 トル
(72)発明者 ラルソン,エリザベス マリア
スウェーデン国 エス−161 37 ブロム
マ,リグガスグ,9,2 トル
Claims (1)
- 【特許請求の範囲】 1.加入者線インタフェース回路の2つの差動増幅器出力段(2、3)を駆動 する駆動段(1)であって、該駆動段(1)が、一方においては、該駆動段へ入 力する横および縦信号ITおよびILのそれぞれに、他方においては、基準電流 IRに、依存して4つの駆動電流を発生し、これらの駆動電流を対をなして前記 差動増幅器出力段(2、3)の2つの入力に供給するようにされており、前記4 つの駆動段電流の全てがゼロよりも大きいことを特徴とする、前記駆動段(1) 。 2.前記4つの駆動電流が、K1、K2、およびK3を比例定数として、K1 *IR−K2*IT−K3*IL、K1*IR+K2*IT+K3*IL、K1 *IR+K2*IT−K3*IL、およびK1*IR−K2*IT+K3*IL であり、前記駆動電流K1*IR−K2*IT−K3*ILおよびK1*IR+ K2*IT+K3*ILが前記差動増幅器出力段の一方(3)へ供給され、一方 前記駆動電流K1*IR+K2*IT−K3*ILおよびK1*IR−K2*I T+K3*ILが前記差動増幅器出力段の他方(2)へ供給されることを特徴と する、請求項第1項記載の駆動段(1)。
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