JPH10302343A - 磁気記録再生装置の頭出し信号検出回路 - Google Patents

磁気記録再生装置の頭出し信号検出回路

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JPH10302343A
JPH10302343A JP9110818A JP11081897A JPH10302343A JP H10302343 A JPH10302343 A JP H10302343A JP 9110818 A JP9110818 A JP 9110818A JP 11081897 A JP11081897 A JP 11081897A JP H10302343 A JPH10302343 A JP H10302343A
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Abstract

(57)【要約】 【課題】ビデオテープの高速走行時でも、再生コントロ
ール信号の周波数に依存せず、頭出し信号部を検出でき
る頭出し信号検出回路を提供する 【解決手段】ＣＴＬヘッド１２から読み出した再生コン
トロール信号ＣＴＬを適度に増幅するアンプ回路部１４
と、この回路部で増幅されデジタル変換された信号ＣＴ
Ｌをアナログ電圧に変換するフィルタ１５と、アナログ
電圧に変換されたＣＴＬ信号の電圧の検出精度を高める
ためキャプスタンモータ１３から検出したキャプスタン
信号ＣＦＧを、信号ＣＴＬと信号ＣＦＧとの周波数比ま
たは任意の分周比で分周する分周回路部１６と、この分
周回路部１６の出力するパルスのステップでフィルタ１
５の出力するアナログ電圧をデジタル信号に変換するＡ
／Ｄ回路部１８と、デジタル信号に変換された信号ＣＴ
Ｌから頭出し信号部を判断する判定回路部１９とを有し
て構成される。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は磁気記録再生を行う
磁気記録再生装置の頭出し信号検出回路に係わり、磁気
記録媒体（以下、ビデオテープと称す）に記録された再
生コントロール信号をデジタル変換した信号のデューテ
ィ比の判別を容易にした磁気記録再生装置の頭出し信号
検出回路に関する。
【０００２】
【従来の技術】磁気記録再生装置には、ビデオテープの
巻き送りおよび巻き戻しの回転を駆動するためのキャプ
スタンモータが搭載され、このモータの回転を制御する
ために、記録時にあらかじめビデオテープに映像信号と
ともにその頭出し部分に記録されている再生コントロー
ル信号を再生時に抽出するが、この抽出に使用される回
路として頭出し信号検出回路が内蔵されている。
【０００３】この種の従来の磁気記録再生装置の頭出し
信号検出回路の一例が、特開平５−１３５４３３号公報
に記載されている。同公報記載の頭出し信号検出回路を
参照すると、ビデオテープから再生された再生コントロ
ール信号ＣＴＬのデューティ比に基づいて頭出し信号が
検出され、この検出された信号に応答して、モード制御
回路がテープ上の再生コントロール信号ＣＴＬの位置を
通過することによって再生コントロール信号ＣＴＬを検
出するごとに巻き戻しおよび巻き送りを繰り返しながら
走行距離を縮めていきその位置を特定していく。この
時、キャプスタンヘッドによりキャプスタンモータから
検出するキャプスタンＦＧパルスをカウント用レジスタ
によりカウントする。このカウント値はテープの移動距
離に対応しており、１パルスが１センチメートルに相当
する。したがって、この移動した距離によってモータの
回転速度を高速、低速制御するので、ＣＴＬ信号の位置
を特定して走行停止するまでの時間は、速度に依存せず
一定にする例である。
【０００４】上述したコントロール信号の位置特定時間
の改善に対しコントロール信号のデューティ比の判別方
法の改善の一例が、松下電子工業会社製のＬＳＩ、ＭＮ
６７５１２／ＭＮ６７５２０のＬＳＩ説明書、１９９１
年１月発行の第１２８頁〜１４５頁に記載されている。
同説明書所載の磁気記録再生装置におけるビデオテープ
およびキャプスタンモータとの相互関係の構成を示した
図７（ａ）と、頭出し信号検出回路の構成をブロック図
で示した図７（ｂ）とを併せて参照すると、この従来の
頭出し信号検出回路は、アンプ部１４、タイマ部２０、
ハイ期間キャプチャ部２１、ロウ期間キャプチャ部２２
および比較回路部２３とを備え、ビデオテープ１１の巻
き送り、巻き戻し回転を駆動するキャプスタンモータ１
３を介してビデオテープ１１を高速走行させ、このビデ
オテープ１１に記録されているコントロール信号ＣＴＬ
をＣＴＬヘッド１２を介して取り込むようになってい
る。
【０００５】ＣＴＬヘッド１２からのコントロール信号
ＣＴＬはアンプ回路部１４に送られ、ここで適度な信号
レベルになるように増幅された後、デジタル信号化され
た再生コントロール信号ＣＴＬとして出力される。
【０００６】ハイ期間キャプチャ部２１では、入力され
た再生コントロール信号ＣＴＬの立ち上がりエッジでタ
イマ部２０の値を取り込むと共にタイマ部２０を初期化
する。再生コントロール信号ＣＴＬの立ち下がりエッジ
のタイミングではタイマ部２０の値をロウ期間キャプチ
ャ部２２に取り込む。
【０００７】比較回路部２３ではハイ期間キャプチャ部
２１とロウ期間キャプチャ部２２に取り込まれたタイマ
値を演算により比較し、頭出し信号を検出している。
【０００８】
【発明が解決しようとする課題】上述した従来の頭出し
信号検出回路におけるコントロール信号ＣＴＬのデュー
ティ判別手段の第１の問題点は、低速走行および高速走
行時の頭出し信号検出時に磁気記録媒体、即ちビデオテ
ープの走行速度に制限が生じるということである。
【０００９】その理由は、通常の再生コントロール信号
ＣＴＬはデューティが６０％、頭だし信号はデューティ
が２７．５％で記録されており、かつ走行速度と再生コ
ントロール信号ＣＴＬの周波数は比例関係にあり、走行
速度が速ければ周波数が高くなり、低速走行では低くな
る。この再生コントロール信号ＣＴＬの頭だし信号を検
出するためにタイマ部を用いるので、再生コントロール
信号ＣＴＬの１周期毎にパルス幅測定を行っている。
【００１０】そのために、再生コントロール信号ＣＴＬ
のデューティ判定が出来るパルスの周波数は、タイマ部
に供給している基準クロックＣＬＫおよびタイマ部２０
がカウント可能なカウント数と、デューティ判定処理時
間に依存するからである。
【００１１】本発明の目的は、上述した従来の欠点に鑑
みなされたものであり、ビデオテープが高速走行をして
いる場合でも、再生コントロール信号ＣＴＬの周波数に
依存せず、再生コントロール信号ＣＴＬの頭出し信号部
を検出できる頭出し信号検出回路を提供することにあ
る。
【００１２】
【課題を解決するための手段】本発明の磁気記録再生装
置の頭出し信号検出回路は、磁気記録媒体を高速または
低速で巻き送りまたは巻き戻し走行する駆動手段と、前
記磁気記録媒体に第１および第２のデューティ比の期間
を有して記録され前記第２のデューティ比の期間を頭出
し信号とする再生コントロール信号を読み出す読み出し
手段と、読み出された前記再生コントロール信号を増幅
し、第１のデジタル信号に変換する手段とを有し、前記
第１のデジタル信号化された再生コントロール信号から
前記頭出し信号を検出することで、前記磁気記録媒体に
記録された記録情報を、前記記録情報の記録先頭位置か
ら再生するとともに、全体の制御動作をＣＰＵが行う磁
気記憶再生装置の頭出し信号検出回路において、前記再
生コントロール信号をアナログ電圧に変換し、このアナ
ログ電圧の変化タイミングで前記再生コントロール信号
の前記第１および前記第２のデューティ比の期間を判断
して前記頭出し信号を検出するデューティ判断手段を有
することを特徴とする。
【００１３】また、前記デューティ判断手段は、前記第
１のデジタル信号化された前記再生コントロール信号を
アナログ信号に変換するアナログ変換手段と、前記駆動
手段から発生する回転速度信号を任意に分周し、分周信
号を出力する分周手段と、前記分周信号に同期し、前記
アナログ電圧に変換された前記再生コントロール信号の
電圧を第２のデジタル信号として検出するデジタル変換
手段と、検出された前記第２のデジタル信号から前記頭
出し信号の有無を判定する判定手段とを備え、前記分周
信号に同期して前記デジタル変換手段が前記アナログ電
圧をサンプリングし出力する前記第２のデジタル信号を
前記判定手段があらかじめ前記ＣＰＵのプログラム上で
設定した頭出し信号電圧値と比較するとともに、前記第
２のデジタル信号が前記頭出し信号電圧値よりも上位の
電圧を示す信号期間であれば第１のデューティ期間と判
断し、下位の電圧を示す信号期間であれば第２のデュー
ティ比の期間と判断する。
【００１４】さらに、前記アナログ信号に変換する手段
は、抵抗素子およびコンデンサ素子からなる積分回路で
構成する。
【００１５】さらにまた、前記デューティ判断手段は、
前記第１のデジタル信号化された前記再生コントロール
信号をアナログ信号に変換するアナログ変換手段と、前
記駆動手段から発生する回転速度信号を任意に分周し、
分周信号を出力する分周手段と、前記アナログ信号電圧
をあらかじめ設定した頭出し信号電圧と比較する比較手
段と、前記分周信号に同期して前記比較手段の比較結果
出力から前記頭出し信号の有無を判定する判定手段とを
備え、前記比較手段が前記アナログ電圧をあらかじめ定
めた頭出し信号電圧と比較するとともに、前記分周信号
に同期して前記判定手段が、あらかじめ前記ＣＰＵのプ
ログラム上で設定された頭出し信号電圧値と前記比較結
果出力とをさらに比較するとともに、前記比較結果の電
圧が前記頭出し信号電圧よりも上位の電圧を示す信号期
間であれば第１のデューティ期間と判断し、下位の電圧
を示す信号期間であれば第２のデューティ比の期間と判
断する。
【００１６】また、前記分周手段の分周比は、前記再生
コントロール信号と前記回転速度信号との周波数比であ
る。
【００１７】
【発明の実施の形態】まず本発明の磁気記録再生装置の
頭出し信号検出回路の概要を述べると、ビデオテープに
記録されている再生コントロール信号ＣＴＬをＣＴＬヘ
ッドで読み出し、この読み出した再生コントロール信号
ＣＴＬを適度な信号レベルに増幅した後、デジタル信号
変換手段でデジタル化することによってパルス状の矩形
波に整形した再生コントロール信号ＣＴＬを生成する。
【００１８】このデジタル変換した再生コントロール信
号ＣＴＬをアナログ電圧変換手段によりデューティに比
例したアナログ電圧に変換する。
【００１９】アナログ電圧に変換された再生コントロー
ル信号ＣＴＬは、アナログ電圧検出手段によりアナログ
電圧値を取り込み、検出した再生コントロール信号ＣＴ
Ｌの電圧値から頭出し信号部判断手段により、再生コン
トロール信号ＣＴＬの頭出し信号部を検出する。
【００２０】また、アナログ電圧に変換された再生コン
トロール信号ＣＴＬの電圧を検出する手段は、アナログ
電圧に変換された再生コントロール信号ＣＴＬの電圧の
検出精度を高めるため、キャプスタンモータから発生す
る回転速度信号（以下、キャプスタン信号ＣＦＧと称
す）を分周する分周手段により、再生コントロール信号
ＣＴＬの電圧を検出するタイミングを生成し、そのタイ
ミングでアナログ電圧に変換された再生コントロール信
号ＣＴＬの電圧の検出を行うものである。
【００２１】次に、本発明の実施の形態を図面を参照し
ながら詳細に説明する。図１は第１の実施の形態の構成
を示したブロック図である。図１を参照すると、頭出し
信号検出回路は、その周辺回路要素として、ビデオテー
プ１１に記録されている再生コントロール信号ＣＴＬを
読み出すためのＣＴＬヘッド１２と、ビデオテープ１１
の回転駆動用のキャプスタンモータ１３とを備え、ＣＴ
Ｌヘッド１２から読み出した再生コントロール信号ＣＴ
Ｌを適度に増幅するアンプ回路部１４と、アンプ回路部
１４で増幅されデジタル変換された再生コントロール信
号ＣＴＬをアナログ電圧に変換するフィルタ部１５と、
アナログ電圧に変換された再生コントロール信号ＣＴＬ
の電圧の検出精度を高めるためキャプスタンモータ１３
から検出したキャプスタン信号ＣＦＧを、再生コントロ
ール信号ＣＴＬと回転速度信号との周波数比である分周
比で分周する分周回路部１６と、この分周回路部１６の
出力するパルスのステップでフィルタ部１５の出力する
アナログ電圧をデジタル信号に変換するＡ／Ｄ回路部１
７と、デジタル信号に変換された再生コントロール信号
ＣＴＬから再生コントロール信号ＣＴＬの頭出し信号部
を判断する判定回路部１８とを有して構成される。
【００２２】次に、この第１の実施の形態の動作につい
て、図１に併せて、フィルタ部１５の回路図を示した図
２（ａ）とフィルタ部の出力であって、再生コントロー
ル信号ＣＴＬのパルス数および変換電圧の関係を示した
図２（ｂ）と再生コントロール信号ＣＴＬのアナログ電
圧変換タイミングを示した図３とを参照しながら詳細に
説明する。
【００２３】ビデオテープ１１に記録されている再生コ
ントロール信号ＣＴＬは、ＣＴＬヘッド１２で読み出さ
れ、アンプ回路部１４で再生コントロール信号ＣＴＬを
所定の信号レベルになるように増幅することにより、再
生コントロール信号ＣＴＬは矩形波に整形され、デジタ
ル信号化される。
【００２４】デジタル変換した再生コントロール信号Ｃ
ＴＬは、フィルタ部１５でデューティに比例したアナロ
グ電圧に変換される。
【００２５】より具体的には図２（ａ）に示すような抵
抗およびコンデンサＣからなる積分型のフィルタ部１５
を用いた場合、その出力変化は次式で求められる。
【００２６】 Ｖn+1＝ａ（ｂn−１）／（ｂ−１）＋ｂn×Ｖ0 ここで、 Ｖ：入力信号のピーク電圧 Ｖ0 ：出力初期電圧 Ｒ：抵抗値 Ｃ：コンデンサ Ｔ1 ：入力信号ハイレベル期間 Ｔ2 ：入力信号ロウレベル期間 ｎ：パルス数（ｎ＞０） Ｋ1 ＝１−ＥＸＰ（−Ｔ1 ／ＲＣ） Ｋ2 ＝ＥＸＰ（−Ｔ2 ／ＲＣ） ａ＝Ｖ×Ｋ1 ×Ｋ2 ｂ＝Ｋ2 ×（１−Ｋ1 ） とする。
【００２７】上式に対しＲ＝２．２ＫΩ、Ｃ＝１μＦを
代入し、入力信号＝１ｋＨｚ、２０ｋＨｚの場合を図２
（ｂ）に示す。
【００２８】このフィルタ部１５に入力する再生コント
ロール信号ＣＴＬの周波数が１ＫＨｚ〜２０ＫＨｚの場
合、図２（ｂ）に示すように、頭出し信号基準電圧を
２．２Ｖとすると、通常の再生コントロール信号ＣＴＬ
（デューティ６０％）は３Ｖ±０．３Ｖに、再生コント
ロール信号ＣＴＬの頭だし信号（デューティ２７．５
％）は１．３５Ｖ±０．３Ｖに変換される。
【００２９】つまり、ハイ期間のデューティ比６０％，
２０ＫＨｚおよびロウ期間のデューティ比６０％，２０
ＫＨｚはそれぞれ細実線および細点線でそれぞれ示すよ
うにパルス数に比例してなだらかな上昇波形になり、パ
ルス数３０で基準電圧の２．２Ｖ，パルス数１４０で
２．９および２．９５Ｖになる。ハイ期間のデューティ
比６０％，１ＫＨｚおよびロウ期間のデューティ比６０
％，１ＫＨｚはそれぞれ細い一点鎖線および細い二点鎖
線でそれぞれ示すようにパルス数が１０の時に約３．８
Ｖおよび２．８Ｖにそれぞれなり、その後パルス数によ
らずそれぞれ３．２５Ｖおよび２．７５Ｖのほぼ一定の
電圧になる。
【００３０】同様に、ハイ期間のデューティ比２７．５
％，２０ＫＨｚおよびロウ期間のデューティ比２７．５
％，２０ＫＨｚはそれぞれ太い実線および太い点線でそ
れぞれ示すようにパルス数に比例してなだらかな下降波
形になり、パルス数３０で基準電圧の２．２Ｖ，パルス
数１４０で１．４５Ｖおよび１．４Ｖになる。ハイ期間
のデューティ比２７．５％，１ＫＨｚおよびロウ期間の
デューティ比２７．５％，１ＫＨｚはそれぞれ太い一点
鎖線および太い二点鎖線でそれぞれ示すようにパルス数
が１０の時に約１．１Ｖおよび１．６Ｖにそれぞれな
り、その後パルス数によらず１．２Ｖおよび１．４Ｖの
ほぼ一定の電圧になる。
【００３１】また、キャプスタンモータ１３から発生す
るキャプスタン信号ＣＦＧは、再生コントロール信号Ｃ
ＴＬと図３からも分かるように、 信号ＣＴＬの周期＝信号ＣＦＧの周期×ｎ（ｎ≧１） のような比例関係があり、キャプスタン信号ＣＦＧを分
周回路部１６により分周することで、再生コントロール
信号ＣＴＬに同期した分周回路出力であるタイミング信
号ＣＦＴを生成することができる。
【００３２】そのため、キャプスタンモータ１３の回転
速度およびビデオテープ１１の走行速度に関わりなく、
再生コントロール信号ＣＴＬに対して、一定の割合でタ
イミングを生成することができる。
【００３３】この再生コントロール信号ＣＴＬに同期し
たタイミング信号をＡ／Ｄ回路部１７に供給し、このタ
イミングに応答して、フィルタ部１５においてアナログ
電圧に変換された再生コントロール信号ＣＴＬの電圧値
を取り込む。
【００３４】Ａ／Ｄ回路部１７に取り込まれた電圧値は
デジタル信号に変換されて判定回路部１８に入力され、
再生コントロール信号ＣＴＬの頭出し信号部であるか否
かをを判断する。
【００３５】判定回路部１８は磁気記録再生装置に内蔵
されるＣＰＵの演算部であり、あらかじめソフト上で設
定された判断基準電圧２．２Ｖに対して、入力した電圧
値のデジタル信号が上位の電圧を示す信号であればデュ
ーティ６０％と判断し、判断基準電圧２．２Ｖに対し
て、デジタル信号が下位の電圧を示す信号であればデュ
ーティ２７．５％と判断する。
【００３６】上述したように、この実施例では、ビデオ
テープから検出した再生コントロール信号ＣＴＬをフィ
ルタ部１５を通すことによってデューティ６０％の期間
は３Ｖ±０．３に、デューティ２７．５％の期間は１．
３５±０．３にそれぞれ変換され、このアナログ電圧
を、再生コントロール信号ＣＴＬよりも周波数が高いキ
ャプスタン信号ＣＦＧを分周したパルスを用いて、再び
デジタル信号に変換する。この変換されたデジタル信号
を判別回路部１８で基準電圧となる頭出し信号電圧の
２．２Ｖと比較してデューティ比を判断するので、低速
走行中で、再生コントロール信号ＣＴＬの周波数が低い
１ｋＨｚの時も、高速走行中で、周波数が高い２０ｋＨ
ｚの時も確実に頭出し信号の検出ができる。
【００３７】さらに具体的に従来例と比較する。従来技
術の判別処理時間を示した図４（ａ），および本発明に
実施の形態の判別処理時間を示した図４（ｂ）をそれぞ
れ参照すると、従来技術の判別処理時間は、Ｘ軸方向に
コントロール信号ＣＴＬの周波数を１，１０，２０，３
０ｋＨｚで示し１パルス幅をそれぞれ１ｍｓ，１００μ
ｓ，５０μｓ，３３μｓとして示してある。一方、Ｙ軸
方向にはコントロール信号ＣＴＬの判別処理時間および
タイマカウントビット数を対応させて示してある。例え
ば、コントロール信号ＣＴＬの周波数が１ｋＨｚのと
き、基本クロックを２ＭＨｚとするとタイマカウントビ
ット数が１１であれば判別処理時間４０〜８０μｓ以内
に判別し、コントロール信号ＣＴＬの周波数が２０ｋＨ
ｚのとき、基本クロックを８ＭＨｚとするとタイマカウ
ントビット数が９であれば判別処理時間１０〜２０μｓ
以内に完全に判別する。したがって、１ｋＨｚ〜２０ｋ
Ｈｚのコントロール信号ＣＴＬを取り込むためには、タ
イマの基準クロックを８ＭＨｚ、ビット数を１３ビット
以上にする必要がある。
【００３８】一方、本実施の形態の場合は、例えば、コ
ントロール信号ＣＴＬの周波数が１ｋＨｚ〜３０ｋＨｚ
のとき、サンプリングクロックを２ＭＨｚとすると判別
処理時間４〜８μｓ以内に判別し、サンプリングクロッ
クを４ＭＨｚとすると判別処理時間２〜４μｓ以内に判
別し、サンプリングクロックを８ＭＨｚとすると判別処
理時間１〜２μｓ以内に判別している。
【００３９】したがって、デューティ判別時間が従来技
術に比べて、約１／４に短縮されることになる。頭だし
信号判定時間が従来技術の１／４になり、従来技術の約
４倍の高速化が可能になる。つまり、従来技術よりも高
速なコントロール信号ＣＴＬのデューティ判別ができ
る。
【００４０】次に、本発明の第２の実施の形態について
図面を参照して詳細に説明する。
【００４１】第２の実施の形態をブロック図で示した図
５を参照すると、頭出し信号検出回路は、前述した第１
の実施の形態と同様に、その周辺回路要素として、ビデ
オテープ１１に記録されている再生コントロール信号Ｃ
ＴＬを読み出すためのＣＴＬヘッド１２と、ビデオテー
プ１１の回転駆動用のキャプスタンモータ１３とを備
え、ＣＴＬヘッド１２から読み出した再生コントロール
信号ＣＴＬを所定のレベルに増幅するアンプ回路部１４
と、アンプ回路部１４で増幅されデジタル変換された再
生コントロール信号ＣＴＬをアナログ電圧に変換するフ
ィルタ１５と、このフィルタ部１５の出力するアナログ
電圧とあらかじめ定める頭出し信号電圧とを比較するコ
ンパレータ回路１９と、アナログ電圧に変換された再生
コントロール信号ＣＴＬの電圧の検出精度を高めるため
キャプスタンモータ１３から検出したキャプスタン信号
ＣＦＧを、再生コントロール信号ＣＴＬとキャプスタン
信号との周波数比である分周比で分周する分周回路部１
６と、この分周回路部１６の出力するパルスのステップ
でコンパレータ回路部１９の出力する再生コントロール
信号ＣＴＬからの頭出し信号部を判断する判定回路部１
９とを有して構成される。 即ち、第１の実施例との相
違点はＡ／Ｄ回路部１７に変えてコンパレータ回路部１
９が用いられ、Ａ／Ｄ回路部１７に供給されていたキャ
プスタン信号ＣＦＧを判定回路部に供給するようにした
ことである。
【００４２】次に、本実施の形態の動作を、図５および
再生コントロール信号ＣＴＬのアナログ電圧変換タイミ
ングを示した図６をそれぞれ参照しながら詳細に説明す
る。
【００４３】ビデオテープ１１に記録されている再生コ
ントロール信号ＣＴＬは、ＣＴＬヘッド１２で読み出さ
れ、アンプ回路部１４で再生コントロール信号ＣＴＬを
所定の信号レベルになるように増幅し、再生コントロー
ル信号ＣＴＬを矩形波に整形して、デジタル信号化す
る。
【００４４】このデジタル変換した再生コントロール信
号ＣＴＬを、フィルタ部１５はデューティに比例したア
ナログ電圧に変換出力する。このアナログ電圧とあらか
じめ設定した頭だし信号電圧値２．２Ｖとをコンパレー
タ回路部１９が比較する。この時、アナログ電圧値が頭
だし信号電圧値２．２Ｖよりも低い場合のみ出力信号を
反転出力する。つまり、図５に示すように、デューティ
６０％の時はロウレベル、デューティ２７．５％の時は
ハイレベルをそれぞれ出力する。
【００４５】また、キャプスタンモータ１３から発生す
るキャプスタン信号ＣＦＧは再生コントロール信号ＣＴ
Ｌとは前述したように、 信号ＣＴＬの周期＝信号ＣＦＧの周期×ｎ（ｎ≧１） の比例関係にあり、キャプスタン信号ＣＦＧを分周回路
部１６により分周することで、再生コントロール信号Ｃ
ＴＬに同期したタイミングの分周出力を生成することが
できる。
【００４６】そのため、キャプスタンモータ１３の回転
速度およびビデオテープ１１の走行速度に関わりなく、
再生コントロール信号ＣＴＬに対して、一定の割合のタ
イミングを生成することができる。
【００４７】この再生コントロール信号ＣＴＬに同期し
たタイミングで、コンパレータ回路部１９の出力を判定
回路部１８で監視することで、より精度の高い再生コン
トロール信号ＣＴＬの頭出し信号部の検出ができる。
【００４８】つまり、判定回路部１８は前述したように
ＣＰＵの演算部であり、再生コントロール信号ＣＴＬに
同期したタイミングで、かつあらかじめソフト上で設定
されたコンパレータ回路部１９の出力に対して、入力し
た電圧値のデジタル信号がハイレベルであればデューテ
ィ６０％と判断し、コンパレータ回路部１９の出力に対
して、デジタル信号がロウレベルであればデューティ２
７．５％と判断する。
【００４９】上述したように、この実施例では、ビデオ
テープから検出した再生コントロール信号ＣＴＬをフィ
ルタ部１５を通すことによってデューティ６０％の期間
は３Ｖ±０．３に、デューティ２７．５％の期間は１．
３５±０．３にそれぞれ変換され、このアナログ電圧
を、コンパレータ回路部１９において頭出し信号電圧と
比較し、頭出し信号電圧よりも低ければハイレベルを、
高ければロウレベルを出力するとともに、このデジタル
信号を判別回路部１８で基準電圧の２．２Ｖと比較して
デューティ比を判断するので、低速走行中で、再生コン
トロール信号ＣＴＬの周波数が低い１ｋＨｚの時も、高
速走行中で、周波数が高い２０ｋＨｚの時も確実に頭出
し信号の検出ができる。
【００５０】この実施の形態でも第１の実施の形態と同
様に、本実施の形態の場合は、例えば、信号ＣＴＬの周
波数が１ｋＨｚ〜３０ｋＨｚのとき、サンプリングクロ
ックを２ＭＨｚとすると判別処理時間４〜８μｓ以内に
判別し、サンプリングクロックを４ＭＨｚとすると判別
処理時間２〜４μｓ以内に判別し、サンプリングクロッ
クを８ＭＨｚとすると判別処理時間１〜２μｓ以内に判
別している。
【００５１】したがって、デューティ判別時間が従来技
術に比べて、約１／４に短縮されることになるので、頭
だし信号判定時間が従来技術の１／４になり、従来技術
の約４倍の高速化が可能になる。つまり、従来技術より
も高速なコントロール信号ＣＴＬのデューティ判別がで
きる。
【００５２】
【発明の効果】以上説明したように、本発明の磁気記録
再生装置の頭出し信号検出回路は、再生コントロール信
号ＣＴＬを適度な信号レベルになるように増幅し、デジ
タル信号に変換する手段と、デジタル変換した再生コン
トロール信号ＣＴＬをアナログ電圧に変換する手段と、
アナログ電圧に変換された再生コントロール信号ＣＴＬ
の電圧を検出する手段と、検出した再生コントロール信
号ＣＴＬの電圧値から頭出し信号部を判断する手段と、
アナログ電圧に変換された再生コントロール信号ＣＴＬ
の電圧の検出精度を高めるため、キャプスタンモータか
ら発生される回転速度信号を分周し、再生コントロール
信号ＣＴＬの電圧を検出するタイミングを生成する手段
とを備えるので、第１の効果は、ビデオテープが高速走
行している場合でも、再生コントロール信号ＣＴＬの周
波数に依存せず、再生コントロール信号ＣＴＬの頭出し
信号を検出できるということである。これにより、ビデ
オテープの巻き送り（ＦＦモード）や巻戻し（ＲＥＷモ
ード）時により高速な走行が可能となる。
【００５３】第２の効果は、ＶＴＲ用マイコンの回路規
模縮小や価格の低減などが可能となる。
【００５４】その理由は、デジタル化した再生コントロ
ール信号ＣＴＬをフィルタで平滑させ、再生コントロー
ル信号ＣＴＬの周波数に依存しないアナログ電圧値で頭
出し信号部を検出することと、比較演算のみで頭だし信
号の判別を行うことで、ビデオテープが高速走行してい
る場合でも再生コントロール信号ＣＴＬの頭出し信号部
の判別が容易に行える。
【００５５】また、再生コントロール信号ＣＴＬに同期
した信号（入力信号より高い周波数）を分周し、その分
周信号をアナログ電圧の取り込みタイミングとして使用
するため、再生コントロール信号ＣＴＬの周波数に依存
せず、１周期毎のアナログ電圧値が容易に取り込め、よ
り精度の高い結果が得られる。
【００５６】また、現在既存のマイコンでは再生コント
ロール信号ＣＴＬの頭だし信号部検出専用タイマ回路を
特別に設けている。しかし、本発明は現在既存の他の用
途に使用されているＡ／Ｄ回路部を用いることが可能で
あり、新たな回路を追加する必要がなく、再生コントロ
ール信号ＣＴＬの頭だし信号部の検出専用タイマ回路が
不要となる。
【００５７】それにより、ＶＴＲ用マイコンとしての回
路規模縮小、価格低減ができる。
【図面の簡単な説明】
【図１】本発明の第１の実施の形態の構成を示すブロッ
ク図である。
【図２】（ａ）フィルタ部１５の回路図である。 （ｂ）フィルタ部１５の出力であって、再生コントロー
ル信号ＣＴＬのパルス数および変換電圧の関係を示した
図である。
【図３】再生コントロール信号ＣＴＬのアナログ電圧変
換タイミングを示した図である。
【図４】（ａ）従来技術の判別処理時間を示した図であ
る。 （ｂ）本発明の実施の形態における判別処理時間を示し
た図である。
【図５】本発明の第２の実施の形態の構成を示すブロッ
ク図である。
【図６】再生コントロール信号ＣＴＬのアナログ電圧変
換タイミングを示した図である。
【図７】（ａ）磁気記録再生装置におけるビデオテープ
およびキャプスタンモータとの相互関係の構成を示した
図である。 （ｂ）頭出し信号検出回路の構成を示したブロック図で
ある。
【符号の説明】
１１ ビデオテープ １２ ＣＴＬヘッド １３ キャプスタンモータ １４ アンプ回路部 １５ フィルタ部 １６ 分周回路部 １７ Ａ／Ｄ回路部 １８ 判定回路部 １９ コンパレータ回路部 ２０ タイマ部 ２１ ハイ期間キャプチャ部 ２２ ロウ期間キャプチャ部 ２３ 比較回路部

Claims (5)

    【特許請求の範囲】
  1. 【請求項１】 磁気記録媒体を高速または低速で巻き送
    りまたは巻き戻し走行する駆動手段と、前記磁気記録媒
    体に第１および第２のデューティ比の期間を有して記録
    され前記第２のデューティ比の期間を頭出し信号とする
    再生コントロール信号を読み出す読み出し手段と、読み
    出された前記再生コントロール信号を増幅し、第１のデ
    ジタル信号に変換する手段とを有し、前記第１のデジタ
    ル信号化された再生コントロール信号から前記頭出し信
    号を検出することで、前記磁気記録媒体に記録された記
    録情報を、前記記録情報の記録先頭位置から再生すると
    ともに、全体の制御動作をＣＰＵが行う磁気記憶再生装
    置の頭出し信号検出回路において、 前記再生コントロール信号をアナログ電圧に変換し、こ
    のアナログ電圧の変化タイミングで前記再生コントロー
    ル信号の前記第１および前記第２のデューティ比の期間
    を判断して前記頭出し信号を検出するデューティ判断手
    段を有することを特徴とする磁気記憶再生装置の頭出し
    信号検出回路。
  2. 【請求項２】 前記デューティ判断手段は、前記第１の
    デジタル信号化された前記再生コントロール信号をアナ
    ログ信号に変換するアナログ変換手段と、前記駆動手段
    から発生する回転速度信号を任意に分周し、分周信号を
    出力する分周手段と、前記分周信号に同期し、前記アナ
    ログ電圧に変換された前記再生コントロール信号の電圧
    を第２のデジタル信号として検出するデジタル変換手段
    と、検出された前記第２のデジタル信号から前記頭出し
    信号の有無を判定する判定手段とを備え、前記分周信号
    に同期して前記デジタル変換手段が前記アナログ電圧を
    サンプリングし出力する前記第２のデジタル信号を前記
    判定手段があらかじめ前記ＣＰＵのプログラム上で設定
    した頭出し信号電圧値と比較するとともに、前記第２の
    デジタル信号が前記頭出し信号電圧値よりも上位の電圧
    を示す信号期間であれば第１のデューティ期間と判断
    し、下位の電圧を示す信号期間であれば第２のデューテ
    ィ比の期間と判断する請求項１記載の磁気記録再生装置
    の頭出し信号検出回路。
  3. 【請求項３】 前記アナログ信号に変換する手段は、抵
    抗素子およびコンデンサ素子からなる積分回路で構成す
    る請求項２記載の磁気記録再生装置の頭出し信号検出回
    路。
  4. 【請求項４】 前記デューティ判断手段は、前記第１の
    デジタル信号化された前記再生コントロール信号をアナ
    ログ信号に変換するアナログ変換手段と、前記駆動手段
    から発生する回転速度信号を任意に分周し、分周信号を
    出力する分周手段と、前記アナログ信号電圧をあらかじ
    め設定した頭出し信号電圧と比較する比較手段と、前記
    分周信号に同期して前記比較手段の比較結果出力から前
    記頭出し信号の有無を判定する判定手段とを備え、 前記比較手段が前記アナログ電圧をあらかじめ定めた頭
    出し信号電圧と比較するとともに、前記分周信号に同期
    して前記判定手段が、あらかじめ前記ＣＰＵのプログラ
    ム上で設定された頭出し信号電圧値と前記比較結果出力
    とをさらに比較するとともに、前記比較結果の電圧が前
    記頭出し信号電圧よりも上位の電圧を示す信号期間であ
    れば第１のデューティ期間と判断し、下位の電圧を示す
    信号期間であれば第２のデューティ比の期間と判断する
    請求項１記載の磁気記録再生装置の頭出し信号検出回
    路。
  5. 【請求項５】 前記分周手段の分周比は、前記再生コン
    トロール信号と前記回転速度信号との周波数比である請
    求項２または４記載の磁気記録再生装置の頭出し信号検
    出回路。
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