JPH10239660A - 液晶表示装置の駆動回路 - Google Patents

液晶表示装置の駆動回路

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JPH10239660A
JPH10239660A JP9043329A JP4332997A JPH10239660A JP H10239660 A JPH10239660 A JP H10239660A JP 9043329 A JP9043329 A JP 9043329A JP 4332997 A JP4332997 A JP 4332997A JP H10239660 A JPH10239660 A JP H10239660A
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Abstract

(57)【要約】 【課題】 液晶表示装置の小型化と低消費電力化。 【解決手段】 電源揺動法を用いて駆動している液晶表
示装置において、直接コントローラ電位の信号を入力で
きる回路を構成することにより、走査電極駆動装置内部
のロジック電圧を低圧化して、小型化と低消費電力化を
行う。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、マトリクス型液晶
表示装置（以下液晶表示装置と記載する）に関し、特に
液晶表示装置を駆動する走査電極駆動装置およびその駆
動方法に関する。
【０００２】
【従来の技術】近年、情報化社会の進展に伴って、液晶
表示装置はテレビ、ＯＡをはじめ、より幅広い分野で用
いられている。特に小型携帯機器では他の表示装置の追
随を許さないほど広く利用されてきている。
【０００３】このような分野では、特に携帯性が重要で
あることから、小型化が求められる反面、視認性からよ
り大きな画面が求められている。そのため限られた領域
内での液晶表示装置の表示領域の拡大が強く求められて
おり、その一方で、周辺領域はますます狭くなってきて
いる。
【０００４】このような狭額縁化への対応の手段のひと
つには、走査電極駆動装置と信号電極駆動装置のスリム
化、小型化があり、走査電極駆動装置と信号電極駆動装
置をスリム化、小型化する方法のひとつに耐圧を低くし
て素子の大きさを小さくするという方法がある。
【０００５】従来用いられてきた方法では、図３に示す
ように、液晶交流動作時に電位を変動させ、走査電極駆
動装置は、Ｖ１とＶ２、Ｖ３とＶ４の組み合わせで出力
し、そのとき、信号電極駆動装置もＶ５とＶ４、Ｖ１と
Ｖ６の組み合わせで出力する。したがって、走査電極駆
動装置、信号電極駆動装置ともに、Ｖ１−Ｖ４以上の耐
圧が必要となり、高耐圧の電極駆動装置を必要としてい
た。
【０００６】この方法では、信号電極駆動装置も高耐圧
の素子で構成しなければならず、小型化、集密化には不
向きであった。また、画素数の増加に伴うデータ信号数
の増大による信号電極駆動装置の高速動作化には、適さ
ず、不利であった。加えて、消費電力についても高電圧
を高速で動作させなくてはならないため、少ないとは言
えなかった。
【０００７】これらの問題の解決方法のひとつとして、
電源揺動法を用いた駆動法があげられる。ここで、電源
揺動法とは、図４のように、グランド電位については、
ＶＡからＶＢに切り替えた電位を、それと同期して高圧
電位については、ＶＣからＶＤに切り替えた電位を走査
電極装置に入力することにより、走査電極駆動装置の耐
圧をあげることなく、信号電極駆動装置の耐圧を大幅に
下げることか可能となり、その結果、データ信号の増大
による信号電極駆動装置の高速動作化、高密度化、低消
費電力化が可能となった。
【０００８】
【発明が解決しようとする課題】しかしながら、電源揺
動法を用いて、走査電極駆動装置に外部システムから信
号を入力する場合、図４に示すように、電源電位が期間
Ａの状態にあるとき、走査電極駆動装置内では、入力信
号がＶＢレベルのときロウレベルの入力となり、ＶＤレ
ベルのときハイレベルの入力となる。また、電源電位が
期間Ｂの状態にあるとき、走査電極駆動装置内では、入
力信号がＶＡレベルのときロウレベルの入力となり、Ｖ
Ｃレベルのときハイレベルの入力となる。
【０００９】このため、外部システムから信号を入力す
る場合、電源電位の状態に応じて、ハイレベルを入力す
る場合にはＶＤレベルまたはＶＣレベルの入力が必要と
なり、ロウレベルを入力する場合にはＶＢレベルまたは
ＶＡレベルの入力が必要となる。そのため、外部から入
力信号の電位を変化させなくてはならず、入力信号の電
位を変換する外部回路が必要になってしまう。
【００１０】加えて、走査電極駆動装置にとって、全体
を必ずしも高耐圧で構成される必要はなく、特に液晶駆
動出力以外でのコントロール信号を処理するような部分
では、むしろ低耐圧で構成された方が消費電力面、小型
化の面で望ましいと考えられる。
【００１１】しかし、現状の電源揺動法を用いた通常の
構成では、低耐圧の回路で構成することは困難である。
【００１２】本発明は、電源揺動法を用いながら、入力
信号をレベルシフトすることなく、入力信号レベルを固
定して入力できる回路を提供する。
【００１３】
【課題を解決するための手段】上記の目的を達成するた
めに、複数の信号電極を駆動する信号電極駆動装置と複
数の走査電極を駆動する走査電極駆動装置からなる液晶
表示装置において、外部システムからの入力信号を直接
電源揺動法を用いて駆動している走査電極駆動装置に入
力して駆動できることを特徴とする。
【００１４】このようにすると、入力信号を外部システ
ムの信号電位のままで、電源揺動法の電位にあわせて、
レベルシフトをすることなく、揺動電源法を用いて駆動
している走査電極駆動装置に入力できる。
【００１５】
【発明の実施の形態】図１は本発明を実施するための回
路構成を示す図である。１０１、１０２、１０７、１０
９は高耐圧のｐｍｏｓで、１０３、１０４、１０５、１
０６、１０８、１１０、１１２、１１４は高耐圧のｎｍ
ｏｓで、１１１、１１３は低耐圧のｐｍｏｓを示す。
【００１６】図１は走査電極駆動装置に入力している電
源電位を図２で示している。図２の電位を説明すると、
ＶＤＤは走査電極駆動装置内部での高耐圧の電源電位、
ＶＣＣは走査電極駆動装置内部での低耐圧の電源電位、
ＶＳＳは走査電極駆動装置内部でのグランド電位、ＶＤ
Ｌは外部システムの入力信号のハイレベル電位、ＶＳＬ
は外部システムの入力信号のロウレベル電位つまり、外
部システムでのグランド電位を示している。
【００１７】図１に示した回路の動作を説明する。ま
ず、入力信号がハイレベル、つまり、ＶＤＬが入力され
た場合を説明する。ＶＤＬが入力されると、ｐｍｏｓ１
０１はオフし、ｐｍｏｓ１０２がオンする。
【００１８】すると、ｎｍｏｓ１０５のゲートにＶＤＬ
が印加され、ｎｍｏｓ１０５がオンし、するとｎｍｏｓ
１０３もオンするので、ｎｍｏｓ１０４のゲートには、
ＶＳＳが印加されることとなって、ｎｍｏｓ１０４はオ
フしてしまう。
【００１９】その結果、ｐｍｏｓ１０７とｎｍｏｓ１０
８で構成されるインバータのゲートにはＶＤＬが印加さ
れて、このインバータの出力はＶＳＳが出力される。ま
た、それに続くｐｍｏｓ１０９とｎｍｏｓ１１０で構成
されるインバータのゲートには、先のインバータの出力
であるＶＳＳが印加されることになり、出力は、ＶＤＬ
が出力される。
【００２０】ｐｍｏｓ１０２、ｎｍｏｓ１０５はそれぞ
れオンしているが、それと各々直列に並んでいる、ｎｍ
ｏｓ１０５、ｐｍｏｓ１０１はオフしているため、入力
信号が変化するとき以外には、電流は流ず、したがっ
て、無駄な消費電流を減らすことができる。
【００２１】ｐｍｏｓ１０７とｎｍｏｓ１０８で構成さ
れるインバータの出力はｎｍｏｓ１１４のゲート入力と
なり、ｎｍｏｓ１１４はオフする。また、ｐｍｏｓ１０
９とｎｍｏｓ１１０で構成されるインバータの出力はｎ
ｍｏｓ１１２のゲート入力となり、ｎｍｏｓ１１２がオ
ンする。
【００２２】ｎｍｏｓ１１２がオンしていることから、
ｐｍｏｓ１１３のゲートには、ＶＳＳが印加されるか
ら、ｐｍｏｓ１１３はオンする。
【００２３】そして、ｐｍｏｓ１１３がオンすると、ｐ
ｍｏｓ１１１のゲートにはＶＣＣが印加されるので、ｐ
ｍｏｓ１１１はオフする。
【００２４】その結果、出力信号には、ＶＣＣが出力さ
れる。つまり、走査電極駆動装置内部の電位レベルにお
けるハイレベルが出力される。
【００２５】次に、入力信号がロウレベル、つまり、Ｖ
ＳＬが入力された場合を説明する。ＶＳＬが入力される
と、ｐｍｏｓ１０１はオンし、ｐｍｏｓ１０２がオフす
る。
【００２６】すると、ｎｍｏｓ１０６のゲートにＶＤＬ
が印加され、ｎｍｏｓ１０６がオンし、するとｎｍｏｓ
１０４もオンするので、ｎｍｏｓ１０５のゲートには、
ＶＳＳが印加されることとなって、ｎｍｏｓ１０５はオ
フしてしまう。
【００２７】その結果、ｐｍｏｓ１０７とｎｍｏｓ１０
８で構成されるインバータのゲートにはＶＳＳが印加さ
れて、このインバータの出力はＶＤＬが出力される。ま
た、それに続くｐｍｏｓ１０９とｎｍｏｓ１１０で構成
されるインバータのゲートには、先のインバータの出力
であるＶＤＬが印加されることになり、出力はＶＳＳが
出力される。
【００２８】ｐｍｏｓ１０７とｎｍｏｓ１０８で構成さ
れるインバータの出力はｎｍｏｓ１１４のゲート入力と
なり、ｎｍｏｓ１１４はオンする。また、ｐｍｏｓ１０
９とｎｍｏｓ１１０で構成されるインバータの出力はｎ
ｍｏｓ１１２のゲート入力となり、ｎｍｏｓ１１２がオ
フする。
【００２９】ｎｍｏｓ１１４がオンしていることから、
ｐｍｏｓ１１１のゲートには、ＶＳＳが印加されるか
ら、ｐｍｏｓ１１１はオンする。
【００３０】そして、ｐｍｏｓ１１１がオンすると、ｐ
ｍｏｓ１１３のゲートにはＶＣＣが印加されるので、ｐ
ｍｏｓ１１３はオフする。
【００３１】その結果、出力信号には、ＶＳＳが出力さ
れる。つまり、走査電極駆動装置内部の電位レベルにお
けるロウレベルが出力される。
【００３２】以上の動作説明を行ったように、入力信号
がＶＤＬで入力されると、図２の回路によりレベル変換
が行われ、ＶＣＣにシフトされる。つまり、走査電極駆
動装置内部における低圧ロジックのハイレベルの信号に
変換されたことになる。
【００３３】同様に、入力信号がＶＳＬで入力される
と、図２の回路によりレベル変換が行われ、ＶＳＳにシ
フトされる。これは、走査電極駆動装置内部における低
圧ロジックのロウレベルの信号に変換されたことにな
る。
【００３４】したがって、これ以降の回路では、高耐圧
のｍｏｓを使う必要がなくなり、すべて、低耐圧のｍｏ
ｓによって、信号処理を行うことができる。
【００３５】そのため、チップ面積を削減でき、消費電
力についても、より低消費電力化ができる。
【００３６】
【発明の効果】電源揺動法を用いて、入力信号を外部で
レベル変換をするなく、入力できることで外部回路を簡
素化できて、また通常、高耐圧ｍｏｓで構成していた回
路を低耐圧ｍｏｓで回路を構成できるようになるため、
チップ面積を小さくすることができ、かつ高電圧で動作
していたものを低電圧で動作できるようになることで消
費電力の低減に効果がある。
【図面の簡単な説明】
【図１】本発明の実施例における回路構成を示す図であ
る。
【図２】本発明の実施例における電源揺動法の電源電位
を示す図である。
【図３】従来例における電源電位を示す図である。
【図４】従来例における電源揺動法の電源電位を示す図
である。
【符号の説明】 １０１、１０２、１０７、１０９ 高耐圧ｐｍｏｓ １０３、１０４、１０５、１０６ 高耐圧ｎｍｏｓ １０８、１１０、１１２、１１４ 高耐圧ｎｍｏｓ １１１、１１３ 低耐圧ｐｍｏｓ

Claims (1)

    【特許請求の範囲】
  1. 【請求項１】 複数の信号電極を駆動する信号電極駆動
    装置と複数の走査電極を駆動する走査電極駆動装置から
    なる液晶表示装置の駆動回路において、外部システムか
    らの入力信号を直接電源揺動法を用いて駆動している走
    査電極駆動装置に入力して駆動できることを特徴とする
    液晶表示装置の駆動回路。
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