JPH10150339A - インピーダンス整合装置及びその制御方法 - Google Patents
インピーダンス整合装置及びその制御方法Info
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- JPH10150339A JPH10150339A JP9299024A JP29902497A JPH10150339A JP H10150339 A JPH10150339 A JP H10150339A JP 9299024 A JP9299024 A JP 9299024A JP 29902497 A JP29902497 A JP 29902497A JP H10150339 A JPH10150339 A JP H10150339A
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03H—IMPEDANCE NETWORKS, e.g. RESONANT CIRCUITS; RESONATORS
- H03H7/00—Multiple-port networks comprising only passive electrical elements as network components
- H03H7/38—Impedance-matching networks
Landscapes
- Transmitters (AREA)
- Measurement Of Resistance Or Impedance (AREA)
- Filters And Equalizers (AREA)
- Networks Using Active Elements (AREA)
Abstract
(57)【要約】
【課題】 より多様な周波数に対する整合機能を一つの
装置で全て遂行し得るための周波数変化に対してインピ
ーダンス整合が可能なインピーダンス整合装置及びその
制御方法を提供する。 【解決手段】 入力周波数を方向性結合器１を介して定
在波比検出部３及び負荷側抵抗検出部４に入力させた
後、マイクロプロセッサ５に入力し、その周波数に対す
る定在波比や位相等を測定した後、この値をマイクロプ
ロセッサで読取り、整合回路部７の回路整数値を計算し
た後、計算した値によって整合回路部を動作させて当該
周波数に対する信号整合機能を遂行し、周波数変化に対
してインピーダンス整合を可能にする。
装置で全て遂行し得るための周波数変化に対してインピ
ーダンス整合が可能なインピーダンス整合装置及びその
制御方法を提供する。 【解決手段】 入力周波数を方向性結合器１を介して定
在波比検出部３及び負荷側抵抗検出部４に入力させた
後、マイクロプロセッサ５に入力し、その周波数に対す
る定在波比や位相等を測定した後、この値をマイクロプ
ロセッサで読取り、整合回路部７の回路整数値を計算し
た後、計算した値によって整合回路部を動作させて当該
周波数に対する信号整合機能を遂行し、周波数変化に対
してインピーダンス整合を可能にする。
Description
【０００１】
【発明の属する技術分野】本発明は、インピーダンス整
合装置及びその制御方法に関するもので、特に使用信号
の周波数に変動がある時、変動された周波数に合う整合
回路を自動に制御し、周波数変化に対してインピーダン
ス整合が可能なインピーダンス整合装置及びその制御方
法に関するものである。
合装置及びその制御方法に関するもので、特に使用信号
の周波数に変動がある時、変動された周波数に合う整合
回路を自動に制御し、周波数変化に対してインピーダン
ス整合が可能なインピーダンス整合装置及びその制御方
法に関するものである。
【０００２】
【関連する背景技術】一般的に使用されている整合回路
は、一周波数に対してだけ動作し、使用周波数を変更す
る時は、変更する周波数に合う整合回路を再び設計する
必要があった。しかし、上記整合回路では、設計時のチ
ューニング過程が複雑であることから、新たな整合回路
を設計することは易しいことではない。よって、一つの
整合回路において、一つ以上の周波数に対して整合し得
る装置及び方法が研究されている。
は、一周波数に対してだけ動作し、使用周波数を変更す
る時は、変更する周波数に合う整合回路を再び設計する
必要があった。しかし、上記整合回路では、設計時のチ
ューニング過程が複雑であることから、新たな整合回路
を設計することは易しいことではない。よって、一つの
整合回路において、一つ以上の周波数に対して整合し得
る装置及び方法が研究されている。
【０００３】その一例として、米国特許第５，４９３，
３１１号が挙げられる。米国特許第５，４９３，３１１
号に開示されるインピーダンスマッチング回路は、アン
テナと、アンテナに直列接続された第１インダクタと、
前記第１インダクタの一端側と接地に接続された第１キ
ャパシタと、前記第１インダクタに第１キャパシタとと
もに並列接続された第２インダクタと、前記第２インダ
クタの一端側と接地に接続された第２キャパシタとから
なっている。
３１１号が挙げられる。米国特許第５，４９３，３１１
号に開示されるインピーダンスマッチング回路は、アン
テナと、アンテナに直列接続された第１インダクタと、
前記第１インダクタの一端側と接地に接続された第１キ
ャパシタと、前記第１インダクタに第１キャパシタとと
もに並列接続された第２インダクタと、前記第２インダ
クタの一端側と接地に接続された第２キャパシタとから
なっている。
【０００４】又、各インダクタとキャパシタの出力共振
周波数が、相違した二つの入力周波数信号に応じて異な
るようにすることで、インピーダンスマッチング回路の
出力信号を制御して二つの周波数に対するインピーダン
スマッチングができるようにしていた。
周波数が、相違した二つの入力周波数信号に応じて異な
るようにすることで、インピーダンスマッチング回路の
出力信号を制御して二つの周波数に対するインピーダン
スマッチングができるようにしていた。
【０００５】
【発明が解決しようとする課題】しかしながら、前記の
ような第５，４９３，３１１号のインピーダンスマッチ
ング回路は、リアクタンスとキャパシタの容量に対応す
る共振周波数が決定されているため、単に二つの周波数
に対してだけインピーダンスマッチングができ、共振周
波数の多段階変化ができず、多様な周波数に対するイン
ピーダンスマッチングが不可能となる問題点があった。
ような第５，４９３，３１１号のインピーダンスマッチ
ング回路は、リアクタンスとキャパシタの容量に対応す
る共振周波数が決定されているため、単に二つの周波数
に対してだけインピーダンスマッチングができ、共振周
波数の多段階変化ができず、多様な周波数に対するイン
ピーダンスマッチングが不可能となる問題点があった。
【０００６】本発明は、このような問題点に鑑み、より
多様な周波数に対する整合機能を一つの装置で全て遂行
し得るためのもので、周波数の変化を感知し、変化され
た周波数から所望中心周波数を選定し、それに対する整
合回路を制御する周波数変化に対してインピーダンス整
合が可能なインピーダンス整合装置及びその制御方法を
提供することを目的とする。
多様な周波数に対する整合機能を一つの装置で全て遂行
し得るためのもので、周波数の変化を感知し、変化され
た周波数から所望中心周波数を選定し、それに対する整
合回路を制御する周波数変化に対してインピーダンス整
合が可能なインピーダンス整合装置及びその制御方法を
提供することを目的とする。
【０００７】
【課題を解決するための手段】前記目的を達成するため
に、本発明では、入力される信号の位相を変換させて分
離する方向性結合器と、前記方向性結合器を通過した信
号を二つの信号に分離する同位相分配器と、前記同位相
分配器で分離された信号を取り込み定在波比を検出する
定在波比検出部と、前記同位相分配器で分離された信号
を取り込み負荷側の抵抗を検出する負荷側抵抗検出部
と、前記定在波比検出部と負荷側抵抗検出部から入力さ
れる信号によりシステムの動作を制御するマイクロプロ
セッサと、前記マイクロプロセッサから伝送される制御
信号により駆動する駆動部と、前記駆動部の駆動により
駆動され、共振周波数を多様に変化させて多様な周波数
に対するインピーダンス整合を遂行し得る多数のスイッ
チを使用して、入力される信号を整合して出力する整合
部とを備えたインピーダンス整合装置及びその制御方法
が提供される。
に、本発明では、入力される信号の位相を変換させて分
離する方向性結合器と、前記方向性結合器を通過した信
号を二つの信号に分離する同位相分配器と、前記同位相
分配器で分離された信号を取り込み定在波比を検出する
定在波比検出部と、前記同位相分配器で分離された信号
を取り込み負荷側の抵抗を検出する負荷側抵抗検出部
と、前記定在波比検出部と負荷側抵抗検出部から入力さ
れる信号によりシステムの動作を制御するマイクロプロ
セッサと、前記マイクロプロセッサから伝送される制御
信号により駆動する駆動部と、前記駆動部の駆動により
駆動され、共振周波数を多様に変化させて多様な周波数
に対するインピーダンス整合を遂行し得る多数のスイッ
チを使用して、入力される信号を整合して出力する整合
部とを備えたインピーダンス整合装置及びその制御方法
が提供される。
【０００８】すなわち、入力周波数を方向性結合器、定
在波比検出部及び負荷側抵抗検出部に入力させた後、マ
イクロプロセッサに入力し、その周波数に対する定在波
比（Voltage Standing wave ratio）や位相等を測定し
た後、この値をマイクロプロセッサで読取り、整合部の
インピーダンスマッチング値（回路素子値）を計算した
後、計算した値によって整合部をスイッチで動作させて
当該周波数に対する信号整合機能を遂行し、周波数変化
に対してインピーダンス整合を可能にする。
在波比検出部及び負荷側抵抗検出部に入力させた後、マ
イクロプロセッサに入力し、その周波数に対する定在波
比（Voltage Standing wave ratio）や位相等を測定し
た後、この値をマイクロプロセッサで読取り、整合部の
インピーダンスマッチング値（回路素子値）を計算した
後、計算した値によって整合部をスイッチで動作させて
当該周波数に対する信号整合機能を遂行し、周波数変化
に対してインピーダンス整合を可能にする。
【０００９】また、前記定在波比検出部と負荷側抵抗検
出部は、アナログ／デジタル変換器を内部に有し、アナ
ログ入力信号をデジタル信号に変換して出力することが
好ましい。また、前記整合部は、第１インダクタバンク
の一端側に第１キャパシタバンクと第２インダクタバン
クが並列に連結され、第１インダクタバンクの他の一端
側にはピンダイオードが信号印加端と並列に連結され、
第２インダクタバンクの他の一端側には第２キャパシタ
バンクが信号印加端と並列に連結され、ピンダイオード
と各キャパシタバンクの他の一端側は全て連結されて二
つの信号印加端に連結されている並列構成のインダクタ
バンクとキャパシタバンクからなることが好ましい。
出部は、アナログ／デジタル変換器を内部に有し、アナ
ログ入力信号をデジタル信号に変換して出力することが
好ましい。また、前記整合部は、第１インダクタバンク
の一端側に第１キャパシタバンクと第２インダクタバン
クが並列に連結され、第１インダクタバンクの他の一端
側にはピンダイオードが信号印加端と並列に連結され、
第２インダクタバンクの他の一端側には第２キャパシタ
バンクが信号印加端と並列に連結され、ピンダイオード
と各キャパシタバンクの他の一端側は全て連結されて二
つの信号印加端に連結されている並列構成のインダクタ
バンクとキャパシタバンクからなることが好ましい。
【００１０】さらに、前記各インダクタバンクは、イン
ダクタとスイッチが並列に連結されてなった二つのイン
ダクタ対が並列に連結されてなり、前記各キャパシタバ
ンクは、キャパシタとスイッチが並列に連結されてなっ
た二つのキャパシタ対が並列に連結されていることが好
ましい。
ダクタとスイッチが並列に連結されてなった二つのイン
ダクタ対が並列に連結されてなり、前記各キャパシタバ
ンクは、キャパシタとスイッチが並列に連結されてなっ
た二つのキャパシタ対が並列に連結されていることが好
ましい。
【００１１】
【発明の実施の形態】以下、添付図面を参照して、本発
明に係るインピーダンス整合装置及びその制御方法を詳
細に説明する。図１は、本発明に係るインピーダンス整
合装置の構成の一例を示すブロック図である。図におい
て、入力される信号の位相を９０°方向に変換させて信
号を分離する９０°方向性結合器１と、前記９０°方向
性結合器１と接続され、９０°方向性結合器１を通過し
た信号を二つの信号に分離する同位相電力分配器２と、
前記同位相電力分配器２と接続され、同位相電力分配器
２で分離された一方の信号を取り込み電圧定在波比を検
出する定在波比検出部３と、前記同位相電力分配器２と
接続され、同位相電力分配器２で分離された他方の信号
を取り込み負荷側の抵抗を検出する負荷側抵抗検出部４
と、前記定在波比検出部３と負荷側抵抗検出部４と接続
され、定在波比検出部３と負荷側抵抗検出部４から入力
される信号から定在波比と位相を検出してシステムの動
作を制御するマイクロプロセッサ５と、前記マイクロプ
ロセッサ５と接続され、入力信号周波数に対するインピ
ーダンスマッチングを可能にする整合回路部７の回路素
子値を満足する信号を作るため、マイクロプロセッサ５
の制御信号に応じてリレーをオン／オフする駆動回路部
６と、前記駆動回路部６の駆動信号に応じて入力信号を
整合するとともに、アンテナ８と接続される整合回路部
７とから構成される。
明に係るインピーダンス整合装置及びその制御方法を詳
細に説明する。図１は、本発明に係るインピーダンス整
合装置の構成の一例を示すブロック図である。図におい
て、入力される信号の位相を９０°方向に変換させて信
号を分離する９０°方向性結合器１と、前記９０°方向
性結合器１と接続され、９０°方向性結合器１を通過し
た信号を二つの信号に分離する同位相電力分配器２と、
前記同位相電力分配器２と接続され、同位相電力分配器
２で分離された一方の信号を取り込み電圧定在波比を検
出する定在波比検出部３と、前記同位相電力分配器２と
接続され、同位相電力分配器２で分離された他方の信号
を取り込み負荷側の抵抗を検出する負荷側抵抗検出部４
と、前記定在波比検出部３と負荷側抵抗検出部４と接続
され、定在波比検出部３と負荷側抵抗検出部４から入力
される信号から定在波比と位相を検出してシステムの動
作を制御するマイクロプロセッサ５と、前記マイクロプ
ロセッサ５と接続され、入力信号周波数に対するインピ
ーダンスマッチングを可能にする整合回路部７の回路素
子値を満足する信号を作るため、マイクロプロセッサ５
の制御信号に応じてリレーをオン／オフする駆動回路部
６と、前記駆動回路部６の駆動信号に応じて入力信号を
整合するとともに、アンテナ８と接続される整合回路部
７とから構成される。
【００１２】前記定在波比検出部３と負荷側抵抗検出部
４には、アナログ／デジタル変換器が内部に設けられて
いるので、アナログ入力信号をデジタル信号に変換して
出力している。前記整合回路部７は、図２に示すよう
に、第１インダクタバンク７１の一端側に第１キャパシ
タバンク７３と第２インダクタバンク７２が並列に連結
され、第１インダクタバンク７１の他の一端側には、ピ
ンダイオード７５が信号印加端と並列に連結され、第２
インダクタバンク７２の他の一端側には、第２キャパシ
タバンク７４が信号印加端と並列に連結され、ピンダイ
オード７５と各キャパシタバンク７３，７４の他の一端
側は、全て連結されて二つの信号印加端に連結されてい
る並列構成の形態である。
４には、アナログ／デジタル変換器が内部に設けられて
いるので、アナログ入力信号をデジタル信号に変換して
出力している。前記整合回路部７は、図２に示すよう
に、第１インダクタバンク７１の一端側に第１キャパシ
タバンク７３と第２インダクタバンク７２が並列に連結
され、第１インダクタバンク７１の他の一端側には、ピ
ンダイオード７５が信号印加端と並列に連結され、第２
インダクタバンク７２の他の一端側には、第２キャパシ
タバンク７４が信号印加端と並列に連結され、ピンダイ
オード７５と各キャパシタバンク７３，７４の他の一端
側は、全て連結されて二つの信号印加端に連結されてい
る並列構成の形態である。
【００１３】前記各インダクタバンク７１，７２は、イ
ンダクタＬとスイッチＳが並列に連結されてなった二つ
のインダクタ対が並列に連結されてなり、各キャパシタ
バンク７３，７４も、前記インダクタバンクと同様に、
キャパシタＣとスイッチＳが並列に連結されてなった二
つのキャパシタ対が並列に連結されている。前記各スイ
ッチＳは、駆動回路部６のリレー駆動によりオン・オフ
され、整合回路部７では、各スイッチＳのオン・オフ状
態によって多様な共振周波数を発生することができ、多
様な共振周波数発生により多様な周波数信号に対して整
合機能を遂行し得る。
ンダクタＬとスイッチＳが並列に連結されてなった二つ
のインダクタ対が並列に連結されてなり、各キャパシタ
バンク７３，７４も、前記インダクタバンクと同様に、
キャパシタＣとスイッチＳが並列に連結されてなった二
つのキャパシタ対が並列に連結されている。前記各スイ
ッチＳは、駆動回路部６のリレー駆動によりオン・オフ
され、整合回路部７では、各スイッチＳのオン・オフ状
態によって多様な共振周波数を発生することができ、多
様な共振周波数発生により多様な周波数信号に対して整
合機能を遂行し得る。
【００１４】前記構成のインピーダンス整合装置の動作
を説明すると、入力される信号（周波数信号）が９０°
方向性結合器１を介して同位相電力分配器２に入力され
ると、同位相電力分配器２は、この入力信号を分配して
定在波比検出部３と負荷側抵抗検出部４に入力させる。
定在波比検出部３では、入力信号から定在波比を検出
し、負荷側抵抗検出部４では、負荷側抵抗を入力抵抗値
と比較し、その差分をマイクロプロセッサ５に入力させ
る。マイクロプロセッサ５では、入力データに基づいて
出力側に必要な反射係数と負荷抵抗値を計算して駆動回
路部６を駆動させる。駆動回路部６では、マイクロプロ
セッサ５から入力された値により、図示しないリレー素
子とダイオードがオン／オフされて、整合回路部７の回
路素子値を満足する信号を発生して整合回路部７に入力
させ、整合回路部７では、入力された信号を整合して出
力する。
を説明すると、入力される信号（周波数信号）が９０°
方向性結合器１を介して同位相電力分配器２に入力され
ると、同位相電力分配器２は、この入力信号を分配して
定在波比検出部３と負荷側抵抗検出部４に入力させる。
定在波比検出部３では、入力信号から定在波比を検出
し、負荷側抵抗検出部４では、負荷側抵抗を入力抵抗値
と比較し、その差分をマイクロプロセッサ５に入力させ
る。マイクロプロセッサ５では、入力データに基づいて
出力側に必要な反射係数と負荷抵抗値を計算して駆動回
路部６を駆動させる。駆動回路部６では、マイクロプロ
セッサ５から入力された値により、図示しないリレー素
子とダイオードがオン／オフされて、整合回路部７の回
路素子値を満足する信号を発生して整合回路部７に入力
させ、整合回路部７では、入力された信号を整合して出
力する。
【００１５】前記インピーダンス整合装置に入力する信
号は、アナログ信号であり、定在波比検出部３と負荷側
抵抗検出部４でデジタル信号に変換されて出力される。
前記マイクロプロセッサ５で反射係数と負荷抵抗値を計
算する過程は、図３に示すように、先ず９０°方向性結
合器１に入力される信号の周波数を読取る第１段階（Ｓ
１）と、前記第１段階（Ｓ１）後、定在波比検出部３と
負荷側抵抗検出部４の出力値を読取る第２段階（Ｓ２）
と、読取ったデータを用いて、係数と負荷抵抗値を計算
すべきプログラム方式を決定する第３段階（Ｓ３）と、
前記第３段階（Ｓ３）で決定されたプログラムを呼出す
第４及び第５段階（Ｓ４，Ｓ５）と、前記第４及び第５
段階で呼出された方式により、反射係数と負荷抵抗値を
計算する第６段階（Ｓ６）と、前記第６段階（Ｓ６）で
計算された反射係数と負荷抵抗値に基づいて回路素子値
を計算する第７段階（Ｓ７）と、計算された回路素子を
駆動回路部６に出力する第８段階（Ｓ８）と、再び定在
波比検出部３と負荷側抵抗検出部４の出力値を読取る第
９段階（Ｓ９）と、前記第９段階（Ｓ９）後、エラー発
生有無をチェックする第１０段階（Ｓ１０）とからな
り、エラーが発生した場合には、前記第２段階（Ｓ２）
の過程を繰返し、またエラーが発生しない場合には、上
記動作過程を終了する。
号は、アナログ信号であり、定在波比検出部３と負荷側
抵抗検出部４でデジタル信号に変換されて出力される。
前記マイクロプロセッサ５で反射係数と負荷抵抗値を計
算する過程は、図３に示すように、先ず９０°方向性結
合器１に入力される信号の周波数を読取る第１段階（Ｓ
１）と、前記第１段階（Ｓ１）後、定在波比検出部３と
負荷側抵抗検出部４の出力値を読取る第２段階（Ｓ２）
と、読取ったデータを用いて、係数と負荷抵抗値を計算
すべきプログラム方式を決定する第３段階（Ｓ３）と、
前記第３段階（Ｓ３）で決定されたプログラムを呼出す
第４及び第５段階（Ｓ４，Ｓ５）と、前記第４及び第５
段階で呼出された方式により、反射係数と負荷抵抗値を
計算する第６段階（Ｓ６）と、前記第６段階（Ｓ６）で
計算された反射係数と負荷抵抗値に基づいて回路素子値
を計算する第７段階（Ｓ７）と、計算された回路素子を
駆動回路部６に出力する第８段階（Ｓ８）と、再び定在
波比検出部３と負荷側抵抗検出部４の出力値を読取る第
９段階（Ｓ９）と、前記第９段階（Ｓ９）後、エラー発
生有無をチェックする第１０段階（Ｓ１０）とからな
り、エラーが発生した場合には、前記第２段階（Ｓ２）
の過程を繰返し、またエラーが発生しない場合には、上
記動作過程を終了する。
【００１６】前記第３段階（Ｓ３）で決定されるプログ
ラム方式としては、チェビシェブ（Chebyshevs）方式と
バッタワース（Butterworth）方式があり、前記両方式
は、既存の整合回路を具現するためのアルゴリズムとし
てマイクロプロセッサ５に貯蔵され、使用者が任意に設
定した条件に基づいて、必要時に呼出して使用される。
例えば、使用者がチェビシェブ方式の呼出し条件を定在
波比が負荷側抵抗検出部４の出力値より大きい場合と
し、またバッタワース方式の呼出し条件を定在波比が負
荷側抵抗検出部４の出力値より小さい場合として設定す
ると、マイクロプロセッサ５は、入力する定在波比と負
荷側抵抗検出部４の出力値を比較し、その結果、定在波
比が負荷側抵抗検出部４の出力値より大きければ、チェ
ビシェブ方式を、また定在波比が負荷側抵抗検出部４の
出力値より小さければ、バッタワース方式を呼出して、
反射係数と負荷抵抗値を計算する。なお、本発明の上記
プログラム方式の呼出し条件は、上記定在波比と負荷側
抵抗検出部４の出力値の比較結果に限らず、他の条件を
呼出し条件として設定することも可能である。
ラム方式としては、チェビシェブ（Chebyshevs）方式と
バッタワース（Butterworth）方式があり、前記両方式
は、既存の整合回路を具現するためのアルゴリズムとし
てマイクロプロセッサ５に貯蔵され、使用者が任意に設
定した条件に基づいて、必要時に呼出して使用される。
例えば、使用者がチェビシェブ方式の呼出し条件を定在
波比が負荷側抵抗検出部４の出力値より大きい場合と
し、またバッタワース方式の呼出し条件を定在波比が負
荷側抵抗検出部４の出力値より小さい場合として設定す
ると、マイクロプロセッサ５は、入力する定在波比と負
荷側抵抗検出部４の出力値を比較し、その結果、定在波
比が負荷側抵抗検出部４の出力値より大きければ、チェ
ビシェブ方式を、また定在波比が負荷側抵抗検出部４の
出力値より小さければ、バッタワース方式を呼出して、
反射係数と負荷抵抗値を計算する。なお、本発明の上記
プログラム方式の呼出し条件は、上記定在波比と負荷側
抵抗検出部４の出力値の比較結果に限らず、他の条件を
呼出し条件として設定することも可能である。
【００１７】第９段階と第１０段階（Ｓ９，Ｓ１０）
は、定在波比検出部３と負荷側抵抗検出部４の出力値を
読取った後、エラーをチェックする過程で、第２段階
（Ｓ２）で読取った定在波比検出部３と負荷側抵抗検出
部４の出力値と、第９段階（Ｓ９）で読取った定在波比
検出部３と負荷側抵抗検出部４の出力値とが同じであれ
ば、エラーが発生しなかったと判断し、上記出力値が異
なっていれば、エラーが発生したと判断している。な
お、本実施例において、上記エラーチェックの方法は、
例えばパリティーチェック等の一般的なエラーチェック
方法を用いる。
は、定在波比検出部３と負荷側抵抗検出部４の出力値を
読取った後、エラーをチェックする過程で、第２段階
（Ｓ２）で読取った定在波比検出部３と負荷側抵抗検出
部４の出力値と、第９段階（Ｓ９）で読取った定在波比
検出部３と負荷側抵抗検出部４の出力値とが同じであれ
ば、エラーが発生しなかったと判断し、上記出力値が異
なっていれば、エラーが発生したと判断している。な
お、本実施例において、上記エラーチェックの方法は、
例えばパリティーチェック等の一般的なエラーチェック
方法を用いる。
【００１８】本実施例は、前記のような方式により反射
係数と負荷抵抗値を計算した後に、回路素子値を計算
し、その値により、図２の整合回路部７のスイッチオン
／オフ状態を調節して、変化された周波数に対する整合
回路を具現し得るものである。即ち、本実施例では、前
記インピーダンス整合装置に使用される信号の周波数が
変化しても、前記のような動作過程により、変化された
周波数に対する整合回路部７の回路素子値を計算して整
合回路部７のスイッチオン・オフ状態を制御すること
で、当該周波数信号に対する整合回路を具現して、変化
された周波数信号を整合し得ることになる。
係数と負荷抵抗値を計算した後に、回路素子値を計算
し、その値により、図２の整合回路部７のスイッチオン
／オフ状態を調節して、変化された周波数に対する整合
回路を具現し得るものである。即ち、本実施例では、前
記インピーダンス整合装置に使用される信号の周波数が
変化しても、前記のような動作過程により、変化された
周波数に対する整合回路部７の回路素子値を計算して整
合回路部７のスイッチオン・オフ状態を制御すること
で、当該周波数信号に対する整合回路を具現して、変化
された周波数信号を整合し得ることになる。
【００１９】
【発明の効果】以上説明したように、本発明は、方向性
結合器で入力される信号の位相を変換させて分離すると
ともに、前記方向性結合器を通過した信号を同位相分配
器で二つの信号に分離し、前記同位相分配器で分離され
た一方の信号を定在波比検出部で取り込んで定在波比を
検出し、前記同位相分配器で分離された他方の信号を負
荷側抵抗検出部で取り込み負荷側の抵抗を検出し、さら
にマイクロプロセッサで前記定在波比検出部と負荷側抵
抗検出部から入力される信号によりシステムの動作を制
御して、前記マイクロプロセッサから伝送される制御信
号により整合部の駆動部を駆動させて、前記方向性結合
器から入力される信号を整合部で整合して出力するの
で、前記のような装置及び制御方法により周波数変化を
感知し、変化された周波数で所望中心周波数を選定し、
それに対する整合回路を実現することができる。
結合器で入力される信号の位相を変換させて分離すると
ともに、前記方向性結合器を通過した信号を同位相分配
器で二つの信号に分離し、前記同位相分配器で分離され
た一方の信号を定在波比検出部で取り込んで定在波比を
検出し、前記同位相分配器で分離された他方の信号を負
荷側抵抗検出部で取り込み負荷側の抵抗を検出し、さら
にマイクロプロセッサで前記定在波比検出部と負荷側抵
抗検出部から入力される信号によりシステムの動作を制
御して、前記マイクロプロセッサから伝送される制御信
号により整合部の駆動部を駆動させて、前記方向性結合
器から入力される信号を整合部で整合して出力するの
で、前記のような装置及び制御方法により周波数変化を
感知し、変化された周波数で所望中心周波数を選定し、
それに対する整合回路を実現することができる。
【図１】本発明に係るインピーダンス整合装置の構成の
一例を示すブロック図である。
一例を示すブロック図である。
【図２】図１に示した整合回路部の詳細構成の一例を示
すブロック図である。
すブロック図である。
【図３】本発明によるマイクロプロセッサの動作過程を
示すフローチャートである。
示すフローチャートである。
１ ９０°方向性結合器 ２ 同位相電力分配器 ３ 定在波比検出部 ４ 負荷側抵抗検出部 ５ マイクロプロセッサ ６ 駆動回路部 ７ 整合回路部 ８ アンテナ ７１，７２ インダクタバンク ７３，７４ キャパシタバンク ７５ ピンダイオード Ｃ キャパシタ Ｌ インダクタ Ｓ スイッチ
Claims (6)
- 【請求項１】 入力される信号の位相を変換させて分離
する方向性結合器と、前記方向性結合器を通過した信号
を二つの信号に分離する同位相分配器と、前記同位相分
配器で分離された信号を取り込み定在波比を検出する定
在波比検出部と、前記同位相分配器で分離された信号を
取り込み負荷側の抵抗を検出する負荷側抵抗検出部と、
前記定在波比検出部と負荷側抵抗検出部から入力される
信号によりシステムの動作を制御するマイクロプロセッ
サと、前記マイクロプロセッサから伝送される制御信号
により駆動する駆動部と、前記駆動部の駆動により駆動
され、入力信号を整合して出力する整合部とから構成さ
れて、多様な周波数の入力信号に対してインピーダンス
マッチングを行うことを特徴とするインピーダンス整合
装置。 - 【請求項２】 前記定在波比検出部と負荷側抵抗検出部
は、アナログ／デジタル変換器を有し、アナログ入力信
号をデジタル信号に変換して出力することを特徴とする
請求項１記載のインピーダンス整合装置。 - 【請求項３】 前記整合部では、共振周波数を多様に変
化させて多様な周波数に対するインピーダンス整合を遂
行し得る多数のスイッチを使用することを特徴とする請
求項１記載のインピーダンス整合装置。 - 【請求項４】 前記整合部は、第１インダクタバンクの
一端側に第１キャパシタバンクと第２インダクタバンク
が並列に連結され、前記第１インダクタバンクの他の一
端側にはピンダイオードが信号印加端と並列に連結さ
れ、前記第２インダクタバンクの他の一端側には第２キ
ャパシタバンクが信号印加端と並列に連結され、前記ピ
ンダイオードと各キャパシタバンクの他の一端側は全て
連結されて二つの信号印加端に連結されている並列構成
のインダクタバンクとキャパシタバンクからなることを
特徴とする請求項１記載のインピーダンス整合装置。 - 【請求項５】 前記各インダクタバンクは、インダクタ
とスイッチが並列に連結されてなった二つのインダクタ
対が並列に連結されてなり、前記各キャパシタバンク
は、キャパシタとスイッチが並列に連結されてなった二
つのキャパシタ対が並列に連結されていることを特徴と
する請求項３又は４記載のインピーダンス整合装置。 - 【請求項６】 入力信号の周波数に対する反射係数と負
荷抵抗値を計算し、これら値によって入力信号周波数に
対する整合部のインピーダンスマッチング値を決定し、
前記整合部が入力信号周波数の変化に対してインピーダ
ンス整合することを特徴とするインピーダンス整合装置
の制御方法。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019960050782A KR100191430B1 (ko) | 1996-10-31 | 1996-10-31 | 주파수 이동이 가능한 자동 정합 회로 장치 및 구현 방법 |
| KR1996-50782 | 1996-10-31 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH10150339A true JPH10150339A (ja) | 1998-06-02 |
Family
ID=19480148
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9299024A Pending JPH10150339A (ja) | 1996-10-31 | 1997-10-30 | インピーダンス整合装置及びその制御方法 |
Country Status (2)
| Country | Link |
|---|---|
| JP (1) | JPH10150339A (ja) |
| KR (1) | KR100191430B1 (ja) |
Cited By (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100391148B1 (ko) * | 2000-11-02 | 2003-07-16 | 삼성전자주식회사 | 프로그래머블 임피던스 제어회로 및 방법 |
| JP2007174198A (ja) * | 2005-12-21 | 2007-07-05 | Shindengen Electric Mfg Co Ltd | インピーダンス整合装置 |
| JP2007181063A (ja) * | 2005-12-28 | 2007-07-12 | Tokimec Inc | 方向性結合器、空中線整合器及び送信機 |
| JP2007531470A (ja) * | 2004-04-02 | 2007-11-01 | インターデイジタル テクノロジー コーポレーション | トランスミッタのインピーダンスを動的に調節し、線形及びスイッチモード電力増幅器を選択的に直列接続するハイブリッド電力増幅器をその中で実施する装置及び方法 |
| US7359681B2 (en) | 2003-07-30 | 2008-04-15 | Lg Electronics Inc. | Transmitting apparatus and method of mobile communication terminal |
| JP2008288793A (ja) * | 2007-05-16 | 2008-11-27 | Nippon Hoso Kyokai <Nhk> | 位相調整型電力分配装置およびそれを用いた自動整合装置 |
| US20110303635A1 (en) * | 2010-06-11 | 2011-12-15 | Shuji Takahashi | Dry etching apparatus and method of dry etching |
| JP2013505044A (ja) * | 2009-09-17 | 2013-02-14 | コーニンクレッカ フィリップス エレクトロニクス エヌ ヴィ | ローカルな自動調整・整合回路を備えたｍｒｉ用マルチエレメントｒｆ送信コイル |
| CN104577328B (zh) * | 2015-01-22 | 2017-07-18 | 山东大学 | 一种rfid天线及其自动匹配方法 |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100554263B1 (ko) * | 2002-12-12 | 2006-02-22 | 홍윤기 | 역률 개선형 전력절감 시스템 |
| KR100593901B1 (ko) * | 2004-04-22 | 2006-06-28 | 삼성전기주식회사 | 방향성 커플러 및 이를 이용한 듀얼밴드 송신기 |
-
1996
- 1996-10-31 KR KR1019960050782A patent/KR100191430B1/ko not_active IP Right Cessation
-
1997
- 1997-10-30 JP JP9299024A patent/JPH10150339A/ja active Pending
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| JP2013505044A (ja) * | 2009-09-17 | 2013-02-14 | コーニンクレッカ フィリップス エレクトロニクス エヌ ヴィ | ローカルな自動調整・整合回路を備えたｍｒｉ用マルチエレメントｒｆ送信コイル |
| US20110303635A1 (en) * | 2010-06-11 | 2011-12-15 | Shuji Takahashi | Dry etching apparatus and method of dry etching |
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Also Published As
| Publication number | Publication date |
|---|---|
| KR19980031233A (ko) | 1998-07-25 |
| KR100191430B1 (ko) | 1999-06-15 |
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