JPH10144787A - 半導体装置及びその製造方法 - Google Patents
半導体装置及びその製造方法Info
- Publication number
- JPH10144787A JPH10144787A JP29502196A JP29502196A JPH10144787A JP H10144787 A JPH10144787 A JP H10144787A JP 29502196 A JP29502196 A JP 29502196A JP 29502196 A JP29502196 A JP 29502196A JP H10144787 A JPH10144787 A JP H10144787A
- Authority
- JP
- Japan
- Prior art keywords
- film
- silicon nitride
- wiring
- nitride film
- silicon dioxide
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
Landscapes
- Electrodes Of Semiconductors (AREA)
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
- Insulated Gate Type Field-Effect Transistor (AREA)
Abstract
ン膜の積層構造と窒化シリコンからなるサイドウォール
とを有する配線において,配線に自己整合してコンタク
トホールを形成する際の上下配線間の短絡を防止する。 【解決手段】 導電膜上に二酸化シリコン膜と第1の窒
化シリコン膜が積層された配線と,該配線の側面に形成
された第2の窒化シリコン膜からなるサイドウォールと
を有し,該二酸化シリコン膜の端面が該第1の窒化シリ
コン膜より内側に存在する, 2)第1の窒化シリコン膜の側面が基板表面に対し斜め
の部分を有する, 3)導電膜の最上部が該第1の窒化シリコン膜の側面よ
り内側に存在する, 4)多層導電膜の上層膜が該第1の窒化シリコン膜の側
面より内側に存在する半導体装置。
Description
製造方法に係り,特に窒化シリコン(Si3N4) 膜のサイド
ウォールを用いたセルフアラインコンタクトのMOS FET
に関する。
を用いたセルフアラインコンタクトのMOS FET を図10
を用いて説明する。
例の説明図である。図10(A) において,シリコン(Si)
基板上に形成された導電膜 1の上に, 窒化シリコン膜 2
を堆積する。
リコン膜 2をパターニングして配線を形成し,その上に
窒化シリコン膜 3を堆積する。図10(C) において,窒
化シリコン膜 3を異方性エッチングして窒化シリコンか
らなるサイドウォール 4を形成する。
5を堆積し,この膜に基板に接続するコンタクトホール
を形成する。コンタクトホールの形成は,窒化シリコン
と二酸化シリコンとのエッチングレートの差により, 配
線に対して自己整合して形成する。
後, 硬い窒化シリコン膜を直接に導電膜に接触させたく
ない等の理由で, サイドウォール形成用窒化シリコン膜
の下に薄い二酸化シリコン膜を敷くことが望ましい。
た酸化膜上に形成された配線である場合は,サイドウォ
ール形成用窒化シリコン膜の下に二酸化シリコン膜を敷
いて窒化シリコン膜の強い応力を緩和したり, サイドウ
ォール形成時のエッチングの基板への損傷を軽減する必
要がある。
プロセス中, 窒化シリコン膜をエッチングストッパ膜と
して用いるセルフアラインコンタクトでは,窒化シリコ
ン膜と二酸化シリコン膜との選択比が十分大きくないと
導電膜 1の肩部で窒化シリコン膜が大きくエッチングさ
れてしまい短絡の原因となる(図11(D) 参照)。
成前に二酸化シリコン膜 6を形成すると,コンタクトホ
ール形成のためのエッチングの際に, サイドウォールと
配線上の窒化シリコン膜との間の二酸化シリコン膜 6が
エッチングされて,下部配線膜 1と上部配線膜 7とが短
絡してしまうことになる(図11(E) 参照)。
化シリコン膜の積層構造と窒化シリコンからなるサイド
ウォールとを有する配線において,配線にセルフアライ
ンしてコンタクトホールを形成する際の上下配線間の短
絡を防止することを目的とする。
と第1の窒化シリコン膜が順に積層された配線と,該配
線の側面に形成された第2の窒化シリコン膜からなるサ
イドウォールとを有し,該第1の二酸化シリコン膜の端
面が該第1の窒化シリコン膜より内側に存在する半導体
装置,あるいは 2)半導体基板上に,導電膜と第1の窒化シリコン膜と
第2の二酸化シリコン膜が順に積層された配線と,該配
線の側面に形成された第2の窒化シリコン膜からなるサ
イドウォールとを有し,該第2の二酸化シリコン膜の端
面が該第1の窒化シリコン膜より内側に存在する半導体
装置,あるいは 3)半導体基板上に,導電膜と第1の窒化シリコン膜が
順に積層された配線と,該配線の側面に形成された第2
の窒化シリコン膜からなるサイドウォールとを有し,該
第1の窒化シリコン膜の側面が該半導体基板表面に対し
斜めの部分を有する半導体装置,あるいは 4)半導体基板上に,導電膜と第1の窒化シリコン膜が
順に積層された配線と,該配線の側面に形成された第2
の窒化シリコン膜からなるサイドウォールとを有し,該
導電膜の最上部が該第1の窒化シリコン膜の側面より内
側に存在する半導体装置,あるいは 5)半導体基板上に,2層構造の導電膜と第1の窒化シ
リコン膜が順に積層された配線と,該配線の側面に形成
された第2の窒化シリコン膜からなるサイドウォールと
を有し,該導電膜の上層膜が該第1の窒化シリコン膜の
側面より内側に存在する半導体装置,あるいは 6)請求項2,3,4,または5において,導電膜と第
1の窒化シリコン膜との間に二酸化シリコン膜を有する
半導体装置,あるいは 7)半導体基板上に導電膜と二酸化シリコン膜と窒化シ
リコン膜を順に堆積し,これらの膜をパターニングして
配線を形成する際に,該二酸化シリコン膜のみ横方向の
エッチングを行う工程を含む半導体装置の製造方法,あ
るいは 8)半導体基板上に導電膜と窒化シリコン膜と二酸化シ
リコン膜を順に堆積し,これらの膜をパターニングして
配線を形成する際に,該二酸化シリコン膜のみ横方向の
エッチングを行う工程を含む半導体装置の製造方法,あ
るいは 9)半導体基板上に導電膜と二酸化シリコン膜との窒化
シリコン膜を堆積し,これらの膜をパターニングして配
線を形成する際に,該窒化シリコン膜の側面が該半導体
基板の表面に対し斜めになるようにエッチングを行う工
程を含む半導体装置の製造方法,あるいは 10)半導体基板上に導電膜と二酸化シリコン膜と窒化
シリコン膜を順に堆積し,これらの膜をパターニングし
て配線を形成する際に,該窒化シリコン膜を最初に等方
性エッチングを行い,その後に異方性エッチングを行う
半導体装置の製造方法,あるいは 11)半導体基板上に導電膜と二酸化シリコン膜と窒化
シリコン膜を順に堆積し,これらの膜をパターニングし
て配線を形成する際に,該導電膜の最上部が該窒化シリ
コン膜の内側に存在するようにエッチングを行う半導体
装置の製造方法,あるいは 12)半導体基板上に多層構造からなる導電膜と二酸化
シリコン膜と窒化シリコン膜を順に堆積し,これらの膜
をパターニングして配線を形成する際に,該導電膜の上
層導電膜が該窒化シリコン膜の内側に存在するようにエ
ッチングを行う半導体装置の製造方法により達成され
る。
窒化シリコン膜の積層の配線構造において,その断面形
状が二酸化シリコン膜,または導電膜最上部が凹んだ側
面を有するようにすることにより, 導電膜の肩部の窒化
シリコン膜の膜厚を実効的に厚くして上下配線間の短絡
を防止している。
れた二酸化シリコン膜, 窒化シリコン膜等の絶縁膜を含
む) の断面形状を単純な長方形でない形状とすることに
より, 窒化シリコンからなるサイドウォールと配線上の
窒化シリコン膜との間の二酸化シリコン膜がエッチング
されても, 上下の配線は短絡することがないようにして
いる。
態(1) の説明図である。図1(A) において,基板上に形
成された導電膜 1の上に二酸化シリコン膜 8と第1の窒
化シリコン膜 2を堆積し,配線のパターニングの際に,
レジスト膜 9をマスクにして第1の窒化シリコン膜 2を
エッチングし,次いで,二酸化シリコン膜 8を等方性エ
ッチングする。
し,その後, 導電膜 1の側面に熱酸化膜 6を形成する。
図1(B) において,基板上に第2の窒化シリコン膜を堆
積し,エッチバックしてサイドウォール 4を形成する。
して自己整合的にコンタクト孔を形成する。この形成は
窒化シリコンと二酸化シリコンとの選択比を利用したエ
ッチングによる。
化シリコン膜の膜厚が実効的に厚いために短絡に強い構
造となる。ここで,二酸化シリコン膜 8は硬い窒化シリ
コン膜を導電膜 1と広い面積で接触させないようにする
ためである。
ッチングについて種々の方法を説明する。 (a) 二酸化シリコン膜 8の等方性エッチングを, 窒化シ
リコン膜 2の異方性エッチングの後, 弗酸溶液によるウ
エットエッチングにより行う。
グを, 窒化シリコン膜 2の異方性エッチングの後, 酸化
膜の等方性ドライエッチングにより行う。 (c) 二酸化シリコン膜 8の等方性エッチングを, 窒化シ
リコン膜 2の異方性エッチングの後, 二酸化シリコン膜
8を異方性エッチングした後, 酸化膜の等方性ドライエ
ッチングにより行う。
グを, 窒化シリコン膜 2の異方性エッチングの後, 二酸
化シリコン膜 8を異方性エッチングした後, 弗酸溶液に
よるウエットエッチングにより行う。
CF4,CHF3,Ar の混合ガスを用いて平行平板型のエッチン
グ装置で行った。また,二酸化シリコン膜の等方性ドラ
イエッチングは, CF4, O2 の混合ガスを用いてダウンフ
ローエッチング装置を用いて行った。
説明図である。図2(A) は図1(A) と同じ工程である。
図2(B) において,実施の形態(1) の図1(A) に記載
の,配線のエッチング後の熱酸化膜の代わりに,気相成
長(CVD) 法による二酸化シリコン膜 6を堆積する。
配線上の窒化シリコン膜 2とサイドウォール 4との間の
二酸化シリコン膜 6がエッチングされても,下部配線 1
と上部配線 7との間で短絡することはない。
説明図である。図3(A) において, 導電膜 1の上に第1
の窒化シリコン膜 2と第2の二酸化シリコン膜10を堆積
し,レジスト膜 9を用いて配線のパターニングの際に,
第1の二酸化シリコン膜10の部分に横方向のエッチング
を行い, 引き続いて, 導電膜 1のエッチングを行う。
シリコン膜 6を堆積し,その上に第2の窒化シリコン膜
を堆積し,異方性エッチングによりサイドウォール 4を
形成する。
し自己整合的に, 窒化シリコンと二酸化シリコンとのエ
ッチング選択比を利用したエッチングを行い, コンタク
トホールを開口し,上部配線 7を形成する。
の二酸化シリコン膜 6がエッチングされても,図示の構
造のため下部配線 1と上部配線 7間の短絡を防止するこ
とができる。
説明図である。図4(A) において,導電膜 1の上に第1
の二酸化シリコン膜 8と第1の窒化シリコン膜 2とを堆
積し,レジスト膜 9を用いて配線のパターニングの際
に,図示のように第1の窒化シリコン膜 2をその断面形
状が台形になるようにエッチングする。引き続いて, 第
1の二酸化シリコン膜 8と導電膜 1のエッチングを行い
配線を形成する。
シリコン膜 6を堆積し,その上に第2の窒化シリコン膜
を堆積し,異方性エッチングによりサイドウォール 4を
形成する。
し自己整合的に, 窒化シリコンと二酸化シリコンとのエ
ッチング選択比を利用したエッチングを行い, コンタク
トホールを開口し,上部配線 7を形成する。
の二酸化シリコン膜 6がエッチングされても,配線上の
第1の窒化シリコン膜 2の断面形状が台形であるため,
下部配線 1と上部配線 7間の短絡を防止することができ
る。
の窒化シリコン膜のエッチングの際のエッチングストッ
パとして用いる。図5(A),(B) は本発明の実施の形態
(5) の説明図である。
窒化シリコン膜 2を堆積し,レジスト膜 9を用いて配線
のパターニングの際に,等方性エッチングと異方性エッ
チングを行って, 第1の窒化シリコン膜 2をその断面形
状が図示のような上部が削られた形になるようにエッチ
ングする。引き続いて, 導電膜 1のエッチングを行い配
線を形成する。
シリコン膜 6を堆積し,その上に第2の窒化シリコン膜
を堆積し,異方性エッチングによりサイドウォール 4を
形成する。
し自己整合的に, 窒化シリコンと二酸化シリコンとのエ
ッチング選択比を利用したエッチングを行い, コンタク
トホールを開口し,上部配線 7を形成する。
の二酸化シリコン膜 6がエッチングされても,配線上の
第1の窒化シリコン膜 2の断面形状が図示の構造である
ため,下部配線 1と上部配線 7間の短絡を防止すること
ができる。
説明図である。図6(A) において,導電膜 1の上に第1
の二酸化シリコン膜 8と第1の窒化シリコン膜 2とを堆
積し,レジスト膜 9を用いて配線のパターニングの際
に,図示のように第1の窒化シリコン膜 2をその断面形
状が逆テーパの台形になるようにエッチングする。引き
続いて, 第1の二酸化シリコン膜 8と導電膜 1のエッチ
ングを行い配線を形成する。
シリコン膜 6を堆積し,その上に第2の窒化シリコン膜
を堆積し,異方性エッチングによりサイドウォール 4を
形成する。
し自己整合的に, 窒化シリコンと二酸化シリコンとのエ
ッチング選択比を利用したエッチングを行い, コンタク
トホールを開口し,上部配線 7を形成する。
の二酸化シリコン膜 6がエッチングされても,配線上の
第1の窒化シリコン膜 2の断面形状が逆テーパの台形で
あるため,下部配線 1と上部配線 7間の短絡を防止する
ことができる。
の窒化シリコン膜のエッチングの際のエッチングストッ
パとして用いる。図7(A),(B) は本発明の実施の形態
(7) の説明図である。
二酸化シリコン膜 8と第1の窒化シリコン膜 2とを堆積
し,レジスト膜 9を用いて配線のパターニングの際に,
図示のよう導電層 1をその断面形状が逆テーパの台形に
なり,導電層 1の最上部が第1の窒化シリコン膜 2より
も内側に入った構造になるようにエッチングする。
シリコン膜 6を堆積し,その上に第2の窒化シリコン膜
を堆積し,異方性エッチングによりサイドウォール 4を
形成する。
し自己整合的に, 窒化シリコンと二酸化シリコンとのエ
ッチング選択比を利用したエッチングを行い, コンタク
トホールを開口し,上部配線 7を形成する。
の二酸化シリコン膜 6がエッチングされても,導電膜 1
の最上部が第1の窒化シリコン膜 2の内側に入った構造
であるため,導電膜(下部配線) 1と上部配線 7間の短
絡を防止することができる。
ン膜 6の堆積の代わりに, 熱酸化膜を形成してもよい。
この場合は,配線上の第1の窒化シリコン膜 2とサイド
ウォール 4との間に殆ど二酸化シリコン膜がないこと,
また, 導電膜 1の最上部が第1の窒化シリコン膜 より
も内側に入った構造であるため,導電膜1の肩部の窒化
シリコン膜の膜厚が実効的に厚くなり下部配線 1と上部
配線 7間の短絡を防止することができる(図7(c) 参
照)。
シリコンの化合物であり,第1の二酸化シリコン膜 8を
導電膜の酸化により形成してもよい。上記の実施の形態
(1) 〜(7) においては,導電層は単層構造としている
が,例えば, ポリシリコン膜/金属シリサイド膜のよう
な2層以上の構造であってもよい。
説明図である。図8(A) において,導電膜 1の上に第1
の二酸化シリコン膜 8と第1の窒化シリコン膜 2とを堆
積し,レジスト膜 9を用いて配線のパターニングの際
に,図示のよう導電層 1を2層構造1A, 1Bとし,上部の
導電膜1Bが第1の窒化シリコン膜2よりも内側に入った
構造になるようにエッチングする。
シリコン膜 6を堆積し,その上に第2の窒化シリコン膜
を堆積し,異方性エッチングによりサイドウォール 4を
形成する。
し自己整合的に, 窒化シリコンと二酸化シリコンとのエ
ッチング選択比を利用したエッチングを行い, コンタク
トホールを開口し,上部配線 7を形成する。
の二酸化シリコン膜 6がエッチングされても,導電層 1
の最上部が第1の窒化シリコン膜 2の内側に入った構造
であるため,下部配線 1と上部配線 7間の短絡を防止す
ることができる。
げる。ポリシリコン/タングステンシリサイド,ポリシ
リコン/チタンシリサイド,ポリシリコン/タングステ
ン,ポリシリコン/コバルトシリサイド,ポリシリコン
/モリブデンシリサイド 等この際に下層の導電膜1Aよ
りも上層の導電膜1Bの方がエッチレートの大きいエッチ
ングは,例えば,ポリシリコン/タングステンシリサイ
ドに対しては,エッチングガスとしてCl2, O2 の混合ガ
スを用いる。
ン膜 6の堆積の代わりに, 熱酸化膜を形成してもよい。
この場合は,配線上の第1の窒化シリコン膜 2とサイド
ウォール 4との間に殆ど二酸化シリコン膜がないこと,
また, 導電膜 1の最上部が第1の窒化シリコン膜 2より
も内側に入った構造であるため,導電膜1の肩部の窒化
シリコン膜の膜厚が実効的に厚くなり下部配線 1と上部
配線 7間の短絡を防止することができる(図8(c) 参
照)。
シリコンの化合物であり,第1の二酸化シリコン膜 8を
導電膜の酸化により形成してもよい。図9(A) 〜(C) は
本発明の実施の形態(9) の説明図である。
の二酸化シリコン膜 8を省略した例である。実施の形態
(1) (2) (7) (8) において,第3の二酸化シリコン膜 6
を省略しても導電膜最上部が第1の窒化シリコン膜 2よ
り内側にあるため,短絡を防止することができる。
ン膜, 窒化シリコン膜の積層構造と窒化シリコンからな
るサイドウォールとを有する配線において,配線にセル
フアラインしてコンタクトホールを形成する際の上下配
線間の短絡を防止することができる。
Claims (6)
- 【請求項1】 導電膜上に二酸化シリコン膜と第1の窒
化シリコン膜が積層された配線と,該配線の側面に形成
された第2の窒化シリコン膜からなるサイドウォールと
を有し,該二酸化シリコン膜の端面が該第1の窒化シリ
コン膜より内側に存在することを特徴とする半導体装
置。 - 【請求項2】 導電膜上に少なくとも第1の窒化シリコ
ン膜が積層された配線と,該配線の側面に形成された第
2の窒化シリコン膜からなるサイドウォールとを有し,
該第1の窒化シリコン膜の側面が該半導体基板表面に対
し斜めの部分を有することを特徴とする半導体装置。 - 【請求項3】 導電膜上に少なくとも第1の窒化シリコ
ン膜が積層された配線と,該配線の側面に形成された第
2の窒化シリコン膜からなるサイドウォールとを有し,
該導電膜の最上部が該第1の窒化シリコン膜の側面より
内側に存在することを特徴とする半導体装置。 - 【請求項4】 多層構造の導電膜上に少なくとも第1の
窒化シリコン膜が積層された配線と,該配線の側面に形
成された第2の窒化シリコン膜からなるサイドウォール
とを有し,該導電膜の上層膜が該第1の窒化シリコン膜
の側面より内側に存在することを特徴とする半導体装
置。 - 【請求項5】 導電膜上に二酸化シリコン膜と窒化シリ
コン膜を堆積し,パターニングして配線を形成する際
に,該二酸化シリコン膜のみ横方向のエッチングを行う
工程を含むことを特徴とする半導体装置の製造方法。 - 【請求項6】 半導体基板上に少なくとも窒化シリコン
膜を堆積し,パターニングして配線を形成する際に,等
方性エッチングと異方性エッチングにより該窒化シリコ
ン膜の膜厚方向の面積を変えることを特徴とする半導体
装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP29502196A JP3520697B2 (ja) | 1996-11-07 | 1996-11-07 | 半導体装置及びその製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP29502196A JP3520697B2 (ja) | 1996-11-07 | 1996-11-07 | 半導体装置及びその製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPH10144787A true JPH10144787A (ja) | 1998-05-29 |
JP3520697B2 JP3520697B2 (ja) | 2004-04-19 |
Family
ID=17815313
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP29502196A Expired - Lifetime JP3520697B2 (ja) | 1996-11-07 | 1996-11-07 | 半導体装置及びその製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3520697B2 (ja) |
Cited By (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6707154B2 (en) | 2000-06-30 | 2004-03-16 | Mitsubishi Denki Kabushiki Kaisha | Semiconductor device and production method for the same |
KR100439027B1 (ko) * | 2001-02-13 | 2004-07-03 | 삼성전자주식회사 | 셀프 얼라인 콘택형성방법 |
JP2006032541A (ja) * | 2004-07-14 | 2006-02-02 | Renesas Technology Corp | 半導体装置 |
JP2017118134A (ja) * | 2009-12-30 | 2017-06-29 | インテル コーポレイション | トランジスタ及びその製造方法 |
-
1996
- 1996-11-07 JP JP29502196A patent/JP3520697B2/ja not_active Expired - Lifetime
Cited By (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6707154B2 (en) | 2000-06-30 | 2004-03-16 | Mitsubishi Denki Kabushiki Kaisha | Semiconductor device and production method for the same |
KR100439027B1 (ko) * | 2001-02-13 | 2004-07-03 | 삼성전자주식회사 | 셀프 얼라인 콘택형성방법 |
JP2006032541A (ja) * | 2004-07-14 | 2006-02-02 | Renesas Technology Corp | 半導体装置 |
JP2017118134A (ja) * | 2009-12-30 | 2017-06-29 | インテル コーポレイション | トランジスタ及びその製造方法 |
US10629483B2 (en) | 2009-12-30 | 2020-04-21 | Intel Corporation | Self-aligned contacts |
US10930557B2 (en) | 2009-12-30 | 2021-02-23 | Intel Corporation | Self-aligned contacts |
US11600524B2 (en) | 2009-12-30 | 2023-03-07 | Intel Corporation | Self-aligned contacts |
US11887891B2 (en) | 2009-12-30 | 2024-01-30 | Intel Corporation | Self-aligned contacts |
Also Published As
Publication number | Publication date |
---|---|
JP3520697B2 (ja) | 2004-04-19 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US5753546A (en) | Method for fabricating metal oxide field effect transistors | |
US5950104A (en) | Contact process using Y-contact etching | |
JP2720796B2 (ja) | 半導体装置の製造方法 | |
US6387751B2 (en) | Method of manufacturing semiconductor device having high-density capacitor elements | |
JPH10135331A (ja) | 半導体装置のコンタクトホール形成方法 | |
JP3520697B2 (ja) | 半導体装置及びその製造方法 | |
JP2000216242A (ja) | 半導体装置の製造方法 | |
JPH07235594A (ja) | 半導体装置の製造方法 | |
JPH08153795A (ja) | コンタクト孔の形成方法 | |
JPH05226333A (ja) | 半導体装置の製造方法 | |
JPH1012868A (ja) | 半導体装置及びその製造方法 | |
JPH09232573A (ja) | コンタクト孔の形成方法 | |
JP2000208620A (ja) | 半導体装置の製造方法 | |
JP2914416B2 (ja) | 半導体装置の製造方法 | |
JP3116432B2 (ja) | 半導体装置の製造方法 | |
US20030047789A1 (en) | Semiconductor device and method of manufacturing the same | |
JP3350156B2 (ja) | 半導体装置の製造方法 | |
JPH04345054A (ja) | 半導体装置及びその製造方法 | |
JPH07326668A (ja) | 半導体装置の製造方法 | |
JPH05109729A (ja) | 半導体装置 | |
JPH05335505A (ja) | 接続構造の形成方法及び該接続構造の形成方法を用いた電子材料の形成方法 | |
JP3182168B2 (ja) | 半導体装置の製造方法及び半導体装置 | |
JPH08153796A (ja) | 半導体装置及びその製造方法 | |
JPH09266252A (ja) | 半導体装置の製造方法 | |
JPH0964174A (ja) | 半導体装置の製造方法 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20040113 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20040126 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080213 Year of fee payment: 4 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090213 Year of fee payment: 5 |
|
S111 | Request for change of ownership or part of ownership |
Free format text: JAPANESE INTERMEDIATE CODE: R313111 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090213 Year of fee payment: 5 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090213 Year of fee payment: 5 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20100213 Year of fee payment: 6 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110213 Year of fee payment: 7 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110213 Year of fee payment: 7 |
|
S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
|
S533 | Written request for registration of change of name |
Free format text: JAPANESE INTERMEDIATE CODE: R313533 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20110213 Year of fee payment: 7 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20120213 Year of fee payment: 8 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20130213 Year of fee payment: 9 |
|
FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20140213 Year of fee payment: 10 |
|
S531 | Written request for registration of change of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313531 |
|
R350 | Written notification of registration of transfer |
Free format text: JAPANESE INTERMEDIATE CODE: R350 |
|
EXPY | Cancellation because of completion of term |