JPH09331432A - デジタル画像処理装置 - Google Patents
デジタル画像処理装置Info
- Publication number
- JPH09331432A JPH09331432A JP14918096A JP14918096A JPH09331432A JP H09331432 A JPH09331432 A JP H09331432A JP 14918096 A JP14918096 A JP 14918096A JP 14918096 A JP14918096 A JP 14918096A JP H09331432 A JPH09331432 A JP H09331432A
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- JP
- Japan
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- image
- numbered lines
- clock
- frame memories
- image processing
- Prior art date
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- Pending
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Abstract
(57)【要約】
【課題】 簡単な構成で画像出力速度の高速化に対応す
る。 【解決手段】 画像読み込み装置２−１と画像処理回路
２−２は３０ＭＨｚのクロックで駆動され、画像処理回
路２−２により処理された画像信号が出力切り替え装置
２−３を介して２系統のフレームメモリ２−４、２−５
に記憶される。そして、画像出力切り替え装置２−３に
よりフレームメモリ２−４、２−５からそれぞれ奇数ラ
インと偶数ラインのデータが２１．５ＭＨｚ（＝４３Ｍ
Ｈｚ÷２）のクロックで同時に読み出され、画像記録装
置２−６、２−７に印加される。画像記録装置２−６、
２−７では２系統のＬＤユニット１２５から奇数ライン
と偶数ラインのレーザ光を同時に１系統のポリゴンミラ
ー１２７に照射することにより、奇数ラインと偶数ライ
ンを同時に感光体１３上に描画する。
る。 【解決手段】 画像読み込み装置２−１と画像処理回路
２−２は３０ＭＨｚのクロックで駆動され、画像処理回
路２−２により処理された画像信号が出力切り替え装置
２−３を介して２系統のフレームメモリ２−４、２−５
に記憶される。そして、画像出力切り替え装置２−３に
よりフレームメモリ２−４、２−５からそれぞれ奇数ラ
インと偶数ラインのデータが２１．５ＭＨｚ（＝４３Ｍ
Ｈｚ÷２）のクロックで同時に読み出され、画像記録装
置２−６、２−７に印加される。画像記録装置２−６、
２−７では２系統のＬＤユニット１２５から奇数ライン
と偶数ラインのレーザ光を同時に１系統のポリゴンミラ
ー１２７に照射することにより、奇数ラインと偶数ライ
ンを同時に感光体１３上に描画する。
Description
【０００１】
【発明の属する技術分野】本発明は、クロックに基づい
て画像を読み取り、記録紙などに出力するデジタル画像
処理装置に関する。
て画像を読み取り、記録紙などに出力するデジタル画像
処理装置に関する。
【０００２】
【従来の技術】一般に、デジタル複写機などにおいてレ
ーザビームを用いて画像を出力する場合には、主走査方
向の画像有効区間の外側で主走査同期検知信号を得るの
で画像出力クロックは画像読み取りクロックより高速で
なければならない。なお、読み取り時のクロックと書き
込み時のクロックとして２系統のクロックを用いた従来
例としては、例えば特開平１−１９５７７２号公報に示
されている。この場合、書き込み時のクロックが読み取
り時のクロックより高速である。
ーザビームを用いて画像を出力する場合には、主走査方
向の画像有効区間の外側で主走査同期検知信号を得るの
で画像出力クロックは画像読み取りクロックより高速で
なければならない。なお、読み取り時のクロックと書き
込み時のクロックとして２系統のクロックを用いた従来
例としては、例えば特開平１−１９５７７２号公報に示
されている。この場合、書き込み時のクロックが読み取
り時のクロックより高速である。
【０００３】
【発明が解決しようとする課題】しかしながら、読み取
り時のクロックと書き込み時のクロックとして２系統の
クロックを用いる場合、例えば読み取り時のクロックと
して３０ＭＨｚで画像を読み取ってこれをバッファに記
憶し、これを書き込み時のクロックとして４２．９ＭＨ
ｚを用いて読み出そうとすると、出力時の画像データ転
送に伴うバッファアクセス速度の対応が困難であるとい
う問題点がある。
り時のクロックと書き込み時のクロックとして２系統の
クロックを用いる場合、例えば読み取り時のクロックと
して３０ＭＨｚで画像を読み取ってこれをバッファに記
憶し、これを書き込み時のクロックとして４２．９ＭＨ
ｚを用いて読み出そうとすると、出力時の画像データ転
送に伴うバッファアクセス速度の対応が困難であるとい
う問題点がある。
【０００４】本発明は上記従来の問題点に鑑み、簡単な
構成で画像出力速度の高速化に対応することができるデ
ジタル画像処理装置を提供することを目的とする。
構成で画像出力速度の高速化に対応することができるデ
ジタル画像処理装置を提供することを目的とする。
【０００５】
【課題を解決するための手段】本発明は上記目的を達成
するために、複数のフレームメモリと、画像データを第
１のクロックで前記複数のフレームメモリに書き込み、
前記複数のフレームメモリに記憶された複数ラインの画
像データを前記第１のクロックより遅い第２のクロック
で同時に読み出す手段と、前記前記複数のフレームメモ
リから同時に読み出された複数ラインの画像データを前
記第２のクロックで同時に描画する手段とを備えたこと
を特徴とする。
するために、複数のフレームメモリと、画像データを第
１のクロックで前記複数のフレームメモリに書き込み、
前記複数のフレームメモリに記憶された複数ラインの画
像データを前記第１のクロックより遅い第２のクロック
で同時に読み出す手段と、前記前記複数のフレームメモ
リから同時に読み出された複数ラインの画像データを前
記第２のクロックで同時に描画する手段とを備えたこと
を特徴とする。
【０００６】
【発明の実施の形態】以下、図面を参照して本発明の実
施の形態を説明する。図１は本発明に係るデジタル画像
処理装置の一実施形態が適用されたデジタル複写機を示
す構成図、図２は図１の書き込み系の一般的な構成を示
す構成図、図３は主走査方向の走査範囲を示す説明図、
図４は本発明に係るデジタル画像処理装置の一実施形態
を示すブロック図である。
施の形態を説明する。図１は本発明に係るデジタル画像
処理装置の一実施形態が適用されたデジタル複写機を示
す構成図、図２は図１の書き込み系の一般的な構成を示
す構成図、図３は主走査方向の走査範囲を示す説明図、
図４は本発明に係るデジタル画像処理装置の一実施形態
を示すブロック図である。
【０００７】図１において、スキャナ１１は原稿を照明
してＣＣＤイメージセンサにより読み取り、図４に示す
デジタル画像処理装置に出力する。デジタル画像処理装
置により処理された画像信号は図２に詳しく示す書き込
み系１２に印加され、レーザビームにより主走査方向に
偏向されて感光ドラム１３上に照射され、感光ドラム１
３上に潜像が形成される。感光ドラム１３の回りにはそ
の回転方向に沿って帯電器１４、書き込み系１２、現像
器１５、転写器１６、クリーニングユニット１７、除電
器１８が配置され、公知の電子写真プロセスにより感光
ドラム１３上の潜像がトナーにより現像され、トナー像
が用紙に転写される。用紙は給紙系１９により給紙され
て転写器１６により感光ドラム１３上のトナー像が転写
され、次いで紙搬送部２０により搬送されて定着器２１
により定着され、外部に排出される。
してＣＣＤイメージセンサにより読み取り、図４に示す
デジタル画像処理装置に出力する。デジタル画像処理装
置により処理された画像信号は図２に詳しく示す書き込
み系１２に印加され、レーザビームにより主走査方向に
偏向されて感光ドラム１３上に照射され、感光ドラム１
３上に潜像が形成される。感光ドラム１３の回りにはそ
の回転方向に沿って帯電器１４、書き込み系１２、現像
器１５、転写器１６、クリーニングユニット１７、除電
器１８が配置され、公知の電子写真プロセスにより感光
ドラム１３上の潜像がトナーにより現像され、トナー像
が用紙に転写される。用紙は給紙系１９により給紙され
て転写器１６により感光ドラム１３上のトナー像が転写
され、次いで紙搬送部２０により搬送されて定着器２１
により定着され、外部に排出される。
【０００８】図２を参照して書き込み系１２の一般的な
構成を説明する。画像処理部１２１により処理された画
像データは、メイン制御板１２２、ＰＷＭ（パルス幅変
調）制御板１２４を介してＬＤ（レーザダイオード）ユ
ニット１２５に印加され、ＬＤユニット１２５内のＬＤ
から画像データに応じてＰＷＭ変調されたレーザビーム
が出射される。このレーザビームはシリンダレンズ１２
６を介してポリゴンミラー１２７に入射して主走査方向
に等角速度偏向され、次いでｆθレンズ１３０により等
速度偏向に補正され、ミラー１３１、防塵ガラス１３２
を介して感光体１３上に照射される。
構成を説明する。画像処理部１２１により処理された画
像データは、メイン制御板１２２、ＰＷＭ（パルス幅変
調）制御板１２４を介してＬＤ（レーザダイオード）ユ
ニット１２５に印加され、ＬＤユニット１２５内のＬＤ
から画像データに応じてＰＷＭ変調されたレーザビーム
が出射される。このレーザビームはシリンダレンズ１２
６を介してポリゴンミラー１２７に入射して主走査方向
に等角速度偏向され、次いでｆθレンズ１３０により等
速度偏向に補正され、ミラー１３１、防塵ガラス１３２
を介して感光体１３上に照射される。
【０００９】また、ポリゴンミラー１２７により走査さ
れたレーザビームは、主走査方向の画像有効区間の外側
で同期検知ミラー１３３により同期検知センサ１３４の
方向に反射され、同期検知センサ１３４により主走査方
向の同期信号が生成されてメイン制御板１２２にフィー
ドバックされる。ポリゴンミラー１２７はポリゴンモー
タ１２９により回転し、ポリゴンモータ１２９はポリゴ
ン制御板１２２により制御される。
れたレーザビームは、主走査方向の画像有効区間の外側
で同期検知ミラー１３３により同期検知センサ１３４の
方向に反射され、同期検知センサ１３４により主走査方
向の同期信号が生成されてメイン制御板１２２にフィー
ドバックされる。ポリゴンミラー１２７はポリゴンモー
タ１２９により回転し、ポリゴンモータ１２９はポリゴ
ン制御板１２２により制御される。
【００１０】ここで、レーザビームにより主走査方向の
画像有効区間の外側で主走査同期検知信号を得るので、
図３に示すようにレーザビームが感光ドラム１３上を走
査する長さをＬ、画像有効区間を０．７Ｌとし、また、
スキャナ１１のクロックを３０ＭＨｚとすると、書き込
み系１２の出力クロックは３０ＭＨｚ×１．０／０．７
＝４２．９ＭＨｚとなる。
画像有効区間の外側で主走査同期検知信号を得るので、
図３に示すようにレーザビームが感光ドラム１３上を走
査する長さをＬ、画像有効区間を０．７Ｌとし、また、
スキャナ１１のクロックを３０ＭＨｚとすると、書き込
み系１２の出力クロックは３０ＭＨｚ×１．０／０．７
＝４２．９ＭＨｚとなる。
【００１１】そこで、本発明では図４に示すように、画
像読み込み装置２−１（スキャナ１１等）と画像処理回
路２−２は３０ＭＨｚのクロックで駆動され、画像処理
回路２−２により処理された画像信号が出力切り替え装
置２−３を介して２系統のフレームメモリ２−４、２−
５に記憶される。そして、画像出力切り替え装置２−３
によりフレームメモリ２−４、２−５からそれぞれ奇数
ラインと偶数ラインのデータが２１．５ＭＨｚ（＝４３
ＭＨｚ÷２）のクロックで同時に読み出され、画像記録
装置２−６、２−７に印加される。
像読み込み装置２−１（スキャナ１１等）と画像処理回
路２−２は３０ＭＨｚのクロックで駆動され、画像処理
回路２−２により処理された画像信号が出力切り替え装
置２−３を介して２系統のフレームメモリ２−４、２−
５に記憶される。そして、画像出力切り替え装置２−３
によりフレームメモリ２−４、２−５からそれぞれ奇数
ラインと偶数ラインのデータが２１．５ＭＨｚ（＝４３
ＭＨｚ÷２）のクロックで同時に読み出され、画像記録
装置２−６、２−７に印加される。
【００１２】フレームメモリ２−４、２−５及び画像出
力切り替え装置２−３は図２に示すメイン制御板１２２
に搭載され、また、画像記録装置２−６、２−７は２系
統のＰＷＭ制御板１２４及びＬＤユニット１２５により
構成される。そして、２系統のＬＤユニット１２５から
奇数ラインと偶数ラインのレーザ光を同時に１系統のポ
リゴンミラー１２７に照射することにより、奇数ライン
と偶数ラインを同時に感光体１３上に描画する。
力切り替え装置２−３は図２に示すメイン制御板１２２
に搭載され、また、画像記録装置２−６、２−７は２系
統のＰＷＭ制御板１２４及びＬＤユニット１２５により
構成される。そして、２系統のＬＤユニット１２５から
奇数ラインと偶数ラインのレーザ光を同時に１系統のポ
リゴンミラー１２７に照射することにより、奇数ライン
と偶数ラインを同時に感光体１３上に描画する。
【００１３】
【発明の効果】以上説明したように請求項１記載の発明
によれば、画像データを第１のクロックで複数のフレー
ムメモリに書き込み、複数のフレームメモリに記憶され
た複数ラインの画像データを第１のクロックより遅い第
２のクロックで読み出して同時に描画するようにしたの
で、簡単な構成で画像出力速度の高速化に対応すること
ができる。
によれば、画像データを第１のクロックで複数のフレー
ムメモリに書き込み、複数のフレームメモリに記憶され
た複数ラインの画像データを第１のクロックより遅い第
２のクロックで読み出して同時に描画するようにしたの
で、簡単な構成で画像出力速度の高速化に対応すること
ができる。
【図１】本発明に係るデジタル画像処理装置の一実施形
態が適用されたデジタル複写機を示す構成図である。
態が適用されたデジタル複写機を示す構成図である。
【図２】図１の書き込み系の一般的な構成を示す構成図
である。
である。
【図３】主走査方向の走査範囲を示す説明図である。
【図４】本発明に係るデジタル画像処理装置の一実施形
態を示すブロック図である。
態を示すブロック図である。
２−３ 出力切り替え装置 ２−４，２−５ フレームメモリ ２−６，２−７ 画像記録装置
Claims (1)
- 【請求項１】 複数のフレームメモリと、 画像データを第１のクロックで前記複数のフレームメモ
リに書き込み、前記複数のフレームメモリに記憶された
複数ラインの画像データを前記第１のクロックより遅い
第２のクロックで同時に読み出す手段と、 前記前記複数のフレームメモリから同時に読み出された
複数ラインの画像データを前記第２のクロックで同時に
描画する手段と、を備えたデジタル画像処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14918096A JPH09331432A (ja) | 1996-06-11 | 1996-06-11 | デジタル画像処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14918096A JPH09331432A (ja) | 1996-06-11 | 1996-06-11 | デジタル画像処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH09331432A true JPH09331432A (ja) | 1997-12-22 |
Family
ID=15469554
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14918096A Pending JPH09331432A (ja) | 1996-06-11 | 1996-06-11 | デジタル画像処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH09331432A (ja) |
-
1996
- 1996-06-11 JP JP14918096A patent/JPH09331432A/ja active Pending
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20040426 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20040511 |
|
| A02 | Decision of refusal |
Effective date: 20041130 Free format text: JAPANESE INTERMEDIATE CODE: A02 |